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位置:首页 > IC型号导航 > 首字符E型号页 > 首字符E的型号第411页 > EM6A9320
ETR onTech
钰创机密
EM6A9320
4M ×32 DDR SDRAM
初步(修订版0.3 7/2002 )
特点
快速时钟速率: 350/333/300/285/250/200兆赫
差分时钟CK & CK #输入
4双向DQS 。两个数据处理
DQS的边缘( 1DQS /字节)
DLL对齐DQ和DQS转换
边沿对齐的数据& DQS输出
中心对齐数据& DQS输入
4内部银行, 1M ×32位的每家银行
可编程的模式和扩展模式寄存器
- CAS#延迟: 3 ,4,5
- 突发长度: 2 , 4 , 8
- 突发类型:顺序&交错
整页突发长度为连续型只
全页突发起始地址应该是偶数
除了DQ的& DM的所有输入为正
在系统时钟的边沿
不写打断阅读功能
4个人DM的控制只写屏蔽
自动刷新和自刷新
4096刷新周期/ 32ms的
电源高达三百三十三分之三百五十〇 / 300 / 285MHz :
V
DD
= 2.8V
±
5%
V
DDQ
= 2.8V
±
5%
电源高达250 / 200MHz的:
V
DD
= 2.5V
±
5%
V
DDQ
= 2.5V
±
5%
接口: SSTL_2 I / O兼容
6WDQGDUG ???? EDOO ) % * $ SDFNDJH
概观
该EM6A9320 DDR SDRAM是高速CMOS
包含128双数据速率同步DRAM
兆比特。它在内部配置为四1M ×32
DRAM与同步接口(所有的信号都
登记在时钟信号CK)的正边缘。
数据输出出现在CK和CK #的两个上升沿。
读取和写入访问到SDRAM是迸发
导向;存取开始在一个选定的位置和
持续的地点在一个设定的号码
编程序列。
访问开始用BankActivate的注册
命令,然后接着读或写
命令。
该EM6A9320提供可编程的读或写
第2,第4 , 8,一种自动预充电功能的脉冲串的长度可以
被使能,以提供一个自定时行预充电是
在脉冲串序列的末尾开始。
刷新功能,自动或自刷新都
易于使用。
此外, EM6A9320具有可编程的DLL
选项。通过具有可编程的模式寄存器和
扩展模式寄存器中,该系统可以选择
最适合的模式,以最大限度地发挥其性能。
这些器件非常适合需要的应用
高内存带宽,导致设备特别
非常适合于高性能的主存储器和
图形应用程序。
订购信息
产品型号
EM6A9320BI-2.8
EM6A9320BI-3.0
EM6A9320BI-3.3
EM6A9320BI-3.5
EM6A9320BI-4
EM6A9320BI-5
频率
350MHz
333MHz
300MHz
285MHz
250MHz
200MHz
电源
V
DD
2.8V
V
DDQ
2.8V
V
DD
2.5V
V
DDQ
2.5V
FBGA
FBGA
FBGA
FBGA
FBGA
FBGA
钰创科技有限公司
6号,科技路。五,科学工业园区,台湾新竹30077 , ROC
电话: ( 886 ) -3-5782345
传真: ( 886 ) -3-5778671
钰创科技公司保留更改产品规格,恕不另行通知。
ETR onTech
1
2
3
4
5
A
DQS0
DM0
VSSQ
DQ3
DQ2
4Mx32 DDR SDRAM
EM6A9320
10
11
12
引脚分配( FBGA 144Ball顶视图)
6
7
8
9
DQ0
DQ31
DQ29
DQ28
VSSQ
DM3
DQS3
B
DQ4
VDDQ
NC
VDDQ
DQ1
VDDQ
VDDQ
DQ30
VDDQ
NC
VDDQ
DQ27
C
DQ6
DQ5
VSSQ
VSSQ
VSSQ
VDD
VDD
VSSQ
VSSQ
VSSQ
DQ26
DQ25
D
DQ7
VDDQ
VDD
VSS
VSSQ
VSS
VSS
VSSQ
VSS
VDD
VDDQ
DQ24
E
DQ17
DQ16
VDDQ
VSSQ
VSS
VSS
VSS
VSS
VSSQ
VDDQ
DQ15
DQ14
F
DQ19
DQ18
VDDQ
VSSQ
VSS
VSS
VSS
VSS
VSSQ
VDDQ
DQ13
DQ12
G
DQS2
DM2
NC
VSSQ
VSS
VSS
VSS
VSS
VSSQ
NC
DM1
DQS1
H
DQ21
DQ20
VDDQ
VSSQ
VSS
VSS
VSS
VSS
VSSQ
VDDQ
DQ11
DQ10
J
DQ22
DQ23
VDDQ
VSSQ
VSS
VSS
VSS
VSS
VSSQ
VDDQ
DQ9
DQ8
K
CAS #
WE#
VDD
VSS
A10
VDD
VDD
NC
VSS
VDD
NC
NC
L
RAS #
NC
NC
BA1
A2
A11
A9
A5
NC
CK
CK #
NC
M
CS #
NC
BA0
A0
A1
A3
A4
A6
A7
A8/
AP
CKE
VREF
引脚分配按名称( FBGA 144Ball )
符号位置符号位置的符号位置的符号位置的符号位置的符号位置的符号位置的符号位置
A0
M4
DQ6
C1
DQ24 D12
CK
L10 VDDQ B6
VSS
E5
VSS
J7
VSSQ G4
A1
M5
DQ7
D1
DQ25 C12
CK #
L11 VDDQ B7
VSS
E6
VSS
J8
VSSQ G9
A2
L5
DQ8
J12 DQ26 C11
CKE M11 VDDQ B9
VSS
E7
VSS
K4 H4 VSSQ
A3
M6
DQ9
J11 DQ27 B12
CS #
M1 VDDQ B11
VSS
E8
VSS
K9 H9 VSSQ
A4
M7 DQ10 H12 DQ28
A9
RAS #
L1 VDDQ D2
VSS
F5 VSSQ A3 VSSQ
J4
A5
L8
DQ11 H11 DQ29
A8
CAS #
K1 VDDQ D11
VSS
F6 VSSQ A10 VSSQ
J9
A6
M8 DQ12 F12 DQ30
B8
WE#
K2 VDDQ E3
VSS
F7 VSSQ C3
NC
B3
A7
M9 DQ13 F11 DQ31
A7
VREF M12 VDDQ E10
VSS
F8 VSSQ C4
NC
B10
A8 / AP M10 DQ14 E12 DQS0 A1
VDD
C6 VDDQ F3
VSS
G5 VSSQ C5
NC
G3
A9
L7
DQ15 E11 DQS1 G12 VDD
C7 VDDQ F10
VSS
G6 VSSQ C8
NC
G10
A10
K5
DQ16
E2 DQS2 G1
VDD
D3 VDDQ H3
VSS
G7 C9 VSSQ
NC
K8
A11
L6
DQ17
E1 DQS3 A12
VDD VDDQ D10 H10
VSS
G8 VSSQ C10
NC
K11
DQ0
A6
DQ18
F2
DM0
A2
VDD
K3 VDDQ J3
VSS
H5 VSSQ D5
NC
K12
DQ1
B5
DQ19
F1
DM1 G11 VDD
K6 VDDQ J10
VSS
H6 VSSQ D8
NC
L2
DQ2
A5
DQ20
H2
DM2
G2
VDD
K7
VSS
D4
VSS
H7 E4 VSSQ
NC
L3
DQ3
A4
DQ21
H1
DM3
A11
VDD
K10
VSS
D6
VSS
H8 E9 VSSQ
NC
L9
DQ4
B1
DQ22
J1
BA0
M3 VDDQ B2
VSS
D7
VSS
J5
VSSQ F4
NC
L12
DQ5
C2
DQ23
J2
BA1
L4 VDDQ B4
VSS
D9
VSS
J6
VSSQ F9
NC
M2
钰创机密
2
修订版0.3
七月。 2002年
ETR onTech
框图
4Mx32 DDR SDRAM
EM6A9320
列解码器
4096 X 256 X 32
CELL
译码器阵列
(BANK #0)
ROW
检测放大器
DLL
时钟
卜FF器
控制
信号
发电机
检测放大器
行解码器
行解码器
CK
CK #
CKE
CS #
RAS #
CAS #
WE#
命令
解码器
模式
注册
4096 X 256 X 32
电池阵列
( BANK # 1 )
列解码器
COLUMN
计数器
A8/AP
列解码器
4096 X 256 X 32
电池阵列
(BANK 2 )
检测放大器
A0
A10
A11
BA0
BA1
地址
卜FF器
SFGSFTI
DPVO
UFS
数据
频闪
卜FF器
DQ0
DQ31
检测放大器
DQ
卜FF器
4096 X 256 X 32
CELL
译码器阵列
( BANK # 3 )
ROW
列解码器
DQS0~3
D
DM0~3
钰创机密
3
修订版0.3
七月。 2002年
ETR onTech
引脚说明
符号
CK , CK #
TYPE
输入
4Mx32 DDR SDRAM
EM6A9320
表1. EM6A9320的引脚的详细信息
描述
差分时钟:
CK,CK # ,由系统时钟驱动。所有的SDRAM输入
命令被采样CK的上升沿。既CK和CK #递增
内部突发计数器和控制输出寄存器。
时钟使能:
CKE激活( HIGH)和停用( LOW )的CK信号。如果CKE
变为低电平同步于时钟,内部时钟从下一个时钟暂停
周期和输出的状态,并爆裂地址只要被冻结为所述CKE遗体
低。当所有银行都处于空闲状态时,去激活所述时钟控制输入到
掉电和自刷新模式。
银行选择:
BA0和BA1定义了该银行的BankActivate ,读,写,或
BankPrecharge命令被应用。他们还定义哪些模式寄存器或
一个模式寄存器设置命令在扩展模式寄存器加载。
地址输入:
A0 - A11是银行激活命令(行内采样
地址A0 - A11)和读/写命令(列地址A0- A7与A8定义
自动预充电),以在各选择一个位置从256K的可用
银行。在一个预充电命令,A8进行采样,以确定是否所有的银行为
预充电( A8 =高) 。地址输入时也一个模式提供了操作码
寄存器组或扩展模式寄存器设置命令。
片选:
CS #使(采样为低电平)和禁用(采样为高电平)的
命令解码器。当CS #被采样到高的所有命令被屏蔽。 CS #
提供了在与多家银行系统外的银行选择。它被认为是
的命令代码的一部分。
行地址选通:
在RAS #信号定义的操作命令
与CAS #一起和WE #信号,并锁定在正面边缘
CK 。当RAS #和CS #断言"LOW"和CAS #是断言"HIGH"任
在BankActivate命令或预充电命令被选中的WE #信号。
当WE#被断言"HIGH , "的BankActivate命令被选择,并且
由BS指定的银行接通时为有效状态。当WE#为有效
"LOW , "的预充电命令被选中,由BS指定的银行
在预充电操作之后,切换到空闲状态。
列地址选通:
在CAS #信号定义的操作命令
与RAS #结合和WE#信号,并且被锁存时的正边缘
CK 。当RAS #保持"HIGH"和CS #是断言"LOW"列访问
通过断言CAS# "LOW"然后启动,读取或写入命令被选中
WE#置"HIGH "或“ LOW" 。
写使能:
WE#信号限定与配合操作命令
在RAS #和CAS #信号和锁存在CK的上升沿。在WE #
输入用于选择BankActivate或预充电命令和读取或写入
命令。
双向数据选通:
该DQSx信号被映射到以下数据
字节: DQS0到DQ0 - DQ7 , DQS1到DQ8 - DQ15 , DQS2到DQ16 - DQ23 , DQS3到
DQ24-DQ31.
数据输入掩码:
DM0 - DM3是特定字节。当DM是输入数据被屏蔽
在写周期采样为高。 DM3口罩DQ31 - DQ24 , DM2口罩DQ23-
DQ16 , DM1口罩DQ15 - DQ8和DM0口罩DQ7 - DQ0 。
数据I / O :
的DQ0 - DQ31输入和输出数据与正同步
CK和CK #的边缘。在I / O是字节屏蔽期间,写操作。
3RZHU 6XSSO \\ ?
CKE
输入
BA0 , BA1
输入
A0-A11
输入
CS #
输入
RAS #
输入
CAS #
输入
WE#
输入
DQS0-DQS3
输入/
产量
输入
DM0 - DM3
DQ0 - DQ31
V
DD
输入/
产量
供应
3RZHU IRU WKH LQSXW EXIIHUV DQG FRUH ORJLF
钰创机密
4
修订版0.3
七月。 2002年
ETR onTech
V
SS
供应
4Mx32 DDR SDRAM
EM6A9320
地面:
IRU WKH LQSXW EXIIHUV DQG FRUH ORJLF
V
DDQ
供应
DQ功率:
提供隔离电源的DQ为提高抗干扰能力。
V
SSQ
供应
DQ地:
提供隔离地面的DQ为提高抗干扰能力。
V
REF
供应
参考电压输入:
0.5 x垂直
DDQ
NC
-
无连接:
这些引脚悬空。
注意:对于该差分时钟的定时基准点的CK和CK #的交叉点。对于任何
使用单端时钟应用,适用于V
REF
以CK #引脚。
操作模式
完全同步操作执行到锁存命令在CK的上升沿。表2显示了
对于操作的真值表命令。
表2.真值表(注(1 ),( 2))的
命令
BankActivate
BankPrecharge
PrechargeAll
写和AutoPrecharge
阅读和AutoPrecharge
模式寄存器设置
扩展模式寄存器设置
无操作
设备取消
突发停止
自动刷新
SelfRefresh入口
SelfRefresh退出
CKEN - 1 CKEN DM BA1 BA0
状态
空闲
(3)
H
X
X
V
V
任何
H
X
X
V
V
任何
H
X
X
X
X
活跃
(3)
H
X
V
V
V
活跃
(3)
H
X
V
V
V
活跃
(3)
H
X
X
V
V
活跃
(3)
H
X
X
V
V
空闲
H
X
X
L
L
空闲
H
X
X
L
H
任何
H
X
X
X
X
任何
H
X
X
X
X
活跃
(4)
H
X
X
X
X
空闲
H
H
X
X
X
空闲
H
L
X
X
X
空闲
L
H
X
X
X
(自刷新)
H
L
X
X
X
A8 A11 -A9 , A7-0 CS # RAS # CAS # WE#
行地址
L
L
H
H
L
X
L
L
H
L
H
X
L
L
H
L
L
L
H
L
L
COLUMN
H
L
H
L
L
地址
L
L
H
L
H
A0~A7
H
L
H
L
H
L
L
L
L
操作码
L
L
L
L
X
X
L
H
H
H
X
X
H
X
X
X
X
X
L
H
H
L
X
X
L
L
L
H
X
X
L
L
L
H
H
X
X
X
X
X
L
H
H
H
H
X
X
X
X
X
L
H
H
H
H
X
X
X
X
X
L
H
H
H
X
X
X
X
X
X
X
X
X
X
X
X
掉电模式进入待机/激活
(5)
掉电模式退出
任何
L
H
X
X
X
(断电)
活跃
H
X
L
X
X
数据写入/输出
启用
活跃
H
X
H
X
X
数据面膜/输出
关闭
注意:
1, V =有效数据,X =无关, L =低电平, H =高电平
2. CKE
n
信号提供命令时,输入电平。
CKE
n-1
信号被输入一个级别时钟周期中提供的命令之前。
3.这些是由BA0 , BA1signals指定银行的状态。
4.阅读突发停止与所有类型的突发BST命令。
5.掉电模式不能在突发操作输入。
当这个命令是断言,在突发周期,设备状态时钟挂起模式。
钰创机密
5
修订版0.3
七月。 2002年
EtronTech
特点
快速时钟速率: 350/333/300/285/250/200兆赫
差分时钟CK & CK #输入
4双向DQS 。两个数据处理
DQS的边缘( 1DQS /字节)
DLL对齐DQ和DQS转换
边沿对齐的数据& DQS输出
中心对齐数据& DQS输入
4内部银行, 1M ×32位的每家银行
可编程的模式和扩展模式
注册
- CAS#延迟: 3 ,4,5
- 突发长度: 2 , 4 , 8
- 突发类型:顺序&交错
整页突发长度为连续型只
全页突发起始地址应该是偶数
除了DQ的& DM的所有输入为正
在系统时钟的边沿
不写打断阅读功能
4个人DM的控制只写屏蔽
自动刷新和自刷新
4096刷新周期/ 32ms的
电源高达三百三十三分之三百五十〇 / 300 / 285MHz :
V
DD
= 2.8V
±
5%
V
DDQ
= 2.8V
±
5%
电源高达250 / 200MHz的:
V
DD
= 2.8V
±
5%
V
DDQ
= 2.8V
±
5%
接口: SSTL_2 I / O兼容
标准的144球FBGA封装
EM6A9320
4M ×32 DDR SDRAM
初步(修订版0.6 5/2006 )
概观
该EM6A9320 DDR SDRAM是高速CMOS
包含128双数据速率同步DRAM
兆比特。它在内部配置为四1M ×32
DRAM与同步接口(所有的信号都
登记在时钟信号CK)的正边缘。
数据输出出现在CK和CK #的两个上升沿。
读取和写入访问到SDRAM是迸发
导向;存取开始在一个选定的位置和
持续的地点在一个设定的号码
编程序列。
访问开始用BankActivate的注册
命令,然后接着读或写
命令。
该EM6A9320提供可编程的读或写
第2,第4 , 8,一种自动预充电功能的脉冲串的长度可以
被使能,以提供一个自定时行预充电是
在脉冲串序列的末尾开始。
刷新功能,自动或自刷新都
易于使用。
此外, EM6A9320具有可编程的DLL
选项。通过具有可编程的模式寄存器和
扩展模式寄存器中,该系统可以选择
最适合的模式,以最大限度地发挥其性能。
这些器件非常适合需要的应用
高内存带宽,导致设备特别
非常适合于高性能的主存储器和
图形应用程序。
订购信息
产品型号
EM6A9320BI-2.8
EM6A9320BI-3.0
EM6A9320BI-3.3
EM6A9320BI-3.5
EM6A9320BI-3.6
EM6A9320BI-4
EM6A9320BI-5
频率
350MHz
333MHz
300MHz
285MHz
275MHz
250MHz
200MHz
电源
FBGA
FBGA
FBGA
FBGA
FBGA
FBGA
FBGA
V
DD
2.8V
V
DDQ
2.8V
钰创科技有限公司
6号,科技路。五,科学工业园区,台湾新竹30077 , ROC
电话: ( 886 ) -3-5782345
传真: ( 886 ) -3-5778671
钰创科技公司保留更改产品规格,恕不另行通知。
EtronTech
1
A
DQS0
2
DM0
3
VSSQ
4
DQ3
5
DQ2
4Mx32 DDR SDRAM
EM6A9320
10
VSSQ
11
DM3
12
DQS3
引脚分配( FBGA 144Ball顶视图)
6
DQ0
7
DQ31
注: VSS引脚热球是可选的
8
DQ29
9
DQ28
B
DQ4
VDDQ
NC
VDDQ
DQ1
VDDQ
VDDQ
DQ30
VDDQ
NC
VDDQ
DQ27
C
DQ6
DQ5
VSSQ
VSSQ
VSSQ
VDD
VDD
VSSQ
VSSQ
VSSQ
DQ26
DQ25
D
DQ7
VDDQ
VDD
VSS
VSSQ
VSS
VSS
VSSQ
VSS
VDD
VDDQ
DQ24
E
DQ17
DQ16
VDDQ
VSSQ
VSS
VSS
VSS
VSS
VSSQ
VDDQ
DQ15
DQ14
F
DQ19
DQ18
VDDQ
VSSQ
VSS
VSS
VSS
VSS
VSSQ
VDDQ
DQ13
DQ12
G
DQS2
DM2
NC
VSSQ
VSS
VSS
VSS
VSS
VSSQ
NC
DM1
DQS1
H
DQ21
DQ20
VDDQ
VSSQ
VSS
VSS
VSS
VSS
VSSQ
VDDQ
DQ11
DQ10
J
DQ22
DQ23
VDDQ
VSSQ
VSS
VSS
VSS
VSS
VSSQ
VDDQ
DQ9
DQ8
K
CAS #
WE#
VDD
VSS
A10
VDD
VDD
NC
VSS
VDD
NC
NC
L
RAS #
NC
NC
BA1
A2
A11
A9
A5
NC
CK
CK #
NC
M
CS #
NC
BA0
A0
A1
A3
A4
A6
A7
A8
CKE
VREF
引脚分配按名称( FBGA 144Ball )
符号位置符号位置的符号位置的符号位置的符号位置的符号位置的符号位置的符号位置
A0
M4
DQ6
C1 DQ24 D12
CK
L10 VDDQ B6
VSS
E5
VSS
J7 VSSQ G4
A1
M5
DQ7
D1 DQ25 C12
CK #
L11 VDDQ B7
VSS
E6
VSS
J8 VSSQ G9
A2
L5
DQ8
J12 DQ26 C11 CKE M11 VDDQ B9
VSS
E7
VSS
K4 H4 VSSQ
A3
M6
DQ9
J11 DQ27 B12
CS #
M1 VDDQ B11
VSS
E8
VSS
K9 H9 VSSQ
A4
M7 DQ10 H12 DQ28 A9
RAS #
L1 VDDQ D2
VSS
F5 VSSQ A3 VSSQ
J4
A5
L8
DQ11 H11 DQ29 A8
CAS # K1 VDDQ D11 VSS
F6 VSSQ A10 VSSQ
J9
A6
M8 DQ12 F12 DQ30 B8
WE#
K2 VDDQ E3
VSS
F7 VSSQ C3
NC
B3
A7
M9 DQ13 F11 DQ31 A7 VREF M12 VDDQ E10
VSS
F8 VSSQ C4
NC
B10
A8 / AP M10 DQ14 E12 DQS0 A1
VDD
C6 VDDQ F3
VSS
G5 VSSQ C5
NC
G3
A9
L7
DQ15 E11 DQS1 G12 VDD
C7 VDDQ F10
VSS
G6 VSSQ C8
NC
G10
A10
K5 DQ16 E2 DQS2 G1
VDD
D3 VDDQ H3
VSS
G7 C9 VSSQ
NC
K8
A11
L6
DQ17 E1 DQS3 A12 VDD VDDQ D10 H10 VSS
G8 VSSQ C10
NC
K11
DQ0
A6 DQ18
F2
DM0
A2
VDD
K3 VDDQ J3
VSS
H5 VSSQ D5
NC
K12
DQ1
B5 DQ19
F1
DM1 G11 VDD
K6 VDDQ J10
VSS
H6 VSSQ D8
NC
L2
DQ2
A5 DQ20 H2
DM2
G2
VDD
K7
VSS
D4
VSS
H7 E4 VSSQ
NC
L3
DQ3
A4 DQ21 H1
DM3 A11 VDD K10
VSS
D6
VSS
H8 E9 VSSQ
NC
L9
DQ4
B1 DQ22
J1
BA0
M3 VDDQ B2
VSS
D7
VSS
J5 VSSQ F4
NC
L12
DQ5
C2 DQ23
J2
BA1
L4 VDDQ B4
VSS
D9
VSS
J6 VSSQ F9
NC
M2
2
修订版0.6
五月。 2006年
EtronTech
框图
4Mx32 DDR SDRAM
EM6A9320
列解码器
行解码器
4096 X 256 X 32
电池阵列
(BANK #0)
检测放大器
CK
CK #
CKE
CS #
RAS #
CAS #
WE#
DLL
时钟
卜FF器
控制
信号
发电机
检测放大器
行解码器
行解码器
命令
解码器
模式
注册
4096 X 256 X 32
电池阵列
( BANK # 1 )
列解码器
COLUMN
计数器
A8/AP
列解码器
4096 X 256 X 32
电池阵列
(BANK 2 )
检测放大器
刷新
计数器
A0
A10
A11
BA0
BA1
地址
卜FF器
DQ
卜FF器
行解码器
DQS0~3
数据
频闪
卜FF器
DQ0
DQ31
检测放大器
4096 X 256 X 32
电池阵列
( BANK # 3 )
列解码器
DM0~3
3
修订版0.6
五月。 2006年
EtronTech
引脚说明
符号
CK , CK #
TYPE
输入
4Mx32 DDR SDRAM
EM6A9320
表1. EM6A9320的引脚的详细信息
描述
差分时钟:
CK,CK # ,由系统时钟驱动。所有的SDRAM输入
命令被采样CK的上升沿。既CK和CK #递增
内部突发计数器和控制输出寄存器。
时钟使能:
CKE激活( HIGH)和停用( LOW )的CK信号。如果CKE
变为低电平同步于时钟,内部时钟从下一个暂停
时钟周期和输出的状态和突发地址只要被冻结为所述CKE
仍然很低。当所有银行都处于空闲状态时,去活的时钟控制
进入掉电和自刷新模式。
银行选择:
BA0和BA1定义了该银行的BankActivate ,读,写,或
BankPrecharge命令被应用。他们还定义哪些模式寄存器或
一个模式寄存器设置命令在扩展模式寄存器加载。
地址输入:
A0 - A11是银行激活命令(行内采样
地址A0 - A11)和读/写命令(列地址A0- A7与A8定义
自动预充电),以在各选择一个位置从256K的可用
银行。在一个预充电命令,A8进行采样,以确定是否所有的银行到
进行预充电(A8 =高) 。地址输入过程中也提供了一个操作码
模式寄存器设置或扩展模式寄存器设置命令。
片选:
CS #使(采样为低电平)和禁用(采样为高电平)的
命令解码器。当CS #被采样到高的所有命令被屏蔽。 CS #
提供了在与多家银行系统外的银行选择。它被认为是
的命令代码的一部分。
行地址选通:
在RAS #信号定义的操作命令
与CAS #一起和WE #信号,并锁定在正面边缘
CK 。当RAS #和CS #断言"LOW"和CAS #是断言"HIGH"任
在BankActivate命令或预充电命令被选中的WE#
信号。当WE#为有效"HIGH , "的BankActivate命令被选中
和由BS指定的银行接通时为有效状态。当WE#为
置"LOW , "的预充电命令被选择和存储体指定由BS
在预充电操作之后被切换到空闲状态。
列地址选通:
在CAS #信号定义的操作命令
与RAS #结合和WE#信号,并且被锁存时的正边缘
CK 。当RAS #保持"HIGH"和CS #是断言"LOW"列访问
通过断言CAS# "LOW"然后启动,读取或写入命令被选中
WE#置"HIGH "或“ LOW" 。
写使能:
WE#信号限定与配合操作命令
在RAS #和CAS #信号和锁存在CK的上升沿。在WE #
输入用于选择BankActivate或预充电命令和读取或写入
命令。
双向数据选通:
该DQSx信号被映射到以下数据
字节: DQS0到DQ0 - DQ7 , DQS1到DQ8 - DQ15 , DQS2到DQ16 - DQ23 , DQS3到
DQ24-DQ31.
数据输入掩码:
DM0 - DM3是特定字节。当DM是输入数据被屏蔽
在写周期采样为高。 DM3口罩DQ31 - DQ24 , DM2口罩DQ23-
DQ16 , DM1口罩DQ15 - DQ8和DM0口罩DQ7 - DQ0 。
数据I / O :
的DQ0 - DQ31输入和输出数据与正同步
CK和CK #的边缘。在I / O是字节屏蔽期间,写操作。
电源:
电源输入缓冲器和核心逻辑
.
CKE
输入
BA0 , BA1
输入
A0-A11
输入
CS #
输入
RAS #
输入
CAS #
输入
WE#
输入
DQS0-DQS3
输入/
产量
输入
DM0 - DM3
DQ0 - DQ31
V
DD
输入/
产量
供应
4
修订版0.6
五月。 2006年
EtronTech
V
SS
供应
4Mx32 DDR SDRAM
EM6A9320
地面:
为输入缓冲器和核心逻辑
.
供应
DQ功率:
提供隔离电源的DQ为提高抗干扰能力。
V
DDQ
供应
DQ地:
提供隔离地面的DQ为提高抗干扰能力。
V
SSQ
供应
参考电压输入:
0.5 x垂直
DDQ
V
REF
NC
-
无连接:
这些引脚悬空。
注意:对于该差分时钟的定时基准点的CK和CK #的交叉点。对于任何
使用单端时钟应用,适用于V
REF
以CK #引脚。
操作模式
完全同步操作执行到锁存命令在CK的上升沿。表2
示出了用于该操作的命令的真值表。
表2.真值表(注(1 ),( 2))的
命令
BankActivate
BankPrecharge
PrechargeAll
写和AutoPrecharge
阅读和AutoPrecharge
模式寄存器设置
扩展模式寄存器设置
无操作
设备取消
突发停止
自动刷新
SelfRefresh入口
SelfRefresh退出
状态
CKEN - 1 CKEN DM BA1 BA0
空闲
(3)
H
X
X
V
V
任何
H
X
X
V
V
任何
H
X
X
X
X
活跃
(3)
H
X
V
V
V
H
X
V
V
V
活跃
(3)
活跃
(3)
H
X
X
V
V
活跃
(3)
H
X
X
V
V
空闲
H
X
X
L
L
空闲
H
X
X
L
H
任何
H
X
X
X
X
任何
H
X
X
X
X
活跃
(4)
H
X
X
X
X
空闲
H
H
X
X
X
空闲
H
L
X
X
X
空闲
L
H
X
X
X
(自刷新)
H
L
X
X
X
A8 A11 -A9 , A7-0 CS # RAS # CAS # WE#
行地址
L
L
H
H
L
X
L
L
H
L
H
X
L
L
H
L
L
L
H
L
L
COLUMN
H
L
H
L
L
地址
L
L
H
L
H
A0~A7
H
L
H
L
H
L
L
L
L
操作码
L
L
L
L
X
X
L
H
H
H
X
X
H
X
X
X
X
X
L
H
H
L
X
X
L
L
L
H
X
X
L
L
L
H
H
X
X
X
X
X
L
H
H
H
H
X
X
X
X
X
L
H
H
H
H
X
X
X
X
X
L
H
H
H
X
X
X
X
X
X
X
X
X
X
X
X
掉电模式进入待机/激活
(5)
掉电模式退出
任何
L
H
X
X
X
(断电)
活跃
H
X
L
X
X
数据写入/输出
启用
活跃
H
X
H
X
X
数据面膜/输出
关闭
注意:
1, V =有效数据,X =无关, L =低电平, H =高电平
2. CKE
n
信号提供命令时,输入电平。
CKE
n-1
信号被输入一个级别时钟周期中提供的命令之前。
3.这些是由BA0 , BA1signals指定银行的状态。
4.阅读突发停止与所有类型的突发BST命令。
5.掉电模式不能在突发操作输入。
当这个命令是断言,在突发周期,设备状态时钟挂起模式。
5
修订版0.6
五月。 2006年
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