EDI8F321024C
1024Kx32 SRAM模块
特点
1024Kx32位CMOS静态
随机存取存储器
访问次数： 15 ， 17 ， 20 ， 25 ，和为35ns
??单个字节的选择
??完全静态的，并没有时钟
?? TTL兼容的I / O
高密度封装
72引脚ZIP， 175号
72引线SIMM ， 176号（角）
72引线SIMM ， 356号（直）
??常见的数据输入和输出
单+ 5V （ ± 10 ％ ）电源供电
1024Kx32静态RAM
CMOS ，高速模块
该EDI8F321024C是一个高速32兆位静态RAM
模块由32位组织为1024K的话。该模块
从8 1024Kx4静态RAM的SOJ构建
包上的环氧树脂层压板（ FR4 ）板。
四个芯片使（EO -E3 ）用于独立地
使4个字节。读或写可以执行
对单个字节或多个字节的任意组合
通过正确使用选择的。
该EDI8F321024C提供72引脚ZIP和72引线
SIMM包，这使32兆内存是
放置在低于1.3平方英寸的电路板空间。
所有的输入和输出为TTL兼容的，并从运营
5V单电源。完全异步电路不需要
时钟或刷新操作，并提供了平等的机会
和周期时间的易用性。
销PD1- PD4 ，用于识别模块的存储密度
在应用中，备用组件可以互换。
引脚配置和框图
NC
PD4
PD1
DQ
DQ1
DQ2
DQ3
VCC
A7
A8
A9
DQ4
DQ5
DQ6
DQ7
W
A14
E
E2
A16
VSS
DQ16
DQ17
DQ18
DQ19
A10
A11
A12
A13
DQ20
DQ21
DQ22
DQ23
VSS
A19
NC
2
4
6
8
10
12
14
16
18
20
22
24
26
28
30
32
34
36
38
40
42
44
46
48
50
52
54
56
58
60
62
64
66
68
70
72
1
3
5
7
9
11
13
15
17
19
21
23
25
27
29
31
33
35
37
39
41
43
45
47
49
51
53
55
57
59
61
63
65
67
69
71
NC
PD3
VSS
PD2
DQ8
DQ9
DQ10
DQ11
A
A1
A2
DQ12
DQ13
DQ14
DQ15
VSS
A15
E1
E3
A17
G
DQ24
DQ25
DQ26
DQ27
A3
A4
A5
VCC
A6
DQ28
DQ29
DQ30
DQ31
A18
NC
引脚名称
A-A19
E-E3
W
G
DQ-DQ31
VCC
VSS
NC
A-A19
W
G
20
地址输入
芯片使
写使能
OUTPUT ENABLE
通用数据
输入/输出
电源（+ 5V± 10％）的
地
无连接
DQ-DQ3
4
4
DQ4-DQ7
E
DQ8-DQ11
4
4
DQ12-DQ15
E1
DQ16-DQ19
4
4
DQ20-DQ23
E2
PD1 & PD3 = VSS
PD2 & PD4 =打开
E3
DQ24-DQ27
4
4
DQ28-DQ31
电子设计成立
一个研究驱动韦斯特伯鲁， MA 01581 USA 508-366-5151 传真508-836-4850
http://www.electronic-designs.com
1
EDI8F321024C启7 3/98 ECO ＃ 9798
绝对最大额定值*
任何引脚相对于VSS的电压
工作温度TA （环境）
商用。
产业
储存温度，塑料
功耗
输出电流。
-0.5V至7.0V
0 ° C至+ 70°C
-40 ° C至+ 85°C
-55 ° C至+ 125°C
7.0瓦
20毫安
建议的直流工作条件
参数
符号
电源电压
VCC
电源电压
VSS
输入高电压VIH
输入低电压VIL
民
4.5
0
2.2
-0.3
典型值
5.0
0
--
--
最大单位
5.5
V
0
V
6.0
V
0.8
V
*压力大于下"Absolute最大Ratings"可能会导致
永久损坏设备。这是一个额定值只和功能
该设备在这些或任何其他条件大于操作指示
本规范的业务部门是不是暗示。暴露在绝对
最大额定值条件下工作会影响其可靠性。
AC测试条件
输入脉冲电平
输入上升和下降时间
输入和输出时序水平
输出负载
（注：对于TEHQZ ， TGHQZ和TWLQZ ， CL = 5pF的）
VSS至3.0V
5ns
1.5V
1TTL ， CL = 30pF的
DC电气特性
参数
工作电源电流
待机（ TTL ）电源电流
全部备用电源电流
CMOS
输入漏电流
输出漏电流
输出高电压
输出低电压
*典型： TA = 25℃ ， VCC = 5.0V
符号
条件
ICC1 W， E = VIL ， II / O = 0毫安，闵周期
ICC2 ê
≥
VIH ， VIN
≤
VIL或VIN
≥
VIH
ICC3
E
≥
VCC-0.2V
VIN
≥
VCC - 0.2V或VIN
≤
0.2V
ILI
VIN = 0V至VCC
国际劳工组织
V I / O = 0V至VCC
VOH
IOH = -4.0mA
VOL
IOL = 8.0毫安
民
典型值
最大
1880
480
80
±80
±20
--
0.4
单位
mA
mA
mA
A
A
V
V
--
--
2.4
--
--
--
--
--
真值表
E
H
L
L
L
W
X
H
L
H
G
X
L
X
H
模式
待机
读
写
产量
DESELECT
产量
高Z
DOUT
DIN
高Z
动力
ICC2/ICC3
ICC1
ICC1
ICC1
电容
（ F = 1.0MHz的， VIN = VCC或VSS ）
参数
地址线
数据线
芯片使能线
写线
符号
CI
CD / Q
CC
CN
最大
60
20
20
60
单位
pF
pF
pF
pF
这些参数进行采样，而不是100 ％测试。
EDI8F321024C
1024Kx32 SRAM模块
2
EDI8F321024C启7 3/98 ECO ＃ 9798
EDI8F321024C
1024Kx32 SRAM模块
交流特性读周期
参数
读周期时间
地址访问时间
芯片使能访问
芯片使能到输出低Z（ 1 ）
芯片禁用到输出高Z（ 1 ）
从地址变更输出保持
输出使能到输出有效
输出使能到输出低Z（ 1 ）
输出禁止到输出高Z（ 1 ）
注1 ：参数保证，但未经测试。
符号
JEDEC Alt键。
TAVAV TRC
TAVQV TAA
TELQV TACS
TELQX TCLZ
TEHQZ TCHZ
TAVQX TOH
TGLQV TOE
TGLQX TOLZ
TGHQZ TOHZ
15ns
最小最大
15
15
15
3
7
3
7
0
7
17ns
最小最大
17
17
17
3
7
3
8
0
7
20ns
最小最大
20
20
20
3
10
3
8
0
8
25ns
最小最大
25
25
25
3
12
3
10
0
10
35ns
最小值最大值单位
35
ns
35
ns
35
ns
3
ns
15
ns
3
ns
12
ns
0
ns
12
ns
读周期1 - W高，G ，E LOW
tAVAV
A
地址1
tAVQV
Q
地址2
TAVQX
数据1
数据2
读周期2 - W高
tAVAV
A
E
TELQV
TELQX
G
TGLQV
TGLQX
Q
TGHQZ
TEHQZ
tAVQV
3
EDI8F321024C启7 3/98 ECO ＃ 9798
交流特性写周期
符号
JEDEC
Alt键。
TAVAV TWC
TELWH TCW
TWLEH TCW
地址建立时间
TAVWL TAS
塔维尔
TAS
地址有效到写结束
TAVWH TAW
TAVEH TAW
把脉冲宽度
TWLWH TWP
TELEH TWP
写恢复时间
tWHAX ALE低TWR
TEHAX TWR
数据保持时间
TWHDX TDH
tEHDX
TDH
写入输出高Z（ 1 ）
TWLQZ TWHZ
数据写入时间
TDVWH TDW
TDVEH TDW
输出写入结束（ 1 ） TWHQX TWLZ活动
参数
写周期时间
芯片使能写操作的结束
注1 ：参数保证，但未经测试。
15ns
17ns
最小值最大值最小值最大值
15
17
10
15
10
15
0
0
0
0
10
15
10
15
12
12
12
12
0
0
0
0
3
3
3
3
0
7
0
8
7
10
7
10
3
3
20ns
25ns
35ns
最小值最大值最小值最大值最小值最大值
20
25
35
15
20
25
15
20
25
0
0
0
0
0
0
15
20
25
15
20
25
15
20
25
15
20
25
0
0
0
0
0
0
3
0
0
3
0
0
0
8
0
12
0
15
12
15
20
12
15
20
3
3
3
单位
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
写周期1 - 硬件控制
tAVAV
A
E
TELWH
tAVWH
W
tAVWL
D
TWLQZ
Q
高Z
tWLWH
tDVWH
数据有效
TWHQX
tWHDX
tWHAX ALE低
EDI8F321024C
1024Kx32 SRAM模块
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EDI8F321024C启7 3/98 ECO ＃ 9798
EDI8F321024C
1024Kx32 SRAM模块
写周期2 - E受控
tAVAV
A
塔维尔
E
tAVEH
TWLEH
W
tDVEH
D
Q
高Z
数据有效
tEHDX
tEHAX
tELEH
5
EDI8F321024C启7 3/98 ECO ＃ 9798
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