飞思卡尔半导体公司
第1节
DSP96002简介
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本手册描述了一个家庭双端口IEEE的浮点可编程CMOS中的第一个成员
处理器。家庭的概念定义为核心的数据ALU ，地址产生单元， 。程序
控制器和相关的指令集。片内程序存储器，数据存储器和外设支持
口众多数字密集型应用程序，并尽量减少系统尺寸和功耗;不过，
它们不被认为是核心的一部分。
第一家庭成员是DSP96002 。该DSP96002的主要特点是支持IEEE的
754单精度（ 8位指数和24位尾数）和单扩展精度（ 11位指数
和32位尾数）浮点和32位有符号和无符号的定点算术运算，再加上2
相同的外部存储器扩展端口。其功能如下表所示。
DSP96002特点
IEEE 745标准的SP （ 32位）和SEP （44位）算术
每秒（MIPS ）， 1650万说明了33 MHz的时钟
每秒（ MFLOPS ），峰值49.5亿浮点指令具有33 MHz的
时钟
单周期32 ×32位并行乘法器
高度并行的指令集和独特的DSP寻址模式
嵌套的硬件DO循环
快速自动返回中断
2路独立的片512 ×32位数据的RAM
2个独立片1024 ×32位数据光碟
片外扩展至2× 2
32
数据存储器的32位字
片1024× 32位程序RAM
片64× 32位的引导ROM
片外扩展至2
32
程序存储器的32位字
两个相同的外部存储器扩展端口
2个32位并行主机MPU / DMA接口
片双通道DMA控制器
片内仿真器
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DSP96002用户手册
1-1
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第2节
信号说明和总线操作
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2.1
引脚
的DSP96002的功能信号组示于图2-2中，并且在下文中描述
部分。一个引脚分配总结如图2-1所示。具体的引脚排列和定时信息是可用
能够在DSP96002技术数据表（ DSP96002 / D） 。
2.1.1包装
该DSP96002是在一个223引脚PGA封装。有176信号引脚（含5备件） ， 17
电源引脚和30引脚接地。所有的包装信息是在数据表提供。
2.1.2中断和模式控制（ 4针）
— — — — –
— — — — –
RESET （复位） - 低电平有效，施密特触发输入。
- [R （E S） （E T）的内部同步
于输入时钟（CLK） 。当认定时，该芯片被放置在复位状态，并且
内部相位发生器复位。施密特触发器输入允许一个缓慢上升的输入
— — — — –
（如电容充电）可靠芯片复位。若R （E S） （E T）是被拉高
牢固插入同步输入时钟（ CLK ） ，确切的启动时间有保证，从而允许
荷兰国际集团多个处理器来启动同步，并在"lock - step"一起运行。
— — — — –
当RESET引脚置为无效，最初的芯片的工作模式被锁定
从MODA ， MODB和的MoDC引脚。
—— — –
MODA / IRQA （模式选择A /外部中断请求） - 低电平输入，内部
—— — –
同步于输入时钟（CLK） 。 MODA / I R Q A选择初始芯片
在硬件复位的操作模式，并成为一个电平敏感的或负的边缘
正常的指令处理过程中引发的，可屏蔽中断请求输入。
MODA ， MODB和的MoDC选择8初始芯片的工作模式之一，锁存到
— — — — –
——
操作模式寄存器（ OMR）时的
- [R （E S） （E T）引脚置为无效。如果我
— –
RQA被断言同步于输入时钟（CLK） ，多个处理器可以是
—— — –
使用WAIT指令，并声称IRQA退出等待重新同步
—— — –
状态。如果处理器处于停止待机状态和IRQA后，可将
处理器将退出STOP状态。
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DSP96002用户手册
2-1
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CPU针脚
复位和的IRQ
时钟输入
一旦端口
CPU备用
安静的力量
安静地
CPU小计
引脚
4
1
4
1
4
4
18
电源/地平面
包装嘈杂的电源平面
包装嘈杂的地平面
包装安静的电源平面
包装安静地平面
电源/接地层小计
引脚
2
5
1
1
9
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端口A / B
数据总线
地址总线
数据电源
地面数据
地址电源
地址地
地址/数据小计
每个端口两个端口
引脚
引脚
32
32
2
4
2
4
76
64
64
4
8
4
8
152
端口A / B
总线控制信号
总线控制备品
总线控制电
总线控制地面
控制小计
每个端口两个端口
引脚
引脚
17
2
1
2
22
34
4
2
4
44
引脚排列摘要
CPU针脚
包电源/地平面
端口A / B引脚
数据和地址
总线控制
汇总
引脚
18
9
152
44
223
图2-1 。 DSP96002功能组针脚分配
—— — –
MODB / IRQB （模式选择B /外部中断请求B） - 低电平输入，内部同步
—— — –
于输入时钟（CLK） 。 MODB / IRQB选择初始芯片的工作模式，能很好地协同
荷兰国际集团的硬件复位，成为一个电平敏感或下降沿触发，屏蔽
正常的指令处理期间中断请求输入。 MODA ， MODB和的MoDC
选择8个初始芯片的工作模式中的一种，被锁存到运作模式寄存器
— — — — –
—— — –
（OMR）时的
- [R （E S） （E T）引脚置为无效。如果I R Q B是断言同步
异步的与输入时钟（CLK） ，多个处理器可以使用重新同步
—— — –
等待指令并声称IRQB退出等待状态。
—— — –
的MoDC / IRQC （模式选择C /外部中断请求C） - 低电平输入，内部同步
—— — –
于输入时钟（CLK） 。的MoDC / IRQC选择初始芯片的操作模式能很好地协同
2-2
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DSP96002用户手册
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