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飞思卡尔半导体公司
DSP56007
飞思卡尔半导体公司...
24位数字信号处理器
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摩托罗拉公司，股份有限公司
半导体产品部
无线事业部
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奥斯汀，德克萨斯州78735-8598
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飞思卡尔半导体公司
目录
第1节
概述。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 1-1
1.1
简介。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 1-3
1.1.1
手册组织。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 1-4
1.1.2
手册中的约定。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 1-5
1.2
DSP56007特点。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 1-6
1.3
DSP56007架构概述。 。 。 。 。 。 。 。 。 。 。 。 。 1-8
1.3.1
外围模块。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 1-9
1.3.2
DSP核心处理器。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 1-10
1.3.2.1
数据算术逻辑单元（ ALU数据） 。 。 。 。 。 。 。 。 。 1-10
1.3.2.2
地址产生单元（ AGU ） 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 1-11
1.3.2.3
程序控制单元。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 1-11
1.3.2.4
数据总线。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 1-12
1.3.2.5
地址总线。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 1-12
1.3.2.6
锁相环（ PLL） 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 1-12
1.3.2.7
片上仿真（一次）端口。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 1-12
1.3.3
回忆。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 1-13
1.3.3.1
程序存储器。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 1-13
1.3.3.2
内存配置位。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 1-15
1.3.3.3
X数据存储器。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 1-15
1.3.3.4
Y数据存储区。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 1-15
1.3.3.5
引导ROM 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 1-15
1.3.3.6
保留的内存空间。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 1-15
1.3.4
输入/输出。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 1-16
1.3.4.1
外部存储器接口。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 1-17
1.3.4.2
串行主机接口（ SHI） 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 1-18
1.3.4.3
串行音频接口（ SAI ） 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 1-18
1.3.4.4
GPIO 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 1-18
第2节
信号说明。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 2-1
2.1
信号组。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 2-3
2.2
电源。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 2-5
2.3
地面。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 2-5
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iii
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2.4
2.5
2.6
2.7
2.8
2.8.1
2.8.2
2.9
2.10
时钟和PLL的信号。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 2-6
外部存储器接口（ EMI） 。 。 。 。 。 。 。 。 。 。 。 。 。 。 2-7
中断和模式控制。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 2-10
串行主机接口（ SHI） 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 2-14
串行音频接口（ SAI） 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 2-18
SAI接收器部分。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 2-18
SAI发射器部分。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 2-20
通用I / O操作。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 2-21
片上仿真（一次
TM
）端口。 。 。 。 。 。 。 。 。 。 。 。 。 。 2-22
MEMORY ，操作模式，
和中断。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 3-1
简介。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 3-3
数据和程序存储器。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 3-3
X数据光盘。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 3-4
Y数据的ROM 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 3-4
自举的DSP。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 3-4
保留的内存空间。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 3-5
数据和程序存储器映射。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 3-5
内存配置的动态切换。 。 。 。 。 。 。 。 。 。 。 3-7
内部I / O存储器映射。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 3-9
操作模式寄存器（ OMR ） 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 3-11
DSP工作模式（ MC ， MB ，MA ） -Bits 4,1和0 。 3-11
程序RAM使能（ PE）的比特2 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 3-11
停止延时（ SD ）位6 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 3-12
工作模式。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 3-12
中断优先级寄存器。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 3-14
锁相环（ PLL）的配置。 。 。 。 。 。 。 。 。 3-17
运行对硬件复位。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 3-18
4-1
4-3
4-3
4-4
4-5
4-7
3
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部分
3.1
3.2
3.2.1
3.2.2
3.2.3
3.2.4
3.3
3.3.1
3.3.2
3.4
3.4.1
3.4.2
3.4.3
3.5
3.6
3.7
3.8
第4节
外部存储器接口。 。 。 。 。 。 。 。 。 。 。 。
4.1
简介。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
4.1.1
操作理论。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
4.1.2
EMI特性。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
4.2
EMI编程模型。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
4.2.1
EMI基址寄存器（ EBAR0和EBAR1 ） 。 。 。 。 。
iv
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EMI写偏移寄存器（ EWOR ） 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 4-7
EMI偏移寄存器（ EOR ） 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 4-8
EMI数据写入寄存器（ EDWR ） 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 4-9
EMI数据读取寄存器（ EDRR ） 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 4-9
EMI数据缓冲寄存器（ EDRB ） 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 4-9
EMI控制/状态寄存器（ ECSR ） 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 4-10
EMI数据总线宽度（ EBW ）位0 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 4-10
EMI的字长度（ EWL [2：0 ]） - 位16,2和1 。 。 。 。 。 4-11
EMI的寻址方式（ EAM [3：0 ]） - 位6-3 。 。 。 。 。 。 。 4-12
EMI递增EBAR后读（ EINR ）位7 。 。 。 。 。 4-16
EMI递增EBAR后写（ EINW ）位8 。 。 。 。 4-16
EMI的中断选择器（EIS [1：0 ]） - 毕特9-10 。 。 。 。 。 。 。 。 。 4-17
EMI内存包裹中断使能（ EMWIE ） -
位11 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 4-17
4.2.7.8
EMI数据写入寄存器空（ EDWE ）位12 。 。 。 。 4-18
4.2.7.9
EMI数据读取寄存器满（ EDRF ）位13 。 。 。 。 。 。 4-18
4.2.7.10
EMI数据缓冲寄存器和数据寄存器读
全部（ EBDF ）位14 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 4-18
4.2.7.11
EMI忙（ EBSY ）位15 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 4-19
4.2.7.12
EMI读取触发选择（ ERTS ）位17 。 。 。 。 。 。 。 。 。 。 4-19
4.2.7.13
EMI DRAM内存时序（ EDTM ）位18 。 。 。 。 。 。 。 4-19
4.2.7.14
EMI SRAM内存时序（ ESTM [ 3 ： 0 ] ） -
位19-22 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 4-20
4.2.7.15
EMI启用（ EME ）位23 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 4-21
4.2.8
EMI刷新控制寄存器（ ERCR ） 。 。 。 。 。 。 。 。 。 。 。 。 。 。 4-21
4.2.8.1
EMI刷新时钟分频器（ ECD [ 7 ： 0 ] ） - 0-7位。 。 。 。 4-22
4.2.8.2
ERCR保留位， 8-17位， 21 。 。 。 。 。 。 。 。 。 。 。 。 。 4-22
4.2.8.3
EMI刷新时钟预分频器（EPS [ 1 ： 0 ] ） - 位18-19 4-22
4.2.8.4
EMI单次刷新（ EOSR ）位20 。 。 。 。 。 。 。 。 。 。 。 4-22
4.2.8.5
EMI刷新启用调试时（ ERED ） -
位22 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 4-22
4.2.8.6
ERCR刷新启用（ EREF ）位23 。 。 。 。 。 。 。 。 。 。 。 4-23
4.3
EMI的地址生成。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 4-23
4.3.1
SRAM绝对寻址。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 4-24
4.3.2
SRAM相对寻址。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 4-25
4.3.3
DRAM相对寻址。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 4-27
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4.2.2
4.2.3
4.2.4
4.2.5
4.2.6
4.2.7
4.2.7.1
4.2.7.2
4.2.7.3
4.2.7.4
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4.3.4
4.4
4.4.1
4.4.2
4.4.3
4.4.3.1
4.4.3.2
4.4.3.3
4.4.4
4.4.5
4.5
4.5.1
4.5.2
4.5.3
4.5.4
4.5.5
4.6
4.7
4.8
4.8.1
4.8.1.1
4.8.1.2
4.8.2
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DRAM绝对寻址。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
DRAM刷新。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
DRAM刷新，而无需使用内部刷新
定时器。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
DRAM刷新一次端口调试模式的思考。
使用内部定时刷新。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
“上线”刷新。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
“关线”刷新。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
一旦端口调试模式的思考。 。 。 。 。 。 。 。 。 。 。
软件控制的刷新。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
DRAM刷新时间。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
EMI操作注意事项。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
EMI触发和流水线。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
读取数据传输。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
写数据传输。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
EMI操作时停止。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
EMI工作在等待。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
DATA-延迟结构。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
EMI - TO-内存连接。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
EMI时机。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
时序图DRAM的寻址方式。 。 。 。 。 。 。
快速的时序模式。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
慢时钟模式。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
时序图SRAM寻址模式。 。 。 。 。 。 。
4-30
4-31
4-31
4-32
4-33
4-33
4-34
4-34
4-34
4-35
4-38
4-38
4-40
4-43
4-45
4-45
4-46
4-48
4-50
4-51
4-52
4-58
4-64
5-1
5-3
5-4
5-4
5-7
5-8
5-8
5-9
5-9
5-9
第5节
串行主机接口。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
5.1
简介。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
5.2
串行主机接口的内部架构。
5.3
串行主机接口的编程模型。 。 。 。
5.3.1
SHI输入/输出移位寄存器（ IOSR ） -Host侧。 。 。 。 。
5.3.2
石主机发送数据寄存器（ HTX ） -DSP侧。 。 。 。
5.3.3
石主机接收数据FIFO （ HRX ） -DSP侧。 。 。 。 。 。 。
5.3.4
施从机地址寄存器（ HSAR ） -DSP侧。 。 。 。 。 。 。
5.3.4.1
HSAR保留位，位17-0,19 。 。 。 。 。 。 。 。 。 。 。 。 。 。
5.3.4.2
HSAR我
2
I2C从地址（ HA [6 ： 3 ] ， HA1 ） -
位23-20,18 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
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