DS99R124AQ
DS99R124AQ 5 - 43 MHz的18位彩色FPD -Link的二FPD -Link的转换器
文献编号： SNLS342
DS99R124AQ 5 - 43 MHz的18位彩色FPD -Link的二FPD -Link的转换器
2011年7月15日
DS99R124AQ
5 - 43 MHz的18位彩色FPD -Link的二FPD -Link的转换器
概述
该DS99R124AQ转换FPD -Link的二FPD -Link的。它反
鲈具有嵌入一个高速串行接口
时钟在一对（FPD链路Ⅱ） 3 LVDS数据/配置
控制流和一个LVDS时钟对（ FPD -Link的） 。该系列
公交方案极大地简化了系统设计，消除偏差
时钟和数据之间的问题，降低了数
连接器插针，降低了互连尺寸，重量和
成本，简化了整体的PCB布局。此外，内部直流
均衡解码用于支持AC耦合在互连
nects 。
该DS99R124AQ转换器恢复数据（RGB）和
控制信号，并提取时钟从串行数据流
器（FPD -Link的二）。它能够锁定到输入数据流
在不使用的训练序列或特殊SYNC的巳
燕鸥和不需要的基准时钟。一个链接状态
（锁定）输出信号被提供。
串行输入流亲的可调输入均衡
志愿组织赔偿的传输介质损耗
电缆，降低了介质引起的确定性抖动。
EMI是通过使用低压差分信号 - 的最小化
荷兰国际集团，输出状态选择功能，并附加输出蔓延
谱的产生。
用较少的导线连接到该显示器的物理接口， FPD-
链接输出， LVDS技术是理想的高速，低
功耗和低EMI的数据传输。
该DS99R124AQ提供48引脚的LLP封装，
在汽车AEC -Q100 2级温度规定
TURE范围为-40 ° C至+ 105°C 。
特点
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5 - 43 MHz的支持（ 140 Mbps至1.2 Gbps的串行链路）
4通道（ 3数据+ 1个时钟） FPD -Link的LVDS输出
3低速过采样LVCMOS输出
AC耦合STP连接多达10米长
集成的输入端接
@高速链路BIST模式和报告引脚
可选的I2C兼容的串行控制总线
RGB666 + VS ， HS ， DE 1对转换
掉电模式下的功耗降至最低
快速随机数据锁定;没有参考时钟
可调输入接收均衡
LOCK （实时连接状态）报告脚
低EMI FPD -Link的输出
SSCG选项为降低EMI
1.8V或3.3V兼容I / O接口
汽车级产品： AEC - Q100 2级合格
>8千伏HBM和ISO 10605 ESD额定值
应用
■
汽车显示了导航
■
汽车显示为娱乐
应用图
30154927
三州
是美国国家半导体公司的注册商标。
2011美国国家半导体公司
301549
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DS99R124AQ
DS99R124AQ引脚图
30154919
FPD -Link的二FPD -Link的转换器 - DS99R124AQ
引脚说明
引脚名称
RIN +
RIN-
CMF
针＃
40
41
42
I / O类型
我， LVDS
我， LVDS
I，模拟
描述
真正的输入
必须将输入的交流加上一个100 nF电容。内部端接。
反相输入
必须将输入的交流加上一个100 nF电容。内部端接。
共模滤波器
VCM的中心抽头是一个虚地这可能交流耦合到地，以增加接收器
共模噪声抑制能力。推荐值为4.7
μF
或更高。
真正的LVDS数据输出
这对应该有一个100
终止标准LVDS电平。
反相LVDS数据输出
这对应该有一个100
终止标准LVDS电平。
真正的LVDS时钟输出
这对应该有一个100
终止标准LVDS电平。
反相LVDS时钟输出
这对应该有一个100
终止标准LVDS电平。
2
FPD -Link的II输入接口
FPD -Link的输出接口
TXOUT [2：0 ] +。
TXOUT [2： 0] -
TXCLKOUT +
TXCLKOUT-
19, 21, 23
20, 22, 24
17
18
O， LVDS
O， LVDS
O， LVDS
O， LVDS
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DS99R124AQ
引脚名称
操作系统[2：0 ]
针＃
12, 11, 10
I / O类型
O， LVMOS
描述
过采样低频输出
这些比特映射到DS99R421的操作系统[ 2：0]的过采样低频输入。信号
一定要慢TXCLK / 5 。在DS90UR241这些映射到DIN [ 23时21分]输入。 OS0
= DIN21 ， OS1 = DIN22 ， OS2 = DIN23 。
LOCK状态输出
LOCK = 1时， PLL锁定时，输出处于激活状态。
LOCK = 0时， PLL被锁定，输出状态由OSS_SEL确定。
也许作为链路状态或标志，当视频数据有效时（ ON / OFF） 。
掉电模式输入
PDB = 1 ，设备启用（正常工作）
PDB = 0时，器件处于掉电时，输出由设置控制。控制寄存器
是
复位。
差分驱动器输出电压选择
VODSEL = 1 ， LVDS视频点播为± 400 mV时， 800 MVP -P （典型值） - 长电缆/德-E的应用
VODSEL = 0 ， LVDS视频点播为± 250 mV时， 500 MVP -P （典型值）
请参阅表
2
输出使能输入
OEN = 1 ， FPD -Link的输出启用（激活） 。
OEN = 0 ， FPD -Link的输出三态。
输出睡眠状态选择输入
SEE
表1
低频模式 - 引脚或寄存器控制
LF_MODE = 1，低频模式（ TXCLKOUT = 5-20兆赫）
LF_MODE = 0时，高频模式（ TXCLKOUT = 20-43兆赫）
扩频时钟发生器（ SSCG ）范围选择
请参阅表
3
和
表4
版权所有
配合低
LVCMOS输出
LOCK
27
O， LVMOS
控制和配置
PDB
1
我， LVCMOS
瓦特/下拉
VODSEL
33
我， LVCMOS
瓦特/下拉
OEN
34
我， LVCMOS
瓦特/下拉
我， LVCMOS
瓦特/下拉
我， LVCMOS
瓦特/下拉
我， LVCMOS
瓦特/下拉
我， LVCMOS
瓦特/下拉
OSS_SEL
LFMODE
35
36
SSC [2：0 ]
RES [1 ：0]的
7, 3, 2
37, 15
控制和配置 - 表带PIN
对于高状态，用一个10 kΩ的上拉至VDDIO ;为低状态时， IO包括内部上拉下来。背带引脚读经
电和设置设备配置。引脚数列以及在方括号共享LVCMOS输出的名字。
EQ
28 [ PASS ]
背带
我， LVCMOS
瓦特/下拉
我， LVCMOS
瓦特/下拉
我， LVCMOS
瓦特/下拉
O， LVCMOS
的FPD -Link的II输入EQ增益控制
EQ = 1 ， EQ增益使能（ 13分贝）
EQ = 0 ， EQ增益被禁用（ 1.625分贝）
BIST使能输入 - 可选
BISTEN = 1， BIST模式被启用。
BISTEN = 0，正常模式。
BIST模式输入 - 可选
BISTM = 1 ，选择有效载荷错误模式
BISTM = 0 ，选择通过/失败结果的唯一模式
通输出（ BIST模式） - 可选
PASS = 1时，未检测到错误
PASS = 0时，检测到的错误
离开，如果不用打开。路由到一个测试点（垫）的推荐。
串行控制总线时钟输入 - 可选
SCL需要一个外部上拉电阻到V
DDIO
.
串行控制总线数据输入/输出 - 可选
SDA需要一个外部上拉电阻到V
DDIO
.
可选BIST模式
BISTEn
29
BISTM
30
通
28
可选的串行总线控制接口
SCL
SDA
5
4
我， LVCMOS
I / O ，
LVCMOS
漏极开路
3
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DS99R124AQ
引脚名称
ID [ X]
针＃
16
I / O类型
I，模拟
描述
串行控制总线的设备ID地址选择 - 可选
接地电阻和10 kΩ的上拉至1.8V的电源轨。看
表5 。
逻辑电源， 1.8 V± 5 ％
模拟电源， 1.8 V± 5 ％
SSC发电机功率， 1.8 V± 5 ％
FPD -Link的电源， 3.3 V± 10 ％
LVCMOS I / O电源， 1.8 V± 5％或3.3 V± 10 ％
地
电源和接地
VDDL
VDDA
VDDP
VDDTX
VDDIO
GND
6, 31
38, 43
8, 46, 47
13
25
9, 14, 26,
32, 39, 44,
45, 48
DAP
动力
动力
动力
动力
动力
地
DAP
地
DAP是大的金属接触的底侧上，位于所述LLP封装的中心。
连接到接地平面
（GND）的具有至少9的通孔。
注： 1 = HIGH ， 0 =低
订购信息
NSID
DS99R124AQSQE
DS99R124AQSQ
DS99R124AQSQX
包装说明
48引脚的LLP ， 7.0× 7.0 ×0.8毫米，节距为0.5mm
48引脚的LLP ， 7.0× 7.0 ×0.8毫米，节距为0.5mm
48引脚的LLP ， 7.0× 7.0 ×0.8毫米，节距为0.5mm
QUANTITY
250
1000
2500
规格
NOPB
NOPB
NOPB
包ID
SQA48A
SQA48A
SQA48A
注：汽车级（Q ），产品采用增强的制造过程和支持过程的汽车市场，
包括缺陷检测方法。可靠性鉴定符合要求和温度等级
在AEC Q100标准定义的。汽车级产品都以字母Q.欲了解更多信息，请访问
http://www.national.com/automotive 。
框图
30154929
FPD -Link的二FPD -Link的转换器
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4
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