DS90UH927Q
为5MHz - 85MHz的24位彩色FPD -Link的III串行器与HDCP
概述
该DS90UH927Q串行器，连同一
DS90UH928Q或DS90UH926Q解串器，提供了一个所谓的
lution用于内容受保护的数字视频的安全分发
在车载娱乐系统。该芯片组传输
鲈一个FPD -Link的视频接口为单对高速
串行接口。数字视频数据是使用保护
行业标准的高带宽数字内容保护
化（ HDCP ）复制保护方案。在FPD -Link的III串行
公交方案支持全双工，高速前向信道
数据传输和低速反向信道通信
化在单个差分链路。音频的整合，
视频和控制数据通过单个差分对降低
互连的尺寸和重量，同时还消除了歪斜
问题和简化系统设计。
该DS90UH927Q串行器嵌入时钟，内容亲
便可使数据有效载荷和电平转换的信号到高
高速差分信号。高达24的RGB数据比特是
随着三个视频控制信号序列，和最多四个
I2S数据输入。
在FPD -Link数据接口，可以方便与接口
数据源的同时，也最大限度地降低电磁干扰和总线宽度。 EMI
在高速的FPD -Link的第三总线的低最小化
电压差分信号，数据加扰和随机
化，和直流平衡。
在HDCP加密引擎是在两个串行器实现
与解串器。 HDCP密钥被存储在片上存储器。
特点
●
集成HDCP带有片上存储密钥加密引擎
●
与I2C兼容的双向控制通道接口
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串行控制总线
低EMI FPD -Link的视频输入
支持高清（ 720p）的数字视频格式。
为5MHz - 85MHz的PCLK支持
RGB888 + VS ， HS ， DE和I2S音频支持
多达4个I2S数字音频输入，用于环绕声
应用
4双向GPIO通道， 2个专用引脚
3.3V单电源供电，工作在1.8V或3.3V LVCMOS兼容
I / O接口
交流耦合的STP互连高达10米
直流平衡&加扰的数据具有嵌入式时钟
支持HDCP中继器的应用
内部生成模式
低功耗模式使功耗降至最低
汽车级产品： AEC - Q100 2级合格
>8kV HBM和ISO 10605 ESD额定值
向后兼容模式
应用
●
汽车显示了导航
●
后座娱乐系统
应用图
30193027
TRI- STATE是美国国家半导体公司的注册商标。
生产数据信息，作为
出版日期。产品符合每规格
德州仪器标准保修条款。
生产加工并不包括
所有测试参数。
301930 SNLS433A
版权所有1999-2012 ，德州仪器
DS90UH927Q
DS90UH927Q引脚图
30193019
DS90UH927Q - 顶视图
引脚说明
引脚名称
RXIN [3：0 ] +。
RXIN [3： 0] -
RxCLKIN +
RxCLKIN-
针＃
38, 34, 32, 30
37, 33, 31, 29
36
35
I / O类型
我， LVDS
我， LVDS
我， LVDS
我， LVDS
描述
真正的LVDS数据输入
每对需要外接100Ω差分端接标准LVDS电平
反相LVDS数据输入
每对需要外接100Ω差分端接标准LVDS电平
真LVDS时钟输入
这对需要外接100Ω差分端接标准LVDS电平
反相LVDS时钟输入
这对需要外接100Ω差分端接标准LVDS电平
FPD -Link的输入接口
LVCMOS并行接口
I2S_WC
I2S_CLK
I2S_DA
I2S_DB
I2S_DC
I2S_DD
1
2
3
4
5
6
我， LVCMOS数字音频接口I2S字时钟和I2S位时钟输入
W /下拉共享的GPIO_REG7和GPIO_REG8
表3
我， LVCMOS数字音频接口I2S数据输入
W /下拉共享与GPIO_REG6 ， GPIO_REG5 ， GPIO2 ， GPIO3
2
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DS90UH927Q
引脚名称
GPIO [ 1：0]
针＃
40, 39
I / O类型
描述
I / O ，
通用I / O
LVCMOS见
表1
W /下拉
我， LVCMOS中继模式选择
W /下拉REPEAT = 0 ，中继模式禁用（默认）
REPEAT = 1 ，中继模式启用
需要一个10kΩ的上拉，如果设置高
我， LVCMOS向后兼容模式选择
W /下拉BKWD = 0 ，接口为DS90UH926 / 8Q （默认）
BKWD = 1 ，接口为DS90UR906 / 8Q ， DS90UR916Q
需要一个10kΩ的上拉，如果设置高
我， LVCMOS FPD -Link的输入地图选择
W /下拉MAPSEL = 0 ，在RxIN3 ±个LSB （默认）
MAPSEL = 1，上RxIN3 ±个MSB
SEE
图12及图13
需要一个10kΩ的上拉，如果设置高
我， LVCMOS低频模式选择
W /下拉LFMODE = 0 ， 15MHz的
≤
RxCLKIN
≤
85MHz的（默认）
LFMODE = 1， 5MHz的
≤
RxCLKIN < 15MHz的
需要一个10kΩ的上拉，如果设置高
重复
21
BKWD
22
MAPSEL
23
LFMODE
25
可选并行接口
GPIO [ 3：2]
6, 5
I / O ，
LVCMOS
W /下拉
I / O ，
LVCMOS
W /下拉
通用I / O
共享与I2S_DD和I2S_DC
SEE
表1
注册仅通用I / O
共享与I2S_CLK ， I2S_WC ， I2S_DA ， I2S_DB
SEE
表2
GPIO_REG
[8:5]
2, 1, 3, 4
控制和配置
PDB
18
我， LVCMOS掉电模式输入引脚
瓦特/下拉必须被驱动或拉至V
DD33
。请参阅“通电要求和PDB Pin"在
应用信息部分。
PDB = H ，设备启用（正常工作）
PDB = L ，器件掉电。
当该装置处于断电状态时，驱动器输出均为高电平时，PLL
是关机，我
DD
被最小化。控制寄存器进行
复位。
I / O ，
LVCMOS
漏极开路
I / O ，
LVCMOS
漏极开路
I，模拟
I2C时钟输入/输出接口
必须有外部上拉至V
DD33
.
不FL燕麦。
推荐的上拉： 4.7kΩ的。
I2C数据输入/输出接口
必须有外部上拉至V
DD33
.
不FL燕麦。
推荐的上拉： 4.7kΩ的。
I2C地址选择
外部上拉至V
DD33
需要在所有条件下。
不FL燕麦。
连接到外部上拉至V
DD33
和下拉至GND创建一个分压器。
SEE
图23和表4
SCL
9
SDA
10
IDX
11
状态
INTB
27
O， LVCMOS HDCP中断
漏极开路INTB = H ，正常
INTB = L ，中断请求
推荐的上拉： 4.7kΩ至V
DDIO
.
不FL燕麦。
I / O， LVDS
真正的输出
输出必须是交流耦合用一个0.1μF的电容。
FPD -Link的III串行接口
DOUT +
17
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DS90UH927Q
框图
30193028
订购信息
NSID
DS90UH927QSQE
DS90UH927QSQ
DS90UH927QSQX
包装说明
40引脚的LLP ， 6.0× 6.0 ×0.8毫米，节距为0.5mm
40引脚的LLP ， 6.0× 6.0 ×0.8毫米，节距为0.5mm
40引脚的LLP ， 6.0× 6.0 ×0.8毫米，节距为0.5mm
QUANTITY
250
1000
2000
规格
NOPB
NOPB
NOPB
包ID
SQA40A
SQA40A
SQA40A
注：汽车级（Q ），产品采用增强的制造过程和支持过程的汽车市场，
包括缺陷检测方法。可靠性鉴定符合要求和温度等级
在AEC Q100标准定义的。汽车级产品都以字母Q.欲了解更多信息，请访问
http://www.ti.com/automotive 。
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