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DS32EV100的可编程均衡器的单
2008年4月18日
DS32EV100
可编程均衡器的单
概述
该DS32EV100的可编程均衡器提供compen-
偿传输介质损失,并降低了medi-
嗯诱导的确定性抖动为NRZ数据信道。该
DS32EV100的操作了优化,以3.2 Gbps的两个
电缆和FR4走线。均衡器通道有8列弗
输入均衡的埃尔斯可以由3进行编程
控制引脚。
均衡器支持交流和直流耦合的数据通路
长期运行长度的数据模式,如PRBS -31 ,和的天平
高级代码,如8B / 10B 。该设备采用差分
电流模式逻辑( CML)的输入和输出。该
DS32EV100可在3毫米×4mm的14引脚无引线
LLP封装。电源由一个2.5V或3.3V供应
供应量。
特点
均衡可达14 dB损耗在3.2 Gbps速率
8级可编程均衡
工作频率高达3.2 Gbps的40 “ FR4走线
0.12 UI残余确定性抖动在3.2 Gbps的40 “
FR4走线
单2.5V或3.3V电源
支持交流或直流耦合宽输入共
模式
低功耗: 100 mW的典型值在2.5V
小型3毫米x 4毫米14引脚的LLP封装
> 8 kV的HBM ESD额定值
-40到85°C的工作温度范围
简化应用图
20206501
2008美国国家半导体公司
202065
www.national.com
DS32EV100
引脚图
20206503
14引脚的LLP封装(3毫米x 4毫米× 0.8毫米,0.5 mm间距)
见NS包装数SQA14A
订购信息
NSID
DS32EV100SD
DS32EV100SDX
封装类型,数量大小
1000 14引脚LLP (3毫米x 4毫米× 0.8毫米,0.5 mm间距,卷轴
4500 14引脚LLP (3毫米x 4毫米× 0.8毫米,0.5 mm间距,卷轴
包ID
SDA14A
SDA14A
引脚说明
引脚名称
针#
I / O ,
TYPE
一,慢性粒细胞白血病
描述
高速差分I / O
IN-
IN +
OUT-
OUT +
BST_2
BST_1
BST_0
动力
V
DD
GND
DAP
其他
NC
1
版权所有。没有留下任何连接。
5
2, 6, 9, 10,
13
PAD
动力
动力
动力
V
DD
= 2.5V ±5%或3.3V±10 %。 V
DD
引脚应连接到V
DD
通过低电感平面
路径。一个0.01μF旁路电容应连接各V之间
DD
连接到GND平面。
接地参考。 GND应该通过一个低阻抗路径连接到一个坚实的接地平面。
接地参考。在包装件的中心露出的焊盘必须被连接到接地
平面板。
4
3
11
12
14
7
8
反相和非反相CML差分输入到均衡器。片上100Ω端接
电阻器连接IN +和IN-之间。请参考图4 。
O, CML反相和均衡器的非反相CML差分输出。片上50Ω
终端电阻+ OUT连接到V
DD
和输出到V
DD
.
I,
BST_2 , BST_1和BST_0选择均衡的实力。 BST_2被拉高。 BST_1
LVCMO和BST_0内部拉低。
S
均衡控制
注意:
I =输入, O =输出
www.national.com
2
DS32EV100
绝对最大额定值
(注1 )
如果是用于军事/航空航天特定网络版设备是必需的,
请向美国国家半导体销售办事处/
经销商咨询具体可用性和规格。
电源电压(V
DD
)
CMOS输入电压
CMOS输出电压
CML输入/输出电压
结温
储存温度
焊接温度
焊接, 4秒
-0.5V至+ 4.0V
-0.5V至+ 4.0V
-0.5V至+ 4.0V
-0.5V至+ 4.0V
+150°C
-65 ° C至+ 150°C
+260°C
ESD额定值
HBM , 1.5 kΩ的, 100 pF的
EIAJ , 0Ω , 200 pF的
热阻,
θ
JA
,
没有空气流动
> 8千伏
> 250 V
40 C / W
推荐工作
条件
电源电压(注9 )
V
DD2.5
到GND
V
DD3.3
到GND
环境温度
2.375
3.0
40
2.5
3.3
25
2.625
3.6
+85
V
V
°C
典型值
最大
单位
电气特性
在推荐,除非另有规定工作电源和温度范围内。 (注2,3 )
符号
动力
P
N
电源
消费
电源噪声
公差(注4 )
V
DD2.5
V
DD3.3
50赫兹 - 100赫兹
100赫兹 - 10兆赫
10兆赫 - 1.6GHz的
V
DD2.5
V
DD3.3
1.6
2.0
0.3
I
OH
= ±3mA电流,V
DD2.5
I
OH
= ±3mA电流,V
DD3.3
I
OL
= 3毫安
V
IN
= V
DD
V
IN
= GND
I
IN-P
输入漏电流V
IN
= V
DD
,具有内部上拉下拉电阻
有内部上拉
V
IN
= GND ,带内部上拉电阻
向下/电阻
源传输
发射信号电平
(IN差异)
输入阈值
电压
的电源电压
发射器EQ
交流耦合或直流耦合要求,
在A点差分测量
(图1)
在B点差分测量
(图1)
直流耦合要求
1.6
15
+1.8
0
+95
–20
2.0
2.4
0.4
+15
100
140
100
40
10
V
DD2.5
V
DD3.3
0.8
150
200
mW
mW
mV
P-P
mV
P-P
mV
P-P
V
V
V
V
V
V
A
A
A
A
参数
条件
典型值
(注2 )
最大
单位
LVTTL DC规格
V
IH
V
IL
V
OH
V
OL
I
IN
输入高电平
电压
低电平输入
电压
高电平输出
电压
低电平输出
电压
输入电流
CML接收器输入端(IN + , IN- )
V
TX
400
1600
mV
P-P
mV
P-P
V
DD
V
DDTX
-0.2
10
V
V
INTRE
V
DDTX
V
ICMDC
120
输入共模直流耦合要求
电压
在A点差分测量
(图1)中, (注7)
差分输入
回波损耗
100兆赫 - 1.6 GHz的,具有固定的效果DE-
嵌入式
V
DDTX
-0.8
V
R
LI
dB
3
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DS32EV100
符号
R
IN
V
OD
参数
输入阻抗
差分输出
电压电平( OUT
DIFF )
输出共
电压模式
转换时间
条件
差分跨IN +和IN 。 (图4)
差分测量与OUT +和OUT-
通过50Ω端接至GND ,交流耦合
(图2)
单端测量直流耦合与
50Ω端接
(注7 )
20%至80 %的差分输出电压,
从输出引脚内1 “进行测量。
(图2)
(注7 )
单端至V
DD
100兆赫 - 1.6 GHz的,具有固定的效果DE-
嵌入式。 IN + =静态高。
在50 %的V传输延迟测量
OD
输入到输出, 100 Mbps的间
(图3) , (注7)
85
典型值
(注2 )
100
最大
115
单位
CML输出( OUT + , OUT- )
550
620
725
mV
P-P
V
OCM
V
DD
-0.2
V
DD
-0.1
V
t
R
, t
F
20
60
ps
R
O
R
LO
t
PLHD
输出电阻
迪FF erential输出
回波损耗
差分低
高传播
延迟
鉴别高到
低传播
延迟
残留
确定性抖动
3.2 Gbps的
残留
确定性抖动
2.5 Gbps的
残留
确定性抖动
1 Gbps的
随机抖动
42
50
10
58
dB
240
ps
t
PHLD
240
ps
均衡
DJ1
40 “ 6万微带FR4的, EQ设置0×06 ,
PRBS -7( 2
7
-1 )模式
(注5,6)
40 “ 6万微带FR4的, EQ设置0×06 ,
PRBS -7( 2
7
-1 )模式
(注5,6)
40 “ 6万微带FR4的, EQ设置0×06 ,
PRBS -7( 2
7
-1 )模式
(注5,6)
(注7,8)
0.12
0.2
UI
P-P
DJ2
0.1
0.16
UI
P-P
DJ3
0.05
0.5
UI
P-P
ps
RMS
RJ
注1 :
“绝对最大额定值”,表示以后可能会损坏设备的限制,包括不可操作性的设备可靠性和退化
和/或性能。该设备和/或无退化的绝对最大额定值或其他条件以外的那些指示的功能操作
推荐工作条件是不是暗示。推荐工作条件表示条件该设备是功能和
设备不应该超出这样的条件下操作。绝对最大数字是保证在-40°C至+ 125 ° C的结温范围内。车型
被验证,只有最大工作电压。
注2 :
典型值在V最可能的参数规范
DD
= 3.3V或2.5V ,T
A
= 25 ℃,并在推荐工作条件时的时间
产品特性并不能保证。
注3 :
根据上市推荐工作条件电气特性表列出了保证的性能规格除非另有修改
或由电气特性条件和/或Notes规定。典型规格仅估计,并不能保证。
注4 :
允许的电源噪声(MV
P-P
正弦波)的典型条件下。
注5 :
规范由定性为最佳补偿设定担保,没有在生产测试。
注6 :
确定性抖动的测量是在所述差分输出(图1的点C) ,再减去在测试信道之前的确定性抖动(图1中的点A) 。
随机抖动是通过使用平均或类似装置中删除。
注7 :
测量时钟类{ 11111 } 00000模式。
注8 :
随机抖动贡献的均衡器被定义为的sqrt (J
OUT2
– J
IN2
). J
OUT
是随机抖动在以ps均衡器输出
RMS
参见图1的点C ;
J
IN
是随机抖动在以ps均衡器的输入
RMS
,参见图1 。
注9 :
在V
DD2.5
为V
DD
= 2.5V ±5%和V
DD3.3
为V
DD
= 3.3V ± 10%.
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4
DS32EV100
20206504
图1.测试设置图
20206505
图2. CML输出转换时间
20206506
图3.传输延迟时序图
20206514
图4.简化的接收器输入端接电路
5
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