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位置：首页 > IC型号导航 > 首字符D型号页 > 首字符D的型号第249页 > DS3141N
设计套件，
DS3141/DS3142/DS3143/DS3144
单/双/三/四
DS3 / E3成帧器
www.maxim-ic.com
概述
在DS3141 ， DS3142 ， DS3143 ， DS3144和
（ DS314x ）设备包括所有必要的电路，
帧格式和多达四个独立的DS3或E3
通道。在这些器件中的每个成帧器
独立配置，支持M23 DS3 ，
C-位奇偶校验DS3或G.751 E3 。成帧器接口
各种线路接口单元（LIU ） ，
微处理器
公交车，
和
其他
系统
组件，而胶合逻辑。每个DS3 / E3成帧器
有它自己的HDLC控制器， FEAC控制器和
BERT ，以及用于错误检测的全力支持和
代，性能监控和环回。
特点
§
§
§
§
§
§
§
§
§
§
§
§
§
§
§
§
§
一/二/三/四路独立的DS3 / E3
在一个芯片上成帧器
框架和格式为M23 DS3 ，C位奇偶
DS3和G.751 E3
刘接口可以是二进制（ NRZ ）或双轨道
（ POS / NEG ）
B3ZS / HDB3编码器和解码器
产生和检测DS3 / E3报警
集成HDLC控制器的每个通道
综合FEAC控制器每个通道
综合误码率测试（BERT）为每个
通道
大的性能监视计数器
线，诊断和有效载荷环回
外部控制发射额外开销
插入口
支持外部定时或环回定时
制宪者可以关断未使用时
8位处理器，支持端口或多路复用
Nonmuxed总线操作（ Intel或Motorola ）
3.3V供电， 5V容限I / O
144引脚， 13毫米X 13毫米CSBGA封装
IEEE 1149.1 JTAG支持
应用
SONET / SDH多路复用器
PDH多路复用器
数字交叉连接系统
接入集中器
ATM与帧中继设备
路由器
工作原理图
刘
接口
POS / NRZ
负
CLK
POS / NRZ
NEG / LCV
CLK
的每一个成帧器
系统
接口
CLK
数据
SYNC
架空
CLK
数据
SYNC
达拉斯
半导体
DS314x
发送
格式化
接受
成帧器
订购信息
部分
DS3141
DS3141N
DS3142
DS3142
DS3143
DS3143N
DS3144
DS3144N
数
成帧器
1
1
2
2
3
3
4
4
温度范围
0 ° C至+ 70°C
-40 ° C至+ 85°C
0 ° C至+ 70°C
-40 ° C至+ 85°C
0 ° C至+ 70°C
-40 ° C至+ 85°C
0 ° C至+ 70°C
-40 ° C至+ 85°C
PIN- PACKAGE
144 CSBGA
144 CSBGA
144 CSBGA
144 CSBGA
144 CSBGA
144 CSBGA
144 CSBGA
144 CSBGA
引脚配置在数据资料的最后。
注意：
该器件的一些修订可能偏离称为勘误表公布的规格。任何器件的多个版本
可能同时获得通过不同的销售渠道。欲了解器件勘误表的信息，请点击这里：
www.maxim-ic.com/errata 。
1 88
REV ： 012003
DS3141 / DS3142 / DS3143 / DS3144单/双/三/四路，DS3 / E3成帧器
目录
1.
2.
3.
4.
5.
框图.......................................................................................................................... 6
应用实例.............................................................................................................. 6
主要特点........................................................................................................................... 7
标准符合性......................................................................................................... 8
引脚说明......................................................................................................................... 9
5.1
5.2
5.3
5.4
5.5
5.6
5.7
6.
7.
6.1
7.1
7.2
T
RANSMIT
F
ORMATTER
刘我
覆盖整个院落
P
插件
................................................................................. 9
R
ECEIVE
F
RAMER
刘我
覆盖整个院落
P
插件
......................................................................................... 9
T
RANSMIT
F
ORMATTER
S
变体系
I
覆盖整个院落
P
插件
........................................................................ 10
R
ECEIVE
F
RAMER
S
变体系
I
覆盖整个院落
P
插件
................................................................................ 12
CPU B
US
I
覆盖整个院落
P
插件
......................................................................................................... 14
我JTAG
覆盖整个院落
P
插件
............................................................................................................... 14
S
UPPLY
, T
美东时间
,
和
R
ESET
P
插件
................................................................................................. 14
S
TATUS
R
EGISTER
D
ESCRIPTION
................................................................................................ 17
P
IN
I
NVERSIONS和
F
奥尔塞
H
室内运动场
/L
OW
...................................................................................... 18
T
变送器
L
逻辑
.................................................................................................................. 18
传输时钟..................................................................................................................................... 18
检测失时钟....................................................................................................................... 19
REGISTERS.................................................................................................................................. 15
功能说明...................................................................................................... 18
7.2.1
7.2.2
7.3
7.4
7.5
R
ECEIVER
L
逻辑
........................................................................................................................ 19
E
RROR
I
NSERTION
...................................................................................................................... 20
L
OOPBACKS
............................................................................................................................... 20
线Loopback...................................................................................................................................... 20
诊断Loopback............................................................................................................................ 20
有效载荷Loopback................................................................................................................................ 20
BERT和环回互动.......................................................................................................... 20
7.5.1
7.5.2
7.5.3
7.5.4
7.6
7.7
7.8
7.9
7.10
C
OMMON和
L
INE
I
覆盖整个院落
R
EGISTERS
................................................................................. 22
主状态寄存器（ MSR ） ............................................................................................................. 28
7.6.1
DS3 / E3 F
RAMER
....................................................................................................................... 32
DS3 / E3成帧器注册Description................................................................................................... 32
7.7.1
DS3 / E3 P
ERFORMANCE
E
RROR
C
OUNTERS
................................................................................ 42
BERT........................................................................................................................................ 45
BERT寄存器说明.................................................................................................................. 45
7.9.1
HDLC
ONTROLLER
............................................................................................................... 53
接收操作............................................................................................................................... 53
7.10.1
2 88
DS3141 / DS3142 / DS3143 / DS3144单/双/三/四路，DS3 / E3成帧器
7.10.2
7.10.3
发送操作.............................................................................................................................. 54
HDLC注册说明.................................................................................................................. 54
7.11
7.11.1
FEAC
ONTROLLER
............................................................................................................... 62
FEAC注册说明.................................................................................................................. 63
8.
操作详情................................................................................................................. 67
8.1
8.2
8.3
8.4
8.5
R
ESET
....................................................................................................................................... 67
DS3
和
E3 M
ODE
C
ONFIGURATION
.......................................................................................... 67
刘
和
S
变体系
I
覆盖整个院落
C
ONFIGURATION
............................................................................. 67
L
OOPBACK
M
副执行秘书办公室
..................................................................................................................... 68
T
RANSMIT
O
VERHEAD
I
NSERTION
................................................................................................ 68
JTAG TAP
ONTROLLER
S
TATE
M
ACHINE
.................................................................................. 69
我JTAG
NSTRUCTION
R
EGISTER和
I
NSTRUCTIONS
...................................................................... 71
JTAG S
可以
R
EGISTERS
............................................................................................................. 72
9.
JTAG信息................................................................................................................... 69
9.1
9.2
9.3
10. DC电气特性............................................. .......................................... 73
11. AC时序特性............................................. .................................................. .. 74
11.1
11.2
11.3
S
变体系
I
覆盖整个院落
T
即时通信
..................................................................................................... 74
M
ICROPROCESSOR
I
覆盖整个院落
T
即时通信
..................................................................................... 76
我JTAG
覆盖整个院落
T
即时通信
........................................................................................................ 81
12.引脚分配..................................................................................................................... 82
13.包装INFORMATION........................................................................................................... 87
14.热信息........................................................................................................... 88
15.修订HISTORY..................................................................................................................... 88
3 88
DS3141 / DS3142 / DS3143 / DS3144单/双/三/四路，DS3 / E3成帧器
图列表
图1-1 。框图....................................................................................................................... 6
图2-1 。应用举例： 12端口非通道化DS3 / E3卡....................................... 6 ...........
图5-1 。发送格式化时间............................................... .................................................. 11
图5-2 。接收成帧器时间....................................................................................................... 13
图6-1 。状态寄存器的中断流量.............................................. ............................................... 17
图7-1 。传输数据块Diagram.............................................................................................. 18
图7-2 。发送时钟框图.............................................. .............................................. 19
图7-3 。接收器框图...................................................................................................... 19
图7-4 。 MSR状态位中断信号流............................................ ....................................... 31
图7-5 。 T3E3SR状态位中断信号流............................................ ................................. 39
图7-6 。 BERT状态位中断信号流............................................ ..................................... 50
图7-7 。 HDLC状态位中断信号流............................................ ..................................... 59
图7-8 。 FEAC状态位中断信号流............................................ ..................................... 65
图9-1 。 JTAG框图........................................................................................................... 69
图9-2 。 JTAG TAP控制器状态机............................................. ...................................... 70
图11-1 。数据路径时序图.............................................. .................................................. 75
图11-2 。线路环回时序图.............................................. ........................................... 75
图11-3 。 SCLK时钟时序........................................................................................................... 76
图11-4 。微处理器的接口时序图（非复用） ........................................... ... 77
图11-5 。微处理器的接口时序图（复用） ........................................... ......... 79
图11-6 。 JTAG接口时序图.............................................. .......................................... 81
图12-1 。 DS3141引脚配置............................................... .................................................. 83
图12-2 。 DS3142引脚配置............................................... .................................................. 84
图12-3 。 DS3143引脚配置............................................... .................................................. 85
图12-4 。 DS3144引脚配置............................................... .................................................. 86
4 88
DS3141 / DS3142 / DS3143 / DS3144单/双/三/四路，DS3 / E3成帧器
表格清单
表4 -A 。适用电信标准............................................... ............................. 8
表6 -A 。注册Map........................................................................................................................ 15
表6 -B所示。状态寄存器集Example................................................................................................ 17
表7 -A 。 BERT /回环交互，有效负载位........................................... ............................... 20
表7 -B所示。 BERT /回环交互开销位........................................... ............................. 21
表7 -C 。常见的线路接口寄存器映射............................................. ..................................... 22
表7 -D 。 DS3 / E3成帧器寄存器映射............................................ .................................................. 32
表7 -E 。 DS3警报标准............................................................................................................... 40
表7 -F 。 E3警报标准.................................................................................................................. 40
表7 -G。 BERT寄存器映射............................................................................................................. 45
表7-H 。 HDLC寄存器映射............................................................................................................. 54
表7 -Ⅰ 。 FEAC注册Map............................................................................................................... 63
表9 -A 。 JTAG指令代码....................................................................................................... 71
表9 -B所示。 JTAG ID Code...................................................................................................................... 72
表10 -A 。建议的直流工作条件.............................................. ............................. 73
表10 -B所示。直流电气特性............................................... ............................................... 73
表11 -A 。数据路径的时序............................................................................................................... 74
表11 -B所示。线路环回时间........................................................................................................ 74
表11 -C上。微处理器的接口时序............................................... ......................................... 76
表11 -D 。 JTAG接口时序....................................................................................................... 81
表12 -A 。引脚分配（排序由信号名称） .......................................... ............................... 82
表14 -A 。热学性能，自然对流............................................. ................................ 88
表14 -B所示。的Theta - JA （Q
JA
）与Airflow.................................................................................................... 88
5 88
设计套件，
DS3141/DS3142/DS3143/DS3144
单/双/三/四
DS3 / E3成帧器
www.maxim-ic.com
概述
在DS3141 ， DS3142 ， DS3143 ， DS3144和
（ DS314x ）设备包括所有必要的电路，
帧格式和多达四个独立的DS3或E3
通道。在这些器件中的每个成帧器
独立配置，支持M23 DS3 ，
C-位奇偶校验DS3或G.751 E3 。成帧器接口
各种线路接口单元（LIU ） ，
微处理器
公交车，
和
其他
系统
组件，而胶合逻辑。每个DS3 / E3成帧器
有它自己的HDLC控制器， FEAC控制器和
BERT ，以及用于错误检测的全力支持和
代，性能监控和环回。
特点
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一/二/三/四路独立的DS3 / E3
在一个芯片上成帧器
框架和格式为M23 DS3 ，C位奇偶
DS3和G.751 E3
刘接口可以是二进制（ NRZ ）或双轨道
（ POS / NEG ）
B3ZS / HDB3编码器和解码器
产生和检测DS3 / E3报警
集成HDLC控制器的每个通道
综合FEAC控制器每个通道
综合误码率测试（BERT）为每个
通道
大的性能监视计数器
线，诊断和有效载荷环回
外部控制发射额外开销
插入口
支持外部定时或环回定时
制宪者可以关断未使用时
8位处理器，支持端口或多路复用
Nonmuxed总线操作（ Intel或Motorola ）
3.3V供电， 5V容限I / O
144引脚， 13毫米X 13毫米CSBGA封装
IEEE 1149.1 JTAG支持
应用
SONET / SDH多路复用器
PDH多路复用器
数字交叉连接系统
接入集中器
ATM与帧中继设备
路由器
工作原理图
刘
接口
POS / NRZ
负
CLK
POS / NRZ
NEG / LCV
CLK
的每一个成帧器
系统
接口
CLK
数据
SYNC
架空
CLK
数据
SYNC
达拉斯
半导体
DS314x
发送
格式化
接受
成帧器
订购信息
部分
DS3141
DS3141N
DS3142
DS3142
DS3143
DS3143N
DS3144
DS3144N
数
成帧器
1
1
2
2
3
3
4
4
温度范围
0 ° C至+ 70°C
-40 ° C至+ 85°C
0 ° C至+ 70°C
-40 ° C至+ 85°C
0 ° C至+ 70°C
-40 ° C至+ 85°C
0 ° C至+ 70°C
-40 ° C至+ 85°C
PIN- PACKAGE
144 CSBGA
144 CSBGA
144 CSBGA
144 CSBGA
144 CSBGA
144 CSBGA
144 CSBGA
144 CSBGA
引脚配置在数据资料的最后。
注意：
该器件的一些修订可能偏离称为勘误表公布的规格。任何器件的多个版本
可能同时获得通过不同的销售渠道。欲了解器件勘误表的信息，请点击这里：
www.maxim-ic.com/errata 。
1 88
REV ： 012003
DS3141 / DS3142 / DS3143 / DS3144单/双/三/四路，DS3 / E3成帧器
目录
1.
2.
3.
4.
5.
框图.......................................................................................................................... 6
应用实例.............................................................................................................. 6
主要特点........................................................................................................................... 7
标准符合性......................................................................................................... 8
引脚说明......................................................................................................................... 9
5.1
5.2
5.3
5.4
5.5
5.6
5.7
6.
7.
6.1
7.1
7.2
T
RANSMIT
F
ORMATTER
刘我
覆盖整个院落
P
插件
................................................................................. 9
R
ECEIVE
F
RAMER
刘我
覆盖整个院落
P
插件
......................................................................................... 9
T
RANSMIT
F
ORMATTER
S
变体系
I
覆盖整个院落
P
插件
........................................................................ 10
R
ECEIVE
F
RAMER
S
变体系
I
覆盖整个院落
P
插件
................................................................................ 12
CPU B
US
I
覆盖整个院落
P
插件
......................................................................................................... 14
我JTAG
覆盖整个院落
P
插件
............................................................................................................... 14
S
UPPLY
, T
美东时间
,
和
R
ESET
P
插件
................................................................................................. 14
S
TATUS
R
EGISTER
D
ESCRIPTION
................................................................................................ 17
P
IN
I
NVERSIONS和
F
奥尔塞
H
室内运动场
/L
OW
...................................................................................... 18
T
变送器
L
逻辑
.................................................................................................................. 18
传输时钟..................................................................................................................................... 18
检测失时钟....................................................................................................................... 19
REGISTERS.................................................................................................................................. 15
功能说明...................................................................................................... 18
7.2.1
7.2.2
7.3
7.4
7.5
R
ECEIVER
L
逻辑
........................................................................................................................ 19
E
RROR
I
NSERTION
...................................................................................................................... 20
L
OOPBACKS
............................................................................................................................... 20
线Loopback...................................................................................................................................... 20
诊断Loopback............................................................................................................................ 20
有效载荷Loopback................................................................................................................................ 20
BERT和环回互动.......................................................................................................... 20
7.5.1
7.5.2
7.5.3
7.5.4
7.6
7.7
7.8
7.9
7.10
C
OMMON和
L
INE
I
覆盖整个院落
R
EGISTERS
................................................................................. 22
主状态寄存器（ MSR ） ............................................................................................................. 28
7.6.1
DS3 / E3 F
RAMER
....................................................................................................................... 32
DS3 / E3成帧器注册Description................................................................................................... 32
7.7.1
DS3 / E3 P
ERFORMANCE
E
RROR
C
OUNTERS
................................................................................ 42
BERT........................................................................................................................................ 45
BERT寄存器说明.................................................................................................................. 45
7.9.1
HDLC
ONTROLLER
............................................................................................................... 53
接收操作............................................................................................................................... 53
7.10.1
2 88
DS3141 / DS3142 / DS3143 / DS3144单/双/三/四路，DS3 / E3成帧器
7.10.2
7.10.3
发送操作.............................................................................................................................. 54
HDLC注册说明.................................................................................................................. 54
7.11
7.11.1
FEAC
ONTROLLER
............................................................................................................... 62
FEAC注册说明.................................................................................................................. 63
8.
操作详情................................................................................................................. 67
8.1
8.2
8.3
8.4
8.5
R
ESET
....................................................................................................................................... 67
DS3
和
E3 M
ODE
C
ONFIGURATION
.......................................................................................... 67
刘
和
S
变体系
I
覆盖整个院落
C
ONFIGURATION
............................................................................. 67
L
OOPBACK
M
副执行秘书办公室
..................................................................................................................... 68
T
RANSMIT
O
VERHEAD
I
NSERTION
................................................................................................ 68
JTAG TAP
ONTROLLER
S
TATE
M
ACHINE
.................................................................................. 69
我JTAG
NSTRUCTION
R
EGISTER和
I
NSTRUCTIONS
...................................................................... 71
JTAG S
可以
R
EGISTERS
............................................................................................................. 72
9.
JTAG信息................................................................................................................... 69
9.1
9.2
9.3
10. DC电气特性............................................. .......................................... 73
11. AC时序特性............................................. .................................................. .. 74
11.1
11.2
11.3
S
变体系
I
覆盖整个院落
T
即时通信
..................................................................................................... 74
M
ICROPROCESSOR
I
覆盖整个院落
T
即时通信
..................................................................................... 76
我JTAG
覆盖整个院落
T
即时通信
........................................................................................................ 81
12.引脚分配..................................................................................................................... 82
13.包装INFORMATION........................................................................................................... 87
14.热信息........................................................................................................... 88
15.修订HISTORY..................................................................................................................... 88
3 88
DS3141 / DS3142 / DS3143 / DS3144单/双/三/四路，DS3 / E3成帧器
图列表
图1-1 。框图....................................................................................................................... 6
图2-1 。应用举例： 12端口非通道化DS3 / E3卡....................................... 6 ...........
图5-1 。发送格式化时间............................................... .................................................. 11
图5-2 。接收成帧器时间....................................................................................................... 13
图6-1 。状态寄存器的中断流量.............................................. ............................................... 17
图7-1 。传输数据块Diagram.............................................................................................. 18
图7-2 。发送时钟框图.............................................. .............................................. 19
图7-3 。接收器框图...................................................................................................... 19
图7-4 。 MSR状态位中断信号流............................................ ....................................... 31
图7-5 。 T3E3SR状态位中断信号流............................................ ................................. 39
图7-6 。 BERT状态位中断信号流............................................ ..................................... 50
图7-7 。 HDLC状态位中断信号流............................................ ..................................... 59
图7-8 。 FEAC状态位中断信号流............................................ ..................................... 65
图9-1 。 JTAG框图........................................................................................................... 69
图9-2 。 JTAG TAP控制器状态机............................................. ...................................... 70
图11-1 。数据路径时序图.............................................. .................................................. 75
图11-2 。线路环回时序图.............................................. ........................................... 75
图11-3 。 SCLK时钟时序........................................................................................................... 76
图11-4 。微处理器的接口时序图（非复用） ........................................... ... 77
图11-5 。微处理器的接口时序图（复用） ........................................... ......... 79
图11-6 。 JTAG接口时序图.............................................. .......................................... 81
图12-1 。 DS3141引脚配置............................................... .................................................. 83
图12-2 。 DS3142引脚配置............................................... .................................................. 84
图12-3 。 DS3143引脚配置............................................... .................................................. 85
图12-4 。 DS3144引脚配置............................................... .................................................. 86
4 88
DS3141 / DS3142 / DS3143 / DS3144单/双/三/四路，DS3 / E3成帧器
表格清单
表4 -A 。适用电信标准............................................... ............................. 8
表6 -A 。注册Map........................................................................................................................ 15
表6 -B所示。状态寄存器集Example................................................................................................ 17
表7 -A 。 BERT /回环交互，有效负载位........................................... ............................... 20
表7 -B所示。 BERT /回环交互开销位........................................... ............................. 21
表7 -C 。常见的线路接口寄存器映射............................................. ..................................... 22
表7 -D 。 DS3 / E3成帧器寄存器映射............................................ .................................................. 32
表7 -E 。 DS3警报标准............................................................................................................... 40
表7 -F 。 E3警报标准.................................................................................................................. 40
表7 -G。 BERT寄存器映射............................................................................................................. 45
表7-H 。 HDLC寄存器映射............................................................................................................. 54
表7 -Ⅰ 。 FEAC注册Map............................................................................................................... 63
表9 -A 。 JTAG指令代码....................................................................................................... 71
表9 -B所示。 JTAG ID Code...................................................................................................................... 72
表10 -A 。建议的直流工作条件.............................................. ............................. 73
表10 -B所示。直流电气特性............................................... ............................................... 73
表11 -A 。数据路径的时序............................................................................................................... 74
表11 -B所示。线路环回时间........................................................................................................ 74
表11 -C上。微处理器的接口时序............................................... ......................................... 76
表11 -D 。 JTAG接口时序....................................................................................................... 81
表12 -A 。引脚分配（排序由信号名称） .......................................... ............................... 82
表14 -A 。热学性能，自然对流............................................. ................................ 88
表14 -B所示。的Theta - JA （Q
JA
）与Airflow.................................................................................................... 88
5 88
设计套件，
DS3141/DS3142/DS3143/DS3144
单/双/三/四
DS3 / E3成帧器
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概述
在DS3141 ， DS3142 ， DS3143 ， DS3144和
（ DS314x ）设备包括所有必要的电路，
帧格式和多达四个独立的DS3或E3
通道。在这些器件中的每个成帧器
独立配置，支持M23 DS3 ，
C-位奇偶校验DS3或G.751 E3 。成帧器接口
各种线路接口单元（LIU ） ，
微处理器
公交车，
和
其他
系统
组件，而胶合逻辑。每个DS3 / E3成帧器
有它自己的HDLC控制器， FEAC控制器和
BERT ，以及用于错误检测的全力支持和
代，性能监控和环回。
特点
§
§
§
§
§
§
§
§
§
§
§
§
§
§
§
§
§
一/二/三/四路独立的DS3 / E3
在一个芯片上成帧器
框架和格式为M23 DS3 ，C位奇偶
DS3和G.751 E3
刘接口可以是二进制（ NRZ ）或双轨道
（ POS / NEG ）
B3ZS / HDB3编码器和解码器
产生和检测DS3 / E3报警
集成HDLC控制器的每个通道
综合FEAC控制器每个通道
综合误码率测试（BERT）为每个
通道
大的性能监视计数器
线，诊断和有效载荷环回
外部控制发射额外开销
插入口
支持外部定时或环回定时
制宪者可以关断未使用时
8位处理器，支持端口或多路复用
Nonmuxed总线操作（ Intel或Motorola ）
3.3V供电， 5V容限I / O
144引脚， 13毫米X 13毫米CSBGA封装
IEEE 1149.1 JTAG支持
应用
SONET / SDH多路复用器
PDH多路复用器
数字交叉连接系统
接入集中器
ATM与帧中继设备
路由器
工作原理图
刘
接口
POS / NRZ
负
CLK
POS / NRZ
NEG / LCV
CLK
的每一个成帧器
系统
接口
CLK
数据
SYNC
架空
CLK
数据
SYNC
达拉斯
半导体
DS314x
发送
格式化
接受
成帧器
订购信息
部分
DS3141
DS3141N
DS3142
DS3142
DS3143
DS3143N
DS3144
DS3144N
数
成帧器
1
1
2
2
3
3
4
4
温度范围
0 ° C至+ 70°C
-40 ° C至+ 85°C
0 ° C至+ 70°C
-40 ° C至+ 85°C
0 ° C至+ 70°C
-40 ° C至+ 85°C
0 ° C至+ 70°C
-40 ° C至+ 85°C
PIN- PACKAGE
144 CSBGA
144 CSBGA
144 CSBGA
144 CSBGA
144 CSBGA
144 CSBGA
144 CSBGA
144 CSBGA
引脚配置在数据资料的最后。
注意：
该器件的一些修订可能偏离称为勘误表公布的规格。任何器件的多个版本
可能同时获得通过不同的销售渠道。欲了解器件勘误表的信息，请点击这里：
www.maxim-ic.com/errata 。
1 88
REV ： 012003
DS3141 / DS3142 / DS3143 / DS3144单/双/三/四路，DS3 / E3成帧器
目录
1.
2.
3.
4.
5.
框图.......................................................................................................................... 6
应用实例.............................................................................................................. 6
主要特点........................................................................................................................... 7
标准符合性......................................................................................................... 8
引脚说明......................................................................................................................... 9
5.1
5.2
5.3
5.4
5.5
5.6
5.7
6.
7.
6.1
7.1
7.2
T
RANSMIT
F
ORMATTER
刘我
覆盖整个院落
P
插件
................................................................................. 9
R
ECEIVE
F
RAMER
刘我
覆盖整个院落
P
插件
......................................................................................... 9
T
RANSMIT
F
ORMATTER
S
变体系
I
覆盖整个院落
P
插件
........................................................................ 10
R
ECEIVE
F
RAMER
S
变体系
I
覆盖整个院落
P
插件
................................................................................ 12
CPU B
US
I
覆盖整个院落
P
插件
......................................................................................................... 14
我JTAG
覆盖整个院落
P
插件
............................................................................................................... 14
S
UPPLY
, T
美东时间
,
和
R
ESET
P
插件
................................................................................................. 14
S
TATUS
R
EGISTER
D
ESCRIPTION
................................................................................................ 17
P
IN
I
NVERSIONS和
F
奥尔塞
H
室内运动场
/L
OW
...................................................................................... 18
T
变送器
L
逻辑
.................................................................................................................. 18
传输时钟..................................................................................................................................... 18
检测失时钟....................................................................................................................... 19
REGISTERS.................................................................................................................................. 15
功能说明...................................................................................................... 18
7.2.1
7.2.2
7.3
7.4
7.5
R
ECEIVER
L
逻辑
........................................................................................................................ 19
E
RROR
I
NSERTION
...................................................................................................................... 20
L
OOPBACKS
............................................................................................................................... 20
线Loopback...................................................................................................................................... 20
诊断Loopback............................................................................................................................ 20
有效载荷Loopback................................................................................................................................ 20
BERT和环回互动.......................................................................................................... 20
7.5.1
7.5.2
7.5.3
7.5.4
7.6
7.7
7.8
7.9
7.10
C
OMMON和
L
INE
I
覆盖整个院落
R
EGISTERS
................................................................................. 22
主状态寄存器（ MSR ） ............................................................................................................. 28
7.6.1
DS3 / E3 F
RAMER
....................................................................................................................... 32
DS3 / E3成帧器注册Description................................................................................................... 32
7.7.1
DS3 / E3 P
ERFORMANCE
E
RROR
C
OUNTERS
................................................................................ 42
BERT........................................................................................................................................ 45
BERT寄存器说明.................................................................................................................. 45
7.9.1
HDLC
ONTROLLER
............................................................................................................... 53
接收操作............................................................................................................................... 53
7.10.1
2 88
DS3141 / DS3142 / DS3143 / DS3144单/双/三/四路，DS3 / E3成帧器
7.10.2
7.10.3
发送操作.............................................................................................................................. 54
HDLC注册说明.................................................................................................................. 54
7.11
7.11.1
FEAC
ONTROLLER
............................................................................................................... 62
FEAC注册说明.................................................................................................................. 63
8.
操作详情................................................................................................................. 67
8.1
8.2
8.3
8.4
8.5
R
ESET
....................................................................................................................................... 67
DS3
和
E3 M
ODE
C
ONFIGURATION
.......................................................................................... 67
刘
和
S
变体系
I
覆盖整个院落
C
ONFIGURATION
............................................................................. 67
L
OOPBACK
M
副执行秘书办公室
..................................................................................................................... 68
T
RANSMIT
O
VERHEAD
I
NSERTION
................................................................................................ 68
JTAG TAP
ONTROLLER
S
TATE
M
ACHINE
.................................................................................. 69
我JTAG
NSTRUCTION
R
EGISTER和
I
NSTRUCTIONS
...................................................................... 71
JTAG S
可以
R
EGISTERS
............................................................................................................. 72
9.
JTAG信息................................................................................................................... 69
9.1
9.2
9.3
10. DC电气特性............................................. .......................................... 73
11. AC时序特性............................................. .................................................. .. 74
11.1
11.2
11.3
S
变体系
I
覆盖整个院落
T
即时通信
..................................................................................................... 74
M
ICROPROCESSOR
I
覆盖整个院落
T
即时通信
..................................................................................... 76
我JTAG
覆盖整个院落
T
即时通信
........................................................................................................ 81
12.引脚分配..................................................................................................................... 82
13.包装INFORMATION........................................................................................................... 87
14.热信息........................................................................................................... 88
15.修订HISTORY..................................................................................................................... 88
3 88
DS3141 / DS3142 / DS3143 / DS3144单/双/三/四路，DS3 / E3成帧器
图列表
图1-1 。框图....................................................................................................................... 6
图2-1 。应用举例： 12端口非通道化DS3 / E3卡....................................... 6 ...........
图5-1 。发送格式化时间............................................... .................................................. 11
图5-2 。接收成帧器时间....................................................................................................... 13
图6-1 。状态寄存器的中断流量.............................................. ............................................... 17
图7-1 。传输数据块Diagram.............................................................................................. 18
图7-2 。发送时钟框图.............................................. .............................................. 19
图7-3 。接收器框图...................................................................................................... 19
图7-4 。 MSR状态位中断信号流............................................ ....................................... 31
图7-5 。 T3E3SR状态位中断信号流............................................ ................................. 39
图7-6 。 BERT状态位中断信号流............................................ ..................................... 50
图7-7 。 HDLC状态位中断信号流............................................ ..................................... 59
图7-8 。 FEAC状态位中断信号流............................................ ..................................... 65
图9-1 。 JTAG框图........................................................................................................... 69
图9-2 。 JTAG TAP控制器状态机............................................. ...................................... 70
图11-1 。数据路径时序图.............................................. .................................................. 75
图11-2 。线路环回时序图.............................................. ........................................... 75
图11-3 。 SCLK时钟时序........................................................................................................... 76
图11-4 。微处理器的接口时序图（非复用） ........................................... ... 77
图11-5 。微处理器的接口时序图（复用） ........................................... ......... 79
图11-6 。 JTAG接口时序图.............................................. .......................................... 81
图12-1 。 DS3141引脚配置............................................... .................................................. 83
图12-2 。 DS3142引脚配置............................................... .................................................. 84
图12-3 。 DS3143引脚配置............................................... .................................................. 85
图12-4 。 DS3144引脚配置............................................... .................................................. 86
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DS3141 / DS3142 / DS3143 / DS3144单/双/三/四路，DS3 / E3成帧器
表格清单
表4 -A 。适用电信标准............................................... ............................. 8
表6 -A 。注册Map........................................................................................................................ 15
表6 -B所示。状态寄存器集Example................................................................................................ 17
表7 -A 。 BERT /回环交互，有效负载位........................................... ............................... 20
表7 -B所示。 BERT /回环交互开销位........................................... ............................. 21
表7 -C 。常见的线路接口寄存器映射............................................. ..................................... 22
表7 -D 。 DS3 / E3成帧器寄存器映射............................................ .................................................. 32
表7 -E 。 DS3警报标准............................................................................................................... 40
表7 -F 。 E3警报标准.................................................................................................................. 40
表7 -G。 BERT寄存器映射............................................................................................................. 45
表7-H 。 HDLC寄存器映射............................................................................................................. 54
表7 -Ⅰ 。 FEAC注册Map............................................................................................................... 63
表9 -A 。 JTAG指令代码....................................................................................................... 71
表9 -B所示。 JTAG ID Code...................................................................................................................... 72
表10 -A 。建议的直流工作条件.............................................. ............................. 73
表10 -B所示。直流电气特性............................................... ............................................... 73
表11 -A 。数据路径的时序............................................................................................................... 74
表11 -B所示。线路环回时间........................................................................................................ 74
表11 -C上。微处理器的接口时序............................................... ......................................... 76
表11 -D 。 JTAG接口时序....................................................................................................... 81
表12 -A 。引脚分配（排序由信号名称） .......................................... ............................... 82
表14 -A 。热学性能，自然对流............................................. ................................ 88
表14 -B所示。的Theta - JA （Q
JA
）与Airflow.................................................................................................... 88
5 88
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