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DS12B887
DS12B887
实时时钟
特点
引脚分配
NC
NC
NC
AD0
AD1
AD2
AD3
AD4
AD5
AD6
AD7
GND
1
2
3
4
5
6
7
8
9
10
11
12
24
23
22
21
20
19
18
17
16
15
14
13
V
CC
SQW
NC
RCLR
NC
IRQ
NC
DS
NC
读/写
AS
CS
简易替换为与IBM AT计算机时钟/校准 -
endar
引脚与MC146818B和DS1287兼容
在超过10年的运作完全非易失性
没有权力
自包含
COUNTS
子系统包括锂,石英,
和支持电路
秒,分钟,小时,天,当天
星期,日期,月份和年份与闰年的COM
补偿
报警
二进制或BCD表示时间,日历和
12或24小时时钟的AM和PM在12小时模式
日光节约时间的选择
复用总线引脚效率
接口配合软件可寻址128 RAM
- 14字节的时钟和控制寄存器
- 114字节的通用RAM
24针密封封装
引脚说明
AD0-AD7
NC
CS
AS
读/写
DS
IRQ
SQW
V
CC
GND
RCLR
复用的地址/数据总线
无连接
芯片选择
地址选通
读/写输入
数据选通
中断请求输出
方波输出
+5伏电源
RAM CLEAR
可编程方波输出信号
总线兼容的中断信号( IRQ )
中断是单独的软件,可屏蔽
和可测试
- 时间的日报警次/秒一次/天
- 定期利率从122
s
500毫秒
- 时钟更新周期结束
描述
该DS12B887实时时钟以及RAM的设计
是一个直接的替代DS1287A或
DS12887A 。该DS12B887是在外形,装配相同的,
函数到DS1287A或DS12887A ,与例外
灰RCLR的,并且有一个附加的64字节的一般
目的RAM 。获得此额外RAM空间是
通过在呈现在AD6的逻辑电平来确定
一个存取周期的地址部分。锂能源
源,石英晶体,和写保护电路是
载有24脚双列直插式封装内。因此,
该DS12B887是一个完整的子系统替换16
组件中的典型应用。该功能
包括时间 - 日期的非易失性时钟,一个报警器,一个单
百年历,可编程中断,
方波发生器,以及114字节的非易失性
静态RAM 。实时时钟特征是
时间的日和存储器,即使在保持
没有权力的。
ECopyright
1995年,由达拉斯半导体公司。
版权所有。有关的重要信息
专利和其他知识产权,请参考
Dallas Semiconductor的数据手册。
080895 1/16
DS12B887
手术
图1中的框图给出了引脚连接
系统蒸发散与DS12B887的主要内部功能。
下面的段落描述了各自的功能
引脚。
框图DS12B887
图1
OSC 。
B8
B64
B64
CS
V
CC
V
BAT
动力
开关
保护
V
CC
POK
周期性的中断/方波
选择器
WAVE OUT
CS
SQW
IRQ
寄存器A, B,C ,D
DS
读/写
AS
ADO-
AD7
BCD /
二进制
增量
用户RAM
114字节
内存
明确
逻辑
RCLR
公共汽车
接口
缓冲
时钟/
日历
更新
时钟,日历,
与报警RAM
POWER- DOWN / POWER- UP
注意事项
实时时钟功能将继续运营
和所有的RAM中,时间,日历和报警存储器的
位置保持的电平的非易失性无关
在V
CC
输入。当V
CC
被施加到DS12B887
并达到大于4.25伏的电平,该设备
变后200毫秒访问,只要该
振荡器运行和振荡器计时链
不复位(见寄存器A) 。这个时间段允许
施加电源后系统达到稳定。当
V
CC
下降到低于4.25伏特,则芯片选择输入端是跨
应受强制为无效电平无关的值的
CS在输入引脚。该DS12B887因此,直写
受保护的。当DS12B887处于写保护
状态下,所有的投入都将被忽略,所有输出均处于高
阻抗状态。当V
CC
低于一个电平
约3伏,外部V
CC
供应
关闭和内部锂电池支持
层数功率实时时钟和RAM
内存。
080895 2/16
DS12B887
信号说明
GND ,V
CC
- 直流电源提供给该设备上,这些
销。 V
CC
是+5伏的输入。当施加5伏
在正常范围内,该装置是完全可访问和
数据可以写入和读出。当V
CC
低于4.25
伏典型,读取和写操作被禁止。不过,
计时功能继续不受
较低的输入电压。由于V
CC
低于3伏的典型,
的RAM和计时器被切换到一个跨
最终锂能源。计时功能
保持的精度
±1
每月分25
o
C
无论在V的电压输入
CC
引脚。
SQW (方波输出) - 该SQW引脚输出
从一个13的由15内部设置抽头的信号
实时时钟的分频器阶段。的频率
SQW引脚可通过编程寄存器来改变
甲于表1中所示的SQW信号可以变
开启和关闭使用寄存器B的服务质素监察部的SQWE位
信号不可用时, V
CC
小于4.25伏
典型的。
周期性的中断率和方波输出频率
表1
选择位寄存器A
RS3
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1
RS2
0
0
0
0
1
1
1
1
0
0
0
0
1
1
1
1
RS1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
RS0
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
t
PI
周期
中断速率
3.90625毫秒
7.8125毫秒
122.070
ms
244.141
ms
488.281
ms
976.5625
ms
1.953125毫秒
3.90625毫秒
7.8125毫秒
15.625毫秒
31.25毫秒
62.5毫秒
125毫秒
250毫秒
500毫秒
SQW输出
频率
256赫兹
128赫兹
8.192千赫
4.096千赫
2.048千赫
1.024千赫
512赫兹
256赫兹
128赫兹
64赫兹
32赫兹
16赫兹
8赫兹
4赫兹
2赫兹
080895 3/16
DS12B887
AD0 - AD7 (双向复用地址/数据
公交车)
- 复用总线节约引脚,因为地址
信息和数据信息的时间共享相同的
信号路径。地址是本过程中的第一
在总线周期的部分,并且在同一引脚和信号
路径是在该周期的第二部分用于数据。
地址/数据复用不慢的存取时间
因为从地址总线切换到DS12B887的
在内部RAM的存取时间产生的数据。
地址必须事先向AS的下降沿有效/
ALE,此时DS12B887锁存地址
从AD0至AD6 。有效的写数据必须存在和
在DS或WR的后面部分保持稳定
脉冲。在一个读周期的DS12B887输出8比特的
在DS或RD脉冲的后面部分的数据。该
读周期被终止,并且在总线返回到高
阻抗状态RD变高。
AS (地址选通输入)
- 一个正向地址
选通脉冲提供给解复用总线。下降
AS / ALE的边缘时,地址被内锁
该DS12B887 。
DS (数据选通或读输入)
- DS端子被称为
阅读( RD ) 。 RD确定的时间段时
DS12B887驱动总线读取数据。 RD信号
是定义相同的输出使能(OE)信号
在一个典型的存储器。
R / W (读/写输入) -The
R / W信号是低电平有效
信号称为WR 。在这种模式下的R / W的引脚具有
上相同的含义,写使能信号(WE)
通用的RAM 。
CS (片选输入)
- 片选信号必须
在DS12B887被置位为低的总线周期是
访问。在CS必须保持在激活状态
RD和WR 。总线周期而发生不
主张CS将锁存地址,但是没有访问将
发生。当V
CC
低于4.25伏,则DS12B887
在内部通过内部禁用禁止访问周期
CS输入。这个动作可以保护双方的实时
在停电时钟和数据RAM中的数据。
IRQ (中断请求输出)
- 该IRQ引脚为
该DS12B887的有源低输出,可用于作为
中断输入到处理器。该IRQ输出保持
低,只要该状态位引起中断是压力
耳鼻喉科和相应的中断使能位被置位。对
清除IRQ引脚的处理器程序正常读取
C寄存器。
当没有中断条件都存在时, IRQ级别
在高阻抗状态。多个中断设备
可以被连接到一个IRQ总线。该IRQ总线是一种开放
漏极开路输出,需要一个外部上拉电阻。
RCLR ( RAM清除)
- 该RCLR引脚用于清除(集
为逻辑1 )的所有114字节的通用RAM但
不影响与所述实时相关的RAM中
时钟。为了清除该RAM中, RCLR必须强制
到的( -0.3到0.8伏)的输入逻辑当V
CC
是AP-
合股。该RCLR功能被设计为通过hu-使用
男子界面(短路手动或接地开关)
并且不被驱动与外部缓冲器。该引脚IN-
ternally拉升。不要使用外部上拉电阻
该引脚上。
地址地图
该DS12B887的地址映射如图2所示。
地址映射包含114字节的用户内存, 10
包含RTC时钟,日历字节的RAM ,和
报警数据,以及它们用于控制4个字节
和状态。所有128个字节,可直接读出或写入
除了以下:
1.寄存器C和D是只读的。
2位寄存器的7是只读的。
3.秒字节的高序位是只读的。
四个寄存器的内容(A,B ,C和D)是
在“寄存器”一节中所述。
080895 4/16
DS12B887
地址映射DS12B887
图2
0
14字节
13
14
0D
0E
00
0
1
2
3
4
5
6
7
8
9
10
11
12
127
7F
13
秒报警
分钟
分报警
小时
ALARM HOURS
星期几
每个月的天
MONTH
YEAR
寄存器A
寄存器B
寄存器C
寄存器D
二进制或BCD INPUTS
080895 5/16
时间,日历和闹钟地点
通过读获得的时间和日历信息
荷兰国际集团相应的内存字节。时间,日历,
和报警设置,或通过编写相应的初始化
RAM字节。在10时间,日历中的内容,并
报警字节可以是二进制或二进制编码决策
MAL ( BCD )格式。在写内部时间,校准 -
endar和报警寄存器,寄存器B的SET位
应写入一个逻辑1 ,以防止从更新
发生的同时获得正在尝试。此外
写作的10时间,日历和报警寄存器中
所选格式(二进制或BCD ),数据模式位( DM)的
寄存器B中必须设置到适当的逻辑电平。
十款时间,日历和闹钟字节必须使用
相同的数据模式。在寄存器B的组位应该是
清除之后的数据模式位已被写入到允许
实时时钟来更新时间和日历
字节。一旦被初始化,实时时钟使所有
更新在所选择的模式。数据模式不能
不重新初始化10数据字节被改变。
表2示出了10的二进制和BCD格式
时间,日历和报警位置。在24-12位的CAN
不可不重新初始化时的位置变化。
当选择12小时格式,高阶位
小时的字节表示下午时它是一个逻辑1 。
时间,日历和闹钟字节总是可以访问该
sible因为他们是双缓冲。每一次
第二个10字节一秒前进和
检查报警条件。如果时间读取和
在更新过程中发生的日历数据,存在问题
其中,秒,分钟,小时等可能不相关。
读不正确的时间和日历的概率
数据是低的。避免任何可能的几种方法
不正确的时间和日历的读取都在后面覆盖
此文本。
三个报警字节可以以两种方式使用。首先,
当闹铃时间写入相应的时间,
分钟和秒的报警位置,报警接口
中断是每一天如果报警开始在指定的时间
使能位为高。第二使用状态是插入
一个“不关心”状态中的一个或多个的三个报警
字节。 “不关心”的代码是任何十六进制值
从C0到FF 。每个字节的两个最显著位
设置了“不关心”的条件时,逻辑1的报警
将产生的每一个小时的时候,“不关心”的位
在时间的字节进行设置。同样,报警根儿
ated每分钟有“不关心”,在时间码
和分钟报警字节。在所有的“不关心”的代码
三种报警字节产生中断每一秒。
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联系人:李
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地址:福田区红荔路上步工业区201栋西座316
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