DM74ALS652八路三态总线收发器和寄存器
1986年10月
修订后的2001年6月
DM74ALS652
八路三态总线收发器和寄存器
概述
该器件集成了一个八进制收发器和一个八进制
D型寄存器配置为使数据的传输
从总线到总线或内部寄存器总线。
该总线收发器具有图腾柱三态输出
专为驱动高容性或厘清的设计
tively低阻抗负载。高阻抗状态，
增加高层次的逻辑驱动器提供该设备的
直接连接到的能力和驱动总线
而不需要接口总线系统组织的线路
或拉组件。它们是特别有吸引力的
实施缓冲寄存器， I / O端口，双向总线
驱动器和工作寄存器。
在DM74ALS652寄存器是边沿触发
D型双稳态多谐振荡器。在时钟的上升沿
（CAB或CBA）的输入数据被存储到相应的
注册。该CAB输入控制数据的传输到
A寄存器和CBA输入控制B寄存器。
提供了SAB和SBA控制引脚来选择
是否实时数据或存储的数据被传输。一个低电平
输入电平中选择的实时数据和一个高电平选择
存储的数据。选择控件有一个“前进行
打破“配置，以消除毛刺这将去甲
马利发生在一个典型的多路转换器的转换期间
间存储和实时数据。
使能（ GAB和GBA ）控制引脚提供了四种
操作模式：实时数据传输总线从A到
B，从B总线的实时数据传输给A，实时总线A
和/或B的数据传送到内部存储器中，或者内部存储
数据传输总线A和/或B.
特点
s
开关规格为50 pF的
s
开关规格保证在整个温度
自命V
CC
范围
s
先进的氧化物隔离，离子注入肖特基TTL
过程
s
三态缓冲器型输出直接驱动的公交线路
s
独立的寄存器，使A和B巴士
s
多路实时和存储的数据
订购代码：
订单号
DM74ALS652WM
DM74ALS652NT
包装数
M24B
N24C
包装说明
24引脚小外形集成电路（ SOIC ） ， JEDEC MS- 013 ， 0.300"宽
24引脚塑料双列直插式封装（ PDIP ） ， JEDEC MS- 001 ， 0.300"宽
在磁带和卷轴可用的设备也。通过附加的后缀字母“X”的订货代码指定。
接线图
2001仙童半导体公司
DS009174
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DM74ALS652
功能表
输入
GAB
X
L
L
L
L
L
H
H
H
L
H
GBA
H
X
H
H
L
L
H
H
H
L
L
出租车
CBA
H / L
SAB
X
X
X
X
X
X
L
X
X
（注2 ）
X
H
SBA
X
X
X
X
L
H
X
X
X
X
（注2 ）
H
数据I / O（注1 ）
操作或功能
A1至A8
输入
未指定
输入
输入
产量
产量
输入
输入
输入
产量
产量
B1直通B8
未指定商店A，按住B
输入
输入
输入
输入
输入
产量
产量
产量
输入
产量
商店B，持有A
商店A和B的数据
隔离，保持存储
实时B数据到总线
存储B数据到总线
实时的数据到B总线
存储在数据到B总线
在这两个寄存器保存一个
在这两个寄存器存储B
存储在数据到B总线和
存储B数据到总线
↑
H / L
↑
↑
H / L
X
H / L
X
↑
H / L
X
X
X
↑
↑
↑
H或L
↑
↑
↑
H或L
H
=
高逻辑电平
L
=
低逻辑电平
X
=
不关心（低或高逻辑电平，包括过渡）
H / L
=
高或低逻辑电平转换除外
↑ =
正向脉冲的边缘
注1 ：
该数据输出功能可被使能或通过在G和DIR输入的各种信号被禁用。数据输入功能始终处于启用状态，
也就是说，在总线引脚的数据将被存储上的时钟输入每低到高的转变。
注2 ：
选择控制
=
L，时钟可以同时出现
选择控制
=
H;时钟必须错开，以便加载两个寄存器。
逻辑图
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2
DM74ALS652
开关特性
在推荐工作的自由空气的温度范围内
（注6 ）
符号
t
PLH
t
PHL
t
PLH
t
PHL
t
PLH
参数
传播延迟时间
低到高电平输出
传播延迟时间
高到低电平输出
传播延迟时间
低到高电平输出
传播延迟时间
高到低电平输出
传播延迟时间
低到高电平输出
（用A或B LOW ） （注6 ）
t
PHL
传播延迟时间
高到低电平输出
（用A或B LOW ） （注6 ）
t
PLH
传播延迟时间
低到高电平输出
（用A或B高） （注6 ）
t
PHL
传播延迟时间
高到低电平输出
（用A或B高） （注6 ）
t
PZH
输出使能时间
高电平输出
t
PZL
输出使能时间
为低电平输出
t
PHZ
输出禁止时间
从高电平输出
t
PLZ
t
PZH
t
PZL
t
PHZ
t
PLZ
输出禁止时间
从低电平输出
输出使能时间
高电平输出
输出使能时间
为低电平输出
输出禁止时间
从高电平输出
输出禁止时间
从低电平输出
SBA或SAB
为A或B
GBA到
A
GBA到
A
GBA到
A
GBA到
A
GAB到
B
GAB到
B
GAB到
B
GAB到
B
3
17
ns
5
20
ns
SBA或SAB
为A或B
6
25
ns
SBA或SAB
为A或B
6
20
ns
SBA或SAB
为A或B
12
35
ns
条件
V
CC
=
4.5V至5.5V ，
C
L
=
50 pF的，
R
1
=
R
2
=
500,
T
A
=
MIN到MAX
从（输入）
到（输出）
CBA还是CAB
为A或B
CBA还是CAB
为A或B
A或B
B或A
A或B
B或A
民
10
5
5
3
最大
30
17
18
12
单位
ns
ns
ns
ns
5
18
ns
1
10
ns
2
6
6
1
2
16
22
18
10
16
ns
ns
ns
ns
ns
注6 ：
这些参数的测量与存储寄存器的内部输出状态相反的总线输入的。
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4
DM74ALS652
物理尺寸
英寸（毫米），除非另有说明
24引脚小外形集成电路（ SOIC ） ， JEDEC MS- 013 ， 0.300"宽
包装数M24B
5
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