【DM74ALS165 8位并行输入/串行输出移位寄存器1986年1月修订后的2000年2月DM74A】,IC型号DM74ALS165N,DM74ALS165N PDF资料,DM74ALS165N经销商,ic,电子元器件-51电子网

DM74ALS165 8位并行输入/串行输出移位寄存器

1986年1月

修订后的2000年2月

DM74ALS165

8位并行输入/串行输出移位寄存器

概述

该DM74ALS165是一个8位串行寄存器，当

主频，移向串行输出，Q数据

。平行于

访问每个阶段由八个单独直接提供

是由一个低的水平，在以SH / LD使能数据输入

输入。该DM74ALS165还具有时钟功能抑制

化和互补串行输出，Q

时钟由低到高的转变来实现

而SH / LD保持高电平， CLK INH是CLK输入

保持低电平。 CLK和CLK INH的（功能的时钟

抑制）的输入是可以互换的。由于低CLK输入

和CLK INH低到高的转变也将accom-

司马策时钟， CLK INH应改为高

水平仅在CLK输入为高。并行加载

当SH / LD举行高抑制。并行输入

寄存器使能，而SH / LD为低indepen-

dently CLK ， CLK INH ，或SER投入的水平。

特点

互补输出

直接重写负载（数据）输入

门控时钟输入

并行 - 串行数据转换

订购代码：

订单号

DM74ALS165M

DM74ALS165N

包装数

M16A

N16E

包装说明

16引脚小外形集成电路（ SOIC ）， JEDEC MS- 012 ， 0.150窄

16引脚塑料双列直插式封装（ PDIP ）， JEDEC MS- 001 ，宽0.300

在磁带和卷轴可用的设备也。通过附加的后缀字母“X”的订货代码指定。

接线图

功能表

输入

移动/时钟时钟串行并行

负载抑制

↑

一... H

国内

输出

产量

高水平（稳态），

低电平（稳态）

不在乎（任何输入，包括过渡）

↑ =

从低到高的电平转变

一... H

稳态输入的输入A至H级，分别为

, Q

Q的水平

, Q

或Q

分别前

表示稳态输入条件建立

, Q

Q的水平

或Q

分别之前的最近

↑

时钟的过渡

2000仙童半导体公司

DS006712

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DM74ALS165

逻辑图

时序图

典型的换档，负载和抑制序列

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DM74ALS165

绝对最大额定值

（注1 ）

电源电压

输入电压

工作自由空气的温度范围

存储温度范围

典型

N包装

男包

74.0°C/W

104.0°C/W

0℃至

+70°C

65°C

+150°C

注1 ：

“绝对最大额定值”，超出该值的

该装置的安全性不能得到保证。该设备不应该

在这些限制操作。在电气定义的参数值

特性表不能保证在绝对最大额定值。

“推荐工作条件”表将定义的条件

器件的实际工作。

推荐工作条件

符号

时钟

电源电压

高电平输入电压

低电平输入电压

高电平输出电流

低电平输出电流

时钟频率

脉冲持续时间

CLK高

CLK低

负载

建立时间

保持时间

经营自由空气温度

SH / LD

数据

CLK INH

↓

CLK前

串行之前CLK

°C

参数

民

4.5

0.8

0.4

典型值

最大

5.5

单位

兆赫

电气特性

在推荐工作的自由空气的温度范围内（除非另有说明）

符号

（注3）

参数

输入钳位电压

高层

输出电压

低层

输出电压

输入电流在最大输入电压V

5.5V, V

高电平输入电流

低电平输入电流

输出驱动电流

电源电流

5.5V, V

2.7V

5.5V, V

0.4V

5.5V, V

2.25V

5.5V （注4 ）

条件

4.5V ，我

= 18

= 0.4

4.5V至5.5V

4.5V

4毫安

8毫安

0.25

0.35

0.4

0.5

0.1

112

民

典型值

（注2 ）

最大

1.5

单位

注2 ：

所有典型值是在V

5V ，T

25°C.

注3 ：

输出条件已被选定，以产生一个电流，其值接近1的一半的真实输出短路电流的，我

注4 ：

与输出开路时，CLK INH和CLK在4.5V ，而施加到SH / LD输入一个时钟脉冲时，我

与并行输入端在4.5V第一测量

然后用并行输入端接地。

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DM74ALS165

开关特性

在推荐的自由空气的温度范围内。所有典型值是在V测

5V ，T

25°C.

符号

最大

PLH

PHL

PLH

PHL

PLH

PHL

PLH

PHL

参数

最大频率

传播延迟时间

低到高电平输出

传播延迟时间

高到低电平输出

传播延迟时间

低到高电平输出

传播延迟时间

高到低电平输出

传播延迟时间

低到高电平输出

传播延迟时间

高到低电平输出

传播延迟时间

低到高电平输出

传播延迟时间

高到低电平输出

负载

或Q

输入

产量

条件

4.5V至5.5V ，

50 pF的，

500

MIN到MAX

民

典型值

最大

单位

兆赫

负载

CLK

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DM74ALS165

物理尺寸

英寸（毫米），除非另有说明

16引脚小外形集成电路（ SOIC ）， JEDEC MS- 012 ， 0.150窄

包装数M16A

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