DAC5682Z

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SLLS853C - 2007年8月 - 修订2009年6月

16位， 1.0 GSPS 2倍， 4倍内插双通道

数位类比转换器（ DAC ）

1

特点

16位数字 - 模拟转换器（ DAC ）

1.0 GSPS更新速率

16位宽带输入LVDS数据总线

- 8个采样输入FIFO

- 交错I / Q数据，双DAC模式

高性能

- 73 dBc的ACLR WCDMA TM1在180兆赫

2X- 32X时钟倍频PLL / VCO

2倍或4倍内插滤波器

- 阻带过渡0.4-0.6 FDATA

- 过滤器在任何低通或可配置

高通模式

- 允许选择高阶影像

FS / 4粗调音台

片上1.2 V参考

差分输出可扩展性： 2至20 mA

包装： 64引脚9 × 9毫米QFN

描述

该DAC5682Z是一个双通道16位1.0 GSPS

数字 - 模拟转换器（DAC ）与宽带

LVDS数据输入，集成的2倍/ 4倍的内插滤波器，

板载时钟乘法器和内部电压

参考。该DAC5682Z提供卓越的线性度，

噪声，串扰和PLL相位噪声性能。

该DAC5682Z集成了宽带LVDS端口

带有片上端接。全速率输入的数据可以是

转移到一个单一的DAC通道，或半速率和

四分之一速率输入的数据可以通过板上进行插值

2倍或4倍的FIR滤波器。每插FIR是

无论是在低通或高通模式配置，

允许选择一个高阶输出光谱的

图像。芯片上的延迟锁定环（DLL）的简化

LVDS提供偏斜控制的接口

LVDS输入数据时钟。

该DAC5682Z允许既复杂或实际产出。

在复杂的模式可选FS / 4粗调音台

提供了粗糙的上变频和双

DAC输出端产生一个复杂的希尔伯特变换

对。外部RF正交调制器，然后

最后进行了单边带上变频。

该DAC5682Z的特点是操作过

-40 ° C至85°C的工业温度范围

并且是在一个64引脚QFN封装。其他

该家族的单信道的成员包括

插DAC5681Z和

非插值

DAC5681.

应用

蜂窝基站

宽带无线接入（ BWA ）

802.16的WiMAX

固定无线回传

电缆调制解调器终端系统（ CMTS ）

订购信息

T

A

-40 ° C至85°C

(1)

(2)

(3)

订货编号

DAC5682ZIRGCT

DAC5682ZIRGCR

封装图/ TYPE

(1) (2) (3)

研资局/ 64QFN四方扁平封装

无引线

传输介质

磁带和卷轴

磁带和卷轴

QUANTITY

250

2000

散热垫尺寸： 7.4毫米× 7.4毫米

MSL峰值温度的Level- 3-260C -168 HR

对于最新的封装和订购信息，请参阅封装选项附录本文档的末尾，或见TI

网站：

www.ti.com 。

1

请注意，一个重要的通知有关可用性，标准保修，并在得克萨斯州的关键应用程序使用

仪器的半导体产品和免责条款及其出现在此数据表的末尾。

PRODUCTION数据信息为出版日期。

产品符合占德州条款规范

仪器标准保修。生产加工过程中不

不一定包括所有参数进行测试。

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这些器件具有有限的内置ESD保护。引线应短接在一起或设备放置在导电泡棉

储存或搬运过程中，以防止对静电损坏MOS大门。

功能框图

CLKVDD

DVDD

VFUSE

AVDD

(1.8V)

(1.8V)

(1.8V)

PLL旁路

CLKIN

CLKINC

DCLKP

DCLKN

A

时钟倍频

PLL 2X- 32X

PLL控制

时钟

分配

FDAC

FDAC/2

FDAC/4

(3.3V)

LPF

1.2V

参考

daca_gain

A-偏移

13

4

ExtIO的

EXTLO

BIASJ

延迟锁定

环（DLL ）

B

PLL使能

同步关闭

模式控制

DLL控制

（ X2绕道）

[模式= LP ， HP ， FS / 8 ， -Fs / 8 ]

（ X1绕道）

[模式= LP ， HP ， FS / 4 ， -Fs / 4 ]

D15P

100

D15N

DDR去交织

16

16

DAC的延迟（ 0-3）

x2

47吨76分贝HBF

x2

47吨76分贝HBF

16bit

DAC

IOUTA1

IOUTA2

CMIX0

D0P

100

8采样FIFO

FIR0

x2

47吨76分贝HBF

FIR0启用

FIR1

x2

47吨76分贝HBF

FIR1启用

CMIX1

D0N

SYNCP

100

16

16

16bit

DAC

4

dacb_gain

IOUTB1

IOUTB2

SYNCn

TXEnable=’1'

SW_SYNC

FIFO同步关闭

SYNC

＆放大器;

控制

(3.3V)

延迟值

CM0模式

CM1模式

B-失调

SYNC=’0->1'

（过渡）

2

2

13

2

SDENB

2

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RESETB

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IOVDD

SDIO

SCLK

GND

SDO

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RGC包装

（ TOP VIEW ）

IOUTB1

IOUTB2

IOUTA1

AVDD

IOUTA2

AVDD

EXTLO

ExtIO的

53

50

64

63

62

61

60

59

58

57

56

55

52

54

51

49

RESETB

DVDD

DVDD

BIASJ

AVDD

LPF

AVDD

AVDD

CLKVDD

CLKIN

CLKINC

GND

SYNCP

SYNCn

D15P

D15N

IOVDD

DVDD

D14P

D14N

D13P

D13N

D12P

D12N

1

2

3

4

5

6

7

8

9

10

11

12

13

14

15

16

48

47

46

45

44

43

42

41

SDENB

SCLK

SDIO

SDO

VFUSE

D0N

D0P

D1N

D1P

DVDD

D2N

D2P

D3N

D3P

D4N

D4P

DAC5682Z

40

39

38

37

36

35

34

33

31

28

17

18

20

21

29

23

24

25

26

D11N

27

22

DCLKN

D7N

D10N

D9N

D8N

D6N

30

19

D11P

D10P

终端功能

终奌站

名字

AVDD

BIASJ

CLKIN

CLKINC

CLKVDD

号

51, 54, 55,

59, 62

57

2

3

1

7, 11, 13,

15, 17, 19,

21, 23, 27,

29, 31, 33,

35, 37, 40,

42

I / O

I

O

I

I

I

模拟电源电压。 （ 3.3V ）

满量程输出电流偏置。对于20mA满量程输出电流，连接960

电阻到GND 。

正外部时钟输入与一个自偏压约为CLKVDD / 2 。随着时钟倍频PLL

启用后， CLKIN提供了较低频率的参考时钟。如果PLL被禁用， CLKIN直接提供

时钟DAC高达1GHz 。

互补的外部时钟输入。 （见CLKIN描述）

内部时钟缓冲器的电源电压。 （ 1.8 V ）

LVDS正输入数据位从0到15的每个正/负LVDS对内部有一个100

端接电阻器。为了总线可以通过逆转

rev_bus

在CONFIG5寄存器位。相关数据格式

到DCLKP / N时钟是双倍数据速率（ DDR） ，每DCLKP / N时钟两个数据样本输入。在

双通道模式下，数据为A通道同时输入DCLKP高。

D15P是最显著数据位（MSB） - 销7

D0P是至少显著数据位（LSB） - 销42

描述

D[15..0]P

I

DCLKP

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D5N

D7P

D9P

D8P

D5P

D6P

32

3

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终端功能（续）

终奌站

名字

号

8, 12, 14,

16, 18, 20,

22, 24, 28,

30, 32, 34,

36, 38, 41,

43

I / O

描述

LVDS的负输入数据比特0到15 （见D [ 15：0]以上P描述）

I

D15N是最显著数据位（MSB） - 销8

D0N是至少显著数据位（LSB） - 销43

D[15..0]N

DCLKP

25

I

正LVDS输入时钟。不像其他的LVDS输入， DCLKP / N对是自偏置约

DVDD / 2和不

不

有为了优化该DLL电路的动作的内部端接电阻器。

请参阅“ DLL运行”一节。对于正确的外部端接，连接100

整个LVDS电阻

其次是0.01系列时钟源线

F

连接到每个DCLKP和DCLKN管脚电容（见

图26）。

为了获得最佳性能，电阻和电容应尽量靠近这些

销。

LVDS负输入时钟。 （见DCLKP描述）

数字供电电压。 （ 1.8 V ）

DCLKN

DVDD

ExtIO的

EXTLO

GND

26

10, 39, 50,

63

56

58

4 ，热

PAD

52

I

I

作为外部参考输入时禁用内部基准（即EXTLO连接到AVDD ） 。

I / O用作1.2V内部基准电压时， EXTLO = GND ，需要0.1

F

去耦电容

作为参考输出时AGND 。

O

I

连接至GND内部参考， AVDD或外部参考。

引脚4和位于QFN封装底部的散热焊盘的理由AVDD ， DVDD和

IOVDD用品。

A通道DAC电流输出。偏移二进制数据为0x0000在DAC输入导致整个模式

量程电流片和对IOUTA1引脚的最小正电压。类似地，为0xFFFF数据输入导致

0毫安的电流宿和对IOUTA1销最正电压。在单个DAC模式下，显示输出

在IOUTA1 / A2对只。

A通道DAC互补电流输出。该IOUTA2具有IOUTA1的相对行为

如上所述。 0x0000的结果在一个0毫安水槽的输入数据值，并在最正电压

IOUTA2引脚。

B通道DAC电流输出。参见上面的IOUTA1描述。

B通道DAC互补电流输出。参见上面的IOUTA2描述。

数字I / O电源电压（ 3.3V ）的引脚RESETB ， SCLK ， SDENB ， SDIO ， SDO 。

PLL环路滤波器的连接。如果不使用时钟倍频PLL ，低通滤波器引脚可以悬空。同时设置

PLL_BYPASS

和

pll_sleep

控制位，可降低功耗。

复位时，该芯片的低。内部上拉。

串行接口的时钟。内部上拉下来。

低电平有效的串行数据使能，总是输入到DAC5682Z 。内部上拉。

在3引脚模式（默认）双向串行接口数据。在4-pin的接口模式（ CONFIG5

sif4),

在SDIO

销仅是输入。内部上拉下来。

在4-pin的模式单向串行接口数据（ CONFIG5

sif4).

SDO引脚处于高阻抗状态

在3针接口模式（默认） ，但可以选择作为通过CONFIG14状态输出引脚

SDO_func_sel （2 ：0）。

内部上拉下来。

LVDS的同步正输入数据。该SYNCP / N LVDS对内部有一个100

端接电阻器。通过

默认情况下，该

SYNCP / N输入必须为逻辑“1” ，使DAC的模拟输出。

见

LVDS SYNCP / N

手术

段进行了详细的描述。

LVDS的同步负输入数据。

数字供电电压。 （ 1.8V ）

连接到DVDD引脚正常运行。

此电源引脚也用于

工厂熔丝编程。

IOUTA1

O

IOUTA2

IOUTB1

IOUTB2

IOVDD

LPF

RESETB

SCLK

SDENB

SDIO

SDO

53

61

60

9

64

49

47

48

46

45

O

O

O

I

I

I

I

I

I / O

O

SYNCP

SYNCn

VFUSE

5

6

44

I

I

I

4

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绝对最大额定值

在工作自由空气的温度范围内（除非另有说明）

DVDD

电源电压范围

(2)

(1)

价值

-0.5到2.3

-0.5到2.3

-0.5到2.3

-0.5到4

-0.5到4

-2至2.6

-0.5到0.5

-0.5到0.5

(2)

(2)

单位

V

V

V

V

V

V

V

V

V

V

V

V

V

V

mA

mA

°C

°C

VFUSE

(2)

CLKVDD

AVDD

(2)

IOVDD

(2)

为AVDD DVDD

CLKVDD到DVDD

IOVDD为AVDD

D [ 15..0 ] P， D [ 15..0 ] N， SYNCP ， SYNCN

电源电压范围

DCLKP ， DCLKN

(2)

CLKIN ， CLKINC

(2)

(2)

-0.5至DVDD + 0.5

-0.3 2.1

-0.5到CLKVDD + 0.5

-0.5到IOVDD + 0.5

-0.5至AVDD + 0.5

-0.5至AVDD + 0.5

20

–30

-40到85

-65到150

SDO ， SDIO ， SCLK ， SDENB ， RESETB

IOUTA1 / B1 ， IOUTA2 / B2

峰值输入电流（任何输入）

峰值总输入电流（所有输入）

工作的自由空气的温度范围内，T

A

： DAC5682Z

存储温度范围

(1)

(2)

(2)

LPF ， ExtIO的， EXTLO ， BIASJ

(2)

强调超越那些在列

绝对最大额定值

可能对器件造成永久性损坏。这些压力额定值

这些或任何其他条件超出下仅标出，并且功能操作

推荐工作条件

不

暗示。暴露于长时间处于最大绝对额定情况下会影响器件的可靠性。

测量相对于GND 。

热特性

在工作自由空气的温度范围内（除非另有说明）

导热系数

T

J

θ

JA

θ

JC

θ

JP

(1)

最高结温

(1)

64ld QFN

125

22

16

0.2

3.5

单位

°C

° C / W

° C / W

° C / W

西塔结到环境（静止空气中）

西塔结到环境（ 150 LFM ）

西塔结到外壳

西塔结到垫

空气流量或散热减少

θ

JA

并且可能需要持续运行于下最大运行条件85° 。

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