DAC5681

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SLLS864A - 2007年8月 - 修订2009年1月

16位， 1.0 GSPS

数位类比转换器（ DAC ）

1

特点

16位数字 - 模拟转换器（ DAC ）

1.0 GSPS更新速率

16位宽带输入LVDS数据总线

- 8个采样输入FIFO

- 片上延迟锁定环

高性能

- 73 dBc的ACLR WCDMA TM1在180兆赫

片上1.2 V参考

差分输出可扩展性： 2至20 mA

包装： 64引脚9 × 9毫米QFN

描述

该DAC5681是一个16位1.0 GSPS的数字 - 模拟

转换器（ DAC），具有宽频带的LVDS数据的输入和

内部基准电压源。该DAC5681报价

卓越的线性和噪声性能。

该DAC5681集成了宽带LVDS端口

片内匹配，提供完整的1.0 GSPS的数据

转移到DAC ，降低电磁干扰，比传统

CMOS数据接口。片上延迟锁定环

（DLL）的简化的LVDS通过提供歪斜接口

控制LVDS输入数据时钟。

该DAC5681的电流导引结构

由电流吸收的分段阵列

开关指挥可达满量程电流20mA至

互补输出节点。一个准确的片

参考电压的温度补偿和

提供了一个稳定的1.2 V基准电压。 （可选）

外部基准也可以使用。

该DAC5681的特点是工作在

-40 ° C至85°C ，是工业级温度范围

可在一个64引脚QFN封装。该器件的引脚

升级到家庭的其他成员：

DAC5681Z和DAC5682Z 。单信道

DAC5681Z和双通道DAC5682Z既

提供可选的2倍/ 4倍内插和时钟

乘法PLL 。

应用

蜂窝基站

宽带无线接入（ BWA ）

802.16的WiMAX

固定无线回传

电缆调制解调器终端系统（ CMTS ）

医疗/测试仪器

雷达系统

订购信息

T

A

-40 ° C至85°C

(1)

(2)

(3)

订货编号

DAC5681IRGCT

DAC5681IRGCR

封装图/ TYPE

(1) (2) (3)

研资局/ 64QFN四方扁平封装

无引线

传输介质

磁带和卷轴

磁带和卷轴

QUANTITY

250

2000

散热垫尺寸： 7.4毫米× 7.4毫米

MSL峰值温度的Level- 3-260C -168 HR

对于最新的封装和订购信息，请参阅封装选项附录本文档的末尾，或见TI

网站：

www.ti.com 。

1

请注意，一个重要的通知有关可用性，标准保修，并在得克萨斯州的关键应用程序使用

仪器的半导体产品和免责条款及其出现在此数据表的末尾。

PRODUCTION数据信息为出版日期。

产品符合占德州条款规范

仪器标准保修。生产加工过程中不

不一定包括所有参数进行测试。

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这些器件具有有限的内置ESD保护。引线应短接在一起或设备放置在导电泡棉

储存或搬运过程中，以防止对静电损坏MOS大门。

功能框图

CLKVDD

DVDD

VFUSE

AVDD

(1.8V)

(1.8V)

(3.3V)

CLKIN

CLKINC

DCLKP

DCLKN

A

(1.8V)

时钟

分配

FDAC

1.2V

参考

ExtIO的

EXTLO

BIASJ

延迟锁定

环（DLL ）

B

同步关闭

DLL控制

模式控制

D15P

100

D15N

DDR去交织

16

DAC的延迟（ 0-3）

8采样FIFO

16

16bit

DAC

4

IOUTA1

IOUTA2

D0P

100

D0N

SYNCP

100

16

延迟值

SYNCn

TXEnable=’1'

SW_SYNC

FIFO同步关闭

SYNC

＆放大器;

控制

DAC增益

SYNC=’0->1'

（过渡）

OFFSET

13

2

(3.3V)

SDENB

2

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RESETB

IOVDD

SDIO

SCLK

GND

SDO

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RGC包装

（ TOP VIEW ）

IOUTA1

AVDD

IOUTA2

AVDD

EXTLO

ExtIO的

53

50

64

63

62

61

60

59

58

57

56

55

52

54

51

49

RESETB

DVDD

DVDD

BIASJ

AVDD

AVDD

NC

AVDD

AVDD

AVDD

CLKVDD

CLKIN

CLKINC

GND

SYNCP

SYNCn

D15P

D15N

IOVDD

DVDD

D14P

D14N

D13P

D13N

D12P

D12N

1

2

3

4

5

6

7

8

9

10

11

12

13

14

15

16

48

47

46

45

44

43

42

41

SDENB

SCLK

SDIO

SDO

VFUSE

D0N

D0P

D1N

D1P

DVDD

D2N

D2P

D3N

D3P

D4N

D4P

DAC5681

40

39

38

37

36

35

34

33

31

28

17

18

20

21

29

23

24

25

26

D11N

27

22

DCLKN

D7N

D10N

D9N

D8N

D6N

30

19

D11P

D10P

终端功能

终奌站

名字

AVDD

BIASJ

CLKIN

CLKINC

CLKVDD

号

51, 54, 55,

59–62

57

2

3

1

7, 11, 13,

15, 17, 19,

21, 23, 27,

29, 31, 33,

35, 37, 40,

42

8, 12, 14,

16, 18, 20,

22, 24, 28,

30, 32, 34,

36, 38, 41,

43

I / O

I

O

I

I

I

模拟电源电压。 （ 3.3V ）

满量程输出电流偏置。对于20mA满量程输出电流，连接960

电阻到GND 。

正外部时钟输入与一个自偏压约为CLKVDD / 2 。

互补的外部时钟输入。 （见CLKIN描述）

内部时钟缓冲器的电源电压。 （ 1.8 V ）

LVDS正输入数据位从0到15的每个正/负LVDS对内部有一个100

端接电阻器。为了总线可以通过逆转

rev_bus

在CONFIG5寄存器位。数据格式

相对于DCLKP / N时钟是双倍数据速率（ DDR） ，每DCLKP / N时钟两个数据样本输入。在

双通道模式下，数据为A通道同时输入DCLKP高。

D15P是最显著数据位（MSB） - 销7

D0P是至少显著数据位（LSB） - 销42

LVDS的负输入数据比特0到15 （见D [ 15：0]以上P描述）

I

D15N是最显著数据位（MSB） - 销8

D0N是至少显著数据位（LSB） - 销43

描述

D[15..0]P

I

D[15..0]N

DCLKP

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D5N

D7P

D9P

D8P

D5P

D6P

32

3

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终端功能（续）

终奌站

名字

号

I / O

描述

正LVDS输入时钟。不像其他的LVDS输入， DCLKP / N对是自偏置约

DVDD / 2和不

不

有为了优化该DLL电路的动作的内部端接电阻器。

请参阅“ DLL运行”一节。对于正确的外部端接，连接100

整个LVDS电阻

其次是0.01系列时钟源线

F

连接到每个DCLKP和DCLKN管脚电容

（见

图17）。

为了获得最佳性能，电阻和电容应尽量靠近，以

这些引脚。

LVDS负输入时钟。 （见DCLKP描述）

数字供电电压。 （ 1.8 V ）

DCLKP

25

I

DCLKN

DVDD

ExtIO的

EXTLO

GND

IOUTA1

26

10, 39, 50,

63

56

58

4 ，热

PAD

52

I

I

作为外部参考输入时禁用内部基准（即EXTLO连接到AVDD ） 。

I / O用作1.2V内部基准电压时， EXTLO = GND ，需要0.1

F

去耦电容

作为参考输出时AGND 。

O

I

O

连接至GND内部参考， AVDD或外部参考。

引脚4和位于QFN封装底部的散热焊盘的理由AVDD ， DVDD和

IOVDD用品。

DAC电流输出。偏移二进制数据0×0000在DAC的输入将导致在满量程电流模式

水槽和在IOUTA1销的至少正电压。类似地，为0xFFFF数据输入产生一个0毫安

电流吸收器和对IOUTA1销最正电压。

DAC的互补电流输出。该IOUTA2已在IOUTA1的相反的行为描述

以上。 0x0000的结果在一个0毫安水槽的输入数据值，并在IOUTA2最正电压

引脚。

数字I / O电源电压（ 3.3V ）的引脚RESETB ， SCLK ， SDENB ， SDIO ， SDO 。

无连接。悬空正常运行。

复位时，该芯片的低。内部上拉。

串行接口的时钟。内部上拉下来。

低电平有效的串行数据使能，总是输入到DAC5681 。内部上拉。

在3引脚模式（默认）双向串行接口数据。在4-pin的接口模式（ CONFIG5

sif4),

该

SDIO引脚是只有一个输入端。内部上拉下来。

在4-pin的模式单向串行接口数据（ CONFIG5

sif4).

SDO引脚处于高阻抗状态

在3针接口模式（默认） ，但可以选择作为通过CONFIG14状态输出引脚

SDO_func_sel （2 ：0）。

内部上拉下来。

LVDS的同步正输入数据。该SYNCP / N LVDS对内部有一个100

端接电阻器。通过

默认情况下，该

SYNCP / N输入必须为逻辑“1” ，使DAC的模拟输出。

见

LVDS SYNCP / N

手术

段进行了详细的描述。

LVDS的同步负输入数据。

数字供电电压。 （ 1.8V ）

连接到DVDD引脚正常运行。

该电源引脚也可用于

工厂熔丝编程。

IOUTA2

IOVDD

NC

RESETB

SCLK

SDENB

SDIO

SDO

53

9

64

49

47

48

46

45

O

I

I

I

I

I

I / O

O

SYNCP

SYNCn

VFUSE

5

6

44

I

I

I

4

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绝对最大额定值

在工作自由空气的温度范围内（除非另有说明）

DVDD

电源电压范围

(2)

(1)

价值

-0.5到2.3

-0.5到2.3

-0.5到2.3

-0.5到4

-0.5到4

-2至2.6

-0.5到0.5

-0.5到0.5

(2)

(2)

单位

V

V

V

V

V

V

V

V

V

V

V

V

V

V

mA

mA

°C

°C

VFUSE

(2)

CLKVDD

AVDD

(2)

IOVDD

(2)

为AVDD DVDD

CLKVDD到DVDD

IOVDD为AVDD

D [ 15..0 ] P， D [ 15..0 ] N， SYNCP ， SYNCN

终端电压范围

DCLKP ， DCLKN

(2)

CLKIN ， CLKINC

(2)

(2)

-0.5至DVDD + 0.5

-0.3 2.1

-0.5到CLKVDD + 0.5

-0.5到IOVDD + 0.5

-0.5至AVDD + 0.5

-0.5至AVDD + 0.5

20

–30

-40到85

-65到150

SDO ， SDIO ， SCLK ， SDENB ， RESETB

IOUTA1 ， IOUTA2

峰值输入电流（任何输入）

峰值总输入电流（所有输入）

工作的自由空气的温度范围内，T

A

： DAC5681

存储温度范围

(1)

(2)

(2)

ExtIO的， EXTLO ， BIASJ

(2)

强调超越那些在列

绝对最大额定值

可能对器件造成永久性损坏。这些压力额定值

这些或任何其他条件超出下仅标出，并且功能操作

推荐工作条件

不

暗示。暴露于长时间处于最大绝对额定情况下会影响器件的可靠性。

测量相对于GND 。

热特性

在工作自由空气的温度范围内（除非另有说明）

导热系数

T

J

θ

JA

θ

JC

θ

JP

(1)

最高结温

(1)

64ld QFN

125

20

16

7

0.2

单位

°C

° C / W

° C / W

° C / W

西塔结到环境（静止空气中）

西塔结到环境（ 150 LFM ）

西塔结到外壳

西塔结到垫

空气流量或散热减少

θ

JA

并且可能需要持续运行于下最大运行条件85° 。

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