DAC3151
DAC3161
DAC3171
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SLAS959A - 2013年8月 - 修订2013年8月
单14- / 12- / 10位500 MSPS数字 - 模拟转换器
检查样品：
DAC3151 ， DAC3161 ， DAC3171
1
特点
单通道
决议
- DAC3151 ： 10位
- DAC3161 ： 12位
- DAC3171 ： 14位
最大采样速率： 500 MSPS
引脚兼容系列
输入接口：
- 并行LVDS输入
- 单或双通道DDR数据时钟
- 内部FIFO
芯片到芯片同步
功耗： 375MW
在20MHz的中频频谱性能
- 信噪比： 76 dBFS的为DAC3171 ; 72dBFS的
DAC3161 ; 62 dBFS的为DAC3151
- SFDR ： 78 dBc的为DAC3171 ;为77dBc
DAC3161 ; 76 dBc的为DAC3151
电流源DAC的
合规范围： -0.5V至1V
包装： 64引脚QFN封装（ 9x9mm ）
应用
无线基础设施
- PA偏置，包络跟踪， TX
雷达
软件定义无线电
信号/波形发生器
电缆头端设备
2
描述
该DAC3151 / DAC3161 / DAC3171是一个家庭
单个通道500MSPS数字 - 模拟转换器
与10 / 12 / 14位分辨率。该系列采用了
10 / 12 / 14 -bit宽LVDS数字总线与输入
FIFO。 14位DAC3171还支持DDR 7位
LVDS接口模式。 FIFO的输入和输出指针
可以跨多个设备进行同步
精确的信号同步。 DAC输出
电流源并终止与GND
合规
范围
of
-0.5
to
1V.
DAC3151 / DAC3161 / DAC3171与引脚兼容
双通道，10位/ 12位/ 14位， 500MSPS数字 -
数模转换器DAC3154 / DAC3164 / DAC3174 。
该器件采用QFN -64使用PowerPad
封装，规定工作在整个工业
温度范围（-40 ° C至85°C ） 。
1
2
请注意，一个重要的通知有关可用性，标准保修，并且在关键的应用程序中使用
德州仪器公司的半导体产品和免责条款及其出现在此数据表的末尾。
使用PowerPad是德州仪器的商标。
版权所有 2013年，德州仪器
PRODUCTION数据信息为出版日期。
产品符合占德州条款规范
仪器标准保修。生产加工过程中不
不一定包括所有参数进行测试。
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这些器件具有有限的内置ESD保护。引线应短接在一起或设备放置在导电泡棉
储存或搬运过程中，以防止对静电损坏MOS大门。
方框图
CLKVDD18
DIGVDD18
VDDA18
VFUSE
DACCLKP
LVPECL
时钟分配
DACCLKN
DATACLKP
DATACLKN
DATA9P
DATA9N
LVDS
100
LVDS
1.2 V
参考
ExtIO的
BIASJ
可编程
延迟
100
10
QMC
A-偏移
测试模式
DACA
收益
8采样FIFO
解交织
10-b
DACA
IOUTAP
IOUTAN
10
DATA0P
DATA0N
LVDS
100
SYNCP
SYNCn
ALIGNP
LVDS
100
VDDA33
可选输入
用于多DAC同步
LVPECL
控制界面
ALIGNN
SDIO
SDO
TxEnable位置
睡觉
TESTMODE
RESETB
报警
GND
SDENB
IOVDD
SCLK
图1. DAC3151全字接口模式
2
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CLKVDD18
DIGVDD18
DACCLKP
LVPECL
VDDA18
VFUSE
时钟分配
DACCLKN
DATACLKP
DATACLKN
DATA11P
DATA11N
LVDS
100
LVDS
1.2 V
参考
ExtIO的
BIASJ
可编程
延迟
100
12
QMC
A-偏移
测试模式
DACA
收益
8采样FIFO
解交织
12-b
DACA
IOUTAP
IOUTAN
12
DATA0P
DATA0N
LVDS
100
SYNCP
SYNCn
ALIGNP
LVDS
100
VDDA33
可选输入
用于多DAC同步
LVPECL
控制界面
ALIGNN
SDIO
SDO
TxEnable位置
睡觉
TESTMODE
RESETB
报警
GND
SDENB
IOVDD
SCLK
图2. DAC3161全字接口模式
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DIGVDD18
DACCLKP
LVPECL
VDDA18
VFUSE
时钟分配
DACCLKN
DATACLKP
DATACLKN
DATA13P
DATA13N
LVDS
100
LVDS
1.2 V
参考
ExtIO的
BIASJ
可编程
延迟
100
14
QMC
A-偏移
测试模式
DACA
收益
8采样FIFO
解交织
14-b
DACA
IOUTAP
IOUTAN
14
DATA0P
DATA0N
LVDS
100
SYNCP
SYNCn
ALIGNP
LVDS
100
VDDA33
可选输入
用于多DAC同步
LVPECL
控制界面
ALIGNN
SDIO
SDO
TxEnable位置
睡觉
TESTMODE
RESETB
报警
GND
SDENB
IOVDD
SCLK
图3. DAC3171全字接口模式
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CLKVDD18
DIGVDD18
DACCLKP
LVPECL
VDDA18
VFUSE
时钟分配
DACCLKN
DA_CLKP
DA_CLKN
DA6P
DA6N
测试模式
LVDS
100
LVDS
1.2 V
参考
ExtIO的
BIASJ
可编程
延迟
DACA
收益
8采样FIFO
解交织
QMC
A-偏移
14-b
DACA
100
IOUTA1
IOUTA2
7
DA0P
DA0N
LVDS
100
VDDA33
控制界面
SDIO
SDO
TxEnable位置
睡觉
图4. DAC3171 7 - bit接口模式
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TESTMODE
RESETB
报警
SDENB
IOVDD
SCLK
GND
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