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位置：首页 > IC型号导航 > 首字符C型号页 > 首字符C的型号第1076页 > CYV15G0403TB-BGXC
CYV15G0403TB
独立时钟四路的HOTLink II
串行器
特点
第二代的HOTLink
技术
符合SMPTE 292M和SMPTE 259M视频
标准
四通道视频串行器
- 195- 1500 - Mbps的串行数据信号速率
- 在不同的信令速率同步操作
支持半速率和全速率时钟
内部锁相环（ PLL）的与无外部PLL
组件
每个冗余差分PECL兼容的串行输出
通道
- 无需外部偏置电阻
- 信令速率控制的边缘速率
- 内部源端接
同步LVTTL并行接口
JTAG边界扫描
内置自测试（BIST ），用于在高速链路的测试
低功耗2W @ 3.3V典型
3.3V单电源供电
热增强型BGA
提供无铅封装选项
0.25μ BiCMOS技术
功能说明
该CYV15G0403TB独立时钟四路的HOTLink II
序列化器是一个点 - 对 - 点或点对多点通信
系统蒸发散构建块实现数据的传输通过各种
高速串行链路，包括SMPTE 292M和SMPTE
259M的视频应用。它支持的信号速率
区间为串行链路195至1500 Mbps的。所有四个通道都
独立，可以同时在不同的操作
率。每个通道在接受10位并行字符
输入寄存器和将它们转换为串行数据。
图1
illus-
trates独立显卡之间的典型连接
协处理器和相应的CYV15G0403TB串行
和CYV15G0404RB时钟恢复器和解串器芯片。
该CYV15G0403TB满足SMPTE- 259M和
SMPTE- 292M符合按照SMPTE EG34-1999病理
逻辑测试要求。
As
a
第二代
的HOTLink
设备，
该
CYV15G0403TB扩展的HOTLink系列具有增强
的集成度和更快的数据速率，同时保持
串行链路兼容性（数据和BIST ）与其他的HOTLink
设备。在CYV15G0403TB四的HOTLink的每个通道
II器件独立加扰接受10位传输
字符。这些字符序列和输出
双正ECL （ PECL ）兼容差分传输
在比特率的任何10或20倍的任务线路驱动器
输入的参考时钟，用于该信道。
每个通道包含一个独立的BIST模式
发电机。这BIST硬件允许在速度测试
在此每个发射部分的高速串行数据路径
设备，每收到一个连接的HOTLink II部分
设备，并在整个互连链路。
图1的HOTLink II系统连接
时钟恢复
输出
10
10
10
独立
通道
CYV15G0403TB
串行器
串行链接
独立
通道
CYV15G0404RB
时钟恢复解串器
10
10
10
10
时钟恢复
输出
赛普拉斯半导体公司
文件编号： 38-02104牧师* C
198冠军苑
圣荷西
,
CA 95134-1709
408-943-2600
修订后的2007年5月2日
[+ ]反馈
视频协处理器
视频协处理器
10
CYV15G0403TB
该CYV15G0403TB是理想的SMPTE应用
不同的数据速率和串行接口标准
必要为每个信道。一些应用包括
多格式路由器，切换器，格式转换器，以及
摄像机。
CYV15G0403TB串行逻辑框图
REFCLKA ±
REFCLKB ±
REFCLKC ±
TXDA [9：0 ]
TXDB [9：0 ]
TXDC [9：0 ]
x10
相
对齐
卜FF器
串行器
x10
相
对齐
卜FF器
串行器
TX
x10
相
对齐
卜FF器
串行器
TX
x10
相
对齐
卜FF器
串行器
TX
TX
OUTB1±
OUTB2±
OUTC1±
OUTC2±
文件编号： 38-02104牧师* C
OUTD1±
OUTD2±
OUTA1±
OUTA2±
TXDD [9：0 ]
REFCLKD ±
第21 2
[+ ]反馈
CYV15G0403TB
串行路径框图
REFCLKA +
REFCLKA ±
TXRATEA
SPDSELA
TXCLKOA
TXERRA
TXCLKA
TXCKSELA
0
1
字符速率时钟A
PABRSTA
比特率时钟A
=内部信号
发送
PLL
PLL
发送
时钟乘法器
时钟乘法器
OE[2..1]A
RESET
TXBISTA
OE[2..1]A
相位对齐
相位对齐
卜FF器
卜FF器
BIST LFSR
输入
注册
TXDA [9：0 ]
10
10
10
10
移
OUTA1+
OUTA1–
OUTA2+
OUTA2–
REFCLKB +
REFCLKB ±
TXRATEB
SPDSELB
TXCLKOB
TXERRB
TxCLKB
TXCKSELB
0
1
字符速率时钟B
PABRSTB
比特率时钟B
发送
PLL
PLL
发送
时钟乘法器B
时钟乘法器
OE[2..1]B
TXBISTB
OE[2..1]B
相位对齐
相位对齐
卜FF器
卜FF器
BIST LFSR
输入
注册
TXDB [9：0 ]
10
10
10
10
移
OUTB1+
OUTB1–
OUTB2+
OUTB2–
REFCLKC +
REFCLKC ±
TXRATEC
SPDSELC
TXCLKOC
TXERRC
TXCLKC
TXCKSELC
0
1
字符速率时钟
PABRSTC
位速率时钟
发送
PLL
PLL
发送
时钟乘法器
时钟乘法器
OE[2..1]C
TXBISTC
OE[2..1]C
相位对齐
相位对齐
卜FF器
卜FF器
BIST LFSR
输入
注册
TXDB [9：0 ]
10
10
10
10
移
OUTC1+
OUTC1–
OUTC2+
OUTC2–
REFCLKD +
REFCLKD ±
TXRATED
SPDSELD
TXCLKOD
TXERRD
TXCLKD
TXCKSELD
0
1
字符速率时钟
PABRSTD
位速率时钟
发送
PLL
PLL
发送
时钟乘法器
时钟乘法器
OE[2..1]D
TXBISTD
OE[2..1]D
相位对齐
相位对齐
卜FF器
卜FF器
BIST LFSR
输入
注册
TXDD [9：0 ]
10
10
10
10
移
OUTD1+
OUTD1–
OUTD2+
OUTD2–
文件编号： 38-02104牧师* C
第21 3
[+ ]反馈
CYV15G0403TB
JTAG和设备配置和控制框图
TXRATE [ A..D ]
TXCKSEL [ A..D ]
PABRST [ A..D ]
TXBIST [ A..D ]
OE[2..1][A..D]
GLEN[11..0]
FGLEN[2..0]
=内部信号
RESET
TRST
雷恩
ADDR [ 3：0]
DATA [ 4：0]
设备CON组fi guration
和控制接口
JTAG
边界
扫描
调节器
TMS
TCLK
TDI
TDO
文件编号： 38-02104牧师* C
第21 4
[+ ]反馈
CYV15G0403TB
引脚配置（顶视图）
[1]
1
A
B
C
D
E
F
G
H
J
K
L
M
N
P
R
T
U
V
W
Y
NC
2
OUT
C1–
OUT
C1+
TMS
3
NC
4
OUT
C2–
OUT
C2+
5
V
CC
V
CC
V
CC
V
CC
6
NC
7
OUT
D1–
OUT
D1+
8
GND
9
GND
10
OUT
D2–
OUT
D2+
11
GND
12
OUT
A1–
OUT
A1+
数据
[1]
数据
[0]
13
GND
14
GND
15
OUT
A2–
OUT
A2+
SPD
SELD
16
V
CC
V
CC
V
CC
V
CC
17
V
CC
NC
18
OUT
B1–
OUT
B1+
TRST
19
V
CC
NC
20
OUT
B2–
OUT
B2+
TDO
V
CC
TDI
V
CC
V
CC
V
CC
V
CC
V
CC
NC
GND
NC
NC
GND
NC
V
CC
V
CC
V
CC
NC
GND
NC
NC
数据
[3]
数据
[2]
GND
NC
NC
GND
TCLK
RESET
V
CC
SPD
SELC
GND
GND
数据
[4]
GND
GND
NC
NC
NC
SCAN TMEN3
EN2
V
CC
V
CC
V
CC
V
CC
V
CC
V
CC
NC
NC
TX
DC[0]
TX
DC[4]
NC
NC
NC
TX
CLKOB
SPD
拉美经济体系
NC
TX
DC[7]
雷恩
TX
DC[1]
SPD
SELB
NC
NC
GND
GND
GND
GND
GND
GND
GND
GND
TX
DC[9]
TX
DC[5]
REF
CLKC-
REF
CLKC +
TX
DC[2]
TX
DC[8]
TX
DC[3]
TX
CLKC
TX
DC[6]
TX
ERRC
NC
NC
NC
NC
NC
NC
NC
NC
NC
NC
NC
NC
NC
NC
TX
DB[6]
TX
CLKB
NC
NC
NC
REF
REF
CLKB + CLKB-
TX
ERRB
GND
GND
GND
GND
GND
GND
GND
GND
NC
NC
NC
NC
TX
DB[5]
TX
DB[1]
TX
DB[4]
TX
DB[0]
TX
DB[3]
TX
DB[9]
TX
DB[2]
TX
DB[7]
NC
TX
CLKOC
NC
NC
V
CC
V
CC
V
CC
V
CC
V
CC
V
CC
V
CC
V
CC
TX
DD[0]
TX
DD[3]
TX
DD[5]
TX
DD[6]
TX
DD[1]
TX
DD[4]
TX
DD[7]
TX
CLKD
TX
DD[2]
TX
DD[8]
TX
DD[9]
V
CC
V
CC
V
CC
V
CC
NC
NC
GND
TX
DA[9]
ADDR
REF
[0]
CLKD-
TX
DA[1]
GND
TX
DA[4]
TX
DA[3]
TX
DA[2]
TX
DA[0]
TX
DA[8]
TX
DA[7]
TX
DA[6]
TX
DA[5]
V
CC
V
CC
V
CC
V
CC
NC
TX
DB[8]
NC
NC
NC
NC
NC
GND
NC
ADDR
REF
TX
[2]
CLKD + CLKOA
ADDR
[1]
NC
GND
NC
NC
NC
NC
NC
NC
NC
NC
GND
ADDR
[3]
TX
CLKOD
NC
TX
地震署
GND
NC
REF
CLKA +
REF
CLKA-
NC
NC
NC
NC
NC
NC
GND
TX
CLKA
NC
GND
TX
ERRD
NC
NC
记
1. NC =不连接。
文件编号： 38-02104牧师* C
第21 5
[+ ]反馈
CYV15G0403TB
独立时钟四路的HOTLink II
串行器
特点
第二代的HOTLink
技术
符合SMPTE 292M和SMPTE 259M视频
标准
四通道视频串行器
- 195- 1500 - Mbps的串行数据信号速率
- 在不同的信令速率同步操作
支持半速率和全速率时钟
内部锁相环（ PLL）的与无外部PLL
组件
每个冗余差分PECL兼容的串行输出
通道
- 无需外部偏置电阻
- 信令速率控制的边缘速率
- 内部源端接
同步LVTTL并行接口
JTAG边界扫描
内置自测试（BIST ），用于在高速链路的测试
低功耗2W @ 3.3V典型
3.3V单电源供电
热增强型BGA
提供无铅封装选项
0.25μ BiCMOS技术
功能说明
该CYV15G0403TB独立时钟四路的HOTLink II
序列化器是一个点 - 对 - 点或点对多点通信
系统蒸发散构建块实现数据的传输通过各种
高速串行链路，包括SMPTE 292M和SMPTE
259M的视频应用。它支持的信号速率
区间为串行链路195至1500 Mbps的。所有四个通道都
独立，可以同时在不同的操作
率。每个通道在接受10位并行字符
输入寄存器和将它们转换为串行数据。
图1
illus-
trates独立显卡之间的典型连接
协处理器和相应的CYV15G0403TB串行
和CYV15G0404RB时钟恢复器和解串器芯片。
该CYV15G0403TB满足SMPTE- 259M和
SMPTE- 292M符合按照SMPTE EG34-1999病理
逻辑测试要求。
As
a
第二代
的HOTLink
设备，
该
CYV15G0403TB扩展的HOTLink系列具有增强
的集成度和更快的数据速率，同时保持
串行链路兼容性（数据和BIST ）与其他的HOTLink
设备。在CYV15G0403TB四的HOTLink的每个通道
II器件独立加扰接受10位传输
字符。这些字符序列和输出
双正ECL （ PECL ）兼容差分传输
在比特率的任何10或20倍的任务线路驱动器
输入的参考时钟，用于该信道。
每个通道包含一个独立的BIST模式
发电机。这BIST硬件允许在速度测试
在此每个发射部分的高速串行数据路径
设备，每收到一个连接的HOTLink II部分
设备，并在整个互连链路。
图1的HOTLink II系统连接
时钟恢复
输出
10
10
10
独立
通道
CYV15G0403TB
串行器
串行链接
独立
通道
CYV15G0404RB
时钟恢复解串器
10
10
10
10
时钟恢复
输出
赛普拉斯半导体公司
文件编号： 38-02104牧师* C
198冠军苑
圣荷西
,
CA 95134-1709
408-943-2600
修订后的2007年5月2日
[+ ]反馈
视频协处理器
视频协处理器
10
CYV15G0403TB
该CYV15G0403TB是理想的SMPTE应用
不同的数据速率和串行接口标准
必要为每个信道。一些应用包括
多格式路由器，切换器，格式转换器，以及
摄像机。
CYV15G0403TB串行逻辑框图
REFCLKA ±
REFCLKB ±
REFCLKC ±
TXDA [9：0 ]
TXDB [9：0 ]
TXDC [9：0 ]
x10
相
对齐
卜FF器
串行器
x10
相
对齐
卜FF器
串行器
TX
x10
相
对齐
卜FF器
串行器
TX
x10
相
对齐
卜FF器
串行器
TX
TX
OUTB1±
OUTB2±
OUTC1±
OUTC2±
文件编号： 38-02104牧师* C
OUTD1±
OUTD2±
OUTA1±
OUTA2±
TXDD [9：0 ]
REFCLKD ±
第21 2
[+ ]反馈
CYV15G0403TB
串行路径框图
REFCLKA +
REFCLKA ±
TXRATEA
SPDSELA
TXCLKOA
TXERRA
TXCLKA
TXCKSELA
0
1
字符速率时钟A
PABRSTA
比特率时钟A
=内部信号
发送
PLL
PLL
发送
时钟乘法器
时钟乘法器
OE[2..1]A
RESET
TXBISTA
OE[2..1]A
相位对齐
相位对齐
卜FF器
卜FF器
BIST LFSR
输入
注册
TXDA [9：0 ]
10
10
10
10
移
OUTA1+
OUTA1–
OUTA2+
OUTA2–
REFCLKB +
REFCLKB ±
TXRATEB
SPDSELB
TXCLKOB
TXERRB
TxCLKB
TXCKSELB
0
1
字符速率时钟B
PABRSTB
比特率时钟B
发送
PLL
PLL
发送
时钟乘法器B
时钟乘法器
OE[2..1]B
TXBISTB
OE[2..1]B
相位对齐
相位对齐
卜FF器
卜FF器
BIST LFSR
输入
注册
TXDB [9：0 ]
10
10
10
10
移
OUTB1+
OUTB1–
OUTB2+
OUTB2–
REFCLKC +
REFCLKC ±
TXRATEC
SPDSELC
TXCLKOC
TXERRC
TXCLKC
TXCKSELC
0
1
字符速率时钟
PABRSTC
位速率时钟
发送
PLL
PLL
发送
时钟乘法器
时钟乘法器
OE[2..1]C
TXBISTC
OE[2..1]C
相位对齐
相位对齐
卜FF器
卜FF器
BIST LFSR
输入
注册
TXDB [9：0 ]
10
10
10
10
移
OUTC1+
OUTC1–
OUTC2+
OUTC2–
REFCLKD +
REFCLKD ±
TXRATED
SPDSELD
TXCLKOD
TXERRD
TXCLKD
TXCKSELD
0
1
字符速率时钟
PABRSTD
位速率时钟
发送
PLL
PLL
发送
时钟乘法器
时钟乘法器
OE[2..1]D
TXBISTD
OE[2..1]D
相位对齐
相位对齐
卜FF器
卜FF器
BIST LFSR
输入
注册
TXDD [9：0 ]
10
10
10
10
移
OUTD1+
OUTD1–
OUTD2+
OUTD2–
文件编号： 38-02104牧师* C
第21 3
[+ ]反馈
CYV15G0403TB
JTAG和设备配置和控制框图
TXRATE [ A..D ]
TXCKSEL [ A..D ]
PABRST [ A..D ]
TXBIST [ A..D ]
OE[2..1][A..D]
GLEN[11..0]
FGLEN[2..0]
=内部信号
RESET
TRST
雷恩
ADDR [ 3：0]
DATA [ 4：0]
设备CON组fi guration
和控制接口
JTAG
边界
扫描
调节器
TMS
TCLK
TDI
TDO
文件编号： 38-02104牧师* C
第21 4
[+ ]反馈
CYV15G0403TB
引脚配置（顶视图）
[1]
1
A
B
C
D
E
F
G
H
J
K
L
M
N
P
R
T
U
V
W
Y
NC
2
OUT
C1–
OUT
C1+
TMS
3
NC
4
OUT
C2–
OUT
C2+
5
V
CC
V
CC
V
CC
V
CC
6
NC
7
OUT
D1–
OUT
D1+
8
GND
9
GND
10
OUT
D2–
OUT
D2+
11
GND
12
OUT
A1–
OUT
A1+
数据
[1]
数据
[0]
13
GND
14
GND
15
OUT
A2–
OUT
A2+
SPD
SELD
16
V
CC
V
CC
V
CC
V
CC
17
V
CC
NC
18
OUT
B1–
OUT
B1+
TRST
19
V
CC
NC
20
OUT
B2–
OUT
B2+
TDO
V
CC
TDI
V
CC
V
CC
V
CC
V
CC
V
CC
NC
GND
NC
NC
GND
NC
V
CC
V
CC
V
CC
NC
GND
NC
NC
数据
[3]
数据
[2]
GND
NC
NC
GND
TCLK
RESET
V
CC
SPD
SELC
GND
GND
数据
[4]
GND
GND
NC
NC
NC
SCAN TMEN3
EN2
V
CC
V
CC
V
CC
V
CC
V
CC
V
CC
NC
NC
TX
DC[0]
TX
DC[4]
NC
NC
NC
TX
CLKOB
SPD
拉美经济体系
NC
TX
DC[7]
雷恩
TX
DC[1]
SPD
SELB
NC
NC
GND
GND
GND
GND
GND
GND
GND
GND
TX
DC[9]
TX
DC[5]
REF
CLKC-
REF
CLKC +
TX
DC[2]
TX
DC[8]
TX
DC[3]
TX
CLKC
TX
DC[6]
TX
ERRC
NC
NC
NC
NC
NC
NC
NC
NC
NC
NC
NC
NC
NC
NC
TX
DB[6]
TX
CLKB
NC
NC
NC
REF
REF
CLKB + CLKB-
TX
ERRB
GND
GND
GND
GND
GND
GND
GND
GND
NC
NC
NC
NC
TX
DB[5]
TX
DB[1]
TX
DB[4]
TX
DB[0]
TX
DB[3]
TX
DB[9]
TX
DB[2]
TX
DB[7]
NC
TX
CLKOC
NC
NC
V
CC
V
CC
V
CC
V
CC
V
CC
V
CC
V
CC
V
CC
TX
DD[0]
TX
DD[3]
TX
DD[5]
TX
DD[6]
TX
DD[1]
TX
DD[4]
TX
DD[7]
TX
CLKD
TX
DD[2]
TX
DD[8]
TX
DD[9]
V
CC
V
CC
V
CC
V
CC
NC
NC
GND
TX
DA[9]
ADDR
REF
[0]
CLKD-
TX
DA[1]
GND
TX
DA[4]
TX
DA[3]
TX
DA[2]
TX
DA[0]
TX
DA[8]
TX
DA[7]
TX
DA[6]
TX
DA[5]
V
CC
V
CC
V
CC
V
CC
NC
TX
DB[8]
NC
NC
NC
NC
NC
GND
NC
ADDR
REF
TX
[2]
CLKD + CLKOA
ADDR
[1]
NC
GND
NC
NC
NC
NC
NC
NC
NC
NC
GND
ADDR
[3]
TX
CLKOD
NC
TX
地震署
GND
NC
REF
CLKA +
REF
CLKA-
NC
NC
NC
NC
NC
NC
GND
TX
CLKA
NC
GND
TX
ERRD
NC
NC
记
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