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位置:首页 > IC型号导航 > 首字符C型号页 > 首字符C的型号第1137页 > CYD09S72V18-167BBXC
FullFlex
FullFlex
TM
同步SDR
双端口SRAM
FullFlex
SDR同步双端口SRAM
特点
功能说明
该FullFlex 双端口SRAM系列包括2兆位, 9 - Mbit的,
18 - Mb和36 - Mbit的同步,真正的双端口静态RAM
这是高速度,低功耗的1.8 V或1.5 V CMOS 。两个端口
设置,可同时实现访问阵列。
同时访问某个位置的触发确定接入
控制权。对于FullFlex72这些端口与独立运作
72位总线宽度和每个端口独立地为配置
2流水线阶段。每个端口还被配置为工作在
流水线或流经模式。
先进功能包括以下内容:
真双端口存储器允许同时访问
从每个端口共享阵列
同步流水线操作单数据速率( SDR)的
在每个端口上运行
在200兆赫的SDR接口
高达28.8 GB / s的带宽( 200 MHz的× 72位× 2个端口)
可选流水线或流通模式
1.5 V或1.8 V核心供电
商用和工业温度
IEEE 1149.1 JTAG边界扫描
可提供484引脚PBGA ( × 72 )和256球FBGA ( 36 ×
和× 18 )包
FullFlex72家庭
36 - Mbit的:有512K × 72 ( CYD36S72V18 )
18兆位: 256千× 72 ( CYD18S72V18 )
9兆位: 128千× 72 ( CYD09S72V18 )
FullFlex36家庭
36 - Mbit的: 1米× 36 ( CYD36S36V18 )
18 - Mbit的:有512K × 36 ( CYD18S36V18 )
9兆位: 256千× 36 ( CYD09S36V18 )
2 - Mbit的:一个64 K × 36 ( CYD02S36V18 )
FullFlex18家庭
36兆位:2米× 18 ( CYD36S18V18 )
18 - Mbit的: 1米× 18 ( CYD18S18V18 )
9 - Mbit的:有512K × 18 ( CYD09S18V18 )
内置的确定性访问控制管理地址
碰撞
在碰撞检测的确定性标志输出
碰撞检测在背到背时钟周期
先不忙地址回读
为提高高速数据传输功能先进,
灵活性
可变阻抗匹配(VIM)
随路时钟
可选的LVTTL ( 3.3V) ,扩展HSTL ( 1.4 V至1.9 V ) ,
1.8 V LVCMOS ,或2.5 V LVCMOS IO每个端口上
突发计数器顺序内存访问
邮箱与中断标志位消息传递
双芯片使易于扩展的深度
内置的确定性访问控制管理地址
在同时访问相同的内存冲突
位置
可变阻抗匹配(VIM) ,以提高数据
通过匹配的输出驱动器阻抗的传输
线路阻抗
随路时钟,以提高数据传输
为了降低静态功耗,芯片使功耗
向下的内部电路。延迟周期前数
在CE0和CE1的改变使能或禁止数据总线
选择用于读出的延迟的周期数相匹配
装置。对于一个有效的读或写发生,激活两个芯片
开启端口输入。
每个端口包含输入地址可选的突发计数器
注册。后从外部装入计数器的初始
地址,计数器内部递增地址。
其他设备的功能包括屏蔽寄存器和镜子
寄存器来控制计数器递增和环绕。该
计数器中断( CNTINT )标志通知主机计数器
到达的下一个时钟周期的最大计数值。主人
读出该数据串计数器的内部地址,掩码寄存器地址,
并在地址线上忙碌地址。主机还加载了
计数器以通过使用存储在所述反射镜的寄存器的地址
重发功能。邮箱中断标志用于
消息传递和JTAG边界扫描和异步
主复位( MRST )也可提供。该
逻辑块
图2页
显示了这些功能。
该FullFlex72是在一个484球塑料BGA封装提供。该
FullFlex36和FullFlex18是256球细间距可
BGA封装,除了它提供了36 - Mbit的器件
484球塑料BGA封装。
赛普拉斯半导体公司
文件编号: 38-06082牧师* K
198冠军苑
圣荷西
,
CA 95134-1709
408-943-2600
修订后的2011年5月31日
[+ ]反馈
FullFlex
逻辑框图
逻辑框图FullFlex72 , FullFlex36和FullFlex18家庭如下:
[1, 2, 3]
FTSEL
L
CQEN
L
PORTSTD [1 :0]的
L
配置块
配置块
FTSEL
R
CQEN
R
PORTSTD [1 :0]的
R
DQ [71 :0]的
L
BE
[7:0]
L
CE
0
L
CE1
L
OE
L
R/
W
L
CQ1
L
CQ1
L
CQ0
L
CQ0
L
IO
控制
IO
控制
DQ [71 :0]的
R
BE
[7:0]
R
CE
0
R
CE1
R
OE
R
R/
W
R
CQ1
R
CQ1
R
CQ0
R
CQ0
R
双端口阵列
L
A [20:0]
L
CNT /
MSK
L
ADS
L
CNTEN
L
CNTRST
L
RET
L
CNTINT
L
C
L
WRP
L
碰撞检测逻辑
R
A [20:0]
R
CNT /
MSK
R
ADS
R
CNTEN
R
CNTRST
R
RET
R
CNTINT
R
C
R
WRP
R
地址&
计数器逻辑
地址&
计数器逻辑
邮箱
INT
L
INT
R
JTAG
TRST
TMS
TDI
TDO
TCK
ZQ0
R
ZQ1
R
MRST
准备
R
LowSPD
R
ZQ0
L
ZQ1
L
准备
L
LowSPD
L
RESET
逻辑
笔记
1. CYD36S18V18器件具有21位地址。该CYD36S36V18和CYD18S18V18器件具有20个地址位。该CYD36S72V18 , CYD18S36V18和
CYD09S18V18器件有19个地址位。该CYD18S72V18和CYD09S36V18器件具有18个地址位。该CYD09S72V18器件具有17位地址。
该CYD02S36V18有16个地址位。
2. FullFlex72系列器件具有72个数据线。该FullFlex36系列器件具有36个数据线。该FullFlex18系列器件具有18个数据线。
3. FullFlex72系列器件具有8字节使能。该FullFlex36系列器件具有四个字节使能。该FullFlex18系列器件有两个字节使能。
文件编号: 38-06082牧师* K
第52 2
[+ ]反馈
FullFlex
目录
选型指南................................................ ................ 9
引脚定义................................................ .................. 9
可选的IO标准............................................. 11
时钟................................................. .................... 11
可选流水线或通过流模式.............. 11
DLL ................................................. ........................... 11
回波时钟................................................ ........... 11
确定性的访问控制.................................... 11
可变阻抗匹配....................................... 12
地址计数器和屏蔽寄存器操作...... 13
计数器负荷运行............................................ 13
面膜负荷运行............................................... 13
反回读操作.................................... 13
面膜回读操作........................................ 13
计数器复位操作.......................................... 13
面膜复位操作............................................... 13
增值业务................................................ 15 ..
保持工作................................................ .......... 15
转发................................................. ................ 15
计数器中断................................................ ....... 15
通过两种计数............................................... ........ 15
由四个计数............................................... ........ 15
邮箱中断................................................ ...... 15
主复位................................................ ............. 18
IEEE 1149.1串行边界扫描( JTAG ) .................. 18
最大额定值................................................ ........... 19
经营范围................................................ ............. 19
电源要求......................................... 19
电气特性............................................... 19
电气特性............................................... 21
电气特性............................................... 24
交流测试负载和波形....................................... 25
开关特性.............................................. 26
开关波形................................................ .... 29
订购信息................................................ ...... 43
有512K × 72 ( 36兆位) 1.8 V / 1.5 V同步
CYD36S72V18双端口SRAM ...................................... 43
256千× 72 ( 18兆位) 1.8 V / 1.5 V同步
CYD18S72V18双端口SRAM ...................................... 43
128千× 72 ( 9兆位) 1.8 V / 1.5 V同步
CYD09S72V18双端口SRAM ...................................... 43
1024 K&times 36 ( 36兆位) 1.8 V / 1.5 V同步
CYD36S36V18双端口SRAM ...................................... 43
有512K × 36 ( 18兆位) 1.8 V / 1.5 V同步
CYD18S36V18双端口SRAM ...................................... 43
256千× 36 ( 9兆位) 1.8 V / 1.5 V同步
CYD09S36V18双端口SRAM ...................................... 44
一个64 K × 36 ( 2兆位), 1.8 V或1.5 V同步
CYD02S36V18双端口SRAM ...................................... 44
2048 K&times 18 ( 36兆位) 1.8 V / 1.5 V同步
CYD36S18V18双端口SRAM ...................................... 45
1024 K&times 18 ( 18兆位) 1.8 V / 1.5 V同步
CYD18S18V18双端口SRAM ...................................... 45
有512K × 18 ( 9兆位) 1.8 V / 1.5 V同步
CYD09S18V18双端口SRAM ...................................... 45
订购代码定义......................................... 45
包图................................................ .......... 46
与缩略语................................................. ....................... 48
文档约定................................................ 。 48
计量单位............................................... ........ 48
文档历史记录页............................................... .. 49
销售,解决方案和法律信息...................... 52
全球销售和设计支持....................... 52
产品................................................. ................... 52
的PSoC解决方案................................................ ......... 52
文件编号: 38-06082牧师* K
第52 3
[+ ]反馈
FullFlex
图1. FullFlex72 SDR 484球BGA引脚(顶视图)
1
A
2
3
DQ59L
4
5
6
DQ51L
DQ52L
DQ53L
CQ1L
7
DQ48L
DQ49L
DQ50L
CQ1L
8
DQ45L
DQ46L
DQ47L
VSS
9
DQ42L
DQ43L
DQ44L
10
DQ39L
DQ40L
DQ41L
11
12
13
DQ39R
DQ40R
DQ41R
14
DQ42R
DQ43R
DQ44R
15
16
17
18
19
20
DQ59R
DQ60R
VSS
VSS
21
DQ61R
22
DNU
DNU DQ61L
DQ57L DQ54L
DQ58L DQ55L
VSS
VSS
VSS
CE0L
BE4L
BE5L
BE6L
BE7L
OEL
BE3L
BE2L
BE1L
BE0L
DQ56L
VSS
VSS
DQ36L DQ36R
DQ37L DQ37R
DQ38L DQ38R
DQ45R DQ48R DQ51R DQ54R DQ57R
DQ46R DQ49R DQ52R DQ55R DQ58R
DQ47R DQ50R DQ53R DQ56R
DNU
CQ1R
CQ1R
VSS
DNU
VSS
VSS
VSS
B
DQ63L DQ62L DQ60L
C
DQ65L DQ64L
D
DQ67L DQ66L
VSS
VSS
DQ62R DQ63R
DQ64R DQ65R
DQ66R DQ67R
LOWSPDL
PORTSTD0L
ZQ0L
[4]
BUSYL CNTINTL
PORTSTD1L
E
DQ69L DQ68L VDDIOL
F
DQ71L DQ70L
G
H
J
K
L
M
N
P
A0L
A2L
A4L
A6L
A8L
A10L
A12L
A14L
A1L
A3L
A5L
A7L
A9L
A11L
A13L
CE1L
RETL
WRPL
READYL
ZQ1L
[4, 5]
CL
VSS
ADSL
VDDIOL VDDIOL VDDIOL VDDIOL
VDDIOL
VTTL
VTTL
VTTL
VDDIOR VDDIOR VDDIOR VDDIOR
VDDIOR DQ68R DQ69R
CE1R
RETR
WRPR
READYR
DQ70R DQ71R
A1R
A3R
A5R
A7R
A9R
A11R
A13R
A15R
A0R
A2R
A4R
A6R
A8R
A10R
A12R
A14R
VDDIOL VDDIOL VDDIOL VDDIOL VDDIOL
VDDIOL VDDIOL VREFL
VDDIOL VDDIOL
VDDIOL VDDIOL
VTTL
VTTL
VTTL
VCORE
VCORE
VCORE
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VCORE
VCORE
VCORE VCORE
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VCORE
VTTL
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VCORE
VDDIOR VDDIOR VDDIOR VDDIOR VDDIOR CE0R
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VREFR VDDIOR VDDIOR BE4R
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VDDIOR VDDIOR BE5R
VDDIOR VDDIOR BE6R
VCORE VDDIOR BE7R ZQ1R
[4, 5]
VCORE
VCORE
VCORE
VTTL
VTTL
VTTL
OER
BE3R
BE2R
CR
VSS
ADSR
VDDIOL VCORE
VDDIOL VDDIOL
VDDIOL VDDIOL
A15L
CNT / MSKL
VDDIOR VDDIOR BE1R
CNT / MSKR
VDDIOR VDDIOR BE0R
INTR
R
A16L
[8]
A17L
[7]
CNTENL
CNTENR A17R
[7]
A16R
[8]
CNTRSTR
T
A18L
[6]
DNU CNTRSTL INTL
U
DQ35L DQ34L
R / WL
VDDIOL VDDIOL VREFL
VREFR VDDIOR VDDIOR
DNU
A18R
[6]
CQENL VDDIOL VDDIOL VDDIOL VDDIOL VDDIOL
VDDIOL
VCORE
VCORE
VDDIOR VDDIOR VDDIOR VDDIOR VDDIOR CQENR
TRST
VSS
VDDIOR
R / WR
DQ34R DQ35R
V
DQ33L DQ32L FTSELL
W
DQ31L DQ30L
Y
DQ29L DQ28L
VSS
VSS
DNU
VSS
DQ20L
VDDIOL VDDIOL VDDIOL VDDIOL
CQ0L
DQ17L
DQ16L
DQ15L
CQ0L
DQ14L
DQ13L
DQ12L
DNU
DQ11L
DQ10L
DQ9L
PORTSTD1R
VTTL
VTTL
VDDIOR VDDIOR VDDIOR VDDIOR VDDIOR
PORTSTD0R
FTSELR DQ32R DQ33R
TDO
TCK
DQ24R
DQ23R
DQ30R DQ31R
DQ28R DQ29R
DQ26R DQ27R
DQ25R
DNU
MRST
VSS
CNTINTR
BUSYR
ZQ0R
[4]
DQ5L
DQ4L
DQ3L
DQ2L
DQ1L
DQ0L
DQ2R
DQ1R
DQ0R
LOWSPDR
VSS
DQ11R
CQ0R
CQ0R
TDI
TMS
DQ8L
DQ7L
DQ6L
DQ5R
DQ4R
DQ3R
DQ8R
DQ7R
DQ6R
DQ14R DQ17R DQ20R
AA
DQ27L DQ26L DQ24L
AB
DNU DQ25L DQ23L
DQ22L DQ19L
DQ21L DQ18L
DQ10R DQ13R DQ16R DQ19R DQ22R
DQ9R
DQ12R DQ15R DQ18R DQ21R
笔记
4.保留此球未连接禁用VIM 。
5.本球只适用于36兆位和DNU为18兆位和更低的密度。
6.请将此球悬空的CYD18S72V18和CYD09S72V18 。
7.请将此球无关的CYD09S72V18 。
8.请将此球无关的CYD04S72V18 。
文件编号: 38-06082牧师* K
第52 4
[+ ]反馈
FullFlex
图2. FullFlex36 SDR 484球BGA引脚(顶视图)
[9]
1
2
3
DNU
DNU
VSS
VSS
4
DNU
DNU
VSS
VSS
VSS
CE0L
BE2L
BE3L
DNU
DNU
OEL
DNU
DNU
BE1L
BE0L
INTL
5
DNU
DNU
DNU
VSS
VSS
6
DQ33L
DQ34L
DQ35L
CQ1L
7
DQ30L
DQ31L
DQ32L
CQ1L
8
DQ27L
DQ28L
DQ29L
VSS
9
DQ24L
DQ25L
DQ26L
10
DQ21L
DQ22L
DQ23L
11
DQ18L
DQ19L
DQ20L
12
DQ18R
DQ19R
DQ20R
13
DQ21R
DQ22R
DQ23R
CNTINTL
VTTL
VCORE
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VCORE
VDDIOL
PORTSTD0R
14
DQ24R
DQ25R
DQ26R
PORTSTD1L
15
16
17
18
DNU
DNU
DNU
VSS
DNU
19
DNU
DNU
VSS
VSS
VSS
CE0R
BE2R
BE3R
DNU
DNU
OER
DNU
DNU
BE1R
BE0R
INTR
20
DNU
DNU
VSS
VSS
21
22
A
DNU DNU
B
DNU DNU
C
DNU DNU
D
DNU DNU
DQ27R DQ30R DQ33R
DQ28R DQ31R DQ34R
DQ29R DQ32R DQ35R
DNU
CQ1R
CQ1R
DNU DNU
DNU DNU
DNU DNU
DNU DNU
LOWSPDL
PORTSTD0L
ZQ0L
[10]
BUSYL
E
DNU DNU VDDIOL
F
DNU DNU
G
H
J
K
L
A0L
A2L
A4L
A6L
A8L
A1L
A3L
CE1L
RETL
WRPL
VDDIOL VDDIOR VDDIOR VDDIOR
VDDIOR
VCORE
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VCORE
VTTL
VTTL
VTTL
VDDIOL VDDIOL VDDIOL VDDIOL
VDDIOR DNU DNU
CE1R
RETR
WRPR
DNU DNU
A1R A0R
A3R A2R
VDDIOL VDDIOL VDDIOR VDDIOR VDDIOR
VDDIOL VDDIOL VREFL
VDDIOL VDDIOL
VDDIOL VDDIOL
VTTL
VTTL
VTTL
VCORE
VCORE
VCORE
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VCORE VCORE
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VDDIOL VDDIOL VDDIOL VDDIOR VDDIOR
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VREFR VDDIOR VDDIOR
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VDDIOR VDDIOR
VDDIOR VDDIOR
VCORE VDDIOR
VCORE
VCORE
VCORE
VTTL
VTTL
VTTL
A5L READYL
A7L ZQ1L
[10]
A9L
CL
VSS
ADSL
CNT / MSKL
READYR A5R A4R
ZQ1R
[10]
A7R A6R
CR
VSS
ADSR
A9R A8R
A11R A10R
A13R A12R
M
A10L A11L
N
A12L A13L
P
A14L A15L
VDDIOL VCORE
VDDIOL VDDIOL
VDDIOL VDDIOL
VDDIOR VDDIOR
VDDIOR VDDIOR
CNT / MSKR
A15R A14R
R
A16L A17L CNTENL
T
A18L A19L
U
DNU DNU
CNTRSTL
CNTENR A17R A16R
CNTRSTR
A19R A18R
VDDIOL VDDIOL VREFL
VREFR VDDIOR VDDIOR
R / WL
CQENL VDDIOL VDDIOL VDDIOR VDDIOR VDDIOR
DNU
VSS
DNU
DNU
DNU
VDDIOR VDDIOR VDDIOR VDDIOR
CQ0L
DQ17L
DQ16L
DQ15L
CQ0L
DQ14L
DQ13L
DQ12L
DNU
DQ11L
DQ10L
DQ9L
PORTSTD1R
VCORE VCORE
VTTL
VTTL
VDDIOL VDDIOL VDDIOL VDDIOR VDDIOR CQENR
VDDIOL VDDIOL VDDIOL VDDIOR
LOWSPDR
R / WR
DNU DNU
V
DNU DNU FTSELL VDDIOL
W
DNU DNU
Y
DNU DNU
AA
DNU DNU
AB
DNU DNU
VSS
VSS
DNU
DNU
MRST
VSS
DNU
DNU
TRST
VSS
DNU
DNU
DNU
VDDIOR FTSELR DNU DNU
TDI
TMS
DNU
DNU
TDO
TCK
DNU
DNU
DNU DNU
DNU DNU
DNU DNU
DNU DNU
CNTINTR BUSYR ZQ0R
[10]
DQ5L
DQ4L
DQ3L
DQ2L
DQ1L
DQ0L
DQ2R
DQ1R
DQ0R
VSS
DQ11R
CQ0R
CQ0R
DQ8L
DQ7L
DQ6L
DQ5R
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笔记
9.使用此引脚排列只为FullFlex36家庭设备CYD36S36V18 。
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