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位置:首页 > IC型号导航 > 首字符C型号页 > 首字符C的型号第271页 > CY7C68014A-128AXC
CY7C68013A , CY7C68014A
CY7C68015A , CY7C68016A
EZ- USB FX2LP USB微控制器
高速USB外设控制器
1.特点( CY7C68013A / 14A / 15A / 16A )
USB 2.0 USB IF高速认证( TID # 40460272 )
单芯片集成了USB 2.0收发器,智能SIE和
增强型8051微处理器
飞度,形式和功能与FX2兼容
引脚兼容
目标代码兼容
功能兼容( FX2LP是一个超集)
超低功耗:我
CC
不超过85毫安在任何模式
理想的公交车和电池供电应用
软件: 8051代码运行:
内部RAM ,它是通过USB下载
内部RAM中,它是从EEPROM加载
外部存储设备( 128引脚封装)
片上代码/数据RAM 16千字节
四个可编程批量/中断/ ISOCHRONOUS
ENDPOINTS
缓冲选项:双人间,三人间和四
其他可编程(批量/中断) 64字节
终点
8位或16位外部数据接口
智能媒体标准的ECC生成
GPIF (通用可编程接口)
可直接连接到大多数并行接口
可编程波形描述符和配置稳压
存器来定义波形
支持多种就绪( RDY )输入和控制( CTL )输出
看跌期权
整合,行业标准的增强型8051
48兆赫, 24兆赫,或12 MHz的CPU操作
每个指令周期四个时钟
两个USART
三个计数器/定时器
扩展的中断系统
两个数据指针
3.3V操作与5V容限输入
矢量USB中断和GPIF / FIFO中断
单独的数据缓冲器的设置和数据部分
控制权转移
集成I
2
C控制器,运行在100或400千赫
四个集成的FIFO
集成胶合逻辑和FIFO降低系统的成本
自动转换到和从16位总线
主机或从机操作
使用外部时钟或异步闪光
轻松连接到ASIC和DSP芯片
可在商用和工业温度级(全
除了VFBGA包)
赛普拉斯半导体公司
文件编号: 38-08032牧师* L
198冠军苑
圣荷西
,
CA 95134-1709
408-943-2600
修订后的2008年2月8日
[+ ]反馈
CY7C68013A , CY7C68014A
CY7C68015A , CY7C68016A
逻辑框图
24兆赫
分机。 XTAL
高性能微
使用标准工具
低功耗选项
地址( 16 )
数据( 8 )
FX2LP
地址( 16 ) /数据总线( 8 )
VCC
x20
PLL
/0.5
/1.0
/2.0
8051核心
12/24/48兆赫,
四个时钟/周期
I
2
C
其他的IO ( 24 )
1.5k
用于连接
FULL- SPEED
D+
D–
集成
全速和
快速
XCVR
USB
2.0
XCVR
CY
灵巧
USB
1.1/2.0
发动机
16 KB
内存
丰富的IO
包括两个USART
一般
可编程I / F
到ASIC / DSP或公交
如标准
ATAPI ,EPP等
ADDR (9)
GPIF
ECC
RDY ( 6 )
的CTL (6)
4 KB
FIFO
8/16
高达96兆字节/秒
爆率
增强型的USB核心
简化代码8051
“软配置”
简单的固件更新
FIFO和端点内存
(主机或从机操作)
1.1特性( CY7C68013A / 14A只)
CY7C68014A :适合电池供电应用
挂起电流: 100
μA
(典型值)
CY7C68013A :适合非电池供电应用
挂起电流: 300
μA
(典型值)
提供五种无铅封装多达40个GPIO
128引脚TQFP封装( 40个GPIO ) , 100引脚TQFP ( 40个GPIO ) , 56针
QFN ( 24个GPIO ) , 56引脚SSOP ( 24个GPIO ) ,以及56引脚VF-
BGA ( 24个GPIO )
赛普拉斯创造了一个符合成本效益的解决方案,提供
卓越的时间将产品推向市场的优势低功耗,使
总线供电的应用。
FX2LP导致数据传输的巧妙架构
每秒53兆字节的速率,最大允许
USB 2.0的带宽,同时还采用低成本8051微
控制器在一个封装小56 VFBGA (采用5mm x 5mm ) 。
因为它采用了USB 2.0收发器,该FX2LP是
更经济,提供比小尺寸解决方案
USB 2.0 SIE或外部收发器实现。同
EZ -USB FX2LP ,赛普拉斯智能SIE处理大部分的
USB 1.1和2.0的硬件协议,释放内嵌
微控制器应用的特定功能,降低
显影时间,以确保USB兼容性问题。
通用可编程接口( GPIF )和主/从
端点FIFO (8位或16位数据总线)提供了一种简单和
无缝连接流行的接口,比如ATA , UTOPIA ,
EPP ,PCMCIA和大多数DSP /处理器。
在FX2LP吸引更小的电流比FX2 ( CY7C68013 ) ,有
两倍的片上代码/数据RAM,以及嵌合,形式和功能
同56 ,100,和128引脚FX2兼容。
五包被定义为家庭: 56VFBGA , 56 SSOP ,
56 QFN , TQFP 100和128 TQFP 。
1.2特性( CY7C68015A / 16A只)
CY7C68016A :适合电池供电应用
挂起电流: 100
μA
(典型值)
CY7C68015A :适合非电池供电应用
挂起电流: 300
μA
(典型值)
可提供无铅56引脚QFN封装( 26个GPIO )
2比CY7C68013A / 14A启用附加更多的GPIO
在相同的空间功能
赛普拉斯半导体公司( Cypress的) EZ- USB
FX2LP ( CY7C68013A / 14A )是一个低功率的版本
EZ -USB FX2 ( CY7C68013 ) ,这是一个高度集成的低
电源的USB 2.0微控制器。通过集成的USB 2.0收发
ceiver ,串行接口引擎( SIE ) ,增强型8051单片机
制器,并在单个芯片中的可编程的外围接口,
文件编号: 38-08032牧师* L
第62 2
[+ ]反馈
CY7C68013A , CY7C68014A
CY7C68015A , CY7C68016A
2.应用
频率是12 MHz 。 8051的时钟频率可以是
通过CPUCS寄存器由8051变,动态。
图1.晶体结构
C1
12 pF的
24兆赫
C2
12 pF的
便携式视频录像机
MPEG / TV转换
DSL调制解调器
ATA接口
存储卡读卡器
传统的转换装置
相机
扫描仪
首页PNA
无线局域网
MP3播放器
联网
12 pF的电容值,假设一丝电容
每边3 pF的上一个4层FR4的PCA
20 × PLL
CLKOUT引脚,可以三态和反转用
内部控制比特,输出50%的占空比时钟8051 ,在
选择8051的时钟频率: 48 MHz时, 24兆赫,或12兆赫。
3.2.2个USART
FX2LP包含两个标准的8051个USART ,通过解决
特殊功能寄存器( SFR )位。该USART接口引脚
可以使用单独的IO管脚,并且不复用
端口引脚。
UART0和UART1可以使用在内部时钟运行
230波特不超过1%的波特率误差。 230波特
操作由内部派生时钟源来实现这
产生溢出脉冲在适当的时候。内部
时钟调整为8051时钟速率( 48兆赫, 24兆赫, 12
兆赫) ,使得它总是呈现正确的频率为230
波特操作。
[1]
3.2.3特殊功能寄存器
某些8051 SFR地址以便能快速
进入关键的FX2LP功能。这些添加的SFR
所示
表1
第4页粗体字表示不标准,
增强型8051寄存器。以“ 0 ”结尾的两个SFR行
和“8”包含位寻址寄存器。这四个IO端口A到
D使用在标准8051中用于端口0的SFR地址
3 ,这在FX2LP不落实。由于快
和更有效的SFR寻址, FX2LP IO端口不是
寻址在外部RAM空间(用MOVX
指令)。
的“参考设计”部分
赛普拉斯网站
为典型的USB 2.0应用程序的其他工具。每
参考设计都包含固件的源和
目标代码,原理图和文档。参观
网站
了解更多信息。
3.功能概述
3.1 USB信号传输速度
FX2LP工作在两点USB定义的三种速率
规范2.0版,日期为2000年4月27日:
全速,以12 Mbps的信号的比特率
高速, 480 Mbps的信号的比特率。
FX2LP不支持低速信令模式
1.5 Mbps的。
3.2 8051微处理器
8051微处理器嵌入到FX2LP系列有
256字节的寄存器RAM ,扩展的中断系统,三
定时器/计数器和两个USART 。
3.2.1 8051时钟频率
FX2LP具有使用外部24片上振荡器电路
兆赫( ± 100ppm以下)的结晶,具有以下特点:
3.3 I
2
C总线
FX2LP支持我
2
C总线作为主只在100- / 400-千赫。
SCL和SDA引脚具有开漏输出和滞后
输入。这些信号必须被拉高至3.3V,即使没有我
2
C
设备连接。
并联谐振
基本模式
500 μW驱动电平
12 - PF( 5 %容差)负载电容
3.4巴士
所有封装, 8位或16位的“先进先出”的双向数据总线,多
路开关连接的IO端口B和D. 128引脚封装:将16位
只输出8051的地址总线, 8位双向数据总线。
片上PLL倍频24 MHz振荡器高达480兆赫,
所要求的收发器/ PHY和内部计数器分频
下来用作8051时钟。默认的8051时钟
1. 115波特的操作,也可以通过分别编程8051 SMOD0或SMOD1位为“1 ”为UART0 , UART1 ,或两者兼而有之。
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第62 3
[+ ]反馈
CY7C68013A , CY7C68014A
CY7C68015A , CY7C68016A
表1.特殊功能寄存器
x
0
1
2
3
4
5
6
7
8
9
A
B
C
D
E
F
8x
IOA
SP
DPL0
DPH0
DPL1
DPH1
DPS
PCON
TCON
TMOD
TL0
TL1
TH0
TH1
CKCON
9x
IOB
EXIF
MPAGE
Ax
国际奥林匹克委员会
INT2CLR
INT4CLR
Bx
IOD
IOE
OEA
OEB
OEC
OED
OEE
IP
EP01STAT
GPIFTRIG
GPIFSGLDATH
GPIFSGLDATLX
GPIFSGLDATLNOX
T2CON
RCAP2L
RCAP2H
TL2
TH2
EICON
EIE
EIP
Cx
SCON1
SBUF1
Dx
PSW
Ex
Fx
B
SCON0
SBUF0
AUTOPTRH1
AUTOPTRL1
版权所有
AUTOPTRH2
AUTOPTRL2
版权所有
IE
EP2468STAT
EP24FIFOFLGS
EP68FIFOFLGS
AUTOPTRSET -UP
3.5 USB启动方法
在上电时序,内部逻辑会检查我
2
端口C
对于EEPROM的联系,它的第一个字节为0xC0
或为0xC2 。如果找到了,它使用的VID / PID / EEPROM中DID值
代替内部存储的值(为0xC0 ) ,或者在引导加载的
EEPROM的内容到内部RAM ( 0xC2的) 。如果没有EEPROM是
检测, FX2LP列举了使用内部存储的描述符。
对于FX2LP的默认ID值VID / PID / DID ( 0x04B4 ,
0x8613 , 0xAxxx其中xxx =芯片版本) 。
[2]
表2.默认ID值FX2LP
供应商ID
产品编号
设备版本
默认VID / PID / DID
0x04B4赛普拉斯半导体
0x8613 EZ -USB FX2LP
0xAnnn取决于芯片版本
( NNN =芯片版本,其中第一
硅= 001 )
在USBCS两个控制位( USB控制和状态)注册,
控制的薪酬流程: DISCON和RENUM 。对
模拟USB断开,固件设置DISCON为1。
重新连接,固件将DISCON为0 。
重新连接前,固件设置或清除RENUM位
表明是否固件或默认的USB设备
处理设备的请求通过端点零:如果RENUM = 0,则
默认的USB设备处理设备请求;如果RENUM = 1,则
固件服务该请求。
3.7总线供电应用
该FX2LP完全支持总线供电设计,通过枚举
少于100毫安所要求的USB 2.0规范。
3.8中断系统
3.8.1 INT2中断请求和使能寄存器
FX2LP针对INT2和INT4自动向量化功能。
有27 INT2 ( USB )载体,和14 INT4 ( FIFO / GPIF )
向量。看到EZ -USB技术参考手册( TRM )的
更多的细节。
3.8.2 USB中断Autovectors
主要的USB中断由27个中断源共享。对
保存时所需的识别码和处理时间
单个USB中断源时, FX2LP提供了第二
中断向量的水平,被称为自动向量化。当USB
中断断言, FX2LP会将程序计数器
到其堆栈中,然后跳转到地址0x0043 ,其中,预计
找到一个“跳”的指令到USB中断服务程序。
3.6的薪酬
由于FX2LP的配置是软的,一个芯片可以采取
的多个不同的USB设备的身份。
当第一次插入USB时, FX2LP列举automati-
在美云和下载固件和USB描述符表
USB连接线。接下来, FX2LP再次枚举,此时如
由下载的信息所限定的设备。这项专利
2所谓的薪酬步骤的过程立即发生时,
该设备插入时,没有一丝的初始下载
已经发生的一步。
2.我
2
C总线的SCL和SDA引脚必须上拉,即使EEPROM未连接。否则,这种检测方法不能正常工作。
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CY7C68013A , CY7C68014A
CY7C68015A , CY7C68016A
在FX2LP跳转指令编码如下:
表3. INT2 USB中断
USB中断表INT2
优先
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
INT2VEC价值
00
04
08
0C
10
14
18
1C
20
24
28
2C
30
34
38
3C
40
44
48
4C
50
54
58
5C
60
64
68
6C
70
74
78
7C
EP2ISOERR
EP4ISOERR
EP6ISOERR
EP8ISOERR
版权所有
版权所有
ISO EP2 OUT PID顺序错误
ISO EP4 OUT PID顺序错误
ISO EP6 OUT PID顺序错误
ISO EP8 OUT PID顺序错误
3.8.3 FIFO / GPIF中断( INT4 )
正如USB中断由27个独立的USB共享
中断源时,FIFO / GPIF中断14个共享
个别FIFO / GPIF源。在FIFO / GPIF中断像
USB中断,可以利用自动向量化。
表4
显示
对于14 FIFO / GPIF中断优先级和INT4VEC值
源。
EP0PING
EP1PING
EP2PING
EP4PING
EP6PING
EP8PING
ERRLIMIT
EP0-IN
EP0-OUT
EP1-IN
EP1-OUT
EP2
EP4
EP6
EP8
IBN
SUDAV
SOF
SUTOK
暂停
USB复位
HISPEED
EP0ACK
来源
可设置数据
帧起始(或微帧)
SETUP令牌接收
USB挂起的请求
总线复位
进入高速运转
FX2LP ACK'd的控制握手
版权所有
EP0 -IN准备加载数据
EP0 -OUT有USB数据
EP1 -IN准备加载数据
EP1 -OUT有USB数据
IN:可用缓冲区。 OUT :缓冲区有数据
IN:可用缓冲区。 OUT :缓冲区有数据
IN:可用缓冲区。 OUT :缓冲区有数据
IN:可用缓冲区。 OUT :缓冲区有数据
IN-批量NAK (任何端点)
版权所有
EP0 OUT被ping它NAK'd
EP1 OUT被ping它NAK'd
EP2 OUT被ping它NAK'd
EP4 OUT被ping它NAK'd
EP6 OUT被ping它NAK'd
EP8 OUT被ping它NAK'd
总线错误超过设定的限制
笔记
如果是自动向量化启用( AV2EN = 1的INTSET -UP
寄存器),则FX2LP替换其INT2VEC字节。因此,如果
高字节( “页” )的跳转表地址是预装在
位置0x0044 ,在自动插入INT2VEC字节
0x0045将跳转到正确的地址,出27
网页中的地址。
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CY7C68015A , CY7C68016A
EZ- USB FX2LP USB微控制器
高速USB外设控制器
1.特点( CY7C68013A / 14A / 15A / 16A )
USB 2.0 USB IF高速认证( TID # 40460272 )
单芯片集成了USB 2.0收发器,智能SIE和
增强型8051微处理器
飞度,形式和功能与FX2兼容
引脚兼容
兼容的目标代码
功能兼容( FX2LP是一个超集)
超低功耗:我
CC
不超过85毫安在任何模式
理想的公交车和电池供电应用
软件: 8051代码运行:
内部RAM,它可通过USB下载
内部RAM中,它是从EEPROM加载
外部存储设备( 128引脚封装)
片上代码/数据RAM 16千字节
四个可编程批量,中断和
同步端点
缓冲选项:双人间,三人间和四
其他可编程(批量/中断) 64字节
终点
8位或16位外部数据接口
智能媒体标准的ECC生成
GPIF (通用可编程接口)
可直接连接到大多数并行接口
可编程波形描述符和配置
寄存器定义波形
支持多种就绪( RDY )输入和控制( CTL )
输出
整合,行业标准的增强型8051
48兆赫, 24兆赫,或12 MHz的CPU操作
每个指令周期四个时钟
两个USART
三个计数器/定时器
扩展的中断系统
两个数据指针
3.3V操作与5V容限输入
矢量USB中断和GPIF / FIFO中断
单独的数据缓冲器的设置和数据部分
控制权转移
集成I
2
C控制器,运行在100或400千赫
四个集成的FIFO
集成胶合逻辑和FIFO降低系统的成本
自动转换到和从16位总线
主机或从机操作
使用外部时钟或异步闪光
轻松连接到ASIC和DSP芯片
可在商用和工业温度级
(除VFBGA所有包)
赛普拉斯半导体公司
文件编号: 38-08032牧师* N
198冠军苑
圣荷西
,
CA 95134-1709
408-943-2600
修订后的2009年7月1日
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CY7C68013A , CY7C68014A
CY7C68015A , CY7C68016A
逻辑框图
24兆赫
分机。 XTAL
高性能微
使用标准工具
低功耗选项
地址( 16 )
数据( 8 )
FX2LP
地址( 16 ) /数据总线( 8 )
VCC
x20
PLL
/0.5
/1.0
/2.0
8051核心
12/24/48兆赫,
四个时钟/周期
I
2
C
额外的I / O ( 24 )
1.5k
用于连接
全速
D+
D–
集成
全速
高速
XCVR
USB
2.0
XCVR
CY
灵巧
USB
1.1/2.0
发动机
16 KB
内存
丰富的I / O
包括两个USART
一般
可编程I / F
到ASIC / DSP或公交
如标准
ATAPI ,EPP等
ADDR (9)
GPIF
ECC
RDY ( 6 )
的CTL (6)
4 KB
FIFO
8/16
高达96兆字节/秒
爆率
增强型的USB核心
简化代码8051
“软配置”
简单的固件更新
FIFO和端点内存
(主机或从机操作)
1.1特性( CY7C68013A / 14A只)
CY7C68014A :适合电池供电应用
挂起电流: 100
μA
(典型值)
CY7C68013A :适合非电池供电应用
挂起电流: 300
μA
(典型值)
提供五种无铅封装,高达40个GPIO
128引脚TQFP封装( 40个GPIO ) , 100引脚TQFP ( 40个GPIO ) , 56针
QFN ( 24个GPIO ) , 56引脚SSOP ( 24个GPIO ) ,以及56引脚
VFBGA ( 24个GPIO )
赛普拉斯创造了一个符合成本效益的解决方案,提供
卓越的时间将产品推向市场的优势低功耗,使
总线供电的应用。
FX2LP导致数据传输的巧妙架构
每秒53兆字节的速率,最大允许
USB 2.0的带宽,同时仍使用低费用8051
微控制器中的一个包,小到一个56 VFBGA (5毫米× 5
毫米)。因为它采用了USB 2.0收发器,该
FX2LP是更经济,提供了一个更小的占位面积的解决方案
比USB 2.0 SIE或外部收发器实现。同
EZ -USB FX2LP ,赛普拉斯智能SIE处理大部分的
USB 1.1和2.0的硬件协议,释放内嵌
微控制器应用的特定功能,降低
显影时间,以确保USB兼容性问题。
通用可编程接口( GPIF )和主/从
端点FIFO (8位或16位数据总线)提供了一种简单和
无缝连接流行的接口,比如ATA , UTOPIA ,
EPP ,PCMCIA和大多数DSP /处理器。
在FX2LP吸引更小的电流比FX2 ( CY7C68013 ) ,有
两倍的片上代码/数据RAM,以及嵌合,形式和功能
同56 ,100,和128引脚FX2兼容。
五包被定义为家庭: 56VFBGA , 56 SSOP ,
56 QFN , TQFP 100和128 TQFP 。
1.2特性( CY7C68015A / 16A只)
CY7C68016A :适合电池供电应用
挂起电流: 100
μA
(典型值)
CY7C68015A :适合非电池供电应用
挂起电流: 300
μA
(典型值)
可提供无铅56引脚QFN封装( 26个GPIO )
两个比CY7C68013A / 14A启用附加更多的GPIO
在相同的空间功能
Cypress的EZ -USB FX2LP ( CY7C68013A / 14A )是一款低功耗
版本的EZ -USB FX2 ( CY7C68013 ) ,哪是一个高度
集成的低功耗USB 2.0微控制器。通过积分
USB2.0收发器,串行接口引擎(SIE ),增强型
8051微控制器和可编程的外围接口
在单个芯片中,
文件编号: 38-08032牧师* N
第62 2
[+ ]反馈
CY7C68013A , CY7C68014A
CY7C68015A , CY7C68016A
2.应用
图1.晶体结构
C1
12 pF的
24兆赫
C2
12 pF的
便携式视频录像机
MPEG / TV转换
DSL调制解调器
ATA接口
存储卡读卡器
传统的转换装置
相机
扫描仪
首页PNA
无线局域网
MP3播放器
联网
20 × PLL
12 pF的电容值,假设一丝电容
每边3 pF的上一个4层FR4的PCA
CLKOUT引脚,可以三态和反转用
内部控制比特,输出50%的占空比时钟8051 ,在
选择8051的时钟频率: 48 MHz时, 24兆赫,或12兆赫。
3.2.2个USART
FX2LP包含两个标准的8051个USART ,通过解决
特殊功能寄存器( SFR )位。该USART接口引脚
可在单独的I / O引脚,并且不与复
端口引脚。
UART0和UART1可以使用在内部时钟运行
230波特不超过1%的波特率误差。 230波特
操作由内部派生时钟源来实现这
产生溢出脉冲在适当的时候。内部
时钟调整为8051时钟速率( 48兆赫, 24兆赫,并
12兆赫) ,使得它总是呈现正确的频率为
230波特操作。
[1]
3.2.3特殊功能寄存器
某些8051 SFR地址以便能快速
进入关键的FX2LP功能。这些添加的SFR
所示
表1
第4页粗体字表示不标准,
增强型8051寄存器。以“ 0 ”结尾的两个SFR行
和“8”包含位寻址寄存器。这四个I / O端口A到
D使用在标准8051中用于端口0的SFR地址
3 ,这在FX2LP不落实。由于快
和更有效的SFR寻址, FX2LP的I / O端口都没有
寻址在外部RAM空间(用MOVX
指令)。
的“参考设计”部分
赛普拉斯网站
为典型的USB 2.0应用程序的其他工具。每
参考设计都包含固件的源和
目标代码,原理图和文档。访问
www.cypress.com
了解更多信息。
3.功能概述
3.1 USB信号传输速度
FX2LP工作在两点USB定义的三种速率
规范2.0版,日期为2000年4月27日:
全程高速,与12 Mbps的信号比特率
高的速度,以480 Mbps的信令比特率。
FX2LP不支持低速信令模式
1.5 Mbps的。
3.2 8051微处理器
8051微处理器嵌入到FX2LP系列有
256字节的寄存器RAM ,扩展的中断系统,三
定时器/计数器和两个USART 。
3.2.1 8051时钟频率
FX2LP具有使用一个外部的片上振荡器电路
24兆赫( ± 100ppm以下)的结晶,具有以下特点:
3.3 I
2
C总线
FX2LP支持我
2
C总线作为主只在100/400千赫。
SCL和SDA引脚具有开漏输出和滞后
输入。这些信号必须被拉高至3.3V,即使没有我
2
C
设备连接。
并联谐振
基本模式
500
μW
驱动电平
12 pF的( 5 %容差)负载电容
3.4巴士
所有封装, 8位或16位的“先进先出”的双向数据总线,
复用I / O端口B和D. 128引脚封装:将16位
只输出8051的地址总线, 8位双向数据总线。
片上PLL倍频24 MHz振荡器高达480兆赫,
所要求的收发器/ PHY和内部计数器分频
下来用作8051时钟。默认的8051时钟
频率是12 MHz 。 8051的时钟频率可以是
通过CPUCS寄存器由8051变,动态。
1. 115波特的操作,也可以通过分别编程8051 SMOD0或SMOD1位为“1 ”为UART0 , UART1 ,或两者兼而有之。
文件编号: 38-08032牧师* N
第62 3
[+ ]反馈
CY7C68013A , CY7C68014A
CY7C68015A , CY7C68016A
表1.特殊功能寄存器
x
0
1
2
3
4
5
6
7
8
9
A
B
C
D
E
F
8x
IOA
SP
DPL0
DPH0
DPL1
DPH1
DPS
PCON
TCON
TMOD
TL0
TL1
TH0
TH1
CKCON
9x
IOB
EXIF
MPAGE
Ax
国际奥林匹克委员会
INT2CLR
INT4CLR
Bx
IOD
IOE
OEA
OEB
OEC
OED
OEE
IP
EP01STAT
GPIFTRIG
GPIFSGLDATH
GPIFSGLDATLX
GPIFSGLDATLNOX
T2CON
RCAP2L
RCAP2H
TL2
TH2
EICON
EIE
EIP
Cx
SCON1
SBUF1
Dx
PSW
Ex
Fx
B
SCON0
SBUF0
AUTOPTRH1
AUTOPTRL1
版权所有
AUTOPTRH2
AUTOPTRL2
版权所有
IE
EP2468STAT
EP24FIFOFLGS
EP68FIFOFLGS
AUTOPTRSET -UP
3.5 USB启动方法
在上电时序,内部逻辑会检查我
2
端口C
对于EEPROM的联系,它的第一个字节为0xC0
或为0xC2 。如果找到了,它使用的VID / PID / EEPROM中DID值
代替内部存储的值(为0xC0 ) ,或者在引导加载的
EEPROM的内容到内部RAM ( 0xC2的) 。如果没有EEPROM是
检测, FX2LP列举了使用内部存储的描述符。
对于FX2LP的默认ID值VID / PID / DID ( 0x04B4 ,
0x8613 , 0xAxxx其中xxx =芯片版本) 。
[2]
表2.默认ID值FX2LP
供应商ID
产品编号
设备版本
默认VID / PID / DID
0x04B4赛普拉斯半导体
0x8613 EZ -USB FX2LP
0xAnnn取决于芯片版本
( NNN =芯片版本,其中第一
硅= 001 )
在USBCS两个控制位( USB控制和状态)注册,
控制的薪酬流程: DISCON和RENUM 。对
模拟USB断开,固件设置DISCON为1。
重新连接,固件将DISCON为0 。
重新连接前,固件设置或清除RENUM位
表明是否固件或默认的USB设备
处理设备的请求通过端点零:如果RENUM = 0,则
默认的USB设备处理设备请求;如果RENUM = 1,则
固件服务该请求。
3.7总线供电应用
该FX2LP完全支持总线供电设计,通过枚举
少于100毫安所要求的USB 2.0规范。
3.8中断系统
3.8.1 INT2中断请求和使能寄存器
FX2LP针对INT2和INT4自动向量化功能。
有27 INT2 ( USB )载体,和14 INT4 ( FIFO / GPIF )
向量。看到EZ -USB技术参考手册( TRM )的
更多的细节。
3.8.2 USB中断Autovectors
主要的USB中断由27个中断源共享。对
保存时所需的识别码和处理时间
单个USB中断源时, FX2LP提供了第二
中断向量的水平,被称为自动向量化。当USB
中断断言, FX2LP会将程序计数器
它的堆栈,然后跳转到地址0x0043 ,其中,预计
找到一个“跳”的指令到USB中断服务程序。
3.6的薪酬
由于FX2LP的配置是软的,一个芯片可以采取
的多个不同的USB设备的身份。
当第一次插入USB时, FX2LP枚举
自动下载固件和USB描述符
桌子上的USB连接线。接下来, FX2LP再次列举,
此时如通过下载的信息所限定的设备。
这款名为ReNumeration专利两步过程发生
瞬间,当设备插入时,没有暗示,
发生的初始下载的一步。
2.我
2
C总线的SCL和SDA引脚必须上拉,即使EEPROM未连接。否则,这种检测方法不能正常工作。
文件编号: 38-08032牧师* N
第62 4
[+ ]反馈
CY7C68013A , CY7C68014A
CY7C68015A , CY7C68016A
在FX2LP跳转指令编码如下:
表3. INT2 USB中断
USB中断表INT2
优先
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
INT2VEC价值
00
04
08
0C
10
14
18
1C
20
24
28
2C
30
34
38
3C
40
44
48
4C
50
54
58
5C
60
64
68
6C
70
74
78
7C
EP2ISOERR
EP4ISOERR
EP6ISOERR
EP8ISOERR
版权所有
版权所有
ISO EP2 OUT PID顺序错误
ISO EP4 OUT PID顺序错误
ISO EP6 OUT PID顺序错误
ISO EP8 OUT PID顺序错误
EP0PING
EP1PING
EP2PING
EP4PING
EP6PING
EP8PING
ERRLIMIT
EP0-IN
EP0-OUT
EP1-IN
EP1-OUT
EP2
EP4
EP6
EP8
IBN
SUDAV
SOF
SUTOK
暂停
USB复位
HISPEED
EP0ACK
来源
可设置数据
帧起始(或微帧)
SETUP令牌接收
USB挂起的请求
总线复位
进入高速运行
FX2LP ACK'd的控制握手
版权所有
EP0 -IN准备加载数据
EP0 -OUT有USB数据
EP1 -IN准备加载数据
EP1 -OUT有USB数据
IN:可用缓冲区。 OUT :缓冲区有数据
IN:可用缓冲区。 OUT :缓冲区有数据
IN:可用缓冲区。 OUT :缓冲区有数据
IN:可用缓冲区。 OUT :缓冲区有数据
IN-批量NAK (任何端点)
版权所有
EP0 OUT被ping它NAK'd
EP1 OUT被ping它NAK'd
EP2 OUT被ping它NAK'd
EP4 OUT被ping它NAK'd
EP6 OUT被ping它NAK'd
EP8 OUT被ping它NAK'd
总线错误超过设定的限制
笔记
如果是自动向量化启用(在INTSET -UP寄存器AV2EN = 1 )时, FX2LP会替换其INT2VEC字节。因此,如果高
字节(“页” )的跳转表地址预装在该位置0x0044 ,在0x0045自动插入INT2VEC字节
跳转到正确的地址了27个地址的页面中。
3.8.3 FIFO / GPIF中断( INT4 )
正如USB中断由27个独立的USB中断源共享的FIFO / GPIF中断由14个独立的共享
FIFO / GPIF源。在FIFO / GPIF中断类似于USB中断,可以利用自动向量化。
表4
页上的图6示出了
对于14 FIFO / GPIF优先级和INT4VEC值中断源。
文件编号: 38-08032牧师* N
第62 5
[+ ]反馈
CY7C68013A , CY7C68014A
CY7C68015A , CY7C68016A
EZ- USB FX2LP USB微控制器
高速USB外设控制器
1.特点( CY7C68013A / 14A / 15A / 16A )
USB 2.0 USB IF高速认证( TID # 40460272 )
单芯片集成了USB 2.0收发器,智能SIE和
增强型8051微处理器
飞度,形式和功能与FX2兼容
引脚兼容
目标代码兼容
功能兼容( FX2LP是一个超集)
超低功耗:我
CC
不超过85毫安在任何模式
理想的公交车和电池供电应用
软件: 8051代码运行:
内部RAM,它可通过USB下载
内部RAM中,它是从EEPROM加载
外部存储设备( 128引脚封装)
片上代码/数据RAM 16千字节
四个可编程批量/中断/ ISOCHRONOUS
ENDPOINTS
缓冲选项:双人间,三人间和四
其他可编程(批量/中断) 64字节
终点
8位或16位外部数据接口
智能媒体标准的ECC生成
GPIF (通用可编程接口)
可直接连接到大多数并行接口
可编程波形描述符和配置
寄存器定义波形
支持多种就绪( RDY )输入和控制( CTL )
输出
整合,行业标准的增强型8051
48兆赫, 24兆赫,或12 MHz的CPU操作
每个指令周期四个时钟
两个USART
三个计数器/定时器
扩展的中断系统
两个数据指针
3.3V操作与5V容限输入
矢量USB中断和GPIF / FIFO中断
单独的数据缓冲器的设置和数据部分
控制权转移
集成I
2
C控制器,运行在100或400千赫
四个集成的FIFO
集成胶合逻辑和FIFO降低系统的成本
自动转换到和从16位总线
主机或从机操作
使用外部时钟或异步闪光
轻松连接到ASIC和DSP芯片
可在商用和工业温度级
(除VFBGA所有包)
赛普拉斯半导体公司
文件编号: 38-08032牧师* M
198冠军苑
圣荷西
,
CA 95134-1709
408-943-2600
修订后的2009年5月22日
[+ ]反馈
CY7C68013A , CY7C68014A
CY7C68015A , CY7C68016A
逻辑框图
24兆赫
分机。 XTAL
高性能微
使用标准工具
低功耗选项
地址( 16 )
数据( 8 )
FX2LP
地址( 16 ) /数据总线( 8 )
VCC
x20
PLL
/0.5
/1.0
/2.0
8051核心
12/24/48兆赫,
四个时钟/周期
额外的I / O ( 24 )
I
2
C
1.5k
用于连接
全速
D+
D–
集成
全速
高速
XCVR
USB
2.0
XCVR
CY
灵巧
USB
1.1/2.0
发动机
16 KB
内存
丰富的I / O
包括两个USART
一般
可编程I / F
到ASIC / DSP或公交
如标准
ATAPI ,EPP等
ADDR (9)
GPIF
ECC
RDY ( 6 )
的CTL (6)
4 KB
FIFO
8/16
高达96兆字节/秒
爆率
增强型的USB核心
简化代码8051
“软配置”
简单的固件更新
FIFO和端点内存
(主机或从机操作)
1.1特性( CY7C68013A / 14A只)
CY7C68014A :适合电池供电应用
挂起电流: 100
μA
(典型值)
CY7C68013A :适合非电池供电应用
挂起电流: 300
μA
(典型值)
提供五种无铅封装,高达40个GPIO
128引脚TQFP封装( 40个GPIO ) , 100引脚TQFP ( 40个GPIO ) , 56针
QFN ( 24个GPIO ) , 56引脚SSOP ( 24个GPIO ) ,以及56引脚VF-
BGA ( 24个GPIO )
赛普拉斯创造了一个符合成本效益的解决方案,提供
卓越的时间将产品推向市场的优势低功耗,使
总线供电的应用。
FX2LP导致数据传输的巧妙架构
每秒53兆字节的速率,最大允许
USB 2.0的带宽,同时还采用低成本8051微
控制器中的一个包,小到一个56 VFBGA (5毫米× 5毫米)的。
因为它采用了USB 2.0收发器,该FX2LP是
更经济,提供比小尺寸解决方案
USB 2.0 SIE或外部收发器实现。同
EZ -USB FX2LP ,赛普拉斯智能SIE处理大部分的
USB 1.1和2.0的硬件协议,释放内嵌
微控制器应用的特定功能,降低
显影时间,以确保USB兼容性问题。
通用可编程接口( GPIF )和主/从
端点FIFO (8位或16位数据总线)提供了一种简单和
无缝连接流行的接口,比如ATA , UTOPIA ,
EPP ,PCMCIA和大多数DSP /处理器。
在FX2LP吸引更小的电流比FX2 ( CY7C68013 ) ,有
两倍的片上代码/数据RAM,以及嵌合,形式和功能
同56 ,100,和128引脚FX2兼容。
五包被定义为家庭: 56VFBGA , 56 SSOP ,
56 QFN , TQFP 100和128 TQFP 。
1.2特性( CY7C68015A / 16A只)
CY7C68016A :适合电池供电应用
挂起电流: 100
μA
(典型值)
CY7C68015A :适合非电池供电应用
挂起电流: 300
μA
(典型值)
可提供无铅56引脚QFN封装( 26个GPIO )
两个比CY7C68013A / 14A启用附加更多的GPIO
在相同的空间功能
Cypress的EZ -USB FX2LP ( CY7C68013A / 14A )是一款低功耗
版本的EZ -USB FX2 ( CY7C68013 ) ,哪是一个高度
集成的低功耗USB 2.0微控制器。通过积分
USB2.0收发器,串行接口引擎(SIE ),增强型
8051微控制器和可编程的外围接口
在单个芯片中,
文件编号: 38-08032牧师* M
第62 2
[+ ]反馈
CY7C68013A , CY7C68014A
CY7C68015A , CY7C68016A
2.应用
图1.晶体结构
C1
12 pF的
24兆赫
C2
12 pF的
便携式视频录像机
MPEG / TV转换
DSL调制解调器
ATA接口
存储卡读卡器
传统的转换装置
相机
扫描仪
首页PNA
无线局域网
MP3播放器
联网
20 × PLL
12 pF的电容值,假设一丝电容
每边3 pF的上一个4层FR4的PCA
CLKOUT引脚,可以三态和反转用
内部控制比特,输出50%的占空比时钟8051 ,在
选择8051的时钟频率: 48 MHz时, 24兆赫,或12兆赫。
3.2.2个USART
FX2LP包含两个标准的8051个USART ,通过解决
特殊功能寄存器( SFR )位。该USART接口引脚
可在单独的I / O引脚,并且不与复
端口引脚。
UART0和UART1可以使用在内部时钟运行
230波特不超过1%的波特率误差。 230波特
操作由内部派生时钟源来实现这
产生溢出脉冲在适当的时候。内部
时钟调整为8051时钟速率( 48兆赫, 24兆赫,并
12兆赫) ,使得它总是呈现正确的频率为
230波特操作。
[1]
3.2.3特殊功能寄存器
某些8051 SFR地址以便能快速
进入关键的FX2LP功能。这些添加的SFR
所示
表1
第4页粗体字表示不标准,
增强型8051寄存器。以“ 0 ”结尾的两个SFR行
和“8”包含位寻址寄存器。这四个I / O端口A到
D使用在标准8051中用于端口0的SFR地址
3 ,这在FX2LP不落实。由于快
和更有效的SFR寻址, FX2LP的I / O端口都没有
寻址在外部RAM空间(用MOVX
指令)。
的“参考设计”部分
赛普拉斯网站
为典型的USB 2.0应用程序的其他工具。每
参考设计都包含固件的源和
目标代码,原理图和文档。访问
www.cypress.com
了解更多信息。
3.功能概述
3.1 USB信号传输速度
FX2LP工作在两点USB定义的三种速率
规范2.0版,日期为2000年4月27日:
全程高速,与12 Mbps的信号比特率
高的速度,以480 Mbps的信令比特率。
FX2LP不支持低速信令模式
1.5 Mbps的。
3.2 8051微处理器
8051微处理器嵌入到FX2LP系列有
256字节的寄存器RAM ,扩展的中断系统,三
定时器/计数器和两个USART 。
3.2.1 8051时钟频率
FX2LP具有使用一个外部的片上振荡器电路
24兆赫( ± 100ppm以下)的结晶,具有以下特点:
3.3 I
2
C总线
FX2LP支持我
2
C总线作为主只在100/400千赫。
SCL和SDA引脚具有开漏输出和滞后
输入。这些信号必须被拉高至3.3V,即使没有我
2
C
设备连接。
并联谐振
基本模式
500
μW
驱动电平
12 pF的( 5 %容差)负载电容
3.4巴士
所有封装, 8位或16位的“先进先出”的双向数据总线,多
路开关连接的I / O端口B和D. 128引脚封装:将16位
只输出8051的地址总线, 8位双向数据总线。
片上PLL倍频24 MHz振荡器高达480兆赫,
所要求的收发器/ PHY和内部计数器分频
下来用作8051时钟。默认的8051时钟
频率是12 MHz 。 8051的时钟频率可以是
通过CPUCS寄存器由8051变,动态。
1. 115波特的操作,也可以通过分别编程8051 SMOD0或SMOD1位为“1 ”为UART0 , UART1 ,或两者兼而有之。
文件编号: 38-08032牧师* M
第62 3
[+ ]反馈
CY7C68013A , CY7C68014A
CY7C68015A , CY7C68016A
表1.特殊功能寄存器
x
0
1
2
3
4
5
6
7
8
9
A
B
C
D
E
F
8x
IOA
SP
DPL0
DPH0
DPL1
DPH1
DPS
PCON
TCON
TMOD
TL0
TL1
TH0
TH1
CKCON
9x
IOB
EXIF
MPAGE
Ax
国际奥林匹克委员会
INT2CLR
INT4CLR
Bx
IOD
IOE
OEA
OEB
OEC
OED
OEE
IP
EP01STAT
GPIFTRIG
GPIFSGLDATH
GPIFSGLDATLX
GPIFSGLDATLNOX
T2CON
RCAP2L
RCAP2H
TL2
TH2
EICON
EIE
EIP
Cx
SCON1
SBUF1
Dx
PSW
Ex
Fx
B
SCON0
SBUF0
AUTOPTRH1
AUTOPTRL1
版权所有
AUTOPTRH2
AUTOPTRL2
版权所有
IE
EP2468STAT
EP24FIFOFLGS
EP68FIFOFLGS
AUTOPTRSET -UP
3.5 USB启动方法
在上电时序,内部逻辑会检查我
2
端口C
对于EEPROM的联系,它的第一个字节为0xC0
或为0xC2 。如果找到了,它使用的VID / PID / EEPROM中DID值
代替内部存储的值(为0xC0 ) ,或者在引导加载的
EEPROM的内容到内部RAM ( 0xC2的) 。如果没有EEPROM是
检测, FX2LP列举了使用内部存储的描述符。
对于FX2LP的默认ID值VID / PID / DID ( 0x04B4 ,
0x8613 , 0xAxxx其中xxx =芯片版本) 。
[2]
表2.默认ID值FX2LP
供应商ID
产品编号
设备版本
默认VID / PID / DID
0x04B4赛普拉斯半导体
0x8613 EZ -USB FX2LP
0xAnnn取决于芯片版本
( NNN =芯片版本,其中第一
硅= 001 )
在USBCS两个控制位( USB控制和状态)注册,
控制的薪酬流程: DISCON和RENUM 。对
模拟USB断开,固件设置DISCON为1。
重新连接,固件将DISCON为0 。
重新连接前,固件设置或清除RENUM位
表明是否固件或默认的USB设备
处理设备的请求通过端点零:如果RENUM = 0,则
默认的USB设备处理设备请求;如果RENUM = 1,则
固件服务该请求。
3.7总线供电应用
该FX2LP完全支持总线供电设计,通过枚举
少于100毫安所要求的USB 2.0规范。
3.8中断系统
3.8.1 INT2中断请求和使能寄存器
FX2LP针对INT2和INT4自动向量化功能。
有27 INT2 ( USB )载体,和14 INT4 ( FIFO / GPIF )
向量。看到EZ -USB技术参考手册( TRM )的
更多的细节。
3.8.2 USB中断Autovectors
主要的USB中断由27个中断源共享。对
保存时所需的识别码和处理时间
单个USB中断源时, FX2LP提供了第二
中断向量的水平,被称为自动向量化。当USB
中断断言, FX2LP会将程序计数器
它的堆栈,然后跳转到地址0x0043 ,其中,预计
找到一个“跳”的指令到USB中断服务程序。
3.6的薪酬
由于FX2LP的配置是软的,一个芯片可以采取
的多个不同的USB设备的身份。
当第一次插入USB时, FX2LP列举automati-
在美云和下载固件和USB描述符表
USB连接线。接下来, FX2LP再次枚举,此时如
由下载的信息所限定的设备。这项专利
2所谓的薪酬步骤的过程立即发生时,
该设备插入时,没有一丝的初始下载
已经发生的一步。
2.我
2
C总线的SCL和SDA引脚必须上拉,即使EEPROM未连接。否则,这种检测方法不能正常工作。
文件编号: 38-08032牧师* M
第62 4
[+ ]反馈
CY7C68013A , CY7C68014A
CY7C68015A , CY7C68016A
在FX2LP跳转指令编码如下:
表3. INT2 USB中断
USB中断表INT2
优先
1
2
3
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5
6
7
8
9
10
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20
21
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31
32
INT2VEC价值
00
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5C
60
64
68
6C
70
74
78
7C
EP2ISOERR
EP4ISOERR
EP6ISOERR
EP8ISOERR
版权所有
版权所有
ISO EP2 OUT PID顺序错误
ISO EP4 OUT PID顺序错误
ISO EP6 OUT PID顺序错误
ISO EP8 OUT PID顺序错误
EP0PING
EP1PING
EP2PING
EP4PING
EP6PING
EP8PING
ERRLIMIT
EP0-IN
EP0-OUT
EP1-IN
EP1-OUT
EP2
EP4
EP6
EP8
IBN
SUDAV
SOF
SUTOK
暂停
USB复位
HISPEED
EP0ACK
来源
可设置数据
帧起始(或微帧)
SETUP令牌接收
USB挂起的请求
总线复位
进入高速运行
FX2LP ACK'd的控制握手
版权所有
EP0 -IN准备加载数据
EP0 -OUT有USB数据
EP1 -IN准备加载数据
EP1 -OUT有USB数据
IN:可用缓冲区。 OUT :缓冲区有数据
IN:可用缓冲区。 OUT :缓冲区有数据
IN:可用缓冲区。 OUT :缓冲区有数据
IN:可用缓冲区。 OUT :缓冲区有数据
IN-批量NAK (任何端点)
版权所有
EP0 OUT被ping它NAK'd
EP1 OUT被ping它NAK'd
EP2 OUT被ping它NAK'd
EP4 OUT被ping它NAK'd
EP6 OUT被ping它NAK'd
EP8 OUT被ping它NAK'd
总线错误超过设定的限制
笔记
如果是自动向量化启用(在INTSET -UP寄存器AV2EN = 1 )时, FX2LP会替换其INT2VEC字节。因此,如果高
字节(“页” )的跳转表地址预装在该位置0x0044 ,在0x0045自动插入INT2VEC字节
跳转到正确的地址了27个地址的页面中。
3.8.3 FIFO / GPIF中断( INT4 )
正如USB中断由27个独立的USB中断源共享的FIFO / GPIF中断由14个独立的共享
FIFO / GPIF源。该FIFO / GPIF中断,如USB中断,可以利用自动向量化。
表4
第6页上显示的优先级
而对于14 FIFO / GPIF INT4VEC值中断源。
文件编号: 38-08032牧师* M
第62 5
[+ ]反馈
CY7C68013A/CY7C68014A
CY7C68015A/CY7C68016A
EZ- USB FX2LP USB微控制器
1.0
特点( CY7C68013A / 14A / 15A / 16A )
USB 2.0 , USB -IF高速认证( TID # 40440111 )
单芯片集成了USB 2.0收发器,智能SIE ,
而增强型8051微处理器
飞度,形式和功能与FX2兼容
- 引脚兼容
- 目标代码兼容
- 功能兼容( FX2LP是一个超集)
超低功耗:我
CC
不超过85毫安在任何模式
- 非常总线和电池供电应用
软件: 8051代码运行:
- 内部RAM,它通过USB下载
- 内部RAM中,它是从EEPROM加载
- 外部存储设备( 128引脚封装)
片上码16千字节/数据RAM
四个可编程批量/中断/等时
NOUS终点
- 缓冲选项:双人间,三人间和四
其他可编程(批量/中断) 64字节
终点
8位或16位外部数据接口
智能媒体标准ECC代
GPIF (通用可编程接口)
- 可直接连接到大多数并行接口
- 可编程的波形描述符和组态
配给寄存器定义波形
- 支持多种就绪( RDY )输入和控制
( CTL )输出
24兆赫
分机。 XTAL
高性能的微
使用标准工具
低功耗选项
地址( 16 )
集成的,符合行业标准的增强型8051
- 48兆赫,24兆赫或12兆赫的CPU操作
- 每个指令周期四个时钟
- 两个USART
- 三个计数器/定时器
- 扩展的中断系统
- 两个数据指针
3.3V操作与5V容限输入
矢量USB中断和GPIF / FIFO中断
另有数据缓冲区的设置和数据部分
CONTROL传输
集成I
2
C控制器,运行在100或400千赫
四个集成的FIFO
- 集成胶合逻辑和FIFO降低系统成本
- 自动转换到和从16位总线
- 主机或从机操作
- 使用外部时钟或异步闪光
- 轻松连接到ASIC和DSP芯片
1.1
特点( CY7C68013A / 14A只)
CY7C68014A :适合于电池供电的应用
- 挂起电流: 100
A
(典型值)
CY7C68013A :适合非电池供电应用
系统蒸发散
- 挂起电流: 300
A
(典型值)
有四种无铅封装多达40个GPIO
- 128引脚TQFP封装( 40个GPIO ) , 100引脚TQFP ( 40个GPIO )
56引脚QFN封装( 24个GPIO )和56引脚SSOP ( 24个GPIO )
数据( 8 )
FX2LP
地址( 16 ) /数据总线( 8 )
VCC
x20
PLL
/0.5
/1.0
/2.0
8051核心
12/24/48兆赫,
四个时钟/周期
I
2
C
额外的I / O ( 24 )
1.5k
用于连接
全速
D+
D–
集成
全速和高速
XCVR
USB
2.0
XCVR
CY
灵巧
USB
1.1/2.0
发动机
16 KB
内存
丰富的I / O
包括两个USART
一般
可编程I / F
到ASIC / DSP或公交
如标准
ATAPI ,EPP等
ADDR (9)
GPIF
ECC
RDY ( 6 )
的CTL (6)
4 KB
FIFO
8/16
高达96兆字节/秒
爆率
增强型的USB核心
简化代码8051
“软配置”
简单的固件更新
FIFO和端点内存
(主机或从机操作)
图1-1 。框图
赛普拉斯半导体公司
文件编号: 38-08032牧师* G
3901北一街
圣荷西
,
CA 95134
408-943-2600
修订后的2005年2月1日
CY7C68013A/CY7C68014A
CY7C68015A/CY7C68016A
1.2
特点( CY7C68015A / 16A只)
一个简单而无缝连接流行的接口,如
ATA , UTOPIA , EPP ,PCMCIA和大多数DSP /处理器。
在FX2LP绘制方法比FX2较少的电流
( CY7C68013 ) ,具有双芯片上的代码/数据RAM,可
配合,形式和功能与56- , 100-兼容, 128
引脚FX2 。
四包定义为家庭: 56 SSOP , 56 QFN ,
100 TQFP和128 TQFP 。
CY7C68016A :适合于电池供电的应用
- 挂起电流: 100
A
(典型值)
CY7C68015A :适合非电池供电应用
系统蒸发散
- 挂起电流: 300
A
(典型值)
提供无铅56引脚QFN封装( 26个GPIO )
- 2比CY7C68013A / 14A以上的GPIO使额外
在相同的占位面积tional功能
赛普拉斯半导体公司( Cypress的) EZ- USB
FX2LP ( CY7C68013A / 14A )是一款低功耗版本
EZ- USB FX2 ( CY7C68013 ) ,这是一种高度集成的,
低功耗USB 2.0微控制器。通过集成的USB 2.0
收发器,串行接口引擎(SIE) ,增强型8051
微控制器,并在一个可编程的外围接口
单芯片,赛普拉斯已经创建了一个极具成本效益的解决方案
提供卓越的时间将产品推向市场的优势,低
动力,使总线供电的应用。
FX2LP导致数据传输的巧妙架构
超过每秒53兆字节的速率,最大允许
USB 2.0的带宽,而仍然使用低成本的8051微
控制器中的一个包,小到一个56的QFN 。因为其纳入
利率USB 2.0收发器,该FX2LP是更经济,
提供比USB更小的占位面积的解决方案2.0 SIE或
外部收发器实现。随着EZ -USB FX2LP ,
赛普拉斯智能SIE处理大多数的USB 1.1和2.0
协议在硬件中,释放的嵌入式微控制器
应用程序特定的功能,降低开发
时间,以确保USB兼容性问题。
通用可编程接口( GPIF )和
主/从端点FIFO ( 8位或16位数据总线)提供
2.0
应用
便携式录像机
MPEG / TV转换
DSL调制解调器
ATA接口
内存卡读卡器
传统转换装置
相机
扫描仪
主页PNA
无线局域网
MP3播放器
联网
赛普拉斯网站的“参考设计”部分
为典型的USB 2.0应用程序的其他工具。每
参考设计都包含固件的源和
目标代码,原理图和文档。请访问
http://www.cypress.com获取更多信息。
文件编号: 38-08032牧师* G
第55 2
CY7C68013A/CY7C68014A
CY7C68015A/CY7C68016A
3.0
3.1
功能概述
USB信号传输速度
CLKOUT引脚,可三态和倒
使用内部的控制位,输出占空比为50% 8051
时钟,在选择的8051时钟频率48 ,24,或12
兆赫。
3.2.2
个USART
FX2LP工作在两点USB定义的三种速率
规范2.0版,日期为2000年4月27日:
全速,与12 Mbps的信号比特率
高速, 480 Mbps的信号的比特率。
FX2LP不支持低速信令模式
1.5 Mbps的。
FX2LP包含两个标准的8051个USART ,通过解决
特殊功能寄存器( SFR )位。该USART接口
引脚可以使用单独的I / O引脚,并且不是多
路开关连接用端口引脚。
UART0和UART1可以使用在内部时钟运行
230波特不超过1%的波特率误差。 230 - 波特
操作由内部派生时钟源来实现这
产生溢出脉冲在适当的时候。该
内部时钟调整为8051时钟速率( 48 , 24 , 12兆赫)
使得它总是呈现正确的频率为230-
波特操作。
[1]
3.2.3
特殊功能寄存器
3.2
8051微处理器
8051微处理器嵌入到FX2LP系列有
256字节的寄存器RAM,扩展的中断系统,
三个定时/计数器和两个USART 。
3.2.1
8051时钟频率
FX2LP具有使用一个外部的片上振荡器电路
24兆赫( ±100 ppm的)晶体具有以下特征:
并联谐振
基本模式
500 μW驱动电平
12 pF的( 5 %容差)负载电容。
片上PLL倍频24 MHz振荡器来
480 MHz时,所要求的收发器/物理层,并且内部
柜台分下来用作8051时钟。默认
8051的时钟频率是12 MHz 。的时钟频率
8051可由8051通过CPUCS改变
登记,动态。
C1
12 pF的
24兆赫
C2
12 pF的
某些8051 SFR地址以便能快速
进入关键的FX2LP功能。这些添加的SFR
所示
表3-1 。
黑体字表示非标,
增强型8051寄存器。以“ 0 ”结尾的两个SFR行
和“8”包含位寻址寄存器。这四个I / O端口
A-D使用了标准的8051使用的SFR地址
端口0-3 ,其未在FX2LP实现。由于
更快,更高效的SFR寻址, FX2LP I / O
端口不会在外部RAM空间寻址(使用
MOVX指令) 。
3.3
I
2
C总线
FX2LP支持我
2
C总线作为主只在100- / 400千赫。
SCL和SDA引脚具有开漏输出和滞后
输入。这些信号必须被拉高至3.3V,即使没有我
2
C
设备连接。
3.4
20 × PLL
巴士
所有封装: 8位或16位的“先进先出”的双向数据总线,多
路开关连接的I / O端口B和D. 128引脚封装:将16位
只输出8051的地址总线, 8位双向数据总线。
12 pF的电容值,假设一丝电容
每边3 pF的上一个4层FR4的PCA
图3-1 。晶体结构
注意:
1. 115波特的操作也可以通过,程序8051 SMOD0或SMOD1位为“1 ”为UART0和/或UART1分别。
文件编号: 38-08032牧师* G
第55 3
CY7C68013A/CY7C68014A
CY7C68015A/CY7C68016A
表3-1 。特殊功能寄存器
x
0
1
2
3
4
5
6
7
8
9
A
B
C
D
E
F
8x
IOA
SP
DPL0
DPH0
DPL1
DPH1
DPS
PCON
TCON
TMOD
TL0
TL1
TH0
TH1
CKCON
SCON0
SBUF0
AUTOPTRH1
AUTOPTRL1
版权所有
AUTOPTRH2
AUTOPTRL2
版权所有
AUTOPTRSET -UP
EP2468STAT
EP24FIFOFLGS
EP68FIFOFLGS
GPIFSGLDATH
GPIFSGLDATLX
GPIFSGLDATLNOX
RENUM 。为了模拟USB断开,固件套
DISCON 1。要重新连接,固件将DISCON为0 。
重新连接前,固件设置或清除RENUM
位表明是否固件或默认的USB设备
将处理设备请求通过端点零:如果RENUM = 0 ,
在默认的USB设备将处理装置的要求;如果RENUM
= 1时,将固件。
EP01STAT
GPIFTRIG
RCAP2L
RCAP2H
TL2
TH2
IE
IP
T2CON
EICON
EIE
EIP
9x
IOB
EXIF
MPAGE
Ax
国际奥林匹克委员会
INT2CLR
INT4CLR
Bx
IOD
IOE
OEA
OEB
OEC
OED
OEE
Cx
SCON1
SBUF1
Dx
PSW
Ex
Fx
B
3.5
USB启动方法
在上电序列,内部逻辑会检查我
2
C
接口的EEPROM连接的第一个字节是
无论是为0xC0或0xC2的。如果找到了,它使用的VID / PID / DID值
在代替内部存储的值的EEPROM (为0xC0 )
或者在引导加载EEPROM中的内容到内部RAM
(为0xC2 ) 。如果没有检测到EEPROM , FX2LP列举使用
内部存储的描述符。对于FX2LP的默认ID值
是VID / PID / DID ( 0x04B4 , 0x8613 , 0xAxxx其中xxx =芯片
修订版) 。
[2]
表3-2 。默认ID值FX2LP
供应商ID
产品编号
设备版本
默认VID / PID / DID
0x04B4赛普拉斯半导体
0x8613 EZ -USB FX2LP
0xAnnn取决于芯片版本
( NNN =芯片版本,其中第一
硅= 001 )
3.7
总线供电应用
该FX2LP完全支持总线供电设计,用enumer-
少于百毫安阿婷根据需要由USB 2.0试样
科幻阳离子。
3.8
3.8.1
中断系统
INT2中断请求和使能寄存器
3.6
的薪酬
FX2LP针对INT2和INT4自动向量化功能。
有27 INT2 ( USB )载体,和14 INT4 ( FIFO / GPIF )
向量。见EZUSB技术参考手册( TRM )的
更多的细节。
3.8.2
USB-中断Autovectors
由于FX2LP的配置是软的,一个芯片可以采取
上的多个不同的USB设备的身份。
当第一次插入USB时, FX2LP列举automat-
在ically和下载固件和USB描述符表
USB连接线。接下来, FX2LP再次枚举,这一次
如通过下载的信息所限定的设备。这
专利的两步过程,称为ReNumeration ,发生
瞬间,当设备插入时,没有一丝的
发生的初始下载的一步。
在USBCS两个控制位( USB控制和状态)
寄存器控制的薪酬流程: DISCON和
主要的USB中断由27个中断源共享。对
保存代码和处理时间一般会是
来识别各个USB中断源所需的
FX2LP提供中断矢量的第二个层次,所谓的
自动向量化。当USB中断后,可将FX2LP
把程序计数器到其堆栈中,然后跳转到
地址0x0043 ,它希望找到一个“跳”的指令
在USB中断服务程序。
注意:
2.
在我
2
C总线的SCL和SDA引脚必须上拉,即使EEPROM未连接。否则,这种检测方法不能正常工作。
文件编号: 38-08032牧师* G
第55 4
CY7C68013A/CY7C68014A
CY7C68015A/CY7C68016A
在FX2LP跳转指令编码如下。
表3-3 。 INT2 USB中断
USB中断表INT2
优先
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
INT2VEC价值
00
04
08
0C
10
14
18
1C
20
24
28
2C
30
34
38
3C
40
44
48
4C
50
54
58
5C
60
64
68
6C
70
74
78
7C
EP2ISOERR
EP4ISOERR
EP6ISOERR
EP8ISOERR
版权所有
版权所有
ISO EP2 OUT PID顺序错误
ISO EP4 OUT PID顺序错误
ISO EP6 OUT PID顺序错误
ISO EP8 OUT PID顺序错误
3.8.3
FIFO / GPIF中断( INT4 )
EP0PING
EP1PING
EP2PING
EP4PING
EP6PING
EP8PING
ERRLIMIT
EP0-IN
EP0-OUT
EP1-IN
EP1-OUT
EP2
EP4
EP6
EP8
IBN
SUDAV
SOF
SUTOK
暂停
USB复位
HISPEED
EP0ACK
来源
建立可用数据
帧起始(或微帧)
建立标记处收到
USB挂起的请求
总线复位
进入高速运行
FX2LP ACK'd的控制握手
版权所有
EP0 -IN准备加载数据
EP0 -OUT有USB数据
EP1 -IN准备加载数据
EP1 -OUT有USB数据
IN:可用缓冲区。 OUT :缓冲区有数据
IN:可用缓冲区。 OUT :缓冲区有数据
IN:可用缓冲区。 OUT :缓冲区有数据
IN:可用缓冲区。 OUT :缓冲区有数据
IN-批量NAK (任何端点)
版权所有
EP0 OUT被ping它NAK'd
EP1 OUT被ping它NAK'd
EP2 OUT被ping它NAK'd
EP4 OUT被ping它NAK'd
EP6 OUT被ping它NAK'd
EP8 OUT被ping它NAK'd
总线错误超过设定的限制
笔记
如果是自动向量化启用( AV2EN = 1的INTSET -UP
寄存器),则FX2LP替换其INT2VEC字节。因此,
如果一个跳转表地址的高字节( “页” )预装
在位置0x0044时,自动插入INT2VEC字节
在0x0045将直接跳转到正确的地址出来的
在页面内27个地址。
正如USB中断由27个独立的共享USB-
中断源时,FIFO / GPIF中断14个共享
个别FIFO / GPIF源。该FIFO / GPIF中断,如
USB中断,可以利用自动向量化。
表3-4
节目
为14 FIFO / GPIF的优先级和INT4VEC值
中断源。
文件编号: 38-08032牧师* G
第55 5
CY7C68013A/CY7C68014A
CY7C68015A/CY7C68016A
EZ- USB FX2LP USB微控制器
1.0
特点( CY7C68013A / 14A / 15A / 16A )
USB 2.0 , USB -IF高速认证( TID # 40440111 )
单芯片集成了USB 2.0收发器,智能SIE ,
而增强型8051微处理器
飞度,形式和功能与FX2兼容
- 引脚兼容
- 目标代码兼容
- 功能兼容( FX2LP是一个超集)
超低功耗:我
CC
不超过85毫安在任何模式
- 非常总线和电池供电应用
软件: 8051代码运行:
- 内部RAM,它通过USB下载
- 内部RAM中,它是从EEPROM加载
- 外部存储设备( 128引脚封装)
片上码16千字节/数据RAM
四个可编程批量/中断/等时
NOUS终点
- 缓冲选项:双人间,三人间和四
其他可编程(批量/中断) 64字节
终点
8位或16位外部数据接口
智能媒体标准ECC代
GPIF (通用可编程接口)
- 可直接连接到大多数并行接口
高性能的微
使用标准工具
低功耗选项
- 可编程的波形描述符和组态
配给寄存器定义波形
- 支持多种就绪( RDY )输入和控制
( CTL )输出
集成的,符合行业标准的增强型8051
- 48兆赫,24兆赫或12兆赫的CPU操作
- 每个指令周期四个时钟
- 两个USART
- 三个计数器/定时器
- 扩展的中断系统
- 两个数据指针
具有5V容限输入3.3V操作
向量化的USB中断和GPIF / FIFO中断
独立的数据缓冲区的设置和数据部分
CONTROL传输
- 集成I
2
C控制器,运行在100或400千赫
四个集成的FIFO
- 集成胶合逻辑和FIFO降低系统成本
- 自动转换到和从16位总线
- 主机或从机操作
- 使用外部时钟或异步闪光
- 轻松连接到ASIC和DSP芯片
可在商用和工业温度
等级(除VFBGA所有包)
24兆赫
分机。 XTAL
地址( 16 )
数据( 8 )
FX2LP
地址( 16 ) /数据总线( 8 )
VCC
x20
PLL
/0.5
/1.0
/2.0
8051核心
12/24/48兆赫,
四个时钟/周期
I
2
C
额外的I / O ( 24 )
1.5k
用于连接
全速
D+
D–
集成
全速和高速
XCVR
USB
2.0
XCVR
CY
灵巧
USB
1.1/2.0
发动机
16 KB
内存
丰富的I / O
包括两个USART
一般
可编程I / F
到ASIC / DSP或公交
如标准
ATAPI ,EPP等
ADDR (9)
GPIF
ECC
RDY ( 6 )
的CTL (6)
4 KB
FIFO
8/16
高达96兆字节/秒
爆率
增强型的USB核心
简化代码8051
“软配置”
简单的固件更新
FIFO和端点内存
(主机或从机操作)
图1-1 。框图
赛普拉斯半导体公司
文件编号: 38-08032牧师* K
198冠军苑
圣荷西
,
CA 95134-1709
408-943-2600
修订后的2006年1月26日
[+ ]反馈
CY7C68013A/CY7C68014A
CY7C68015A/CY7C68016A
1.1
特点( CY7C68013A / 14A只)
CY7C68014A :适合于电池供电的应用
- 挂起电流: 100
A
(典型值)
CY7C68013A :适合非电池供电应用
系统蒸发散
- 挂起电流: 300
A
(典型值)
提供五种无铅封装多达40个GPIO
- 128引脚TQFP封装( 40个GPIO ) , 100引脚TQFP ( 40个GPIO )
56引脚QFN封装( 24个GPIO ) , 56引脚SSOP ( 24个GPIO ) ,以及
56引脚VFBGA ( 24个GPIO )
EZ -USB FX2LP ,赛普拉斯智能SIE处理大部分的
USB 1.1和2.0的硬件协议,释放内嵌
微控制器的应用程序特定的功能和
减少开发时间,以确保USB兼容性问题。
通用可编程接口( GPIF )和
主/从端点FIFO ( 8位或16位数据总线)提供
一个简单而无缝连接流行的接口,如
ATA , UTOPIA , EPP ,PCMCIA和大多数DSP /处理器。
在FX2LP绘制方法比FX2较少的电流
( CY7C68013 ) ,具有双芯片上的代码/数据RAM,可
配合,形式和功能与56- , 100-兼容,
128引脚FX2 。
五包被定义为家庭: 56VFBGA , 56 SSOP ,
56 QFN , TQFP 100和128 TQFP 。
1.2
特点( CY7C68015A / 16A只)
CY7C68016A :适合于电池供电的应用
- 挂起电流: 100
A
(典型值)
CY7C68015A :适合非电池供电应用
系统蒸发散
- 挂起电流: 300
A
(典型值)
提供无铅56引脚QFN封装( 26个GPIO )
- 2比CY7C68013A / 14A以上的GPIO使额外
在相同的占位面积tional功能
赛普拉斯半导体公司( Cypress的) EZ- USB
FX2LP ( CY7C68013A / 14A )是一款低功耗版本
EZ- USB FX2 ( CY7C68013 ) ,这是一种高度集成的,
低功耗USB 2.0微控制器。通过集成的USB 2.0
收发器,串行接口引擎(SIE) ,增强型8051
微控制器,并在一个可编程的外围接口
单芯片,赛普拉斯已经创建了一个极具成本效益的解决方案
提供卓越的时间将产品推向市场的优势,低
动力,使总线供电的应用。
FX2LP导致数据传输的巧妙架构
超过每秒53兆字节的速率,最大允许
USB 2.0的带宽,而仍然使用低成本的8051微
控制器在一个封装小56 VFBGA (采用5mm x 5mm ) 。
因为它采用了USB 2.0收发器,该FX2LP是
更经济,提供比小尺寸解决方案
USB 2.0 SIE或外部收发器实现。同
2.0
应用
便携式录像机
MPEG / TV转换
DSL调制解调器
ATA接口
内存卡读卡器
传统转换装置
相机
扫描仪
主页PNA
无线局域网
MP3播放器
联网
赛普拉斯网站的“参考设计”部分
为典型的USB 2.0应用程序的其他工具。每
参考设计都包含固件的源和
目标代码,原理图和文档。请访问
http://www.cypress.com获取更多信息。
文件编号: 38-08032牧师* K
第60页2
[+ ]反馈
CY7C68013A/CY7C68014A
CY7C68015A/CY7C68016A
3.0
3.1
功能概述
USB信号传输速度
CLKOUT引脚,可三态和倒
使用内部的控制位,输出占空比为50% 8051
时钟,在选择的8051时钟频率48 ,24,或12
兆赫。
3.2.2
个USART
FX2LP工作在两点USB定义的三种速率
规范2.0版,日期为2000年4月27日:
全速,与12 Mbps的信号比特率
高速, 480 Mbps的信号的比特率。
FX2LP不支持低速信令模式
1.5 Mbps的。
FX2LP包含两个标准的8051个USART ,通过解决
特殊功能寄存器( SFR )位。该USART接口
引脚可以使用单独的I / O引脚,并且不是多
路开关连接用端口引脚。
UART0和UART1可以使用在内部时钟运行
230波特不超过1%的波特率误差。 230 - 波特
操作由内部派生时钟源来实现这
产生溢出脉冲在适当的时候。该
内部时钟调整为8051时钟速率( 48 , 24 , 12兆赫)
使得它总是呈现正确的频率为
230波特操作。
[1]
3.2.3
特殊功能寄存器
3.2
8051微处理器
8051微处理器嵌入到FX2LP系列有
256字节的寄存器RAM,扩展的中断系统,
三个定时/计数器和两个USART 。
3.2.1
8051时钟频率
FX2LP具有使用一个外部的片上振荡器电路
24兆赫( ±100 ppm的)晶体具有以下特征:
并联谐振
基本模式
500 μW驱动电平
12 pF的( 5 %容差)负载电容。
片上PLL倍频24 MHz振荡器来
480 MHz时,所要求的收发器/物理层,并且内部
柜台分下来用作8051时钟。默认
8051的时钟频率是12 MHz 。的时钟频率
8051可由8051通过CPUCS改变
登记,动态。
C1
12 pF的
24兆赫
C2
12 pF的
某些8051 SFR地址以便能快速
进入关键的FX2LP功能。这些添加的SFR
所示
表3-1 。
黑体字表示非标,
增强型8051寄存器。以“ 0 ”结尾的两个SFR行
和“8”包含位寻址寄存器。这四个I / O端口
A-D使用了标准的8051使用的SFR地址
端口0-3 ,其未在FX2LP实现。由于
更快,更高效的SFR寻址, FX2LP I / O
端口不会在外部RAM空间寻址(使用
MOVX指令) 。
3.3
I
2
C总线
FX2LP支持我
2
C总线作为主只在100- / 400千赫。
SCL和SDA引脚具有开漏输出和滞后
输入。这些信号必须被拉高至3.3V,即使没有我
2
C
设备连接。
3.4
20 × PLL
巴士
所有封装: 8位或16位的“先进先出”的双向数据总线,多
路开关连接的I / O端口B和D. 128引脚封装:将16位
只输出8051的地址总线, 8位双向数据总线。
12 pF的电容值,假设一丝电容
每边3 pF的上一个4层FR4的PCA
图3-1 。晶体结构
注意:
1. 115波特的操作也可以通过,程序8051 SMOD0或SMOD1位为“1 ”为UART0和/或UART1分别。
文件编号: 38-08032牧师* K
第60页3
[+ ]反馈
CY7C68013A/CY7C68014A
CY7C68015A/CY7C68016A
表3-1 。特殊功能寄存器
x
0
1
2
3
4
5
6
7
8
9
A
B
C
D
E
F
8x
IOA
SP
DPL0
DPH0
DPL1
DPH1
DPS
PCON
TCON
TMOD
TL0
TL1
TH0
TH1
CKCON
9x
IOB
EXIF
MPAGE
Ax
国际奥林匹克委员会
INT2CLR
INT4CLR
Bx
IOD
IOE
OEA
OEB
OEC
OED
OEE
SCON0
SBUF0
AUTOPTRH1
AUTOPTRL1
版权所有
AUTOPTRH2
AUTOPTRL2
版权所有
IE
EP2468STAT
EP24FIFOFLGS
EP68FIFOFLGS
IP
EP01STAT
GPIFTRIG
GPIFSGLDATH
GPIFSGLDATLX
GPIFSGLDATLNOX
T2CON
RCAP2L
RCAP2H
TL2
TH2
EICON
EIE
EIP
Cx
SCON1
SBUF1
Dx
PSW
Ex
Fx
B
AUTOPTRSET -UP
3.5
USB启动方法
在上电序列,内部逻辑会检查我
2
C
接口的EEPROM连接的第一个字节是
无论是为0xC0或0xC2的。如果找到了,它使用的VID / PID / DID值
在代替内部存储的值的EEPROM (为0xC0 )
或者在引导加载EEPROM中的内容到内部RAM
(为0xC2 ) 。如果没有检测到EEPROM , FX2LP列举使用
内部存储的描述符。对于FX2LP的默认ID值
是VID / PID / DID ( 0x04B4 , 0x8613 , 0xAxxx其中xxx =芯片
修订版) 。
[2]
表3-2 。默认ID值FX2LP
供应商ID
产品编号
设备版本
默认VID / PID / DID
0x04B4赛普拉斯半导体
0x8613 EZ -USB FX2LP
0xAnnn取决于芯片版本
( NNN =芯片版本,其中第一
硅= 001 )
RENUM 。为了模拟USB断开,固件套
DISCON 1。要重新连接,固件将DISCON为0 。
重新连接前,固件设置或清除RENUM
位表明是否固件或默认的USB设备
将处理设备请求通过端点零:如果RENUM = 0 ,
在默认的USB设备将处理装置的要求;如果RENUM
= 1时,将固件。
3.7
总线供电应用
该FX2LP完全支持总线供电设计,用enumer-
少于百毫安阿婷根据需要由USB 2.0试样
科幻阳离子。
3.8
3.8.1
中断系统
INT2中断请求和使能寄存器
3.6
的薪酬
FX2LP针对INT2和INT4自动向量化功能。
有27 INT2 ( USB )载体,和14 INT4 ( FIFO / GPIF )
向量。看到EZ -USB技术参考手册( TRM )的
更多的细节。
3.8.2
USB-中断Autovectors
由于FX2LP的配置是软的,一个芯片可以采取
上的多个不同的USB设备的身份。
当第一次插入USB时, FX2LP列举automat-
在ically和下载固件和USB描述符表
USB连接线。接下来, FX2LP再次枚举,这一次
如通过下载的信息所限定的设备。这
专利的两步过程,称为ReNumeration ,发生
瞬间,当设备插入时,没有一丝的
发生的初始下载的一步。
在USBCS两个控制位( USB控制和状态)
寄存器控制的薪酬流程: DISCON和
主要的USB中断由27个中断源共享。对
保存代码和处理时间一般会是
来识别各个USB中断源所需的
FX2LP提供中断矢量的第二个层次,所谓的
自动向量化。当USB中断后,可将FX2LP
把程序计数器到其堆栈中,然后跳转到
地址0x0043 ,它希望找到一个“跳”的指令
在USB中断服务程序。
注意:
2.
在我
2
C总线的SCL和SDA引脚必须上拉,即使EEPROM未连接。否则,这种检测方法不能正常工作。
文件编号: 38-08032牧师* K
第60页4
[+ ]反馈
CY7C68013A/CY7C68014A
CY7C68015A/CY7C68016A
在FX2LP跳转指令编码如下。
表3-3 。 INT2 USB中断
USB中断表INT2
优先
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
INT2VEC价值
00
04
08
0C
10
14
18
1C
20
24
28
2C
30
34
38
3C
40
44
48
4C
50
54
58
5C
60
64
68
6C
70
74
78
7C
EP2ISOERR
EP4ISOERR
EP6ISOERR
EP8ISOERR
版权所有
版权所有
ISO EP2 OUT PID顺序错误
ISO EP4 OUT PID顺序错误
ISO EP6 OUT PID顺序错误
ISO EP8 OUT PID顺序错误
3.8.3
FIFO / GPIF中断( INT4 )
EP0PING
EP1PING
EP2PING
EP4PING
EP6PING
EP8PING
ERRLIMIT
EP0-IN
EP0-OUT
EP1-IN
EP1-OUT
EP2
EP4
EP6
EP8
IBN
SUDAV
SOF
SUTOK
暂停
USB复位
HISPEED
EP0ACK
来源
建立可用数据
帧起始(或微帧)
建立标记处收到
USB挂起的请求
总线复位
进入高速运行
FX2LP ACK'd的控制握手
版权所有
EP0 -IN准备加载数据
EP0 -OUT有USB数据
EP1 -IN准备加载数据
EP1 -OUT有USB数据
IN:可用缓冲区。 OUT :缓冲区有数据
IN:可用缓冲区。 OUT :缓冲区有数据
IN:可用缓冲区。 OUT :缓冲区有数据
IN:可用缓冲区。 OUT :缓冲区有数据
IN-批量NAK (任何端点)
版权所有
EP0 OUT被ping它NAK'd
EP1 OUT被ping它NAK'd
EP2 OUT被ping它NAK'd
EP4 OUT被ping它NAK'd
EP6 OUT被ping它NAK'd
EP8 OUT被ping它NAK'd
总线错误超过设定的限制
笔记
如果是自动向量化启用( AV2EN = 1的INTSET -UP
寄存器),则FX2LP替换其INT2VEC字节。因此,
如果一个跳转表地址的高字节( “页” )预装
在位置0x0044时,自动插入INT2VEC字节
在0x0045将直接跳转到正确的地址出来的
在页面内27个地址。
正如USB中断由27个独立的共享
USB -中断源时,FIFO / GPIF中断共享
14个独立的FIFO / GPIF源。该FIFO / GPIF
中断,如USB中断,可以利用自动向量化。
表3-4
示为14的优先级和INT4VEC值
FIFO / GPIF中断源。
文件编号: 38-08032牧师* K
第60页5
[+ ]反馈
CY7C68013A , CY7C68014A
CY7C68015A , CY7C68016A
EZ -USB
FX2LP USB微控制器
高速USB外设控制器
EZ- USB FX2LP USB微控制器,高速USB外设控制器
特点
USB 2.0 USB IF高速认证( TID # 40460272 )
单芯片集成了USB 2.0收发器,智能SIE和
增强型8051微处理器
飞度,形式和功能与FX2兼容
引脚兼容
兼容的目标代码
功能兼容( FX2LP是一个超集)
超低功耗:我
CC
不超过85毫安在任何模式
理想的公交车和电池供电应用
软件: 8051代码运行:
内部RAM,它可通过USB下载
内部RAM中,它是从EEPROM加载
外部存储设备( 128引脚封装)
片上代码/数据RAM的16 KB
四个可编程批量,中断和
同步端点
缓冲选项:双人间,三人间和四
其他可编程(批量/中断) 64字节
终点
8位或16位外部数据接口
智能媒体标准的ECC生成
GPIF (通用可编程接口)
可直接连接到大多数并行接口
可编程波形描述符和配置
寄存器定义波形
支持多种就绪( RDY )输入和控制( CTL )
输出
整合,行业标准的增强型8051
48兆赫, 24兆赫,或12 MHz的CPU操作
每个指令周期四个时钟
两个USART
三个计数器/定时器
扩展的中断系统
两个数据指针
3.3 V工作电压为5 V容限输入
矢量USB中断和GPIF / FIFO中断
单独的数据缓冲器的设置和数据部分
控制权转移
集成I
2
C控制器,运行在100或400千赫
四个集成的FIFO
集成胶合逻辑和FIFO降低系统的成本
自动转换到和从16位总线
主机或从机操作
使用外部时钟或异步闪光
轻松连接到ASIC和DSP芯片
可在商用和工业温度级
(除VFBGA所有包)
特点( CY7C68013A / 14A只)
CY7C68014A :适合电池供电应用
挂起电流: 100
A
(典型值)
CY7C68013A :适合非电池供电应用
挂起电流: 300
A
(典型值)
提供五种无铅封装,高达40个GPIO
128引脚TQFP封装( 40个GPIO ) , 100引脚TQFP ( 40个GPIO ) , 56针
QFN ( 24个GPIO ) , 56引脚SSOP ( 24个GPIO ) ,以及56引脚
VFBGA ( 24个GPIO )
特点( CY7C68015A / 16A只)
CY7C68016A :适合电池供电应用
挂起电流: 100
A
(典型值)
CY7C68015A :适合非电池供电应用
挂起电流: 300
A
(典型值)
可提供无铅56引脚QFN封装( 26个GPIO )
两个比CY7C68013A / 14A启用附加更多的GPIO
在相同的空间功能
赛普拉斯半导体公司
文件编号: 38-08032牧师* V
198冠军苑
圣荷西
,
CA 95134-1709
408-943-2600
修订后的2012年2月7日
CY7C68013A , CY7C68014A
CY7C68015A , CY7C68016A
逻辑框图
24兆赫
分机。 XTAL
高性能微
使用标准工具
低功耗选项
地址( 16 )
数据( 8 )
FX2LP
地址( 16 ) /数据总线( 8 )
VCC
x20
PLL
/0.5
/1.0
/2.0
8051核心
12/24/48兆赫,
四个时钟/周期
I
2
C
额外的I / O ( 24 )
1.5k
用于连接
全速
D+
D–
集成
全速
高速
XCVR
USB
2.0
XCVR
CY
灵巧
USB
1.1/2.0
发动机
16 KB
内存
丰富的I / O
包括两个USART
一般
可编程I / F
到ASIC / DSP或公交
如标准
ATAPI ,EPP等
ADDR (9)
GPIF
ECC
RDY ( 6 )
的CTL (6)
4 KB
FIFO
8/16
高达96兆字节/秒
爆率
增强型的USB核心
简化代码8051
“软配置”
简单的固件更新
FIFO和端点内存
(主机或从机操作)
Cypress的EZ -USB
FX2LP ( CY7C68013A / 14A)是一个低
将EZ-USB FX2 ( CY7C68013 ),它是一个功率版本
高集成度,低功耗的USB 2.0微控制器。通过
集成USB 2.0收发器,串行接口引擎( SIE ) ,
增强的8051微控制器和可编程的外围
在单个芯片中的接口,
赛普拉斯创造了一个符合成本效益的解决方案,提供
卓越的时间将产品推向市场的优势低功耗,使
总线供电的应用。
FX2LP导致数据传输的巧妙架构
每秒53兆字节的速率,最大允许
USB 2.0的带宽,同时仍使用低费用8051
微控制器中的一个包,小到一个56 VFBGA (5毫米× 5
毫米)。因为它采用了USB 2.0收发器,该
FX2LP是更经济,提供了一个更小的占位面积的解决方案
比USB 2.0 SIE或外部收发器实现。同
EZ -USB FX2LP ,赛普拉斯智能SIE处理大部分的
USB 1.1和2.0的硬件协议,释放内嵌
微控制器应用的特定功能,降低
显影时间,以确保USB兼容性问题。
通用可编程接口( GPIF )和主/从
端点FIFO (8位或16位数据总线)提供了一种简单和
无缝连接流行的接口,比如ATA , UTOPIA ,
EPP ,PCMCIA和大多数DSP /处理器。
在FX2LP吸引更小的电流比FX2 ( CY7C68013 ) ,有
两倍的片上代码/数据RAM,以及嵌合,形式和功能
同56 ,100,和128引脚FX2兼容。
五包被定义为家庭: 56 VFBGA , 56 SSOP ,
56 QFN , TQFP 100和128 TQFP 。
文件编号: 38-08032牧师* V
第66 2
CY7C68013A , CY7C68014A
CY7C68015A , CY7C68016A
目录
应用................................................. ..................... 4
功能概述................................................ 4 ........
USB信号传输速度............................................... ... 4
8051微处理器................................................ ... 4
I
2
C总线................................................ ........................ 4
巴士................................................. ......................... 4
USB引导方法............................................... 5 .......
的薪酬................................................. ............ 5
总线供电应用.......................................... 5
中断系统................................................ .......... 5
复位和唤醒............................................... 7 .......
程序/数据RAM .............................................. 8 .......
注册地址................................................ ... 10
端点RAM ................................................ ........... 11
外部FIFO接口............................................. 12
GPIF ................................................. ......................... 13
ECC代
[7] ................................................................... 13
USB上传和下载................................... 13
自动指针访问................................................ ... 13
I
2
C控制器................................................ ............. 14
兼容上一代EZ -USB FX2 。 14
CY7C68013A / 14A和CY7C68015A / 16A差异14
引脚分配................................................ ............ 15
CY7C68013A / 15A的引脚说明.......................... 22
注册摘要................................................ .......... 30
绝对最大额定值.......................................... 37
工作条件................................................ ..... 37
热特性................................................ 37
直流特性................................................ ......... 38
USB收发器................................................ ....... 38
AC电气特性........................................ 39
USB收发器................................................ ....... 39
程序存储器读............................................. 39
数据存储器读............................................... .... 40
数据存储器写............................................... .... 41
PORTC频闪功能计时............................... 42
GPIF同步信号....................................... 43
Slave FIFO同步读取................................. 44
Slave FIFO异步读取............................... 45
Slave FIFO同步写................................. 46
Slave FIFO异步写............................... 47
Slave FIFO同步数据包结束频闪........... 47
Slave FIFO异步数据包结束频闪......... 48
从FIFO输出使能........................................ 49
从FIFO地址为标志/数据............................ 49
Slave FIFO同步地址............................ 49
Slave FIFO异步地址.......................... 50
序列图................................................ .... 50
订购信息................................................ ...... 55
订购代码定义......................................... 55
包图................................................ .......... 56
PCB布局建议.................................... 61
四方扁平封装无引线( QFN )封装
设计说明................................................ ................... 62
与缩略语................................................. ....................... 63
文档约定................................................ 63
计量单位............................................... ........ 63
文档历史记录页............................................... .. 64
销售,解决方案和法律信息...................... 66
全球销售和设计支持....................... 66
产品................................................. ................... 66
的PSoC解决方案................................................ ......... 66
文件编号: 38-08032牧师* V
第66 3
CY7C68013A , CY7C68014A
CY7C68015A , CY7C68016A
1.应用
图2-1 。晶体结构
C1
12 pF的
24兆赫
C2
12 pF的
便携式视频录像机
MPEG / TV转换
DSL调制解调器
ATA接口
存储卡读卡器
传统的转换装置
相机
扫描仪
无线局域网
MP3播放器
联网
20 × PLL
12 pF的电容值,假设一丝电容
每边3 pF的上一个4层FR4的PCA
CLKOUT引脚,可以三态和反转用
内部控制比特,输出50%的占空比时钟8051 ,在
选择8051的时钟频率: 48 MHz时, 24兆赫,或12兆赫。
2.2.2个USART
FX2LP包含两个标准的8051个USART ,通过解决
特殊功能寄存器( SFR )位。该USART接口引脚
可在单独的I / O引脚,并且不与复
端口引脚。
UART0和UART1可以使用在内部时钟运行
230波特不超过1%的波特率误差。 230波特
操作由内部派生时钟源来实现这
产生溢出脉冲在适当的时候。内部
时钟调整为8051时钟速率( 48兆赫, 24兆赫,并
12兆赫) ,使得它总是呈现正确的频率为
230波特操作。
[1]
2.2.3特殊功能寄存器
某些8051 SFR地址以便能快速
进入关键的FX2LP功能。这些添加的SFR
所示
表1第5页。
黑体字表示非标准,
增强型8051寄存器。以“ 0 ”结尾的两个SFR行
和“8”包含位寻址寄存器。这四个I / O端口A到
D使用在标准8051中用于端口0的SFR地址
3 ,这在FX2LP不落实。由于快
和更有效的SFR寻址, FX2LP的I / O端口都没有
寻址在外部RAM空间(用MOVX
指令)。
的“参考设计”部分
赛普拉斯网站
为典型的USB 2.0应用程序的其他工具。每
参考设计都包含固件的源和
目标代码,原理图和文档。访问
www.cypress.com
了解更多信息。
2.功能概述
2.1 USB信号传输速度
FX2LP工作在两点USB定义的三种速率
规范2.0版,日期为2000年4月27日:
全程高速,与12 Mbps的信号比特率
高速, 480 Mbps的信号比特率
FX2LP不支持低速信令模式
1.5 Mbps的。
2.2 8051微处理器
8051微处理器嵌入到FX2LP系列有
256字节的寄存器RAM ,扩展的中断系统,三
定时器/计数器和两个USART 。
2.2.1 8051时钟频率
FX2LP具有使用一个外部的片上振荡器电路
24兆赫( ± 100ppm以下)的结晶,具有以下特点:
2.3 I
2
C总线
FX2LP支持我
2
C总线作为主只在100/400千赫。
SCL和SDA引脚具有开漏输出和滞后
输入。这些信号必须被拉高至3.3V,即使没有我
2
C
设备连接。
并联谐振
基本模式
500
W
驱动电平
12 pF的( 5 %容差)负载电容
2.4巴士
所有封装, 8位或16位的“先进先出”的双向数据总线,
复用I / O端口B和D. 128引脚封装:将16位
只输出8051的地址总线, 8位双向数据总线。
片上PLL倍频24 MHz振荡器高达480兆赫,
所要求的收发器/ PHY和内部计数器分频
下来用作8051时钟。默认的8051时钟
频率是12 MHz 。 8051的时钟频率可以是
通过CPUCS寄存器由8051变,动态。
1. 115波特的操作,也可以通过分别编程8051 SMOD0或SMOD1位为“1 ”为UART0 , UART1 ,或两者兼而有之。
文件编号: 38-08032牧师* V
第66 4
CY7C68013A , CY7C68014A
CY7C68015A , CY7C68016A
表1.特殊功能寄存器
x
0
1
2
3
4
5
6
7
8
9
A
B
C
D
E
F
8x
IOA
SP
DPL0
DPH0
DPL1
DPH1
DPS
PCON
TCON
TMOD
TL0
TL1
TH0
TH1
CKCON
9x
IOB
EXIF
MPAGE
SCON0
SBUF0
AUTOPTRH1
AUTOPTRL1
版权所有
AUTOPTRH2
AUTOPTRL2
版权所有
Ax
国际奥林匹克委员会
INT2CLR
INT4CLR
IE
EP2468STAT
EP24FIFOFLGS
EP68FIFOFLGS
AUTOPTRSET -UP
Bx
IOD
IOE
OEA
OEB
OEC
OED
OEE
IP
EP01STAT
GPIFTRIG
GPIFSGLDATH
GPIFSGLDATLX
GPIFSGLDATLNOX
Cx
SCON1
SBUF1
T2CON
RCAP2L
RCAP2H
TL2
TH2
Dx
PSW
EICON
Ex
EIE
Fx
B
EIP
2.5 USB启动方法
在上电时序,内部逻辑会检查我
2
端口C
对于EEPROM的联系,它的第一个字节为0xC0
或为0xC2 。如果找到了,它使用的VID / PID / EEPROM中DID值
代替内部存储的值(为0xC0 ) ,或者在引导加载的
EEPROM的内容到内部RAM ( 0xC2的) 。如果没有EEPROM是
检测, FX2LP列举了使用内部存储的描述符。
对于FX2LP的默认ID值VID / PID / DID ( 0x04B4 ,
0x8613 , 0xAxxx其中xxx =芯片版本) 。
[2]
表2.默认ID值FX2LP
供应商ID
产品编号
设备版本
默认VID / PID / DID
0x04B4赛普拉斯半导体
0x8613 EZ -USB FX2LP
0xAnnn取决于芯片版本
( NNN =芯片版本,其中第一
硅= 001 )
在USBCS两个控制位( USB控制和状态)注册,
控制的薪酬流程: DISCON和RENUM 。对
模拟USB断开,固件设置DISCON为1。
重新连接,固件将DISCON为0 。
重新连接前,固件设置或清除RENUM位
表明是否固件或默认的USB设备
处理设备的请求通过端点零:如果RENUM = 0,则
默认的USB设备处理设备请求;如果RENUM = 1,则
固件服务该请求。
2.7总线供电应用
该FX2LP完全支持总线供电设计,通过枚举
少于100毫安所要求的USB 2.0规范。
2.8中断系统
2.8.1 INT2中断请求和使能寄存器
FX2LP针对INT2和INT4自动向量化功能。
有27 INT2 ( USB )载体,和14 INT4 ( FIFO / GPIF )
向量。看到EZ -USB技术参考手册( TRM )的
更多的细节。
2.8.2 USB中断Autovectors
主要的USB中断由27个中断源共享。对
保存时所需的识别码和处理时间
单个USB中断源时, FX2LP提供了第二
中断向量的水平,被称为自动向量化。当USB
中断断言, FX2LP会将程序计数器
它的堆栈,然后跳转到地址0x0043 ,其中,预计
找到一个“跳”的指令到USB中断服务程序。
2.6的薪酬
由于FX2LP的配置是软的,一个芯片可以采取
的多个不同的USB设备的身份。
当第一次插入USB时, FX2LP枚举
自动下载固件和USB描述符
桌子上的USB连接线。接下来, FX2LP再次列举,
此时如通过下载的信息所限定的设备。
这款名为ReNumeration专利两步过程发生
瞬间,当设备插入时,没有暗示,
发生的初始下载的一步。
2.我
2
C总线的SCL和SDA引脚必须上拉,即使EEPROM未连接。否则,这种检测方法不能正常工作。
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第66 5
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