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位置:首页 > IC型号导航 > 首字符C型号页 > 首字符C的型号第746页 > CY7C60413-16LKXC
CY7C604XX
的enCoRe V低压微控制器
特点
强大的哈佛架构处理器
M8C处理器,运行速度高达24 MHz
低功耗高处理速度
中断控制器
1.71V至3.6V工作电压
温度范围: 0 ℃ 70℃
灵活的片上存储器
高达32K闪存程序存储器
50000的擦除和写入周期
灵活的保护模式
高达2048字节的SRAM数据存储
在系统内串行编程( ISSP )
完备的开发工具
免费的开发工具(的PSoC Designer )
全功能,在线仿真器和编程器
全速仿真
复杂断点结构
128K跟踪存储器
精密的可编程时钟
无晶体振荡器,支持外部晶振或
谐振器
内部± 5.0 % 6 , 12 ,或24 MHz的主振荡器
内部低速振荡器在32kHz看门狗和
sleep.The频率范围为19 50 kHz,采用32千赫
典型的价值
可编程引脚配置
25毫安灌电流上的所有GPIO
拉起,所有GPIO高阻,开漏输出, CMOS驱动模式
在所有的GPIO可配置的输入
低压差稳压器的端口1引脚。可编程
以输出3.0 , 2.5 ,或1.8V的I / O引脚
可选的,规范的数字I /端口1 O
端口1可配置输入阈值
3.0V 20 mA的总端口1的源电流
热插拔
在端口0和1 5毫安强大的驱动模式
其它系统资源
可配置的通信速度
2
I C奴隶
可选50千赫, 100千赫,或400千赫
实施不需要时钟延长
在睡眠模式下实现与电流小于100 mA
硬件地址检测
SPI主机和SPI从机
93.75 kHz到12 MHz之间的配置
3个16位定时器
8位用于监视电池电压或其他信号的ADC -
与外部元件
看门狗和休眠定时器
集成监控电路
的enCoRe V LV框图
的enCoRe V
低电压
CORE
端口4
端口3
端口2
端口1
端口0
前卫。 LDO
系统总线
SRAM
2048字节
打断
调节器
SROM
32K闪存
睡眠和
看门狗
CPU核心
(M8C)
6/12/24 MHz内部主振荡器
3个16位
计时器
I2C从/ SPI
主从
POR和LVD
系统复位
系统资源
赛普拉斯半导体公司
文档编号: 001-12395修订版* H
198冠军苑
圣荷西
,
CA 95134-1709
408-943-2600
修订后的二零零九年一月三十日
[+ ]反馈
CY7C604XX
功能概述
安可V LV系列器件设计用于替代
多个传统的低电压微控制器系统康波
堂费与一体,低成本的单芯片可编程组件。
通信外设( I2C / SPI ) ,一个快速的CPU ,闪存
程序存储器, SRAM数据存储器和可配置的I / O都
包括在一系列方便易用的引脚布局。
该架构为这个设备的家庭,如图的enCoRe
V LV框图,包括两个主要方面: CPU
芯和系统资源。根据的enCoRe V LV
包,最多36个通用输入输出(GPIO)也包括在内。
增强了赛普拉斯的传统低电压单片机
制器包括更快的CPU在低电压运行,低
电流消耗两倍的RAM和闪存,热可插拔
的I / O , I2C硬件地址识别,新的非常低电流
睡眠模式和新的封装选项。
入门
最快捷的方式来理解的enCoRe V硅是
阅读本数据手册和使用PSoC Designer集成
开发环境(IDE) 。该数据表的概述
安可V集成电路和提出了具体的引脚,
寄存器和电气规格。为了更深入的信息,
以及详细的编程信息,请参考
的PSoC可编程系统级芯片技术参考
手册,
对于CY8C28xxx PSoC器件。
最多最新的订购,封装和电气规范
信息,请参考最新的enCoRe V器件的数据手册
该公司的网站上
http://www.cypress.com 。
开发套件
开发套件可在网上从赛普拉斯在
www.cypress.com/shop
并通过越来越多的
区域和全球分销商,其中包括箭头,安富利,
Digi-Key询问,派睿电子,富昌电子和纽瓦克。
安可V LV核心
安可V LV的核心是支持丰富的强大引擎
指令集。它包括SRAM用于数据存储,一个
中断控制器,睡眠和看门狗定时器,以及IMO
(内部主振荡器)和ILO (内部低速振荡器) 。
CPU核心,被称为M8C ,是一个功能强大的处理器,
速度高达24 MHz 。的M8C是四MIPS, 8位哈佛
架构的微处理器。
系统资源提供额外的功能,诸如
可配置的I
2
I2C从和SPI主从通信
接口和由M8C支持的各种系统复位。
训练
免费技术培训(点播,网络研讨会和讲习班)
可在网上
www.cypress.com/training 。
培训
涵盖了广泛的主题和技能水平,以帮助您
您的设计。
CYPros顾问
经过认证的PSoC顾问为您提供从技术
协助完成PSoC设计。要联系或成为
的PSoC顾问去www.cypress.com/cypros 。
其它系统资源
系统资源,其中一些上面已经列,
提供额外的能力来完成系统非常有用。
其他资源包括低电压检测和电源
复位。下面的语句描述的每个优点
系统资源:
解决方案库
请访问我们的成长的解决方案库的设计重点在
www.cypress.com/solutions 。
在这里,你可以找到各种应用程序
阳离子设计,包括固件和硬件设计文件
这使您能够快速完成你的设计。
8位的片上系统性能与ADC共用
管理器(用于基于温度来计算参数
闪存的写入操作)和用户。
在我
2
I2C从和SPI主从模块提供50 , 100 ,
以上两条线路400 kHz的交流。 SPI通信
在三个或四线运行速度为46.9千赫至3兆赫
(下为速度较慢的系统时钟) 。
在我
2
I2C从模式下,硬件地址识别功能
通过消除减少了本来就低功率消耗
需要CPU的干预,直到分组寻址到目标
设备已被接收。
低电压检测( LVD)中断信号可以在应用程序
阳离子电压下降时,而先进的POR(上电
上电复位)电路,省去了系统监控。
5V的最大输入, 1.8V,2.5V , 3V或可选的输出,低
差稳压器( LDO)调节提供的I / O 。名册
控制旁路模式使用户能够禁用LDO 。
标准赛普拉斯的PSoC IDE工具可用于调试
安可V LV系列器件。
技术支援
对于技术问题的支持,搜索知识库
文章和论坛
www.cypress.com/support 。
如果你不能
找到问题的答案,请致电技术支持
1-800-541-4736.
应用笔记
应用笔记有一个很好的介绍了各种
PSoC设计。它们都坐落在这里:
www.cypress.com/psoc 。
在选择应用程序的注意事项
文档标签。
文档编号: 001-12395修订版* H
分页: 30 2
[+ ]反馈
CY7C604XX
开发工具
的PSoC Designer是微软
基于Windows的集成
发展
环境
可编程
系统级芯片(的PSoC )器件。在PSoC Designer IDE运行
在Windows XP或Windows Vista 。
此系统提供了设计数据库管理按项目,
一个与在线仿真器集成调试器,在系统
编程支持,以及内置的第三方assem-支持
的BLER和C编译器。
的PSoC Designer还支持开发的C语言编译器
专为喝采和PSoC系列器件。
装配工。
该编译器允许汇编代码是
与C语言代码无缝地合并。链接库自动使用
绝对地址或编译在相对模式下,和联
与其他软件模块,以实现绝对寻址。
C语言的编译器。
C语言编译器可
支持设备的喝采和PSoC家庭。该
产品允许您创建用于PSoC完整C语言程序
家庭设备。
该优化的C编译器提供C的全部功能定制
PSoC架构。他们来完成嵌入式
提供端口和总线操作,标准键盘和库
显示支持,以及扩展的数学功能。
调试器
的PSoC Designer的调试环境,它提供
硬件电路仿真功能,让您在测试程序
同时提供的PSoC的内部观察物理系统
装置。调试器命令允许设计人员阅读和
程序闪存,读取和写入数据存储,读取和写入I / O
寄存器,读取和写入CPU寄存器,设置和清除突破性
点,以及提供程序运行,暂停和步进控制。该
调试器还允许设计人员创建了一个跟踪缓冲器
关注的寄存器和存储器位置。
在线帮助系统
在线帮助系统显示在线,上下文敏感的帮助
给用户。设计程序的帮助和快速参考,
每个功能子系统都有自己的上下文相关帮助。
该系统还提供了教程和链接,常见问题解答以及
在线支持论坛,以辅助设计者起步。
在线仿真器
低成本,高功能ICE (在线仿真器)是
可供开发的支持。该硬件有
能力,以单个器件编程。
仿真器包含通过连接到PC的基本单位
USB端口的方式。基本单元是通用的,与经营
所有的enCoRe和PSoC器件。仿真主机每台设备
家庭是单独提供的。仿真主机的
在PSoC器件在目标板上,并进行全
速度( 24 MHz)的运行。
PSoC Designer软件子系统
芯片级视图
芯片级视图是一个传统的集成开发
环境(IDE )的基础上的PSoC Designer 4.4 。选择一个基地
设备一起工作,然后选择不同的板载模拟和
数字元件称为使用PSoC的用户模块
块。用户模块的示例有ADC , DAC,放大器
和过滤器。配置用户模块所选择的应用程序
阳离子及它们相互连接,并在适当的管脚。
然后生成您的项目。这会在你的项目
API和,你可以用它来编写应用程序库。
该工具还支持多种组态易发展
tions和动态重新配置。动态重配置
能够改变的配置在运行时。
系统级视图
系统级视图是一个拖和拖放可视化嵌入式
系统设计环境的基础上的PSoC Designer 。
混合设计
可以在系统级视图开始,允许其选择和
配置用户模块,路由和生成代码,然后
切换到芯片级,以便对其进行完全控制
片上资源。该项目有着共同的代码,所有的意见
编辑建设者,共同调试,仿真和编程
工具。
代码生成工具
的PSoC Designer支持多种第三方C编译器及
装配工。代码生成工具无缝工作中
在PSoC Designer界面已经过测试,采用了全
一系列的调试工具。选择是你的。
文档编号: 001-12395修订版* H
第30 3
[+ ]反馈
CY7C604XX
采用PSoC Designer进行设计
为安可V器件的开发过程与
传统的固定功能微处理器。强大
的PSoC Designer工具,让你的设计和运行的核心
在几分钟而不是几小时。
开发过程中,可以归纳为以下
四步:
1.选择组件
2.配置组件
3.组织和连接
4.生成,验证和调试
赋值函数。在芯片级视图,执行
选择,配置和路由,使您拥有完整的
控制使用的所有片上资源。
生成,验证和调试
当你准备好测试硬件配置或移动
在为项目开发代码,执行“生成
配置文件“的步骤。这会让PSoC Designer
生成源代码,自动对器件进行配置
您的规格,并提供了软件系统。
两者的系统级和芯片级设计生成软件
根据您的设计。芯片级设计提供了应用程序
编程接口(API )与高级别功能
控制和响应硬件事件在运行时和中断
服务程序根据需要可以调整。系统级
设计也是完全生成一个C main()程序
控制所选择的应用程序,并包含占位符
在战略位置上的自定义代码,让您进一步细化
的软件,而不会中断生成的代码。
一个完整的代码开发环境可以让你
开发和定制C语言应用程序,组件
语言,或两者兼而有之。
在发展过程中的最后一步到位内
的PSoC Designer的调试器(点击连接进入
图标)。的PSoC Designer下载HEX图像在电路
仿真器( ICE),而以全速运行。的PSoC Designer
调试功能相媲美的成本很多时候系统
更多。除了传统的单步,运行到断点,
监视变量功能外,调试接口提供了大量
跟踪缓冲区,并允许您定义复杂断点事件
这包括监测的地址和数据总线的值,存储器
位置和外部信号。
选择组件
芯片级视图提供预构建,预测试的图书馆
硬件外设组件。这些组件被称为
“用户模块”用户模块使选择和实施
外围设备简单,进来的模拟,数字和
混合信号的品种。
配置组件
每个选择的组件建立基本寄存器
设置,实现所选择的功能。它们还提供了
参数和属性,让用户定制自己的精确
配置您的特定应用程序。
芯片级用户模块都记录在数据表的
直接在PSoC Designer中进行查看。这些数据表说明
该组件的内部操作并提供perfor-
曼斯规范。每个数据表中描述了每个
用户模块参数,并包含其他信息,您可以
要成功实现设计。
组织和连接
您可以通过相互连接的用户建立在芯片级信号链
模块相互之间以及所述I / O管脚或连接的系统级
输入,输出,和相互通过通信接口
文档编号: 001-12395修订版* H
第30 4
[+ ]反馈
CY7C604XX
文档约定
使用的缩略语
下面的表列出了在此所用的缩写词
文档。
缩写
API
中央处理器
GPIO
ICE
国际劳工组织
IMO
IO
最低位
LVD
最高位
POR
PPOR
的PSoC
SLIMO
SRAM
描述
应用程序编程接口
中央处理单元
通用IO
在线仿真器
内部低速振荡器
内部主振荡器
输入/输出
最显著位
低电压检测
最有效位
上电复位
上电复位精密电源
可编程系统级芯片
慢IMO
静态随机存取存储器
计量单位
一个计量单位表位于电气规格
部分。
表7
第14页列出了用于所有的缩写
测量的enCoRe V LV设备。
数字命名
十六进制数表示,在所有的字母
大写字母附加小写的“h” (例如,“ 14H ”或
' 3AH ') 。十六进制数,也可以通过加“0x”代表
前缀, C编码规范。二进制数有
附加小写“ b位(例如, 01010100b ”或
“ 01000011b ” ) 。未采用的“H” , “B”表示,或0X是
小数。
文档编号: 001-12395修订版* H
第30个5
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CY7C604XX
的enCoRe V低压微控制器
特点
强大的哈佛架构处理器
M8C处理器,运行速度高达24 MHz
低功耗高处理速度
中断控制器
1.71V至3.6V工作电压
温度范围: 0 ℃ 70℃
灵活的片上存储器
高达32K闪存程序存储器
50000的擦除和写入周期
灵活的保护模式
高达2048字节的SRAM数据存储
在系统内串行编程( ISSP )
完备的开发工具
免费的开发工具(的PSoC Designer )
全功能,在线仿真器和编程器
全速仿真
复杂断点结构
128K跟踪存储器
精密的可编程时钟
无晶体振荡器,支持外部晶振或
谐振器
内部± 5.0 % 6 , 12 ,或24 MHz的主振荡器
内部低速振荡器在32kHz看门狗和
sleep.The频率范围为19 50 kHz,采用32千赫
典型的价值
可编程引脚配置
25毫安灌电流上的所有GPIO
拉起,所有GPIO高阻,开漏输出, CMOS驱动模式
在所有的GPIO可配置的输入
低压差稳压器的端口1引脚。可编程
以输出3.0 , 2.5 ,或1.8V的I / O引脚
可选的,规范的数字I /端口1 O
端口1可配置输入阈值
3.0V 20 mA的总端口1的源电流
热插拔
在端口0和1 5毫安强大的驱动模式
其它系统资源
可配置的通信速度
2
I C奴隶
可选50千赫, 100千赫,或400千赫
实施不需要时钟延长
在睡眠模式下实现与电流小于100 mA
硬件地址检测
SPI主机和SPI从机
93.75 kHz到12 MHz之间的配置
3个16位定时器
8位用于监视电池电压或其他信号的ADC -
与外部元件
看门狗和休眠定时器
集成监控电路
的enCoRe V LV框图
的enCoRe V
低电压
CORE
端口4
端口3
端口2
端口1
端口0
前卫。 LDO
系统总线
SRAM
2048字节
打断
调节器
SROM
32K闪存
睡眠和
看门狗
CPU核心
(M8C)
6/12/24 MHz内部主振荡器
3个16位
计时器
I2C从/ SPI
主从
POR和LVD
系统复位
系统资源
赛普拉斯半导体公司
文档编号: 001-12395修订版* H
198冠军苑
圣荷西
,
CA 95134-1709
408-943-2600
修订后的二零零九年一月三十日
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CY7C604XX
功能概述
安可V LV系列器件设计用于替代
多个传统的低电压微控制器系统康波
堂费与一体,低成本的单芯片可编程组件。
通信外设( I2C / SPI ) ,一个快速的CPU ,闪存
程序存储器, SRAM数据存储器和可配置的I / O都
包括在一系列方便易用的引脚布局。
该架构为这个设备的家庭,如图的enCoRe
V LV框图,包括两个主要方面: CPU
芯和系统资源。根据的enCoRe V LV
包,最多36个通用输入输出(GPIO)也包括在内。
增强了赛普拉斯的传统低电压单片机
制器包括更快的CPU在低电压运行,低
电流消耗两倍的RAM和闪存,热可插拔
的I / O , I2C硬件地址识别,新的非常低电流
睡眠模式和新的封装选项。
入门
最快捷的方式来理解的enCoRe V硅是
阅读本数据手册和使用PSoC Designer集成
开发环境(IDE) 。该数据表的概述
安可V集成电路和提出了具体的引脚,
寄存器和电气规格。为了更深入的信息,
以及详细的编程信息,请参考
的PSoC可编程系统级芯片技术参考
手册,
对于CY8C28xxx PSoC器件。
最多最新的订购,封装和电气规范
信息,请参考最新的enCoRe V器件的数据手册
该公司的网站上
http://www.cypress.com 。
开发套件
开发套件可在网上从赛普拉斯在
www.cypress.com/shop
并通过越来越多的
区域和全球分销商,其中包括箭头,安富利,
Digi-Key询问,派睿电子,富昌电子和纽瓦克。
安可V LV核心
安可V LV的核心是支持丰富的强大引擎
指令集。它包括SRAM用于数据存储,一个
中断控制器,睡眠和看门狗定时器,以及IMO
(内部主振荡器)和ILO (内部低速振荡器) 。
CPU核心,被称为M8C ,是一个功能强大的处理器,
速度高达24 MHz 。的M8C是四MIPS, 8位哈佛
架构的微处理器。
系统资源提供额外的功能,诸如
可配置的I
2
I2C从和SPI主从通信
接口和由M8C支持的各种系统复位。
训练
免费技术培训(点播,网络研讨会和讲习班)
可在网上
www.cypress.com/training 。
培训
涵盖了广泛的主题和技能水平,以帮助您
您的设计。
CYPros顾问
经过认证的PSoC顾问为您提供从技术
协助完成PSoC设计。要联系或成为
的PSoC顾问去www.cypress.com/cypros 。
其它系统资源
系统资源,其中一些上面已经列,
提供额外的能力来完成系统非常有用。
其他资源包括低电压检测和电源
复位。下面的语句描述的每个优点
系统资源:
解决方案库
请访问我们的成长的解决方案库的设计重点在
www.cypress.com/solutions 。
在这里,你可以找到各种应用程序
阳离子设计,包括固件和硬件设计文件
这使您能够快速完成你的设计。
8位的片上系统性能与ADC共用
管理器(用于基于温度来计算参数
闪存的写入操作)和用户。
在我
2
I2C从和SPI主从模块提供50 , 100 ,
以上两条线路400 kHz的交流。 SPI通信
在三个或四线运行速度为46.9千赫至3兆赫
(下为速度较慢的系统时钟) 。
在我
2
I2C从模式下,硬件地址识别功能
通过消除减少了本来就低功率消耗
需要CPU的干预,直到分组寻址到目标
设备已被接收。
低电压检测( LVD)中断信号可以在应用程序
阳离子电压下降时,而先进的POR(上电
上电复位)电路,省去了系统监控。
5V的最大输入, 1.8V,2.5V , 3V或可选的输出,低
差稳压器( LDO)调节提供的I / O 。名册
控制旁路模式使用户能够禁用LDO 。
标准赛普拉斯的PSoC IDE工具可用于调试
安可V LV系列器件。
技术支援
对于技术问题的支持,搜索知识库
文章和论坛
www.cypress.com/support 。
如果你不能
找到问题的答案,请致电技术支持
1-800-541-4736.
应用笔记
应用笔记有一个很好的介绍了各种
PSoC设计。它们都坐落在这里:
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在选择应用程序的注意事项
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分页: 30 2
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开发工具
的PSoC Designer是微软
基于Windows的集成
发展
环境
可编程
系统级芯片(的PSoC )器件。在PSoC Designer IDE运行
在Windows XP或Windows Vista 。
此系统提供了设计数据库管理按项目,
一个与在线仿真器集成调试器,在系统
编程支持,以及内置的第三方assem-支持
的BLER和C编译器。
的PSoC Designer还支持开发的C语言编译器
专为喝采和PSoC系列器件。
装配工。
该编译器允许汇编代码是
与C语言代码无缝地合并。链接库自动使用
绝对地址或编译在相对模式下,和联
与其他软件模块,以实现绝对寻址。
C语言的编译器。
C语言编译器可
支持设备的喝采和PSoC家庭。该
产品允许您创建用于PSoC完整C语言程序
家庭设备。
该优化的C编译器提供C的全部功能定制
PSoC架构。他们来完成嵌入式
提供端口和总线操作,标准键盘和库
显示支持,以及扩展的数学功能。
调试器
的PSoC Designer的调试环境,它提供
硬件电路仿真功能,让您在测试程序
同时提供的PSoC的内部观察物理系统
装置。调试器命令允许设计人员阅读和
程序闪存,读取和写入数据存储,读取和写入I / O
寄存器,读取和写入CPU寄存器,设置和清除突破性
点,以及提供程序运行,暂停和步进控制。该
调试器还允许设计人员创建了一个跟踪缓冲器
关注的寄存器和存储器位置。
在线帮助系统
在线帮助系统显示在线,上下文敏感的帮助
给用户。设计程序的帮助和快速参考,
每个功能子系统都有自己的上下文相关帮助。
该系统还提供了教程和链接,常见问题解答以及
在线支持论坛,以辅助设计者起步。
在线仿真器
低成本,高功能ICE (在线仿真器)是
可供开发的支持。该硬件有
能力,以单个器件编程。
仿真器包含通过连接到PC的基本单位
USB端口的方式。基本单元是通用的,与经营
所有的enCoRe和PSoC器件。仿真主机每台设备
家庭是单独提供的。仿真主机的
在PSoC器件在目标板上,并进行全
速度( 24 MHz)的运行。
PSoC Designer软件子系统
芯片级视图
芯片级视图是一个传统的集成开发
环境(IDE )的基础上的PSoC Designer 4.4 。选择一个基地
设备一起工作,然后选择不同的板载模拟和
数字元件称为使用PSoC的用户模块
块。用户模块的示例有ADC , DAC,放大器
和过滤器。配置用户模块所选择的应用程序
阳离子及它们相互连接,并在适当的管脚。
然后生成您的项目。这会在你的项目
API和,你可以用它来编写应用程序库。
该工具还支持多种组态易发展
tions和动态重新配置。动态重配置
能够改变的配置在运行时。
系统级视图
系统级视图是一个拖和拖放可视化嵌入式
系统设计环境的基础上的PSoC Designer 。
混合设计
可以在系统级视图开始,允许其选择和
配置用户模块,路由和生成代码,然后
切换到芯片级,以便对其进行完全控制
片上资源。该项目有着共同的代码,所有的意见
编辑建设者,共同调试,仿真和编程
工具。
代码生成工具
的PSoC Designer支持多种第三方C编译器及
装配工。代码生成工具无缝工作中
在PSoC Designer界面已经过测试,采用了全
一系列的调试工具。选择是你的。
文档编号: 001-12395修订版* H
第30 3
[+ ]反馈
CY7C604XX
采用PSoC Designer进行设计
为安可V器件的开发过程与
传统的固定功能微处理器。强大
的PSoC Designer工具,让你的设计和运行的核心
在几分钟而不是几小时。
开发过程中,可以归纳为以下
四步:
1.选择组件
2.配置组件
3.组织和连接
4.生成,验证和调试
赋值函数。在芯片级视图,执行
选择,配置和路由,使您拥有完整的
控制使用的所有片上资源。
生成,验证和调试
当你准备好测试硬件配置或移动
在为项目开发代码,执行“生成
配置文件“的步骤。这会让PSoC Designer
生成源代码,自动对器件进行配置
您的规格,并提供了软件系统。
两者的系统级和芯片级设计生成软件
根据您的设计。芯片级设计提供了应用程序
编程接口(API )与高级别功能
控制和响应硬件事件在运行时和中断
服务程序根据需要可以调整。系统级
设计也是完全生成一个C main()程序
控制所选择的应用程序,并包含占位符
在战略位置上的自定义代码,让您进一步细化
的软件,而不会中断生成的代码。
一个完整的代码开发环境可以让你
开发和定制C语言应用程序,组件
语言,或两者兼而有之。
在发展过程中的最后一步到位内
的PSoC Designer的调试器(点击连接进入
图标)。的PSoC Designer下载HEX图像在电路
仿真器( ICE),而以全速运行。的PSoC Designer
调试功能相媲美的成本很多时候系统
更多。除了传统的单步,运行到断点,
监视变量功能外,调试接口提供了大量
跟踪缓冲区,并允许您定义复杂断点事件
这包括监测的地址和数据总线的值,存储器
位置和外部信号。
选择组件
芯片级视图提供预构建,预测试的图书馆
硬件外设组件。这些组件被称为
“用户模块”用户模块使选择和实施
外围设备简单,进来的模拟,数字和
混合信号的品种。
配置组件
每个选择的组件建立基本寄存器
设置,实现所选择的功能。它们还提供了
参数和属性,让用户定制自己的精确
配置您的特定应用程序。
芯片级用户模块都记录在数据表的
直接在PSoC Designer中进行查看。这些数据表说明
该组件的内部操作并提供perfor-
曼斯规范。每个数据表中描述了每个
用户模块参数,并包含其他信息,您可以
要成功实现设计。
组织和连接
您可以通过相互连接的用户建立在芯片级信号链
模块相互之间以及所述I / O管脚或连接的系统级
输入,输出,和相互通过通信接口
文档编号: 001-12395修订版* H
第30 4
[+ ]反馈
CY7C604XX
文档约定
使用的缩略语
下面的表列出了在此所用的缩写词
文档。
缩写
API
中央处理器
GPIO
ICE
国际劳工组织
IMO
IO
最低位
LVD
最高位
POR
PPOR
的PSoC
SLIMO
SRAM
描述
应用程序编程接口
中央处理单元
通用IO
在线仿真器
内部低速振荡器
内部主振荡器
输入/输出
最显著位
低电压检测
最有效位
上电复位
上电复位精密电源
可编程系统级芯片
慢IMO
静态随机存取存储器
计量单位
一个计量单位表位于电气规格
部分。
表7
第14页列出了用于所有的缩写
测量的enCoRe V LV设备。
数字命名
十六进制数表示,在所有的字母
大写字母附加小写的“h” (例如,“ 14H ”或
' 3AH ') 。十六进制数,也可以通过加“0x”代表
前缀, C编码规范。二进制数有
附加小写“ b位(例如, 01010100b ”或
“ 01000011b ” ) 。未采用的“H” , “B”表示,或0X是
小数。
文档编号: 001-12395修订版* H
第30个5
[+ ]反馈
CY7C604XX
的enCoRe V低压微控制器
特点
强大的哈佛架构处理器
M8C处理器,运行速度高达24 MHz
低功耗高处理速度
中断控制器
1.71 V至3.6 V的工作电压
商业级温度范围: 0 ° C至+ 70°C
灵活的片上存储器
高达32K的闪存程序存储器
50000的擦除和写入周期
灵活的保护模式
高达2048字节的SRAM数据存储
在系统内串行编程( ISSP )
完备的开发工具
免费的开发工具(的PSoC Designer )
全功能,在线仿真器和编程器
全速仿真
复杂断点结构
128K的跟踪存储器
精密的可编程时钟
无晶体振荡器,支持外部晶振或
谐振器
内部± 5.0 % 6 , 12 ,或24 MHz的主振荡器
内部低速振荡器在32kHz看门狗和
睡觉。的频率范围为19到50千赫与32千赫
典型的价值
可编程引脚配置
多达36个的GPIO (取决于封装)
25毫安灌电流上的所有GPIO
拉,高阻,开漏输出, CMOS驱动模式上的所有GPIO
CMOS驱动模式(5 mA输出电流)对端口0和1 :
20毫安( 3.0 V)的总电源电流
低压差稳压器的端口1引脚:
可编程输出3.0V,2.5V , 1.8V或
可选的,规范的数字I /端口1 O
端口1可配置的输入阈值
在端口1热插拔功能
其它系统资源
可配置的通信速度
2
I C奴隶
可选50千赫, 100千赫,或400千赫
实施不需要时钟延长
在睡眠模式下实现与电流小于100 mA
硬件地址检测
SPI主机和SPI从机
可配置的46.9 kHz到12 MHz的
3个16位定时器
10位ADC,用于监视电池电压或其他信号
与外部元件
看门狗和休眠定时器
集成监控电路
的enCoRe V LV框图
端口4
端口3
端口2
端口1
端口0
前卫。 LDO
的enCoRe V
CORE
系统总线
SRAM
2048字节
打断
调节器
SROM
8 K / 16 K / 32 K
FL灰
睡眠和
看门狗
CPU核心
(M8C)
6/12/ 24 MHz的内部主振荡器
ADC
3个16位
计时器
I2C从/ SPI
主从
POR和LVD
系统复位
系统资源
赛普拉斯半导体公司
文件编号: 001-12395修订版* N
198冠军苑
圣荷西
,
CA 95134-1709
408-943-2600
修订后的2013年4月24日
CY7C604XX
目录
功能概述................................................ ........ 3
安可V LV核心............................................. 3
10位ADC .............................................. ..................... 3
SPI ................................................. .............................. 4
I2C从................................................ ..................... 4
额外的系统资源..................................... 5
入门................................................ .................. 5
应用说明................................................ 5 ........
开发套件................................................ 5 ........
培训................................................. ...................... 5
CYPros顾问................................................ 5 ....
解决方案库................................................ .......... 5
技术支援................................................ 5 .......
开发工具................................................ .......... 6
PSoC Designer软件子系统........................ 6
采用PSoC Designer进行....................................... 7设计
选择用户模块............................................... 7 ....
配置用户模块.............................................. 7
组织和连接............................................... 7
生成,验证和调试....................................... 7
引脚配置................................................ ............. 8
16引脚器件的引脚............................................. .......... 8
32引脚器件的引脚............................................. .......... 9
48引脚器件的引脚............................................. ........ 11
注册参考................................................ ......... 13
注册约定................................................ .... 13
寄存器映射表............................................... 13
电气规格................................................ 16
绝对最大额定值....................................... 17
工作温度............................................. 17
直流电气特性........................................ 18
DC芯片级规范.................................... 18
DC通用I / O规格.................... 19
ADC电气规格.................................... 21
DC POR和LVD规范.............................. 22
直流编程规范............................... 22
AC电气特性........................................ 23
AC芯片级规范.................................... 23
通用IO的交流规格..................... 24
交流外部时钟规范.............................. 25
交流编程规范................................ 25
交流I2C规范............................................... 26
包图................................................ ............ 28
包装尺寸................................................ .. 28
包处理................................................ ........... 30
热阻................................................ ..... 30
电容上的晶体引脚.................................... 30
回流焊峰值温度................................. 30
订购信息................................................ ...... 31
订购代码定义......................................... 31
与缩略语................................................. ....................... 32
文档约定................................................ 32
计量单位............................................... ........ 32
附录:勘误文档的
的enCoRe V - CY7C643xx和
的enCoRe V LV - CY7C604xx ........................................ 33
CY7C643xx和CY7C604xx勘误表摘要......... 33
文档历史记录页............................................... 35 ..
销售,解决方案和法律信息...................... 38
全球销售和设计支持....................... 38
产品................................................. ................... 38
的PSoC解决方案................................................ ......... 38
文件编号: 001-12395修订版* N
第38 2
CY7C604XX
功能概述
安可V LV系列器件设计用于替代
多个传统的低电压微控制器系统康波
堂费与一体,低成本的单芯片可编程组件。
通信外设(我
2
C / SPI ) ,一个快速的CPU ,闪存程序
存储器,SRAM数据存储器和可配置的I / O都包括
在一系列方便易用的引脚布局。
该架构为这个设备的家庭,如图
的enCoRe
V LV框图,
包括两个主要方面:在CPU
芯和系统资源。根据的enCoRe V LV
包,多达36个的GPIO也包括在内。
增强了赛普拉斯的传统低电压单片机
制器包括更快的CPU在低电压运行,低
电流消耗两倍的RAM和闪存,热可插拔
I / O的,我
2
硬件地址识别,新的非常低电流
睡眠模式和新的封装选项。
图1. ADC系统性能框图
V
IN
TEMP SENSOR / ADC
温度
二极管
ADC
安可V LV核心
安可V LV的核心是支持丰富的强大引擎
指令集。它包括SRAM用于数据存储,一个
中断控制器,睡眠和看门狗定时器,以及IMO
(内部主振荡器)和ILO (内部低速振荡器) 。
CPU核心,被称为M8C ,是一个功能强大的处理器,
速度高达24 MHz 。的M8C是四MIPS, 8位哈佛
架构的微处理器。
系统资源提供额外的功能,诸如
可配置的I
2
I2C从和SPI主从通信
接口和由M8C支持的各种系统复位。
系统总线
接口模块
命令/状态
10位ADC
的enCoRe V LV设备上的ADC是一个独立的模块
一个状态机接口来控制存取该块。该
ADC被收纳连同温度传感器芯和
可以连接到这个或模拟多路复用总线。作为默认
操作中,ADC连接到所述温度传感器
二极管,得到温度的数字值。
接口M8
(处理器)核心
该ADC用户模块包含一个集成模块和一个
比较器具有正和负输入端的多路复用器进行设置。
输入到积分器级来自模拟全局
输入多路复用器或温度传感器的输入电压范围
0 V至1.3 V,其中1.3 V是满刻度的72%。
在ADC只配置(在ADC MUX选择模拟
多路公交车,而不是默认的温度传感器连接) ,一个
外部电压可以连接到该调制器的输入
用于电压转换。 ADC被运行为一个周期数
由定时器设定,取决于ADC的分辨率
用户所希望的。计数器计数的出游人数
比较器,其正比于输入电压。临时
传感器模块的时钟速度为36 MHz和分频为1
12兆赫ADC操作。
文件编号: 001-12395修订版* N
第38 3
CY7C604XX
SPI
串行外设互连( SPI ) 3 - wire协议的用途
在时钟的两个边沿,使同步通信
而不需要严格的设置和保持要求。
图2.基本的SPI配置
数据被输出由
数据被记录在
无论是主
在这两个设备的输入
和从站
时钟的相对边缘。
的一个边缘
时钟。
SCLK
MOSI
MISO
SPI配置寄存器( SPI_CFG )设置主/从
功能,时钟速度和中断选择。 SPI控制
注册( SPI_CR )提供4个控制位和4个状态位
对于设备接口和同步。
该SPIM硬件具有用于驱动从选择不支持
( SS_ )信号。这个信号的行为和使用的应用程序
的enCoRe V
与设备相关的和,如果需要的话,为必须实现
mented固件。
还有一个额外的数据输入在SPIS ,从选择( SS_ )
这是一个低电平有效信号。 SS_必须置为启用
该SPIS接收和发送。 SS_有两个高级别
功能:1)为使一个给定的从机的一个选择
多从环境,和2)提供额外的时钟
对TX数据在SPI模式0和1排队。
一个设备可以是主机或从机。一个主输出时钟
数据从设备和从设备的输入数据。从器件
输入端从主设备和输出数据的时钟和数据
输入到主站。总之,主机和从机具有至关重要
tially一个圆形的移位寄存器,主机产生
时钟和启动数据传输。
当主机发送8位时发生的基本的数据传输
数据,以及8个时钟周期。在任何转让,主机和
从站同时发送和接收。如果主机只
发送数据时,从从所述接收到的数据被忽略。如果
大师希望从从机接收数据时,主机必须
发送无效字节产生的时钟从站发送
数据备份。
图3. SPI框图
SPI模块
MOSI ,
MISO
SCLK
DATA_IN DATA_OUT
CLK_IN
系统时钟
SS_
CLK_OUT
INT
MOSI ,
MISO
SCLK
I
2
I2C从
在我
2
I2C从增强的通信模块是
串行到并行处理器,设计成连接在
的enCoRe V低压设备到一个两线我
2
C串行通信
总线。从而无需过多的CPU干预和
开销,块提供I
2
对于状态的C-具体支持
检测和生成帧位的。缺省情况下,我
2
C
奴隶增强模块固件兼容
上一代的我
2
I2C从功能。然而,这
模块提供的新功能,可配置成
实现显著的灵活性,内部和外部
连接。
图4.我
2
框图
I2C加
SLAVE
I2C核心
SDA_IN
I2C基本
CON组fi guration
I2C_CFG
缓冲模块
CPU端口
I2C_BUF
系统总线
至/从
GPIO
引脚
SCL_IN
SDA_OUT
SCL_OUT
I2C_EN
I2C_SCR
I2C_DR
32字节的RAM
硬件地址CMP
I2C_ADDR
缓冲CTL
I2C_BP
注册
再加上特色
系统时钟
待机
I2C_CP
MCU_BP
MCU_CP
配置[7 :0]的
TRANSMIT [7 :0]的
CONTROL [ 7:0]
RECEIVE [7:0 ]
I2C_XCFG
I2C_XSTAT
文件编号: 001-12395修订版* N
第38 4
CY7C604XX
基本我
2
C的特征包括:
奴隶,
字节
入门
最快捷的方式来理解的enCoRe V硅是
阅读本数据手册和使用PSoC Designer集成
开发环境(IDE) 。该数据表的概述
安可V集成电路和提出了具体的引脚,
寄存器和电气规格。为了更深入的信息,
随着详细的编程信息,请参考
的PSoC
可编程系统级芯片技术参考手册,
对于CY8C28xxx PSoC器件。
最多最新的订购,封装和电气规范
信息,在参考了最新的enCoRe V器件数据表
访问网站
http://www.cypress.com 。
发射机和接收机操作
处理低CPU开销
或轮询CPU接口
支持高达400 kHz的时钟频率
打断
支持
7-
或10位寻址(通过固件支持)
操作(通过固件支持)
7位硬件地址比较
数据缓冲方案
SMBUS
在我的增强功能
2
I2C从增强的模块包括:
支持
灵活的
A
A
应用笔记
赛普拉斯应用笔记
是一个很好的介绍
各种可能的PSoC设计。
“没有公交车熄火的经营模式
低功耗总线监控模式
在我
2
C地块控制数据( SDA)和时钟( SCL )的
外部I
2
通过直接连接至2 C接口
专用的GPIO引脚。当我
2
C被启用,这些GPIO引脚
不适用于一般用途。安可V LV CPU
通过我与块固件交互/ O寄存器读取和
写和固件同步通过实施
轮询和/或中断。
在默认的操作模式,这是固件兼容
我以前的版本
2
I2C从模块中,我
2
C总线处于停顿状态
对每一个接收到的地址或字节,并在CPU要求
因为我前需要读取的数据或提供数据
2
C总线
继续。然而,这我
2
I2C从增强模块提供
新的数据缓冲能力作为增强功能。在
EZI
2
缓冲模式中,我
2
I2C从接口显示为
32字节的RAM缓存到外部I
2
C中间。使用简单
预定义的协议中,主控制读写
指针到RAM 。当启用该方法中,从机
从来没有摊位的公交车。在这个协议中,数据在可用
的RAM (这是由CPU管理)是有效的。
开发套件
PSoC开发套件
可从网上和通过
越来越多的区域和全球分销商,这
包括箭头,安富利, Digi-Key询问,派睿电子,富昌电子和
纽瓦克。
训练
免费的PSoC技术培训
(点播,网络研讨会,并
车间) ,它通过可在网上
www.cypress.com ,
涵盖了广泛的主题和技能水平,以帮助您
您的设计。
CYPros顾问
经过认证的PSoC顾问为您提供从技术阿西斯
tance来完成PSoC设计。要联系或成为的PSoC
顾问去了
CYPros顾问
网站。
解决方案库
请访问我们的成长
解决方案库的重点设计。
在这里,您
可以发现,包括固件和各种应用设计
硬件设计文件,使您能够完成你的设计
快。
其它系统资源
系统资源,其中一些上面已经列,
提供额外的能力来完成系统非常有用。
其他资源包括低电压检测和电源
复位。下面的语句描述的每个优点
系统资源:
技术支援
技术支援
- 包括一个可搜索的知识库
文章和技术论坛 - 也可在网上。如果您
找不到问题的答案,请致电我们的技术
1-800-541-4736支持热线。
低电压检测( LVD)中断信号可以在应用程序
阳离子电压下降时,而先进的电
复位( POR)电路,省去了系统监控。
该3.6 V最大输入, 1.8 , 2.5或3 V可选的输出,
低压差稳压器( LDO)调节提供的I / O 。一
寄存器控制旁路模式使用户可以禁用
该LDO 。
标准赛普拉斯的PSoC IDE工具可用于调试
安可V LV系列器件。
文件编号: 001-12395修订版* N
第38 5
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