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CY7C601xx , CY7C602xx
的enCoRe II低电压微控制器
1.产品特点
的enCoRe II低电压(的enCoRe II LV) - 增强
减少组件
国内非晶振荡器可选克斯特支持
内部时钟或外部晶体或谐振器
可配置IO为没有外部的COM真实世界的接口
ponents
增强型8位微控制器
哈佛架构
M8C CPU速度可达12 MHz或来源由外部
晶振,谐振器或时钟信号
内部存储器
256字节的RAM
8 KB的闪存,包括EEROM仿真
低功耗
通常情况下2.25毫安在3 MHz
5
μA
睡觉
在系统重新编程
可以方便的固件更新
通用IO口
多达36个通用IO ( GPIO)引脚
所有GPIO引脚2 mA输出电流。可配置8个或
每个引脚的电流吸收器50毫安在指定的销
每个GPIO端口支持高阻抗输入, config-
urable拉起,开漏输出, CMOS和TTL输入,
CMOS输出
可屏蔽中断所有的IO引脚
SPI串行通信
主机或从机操作
可配置高达每秒传输的2 Mbit
支持半双工单根数据线模式,光学传感器
2通道8位或1通道16位定时器捕捉寄存器。
捕捉定时器寄存器保存上升沿和下降沿时间
每两个寄存器的两个输入引脚
独立的寄存器上升沿和下降沿捕获
简化了接口到RF输入用于无线应用
在挂起模式内部低功耗唤醒定时器
周期性唤醒,无需外部元件
可编程间隔定时器中断
减少RF辐射在27 MHz和96 MHz的
看门狗定时器( WDT )
低电压检测与用户选择的阈值电压
改进的输出驱动器,以降低EMI
2.7V至3.6V的直流工作电压
从0-70 ° C工作温度
采用24和40引脚PDIP , 24引脚SOIC , 24引脚QSOP
和SSOP , 28引脚SSOP和48引脚SSOP
基于赛普拉斯的PSoC先进的开发工具
工具
行业标准的编程支持
2.逻辑框图
打断
控制
4 SPI / GPIO
引脚
16扩展
I / O引脚
16个GPIO
引脚
唤醒
定时器
国内
12兆赫
振荡器
时钟
控制
水晶
振荡器
只有CY7C601xx
M8C CPU
内存
256字节
FL灰
8K字节
CAPTURE
计时器
12位定时器
POR /
低电压
检测
VDD
看门狗
定时器
赛普拉斯半导体公司
文件38-16016牧师* D
198冠军苑
圣荷西
,
CA 95134-1709
408-943-2600
修订后的2008年5月19日
[+ ]反馈
CY7C601xx , CY7C602xx
3.应用
该CY7C601xx和CY7C602xx是针对以下
应用范围:
PC无线HID设备
小鼠(光学机械,光学,轨迹球)
键盘
演示工具
赌博
操纵杆
游戏手柄
通用无线应用
遥控器
条码扫描器
POS终端
消费类电子产品
玩具
此外,安可II LV包括一个看门狗定时器,一个向量
中断控制器, 16位自由运行定时器捕获
寄存器,和一个12位可编程间隔计时器。电源
上电复位电路检测当电源被施加到器件上,
复位逻辑到一个已知的状态,并且在执行指令
Flash地址为0x0000 。当电量低于可编程
触发电压时,它产生一个复位或者被配置成生成
中断。有一个低电压检测电路,其检测当
V
CC
低于可编程的触发电压。这被配置
urable以产生LVD中断通知处理器大约
低电压事件。 POR和LVD共享同一个中断;
还有就是每个没有单独的中断。看门狗定时器
确保固件永远不会被锁定在一个无限循环。
该微控制器支持17可屏蔽中断
向量中断控制器。所有的中断可以被屏蔽。
中断源包括LVR或上电复位,可编程间隔
计时器,从自由标称1.024毫秒可编程输出
运行的定时器,两个捕捉定时器, 5个GPIO端口,三个GPIO
销,两个SPI ,一个16位自由运行的定时器包住,和一个内部
唤醒定时器中断。唤醒定时器产生周期性的接口
启用时,中断产生。捕捉定时器中断每当
新的定时器值保存由于所选的GPIO边沿事件。一
共有八个GPIO的中断同时支持TTL或CMOS
阈值。对于额外的灵活性,对边沿敏感GPIO
引脚,中断极性可编程为上升沿或
坠落。
自由运行的定时器产生中断1024
μs
率。它
还产生一个中断时,自由运行计数器
发生-每16.384毫秒溢出。事件的持续时间
在固件控制下被读出计时器的测量
启动以及事件的结束,然后计算该差
这两个值之间。两个8位定时器捕捉寄存器
保存自由运行的计时器,当一个可编程的8位范围
在两个捕捉引脚( P0.5和P0.6 )一个GPIO边缘发生。
两个8位捕获寄存器伙同成一个单一的16位
捕捉寄存器。
安可II LV通过支持在系统编程
P1.0和P1.1引脚作为串行编程模式接口。
4.简介
安可II LV系列提供的功能和好处
的enCoRe II非USB应用。安可II系列有
集成振荡器,消除了外部晶振或
谐振器中,降低了整体成本。其它外部元件,
如唤醒电路,还集成了该芯片。
安可II LV是一款低电压,低成本8位闪存编程
梅布尔微控制器。
安可II LV拥有多达36个GPIO引脚。在IO引脚
分成五个端口(端口0 4)。在端口0和1的销
被分别配置,当在端口2 ,3和4的插针
仅配置为一组。每个GPIO端口支持高
阻抗输入,可配置的上拉,开漏输出,
CMOS和TTL输入和CMOS输出最多五个引脚
支持高达50 mA灌电流的可编程驱动强度。
此外,每个IO管脚被用于生成一个GPIO中断
微控制器。每个GPIO端口都有自己的GPIO的中断
矢量除GPIO端口0 GPIO端口0了,在
除了端口的中断矢量,三个专用引脚
有独立的中断向量( P0.2 - P0.4 ) 。
安可II LV设有一个内部振荡器。任选地,一个
外部1兆赫至24兆赫晶体被用来提供更高的
精密基准。安可II LV还支持外接
时钟。
安可II LV有8 KB的闪存用户代码和256
字节的RAM堆栈空间和用户变量。
5.约定
在本文档中,在寄存器的位位置被遮蔽,以
这表明安可II LV家族的成员实施
的位。
在所有的enCoRe II LV家族成员
只有CY7C601xx
文件38-16016牧师* D
第67 2
[+ ]反馈
CY7C601xx , CY7C602xx
6.插脚引线
图6-1 。包配置
顶视图
CY7C60223
24引脚PDIP
P3.0
P3.1
SCLK/P1.4
SMOSI/P1.5
SMISO/P1.6
P1.7
NC
NC
P0.7
TIO1/P0.6
TIO0/P0.5
INT2/P0.4
1
2
3
4
5
6
7
8
9
10
11
12
24
23
22
21
20
19
18
17
16
15
14
13
P1.3/SSEL
P1.2
V
DD
P1.1
P1.0
V
SS
P2.0
P2.1
P0.0/CLKIN
P0.1/CLKOUT
P0.2/INT0
P0.3/INT1
CY7C60223
24引脚SOIC
NC
P0.7
TIO1/P0.6
TIO0/P0.5
INT2/P0.4
INT1/P0.3
INT0/P0.2
CLKOUT\P0.1
CLKIN\P0.0
P2.1
P2.0
V
SS
1
2
3
4
5
6
7
8
9
10
11
12
24
23
22
21
20
19
18
17
16
15
14
13
NC
P1.7
P1.6/SMISO
P1.5/SMOSI
P1.4/SCLK
P3.1
P3.0
P1.3/SSEL
P1.2
V
DD
P1.1
P1.0
CY7C60223
24引脚QSOP
NC
P0.7
TIO1/P0.6
TIO0/P0.5
INT2/P0.4
INT1/P0.3
INT0/P0.2
CLKOUT\P0.1
CLKIN\P0.0
P2.1
P2.0
NC
1
2
3
4
5
6
7
8
9
10
11
12
24
23
22
21
20
19
18
17
16
15
14
13
P1.7
P1.6/SMISO
P1.5/SMOSI
P1.4/SCLK
P3.1
P3.0
P1.3/SSEL
P1.2
V
DD
P1.1
P1.0
V
SS
CY7C60113
28引脚SSOP
V
DD
P2.7
P2.6
P2.5
P2.4
P0.7
TIO1/P0.6
TIO0/P0.5
INT2/P0.4
INT1/P0.3
INT0/P0.2
CLKOUT/P0.1
CLKIN/P0.0
V
SS
1
2
3
4
5
6
7
8
9
10
11
12
13
14
28
27
26
25
24
23
22
21
20
19
18
17
16
15
V
SS
P3.7
P3.6
P3.5
P3.4
P1.7
P1.6/SMISO
P1.5/SMOSI
P1.4/SCLK
P1.3/SSEL
P1.2
V
DD
P1.1
P1.0
CY7C60123
40引脚PDIP
V
DD
P4.1
P4.0
P2.7
P2.6
P2.5
P2.4
P2.3
P2.2
P2.1
P2.0
P0.7
T1O1/P0.6
TIO0/P0.5
INT2/P0.4
INT1/P0.3
INT0/P0.2
CLKOUT/P0.1
CLKIN/P0.0
V
SS
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
40
39
38
37
36
35
34
33
32
31
30
29
28
27
26
25
24
23
22
21
V
SS
P4.3
P4.2
P3.7
P3.6
P3.5
P3.4
P3.3
P3.2
P3.1
P3.0
P1.7
P1.6/SMISO
P1.5/SMOSI
P1.4/SCLK
P1.3/SSEL
P1.2
V
DD
P1.1
P1.0
CY7C60123
48引脚SSOP
NC
NC
NC
NC
V
DD
P4.1
P4.0
P2.7
P2.6
P2.5
P2.4
P2.3
P2.2
P2.1
P2.0
P0.7
TIO1/P0.6
TIO0/PO.5
INT2/P0.4
INT1/P0.3
INT0/P0.2
CLKOUT/P0.1
CLKIN/P0.0
V
SS
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
48
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
32
31
30
29
28
27
26
25
NC
NC
NC
NC
V
SS
P4.3
P4.2
P3.7
P3.6
P3.5
P3.4
P3.3
P3.2
P3.1
P3.0
P1.7
P1.6/SMISO
P1.5/SMOSI
P1.4/SCLK
P1.3/SSEL
P1.2
V
DD
P1.1
P1.0
文件38-16016牧师* D
第67 3
[+ ]反馈
CY7C601xx , CY7C602xx
6.1引脚分配
表6-1 。引脚分配
48
40
28
24
24
SSOP PDIP SSOP QSOP SOIC
7
6
42
43
34
35
36
37
38
39
40
41
15
14
13
12
11
10
9
8
25
3
2
38
39
30
31
32
33
34
35
36
37
11
10
9
8
7
6
5
4
21
5
4
3
2
15
14
13
20
24
25
26
27
11
10
11
10
18
17
19
20
18
19
1
2
24
PDIP
名字
P4.0
P4.1
P4.2
P4.3
P3.0
P3.1
P3.2
P3.3
P3.4
P3.5
P3.6
P3.7
P2.0
P2.1
P2.2
P2.3
P2.4
P2.5
P2.6
P2.7
P1.0
GPIO口位0
如果此引脚用作通用输出它汲取电流。
据,因此,被配置为输入,以减少电流消耗。
GPIO口位1
如果此引脚用作通用输出它汲取电流。
据,因此,被配置为输入,以减少电流消耗。
GPIO口位2
GPIO口位分别3配置
复用功能是SPI总线的SSEL信号。
GPIO端口1位独立4配置
复用功能是SPI总线的SCLK信号。
GPIO口位分别5配置
复用功能是SPI总线的SMOSI信号。
GPIO端口1位独立6配置
复用功能是SPI总线的SMISO信号。
GPIO端口1位独立7配置
TTL电压阈值。
GPIO端口2配置为一组(字节)
GPIO端口3设置为一组(字节)
描述
GPIO端口4配置为一组(半字节)
26
22
16
15
14
21
P1.1
28
29
30
31
32
33
24
25
26
27
28
29
18
19
20
21
22
23
17
18
21
22
23
24
16
17
20
21
22
23
23
24
3
4
5
6
P1.2
P1.3/SSEL
P1.4/SCLK
P1.5/SMOSI
P1.6/SMISO
P1.7
文件38-16016牧师* D
第67 4
[+ ]反馈
CY7C601xx , CY7C602xx
表6-1 。引脚分配
(续)
48
40
28
24
24
SSOP PDIP SSOP QSOP SOIC
23
19
13
9
9
24
PDIP
16
名字
P0.0/CLKIN
描述
GPIO端口0位0分别配置
在CY7C601xx ,可选的时钟输入,当外部振荡器
当外部振荡器被禁止或外部振荡器输入
启用。
在CY7C602xx ,振荡器输入当配置为时钟输入。
22
18
12
8
8
15
P0.1 / CLKOUT GPIO端口0位单独1配置
在CY7C601xx ,可选的时钟输出,当外部振荡器
禁用或外部振荡器的输出驱动器时,外部振荡
荡器被启用。
在CY7C602xx ,振荡器的输出当配置为时钟输出。
P0.2/INT0
P0.3/INT1
P0.4/INT2
P0.5/TIO0
P0.6/TIO1
P0.7
NC
NC
V
DD
GPIO端口0位独立2配置
可选择上升沿触发中断INT0 。
GPIO端口0位独立3配置
可选择上升沿触发中断INT1 。
GPIO端口0位独立4配置
可选择上升沿触发中断INT2 。
GPIO端口0位独立5配置
复用功能定时器捕捉输入或定时器输出TIO0 。
GPIO端口0位独立6配置
复用功能定时器捕捉输入或定时器输出TIO1 。
GPIO端口0位独立7配置
无连接
无连接
动力
21
20
19
18
17
16
1,2,3,
4
45,46,
47,48
5
27
44
24
17
16
15
14
13
12
11
10
9
8
7
6
7
6
5
4
3
2
1
12
7
6
5
4
3
2
1
24
14
13
12
11
10
9
7
8
1
23
40
20
17
1
14
28
16
13
15
12
22
19
V
SS
文件38-16016牧师* D
第67 5
[+ ]反馈
CY7C601xx
CY7C602xx
的enCoRe II低电压
微控制器
特点
的enCoRe II低电压(的enCoRe II LV ) - “增强
分量减少“
- 内部非晶振荡器的可选支持
外部时钟或外部晶体或谐振器。
- 可配置的IO为无外部真实世界的接口
组件
增强型8位微控制器
- 哈佛架构
- M8C CPU速度可高达12 MHz或来源由
外部晶振,谐振器或时钟信号
内部存储器
- 256字节的RAM
- 8 KB的闪存,包括EEROM仿真
低功耗
- 通常2.25毫安在3 MHz
— 5
A
睡觉
在系统重新编程
- 允许方便的固件更新
通用I / O端口
- 最多36个通用I / O( GPIO )引脚
- 对GPIO引脚高电流驱动。可配置的8位或50
在指定的引脚毫安/针吸电流
- 每个GPIO端口支持高阻抗输入, config-
urable上拉,开漏输出, CMOS / TTL输入,
CMOS输出
- 可屏蔽中断的所有I / O引脚
SPI串行通信
- 主机或从机操作
- 可配置高达2兆位/秒的传输。
- 支持半双工单根数据线模式,光
传感器
2通道8位或1通道16位定时器捕捉寄存器。
捕捉定时器寄存器保存上升沿和下降沿
- 每两个寄存器的两个输入引脚
- 独立的寄存器上升沿和下降沿捕获
- 简化界面, RF输入,用于无线应用
内部低功率唤醒定时器在挂起模式
- 定期唤醒,无需外部元件
可编程间隔定时器中断
减少RF辐射在27 MHz和96 MHz的
看门狗定时器( WDT )
低电压检测与用户选择的门槛
电压
改进的输出驱动器,以降低EMI
工作电压为2.7V至3.6VDC
从0-70 ° C工作温度
可在四十〇分之二十四引脚PDIP , 24引脚SOIC ,24引脚
QSOP / SSOP , 28引脚SSOP和48引脚SSOP封装。
基于赛普拉斯的PSoC先进的开发工具
工具
行业标准的编程支持
应用
该CY7C601xx / CY7C602xx是针对以下
应用范围:
PC无线HID设备
- 小鼠(光学机械,光学,轨迹球)
- 键盘
- 演示工具
游戏
- 操纵杆
- 游戏手柄
通用无线应用
- 遥控器
- 条码扫描仪
- POS终端
- 消费电子
玩具
介绍
安可II LV系列提供的功能和好处
的enCoRe II非USB应用。安可II系列具有
一个集成的振荡器,消除了外部晶振或
谐振器中,降低了整体成本。其它外部元件,
如唤醒电路,还集成了该芯片。
安可II LV是一个低电压,低成本的8位闪烁
可编程微控制器
安可II LV拥有多达36个通用I / O
( GPIO )引脚。在I / O引脚分为五个端口(端口0
4)。在端口0和端口1的引脚可以分别配置
个别地,而在端口2,第3管脚和4可能只是
被配置为一组。每个GPIO端口支持高
阻抗输入,可配置的上拉,开漏输出,
CMOS / TTL输入和CMOS输出最多五个引脚
支持高达50 mA片可编程驱动强度
电流。此外,每个I / O引脚可被用于产生一个
GPIO的中断给单片机。每个GPIO端口都有
自己的GPIO中断除GPIO端口0向量。
GPIO端口0有除了端口的中断向量,三
专用引脚具有独立的中断向量
(P0.2–P0.4).
赛普拉斯半导体公司
文件38-16016牧师* C
198冠军苑
圣荷西
,
CA 95134-1709
408-943-2600
修订后的2006年10月23日
[+ ]反馈
CY7C601xx
CY7C602xx
安可II LV设有一个内部振荡器。任选地,一个
外部1兆赫至24兆赫晶体可以用来提供一个
高精密基准。安可II LV也支持
外部时钟
安可II LV有8 KB的闪存供用户代码和
256个字节的RAM用于堆栈空间和用户变量。
此外,安可II LV包括一个看门狗定时器,
向量中断控制器, 16位自由运行定时器
捕捉寄存器和一个12位可编程间隔定时器。
上电复位电路检测当电源被施加到
该装置中,将复位逻辑到一个已知的状态,并且开始
在闪存执行指令地址0x0000 。当电源
低于可编程门限电压就产生一个复位或
可以被配置为产生中断。有一种低 -
电压检测电路检测时, V
CC
下降到低于
可编程跳转电压和它可以被配置为
产生LVD中断通知处理器有关
低电压事件。 POR和LVD共享同一个中断;
还有就是每个没有单独的中断。看门狗定时器
可用于确保固件程序停止在一个
无限循环。
该微控制器支持17可屏蔽中断
向量中断控制器。所有的中断可以被屏蔽。
中断源包括LVR / POR ,一个可编程间隔
计时器,从免费的标称1.024毫秒可编程输出
运行定时器,两个捕捉定时器, 5个GPIO端口,三个
GPIO引脚,两个SPI , 16位自由运行定时器包装和
内部唤醒定时器中断。唤醒定时器的原因
当启用周期性的中断。捕捉定时器中断
每当一个新的计时器的值被保存,由于所选的GPIO
边缘事件。共有8个GPIO中断支持TTL
或CMOS阈值。为了进一步增强灵活性,在边沿
敏感的GPIO引脚,中断极性是可编程的,
可无论是上升或下降。
自由运行的定时器产生中断,在1024微秒率。
它也可以产生中断时,自由运行计数器
发生-每16.384毫秒溢出。计时器可以用来
通过测量一个事件在固件控制下的持续时间
读取定时器的开始和在事件结束时,则
计算这两个值之间的差。两个8
位捕捉定时器寄存器保存的可编程的8位范围
自由运行的定时器上的两个当GPIO边缘出现
捕捉引脚( P0.5 , P0.6 ) 。两个8位捕获寄存器可
将伙同成一个单一的16位捕获寄存器。
安可II LV通过支持在系统编程
的P1.0和P1.1引脚作为串行编程模式
界面。
约定
在本文档中,在寄存器的位位置被遮蔽,以
这表明安可II LV家族的成员实施
的位。
在所有的enCoRe II LV家族成员
只有CY7C601xx
逻辑框图
图1. CY7C601xx / CY7C602xx框图
打断
控制
4 SPI / GPIO
引脚
16扩展
I / O引脚
16个GPIO
引脚
唤醒
定时器
国内
12兆赫
振荡器
时钟
控制
水晶
振荡器
只有CY7C601xx
M8C CPU
内存
256字节
FL灰
8K字节
CAPTURE
计时器
12位定时器
POR /
低电压
检测
VDD
看门狗
定时器
文件38-16016牧师* C
第62 2
[+ ]反馈
CY7C601xx
CY7C602xx
包/引脚配置
图2.包配置
顶视图
CY7C60223
24引脚PDIP
P3.0
P3.1
SCLK/P1.4
SMOSI/P1.5
SMISO/P1.6
P1.7
NC
NC
P0.7
TIO1/P0.6
TIO0/P0.5
INT2/P0.4
1
2
3
4
5
6
7
8
9
10
11
12
24
23
22
21
20
19
18
17
16
15
14
13
P1.3/SSEL
P1.2
V
DD
P1.1
P1.0
V
SS
P2.0
P2.1
P0.0/CLKIN
P0.1/CLKOUT
P0.2/INT0
P0.3/INT1
CY7C60223
24引脚SOIC
NC
P0.7
TIO1/P0.6
TIO0/P0.5
INT2/P0.4
INT1/P0.3
INT0/P0.2
CLKOUT\P0.1
CLKIN\P0.0
P2.1
P2.0
V
SS
1
2
3
4
5
6
7
8
9
10
11
12
24
23
22
21
20
19
18
17
16
15
14
13
NC
P1.7
P1.6/SMISO
P1.5/SMOSI
P1.4/SCLK
P3.1
P3.0
P1.3/SSEL
P1.2
V
DD
P1.1
P1.0
CY7C60223
24引脚QSOP
NC
P0.7
TIO1/P0.6
TIO0/P0.5
INT2/P0.4
INT1/P0.3
INT0/P0.2
CLKOUT\P0.1
CLKIN\P0.0
P2.1
P2.0
NC
1
2
3
4
5
6
7
8
9
10
11
12
24
23
22
21
20
19
18
17
16
15
14
13
P1.7
P1.6/SMISO
P1.5/SMOSI
P1.4/SCLK
P3.1
P3.0
P1.3/SSEL
P1.2
V
DD
P1.1
P1.0
V
SS
CY7C60113
28引脚SSOP
V
DD
P2.7
P2.6
P2.5
P2.4
P0.7
TIO1/P0.6
TIO0/P0.5
INT2/P0.4
INT1/P0.3
INT0/P0.2
CLKOUT/P0.1
CLKIN/P0.0
V
SS
1
2
3
4
5
6
7
8
9
10
11
12
13
14
28
27
26
25
24
23
22
21
20
19
18
17
16
15
V
SS
P3.7
P3.6
P3.5
P3.4
P1.7
P1.6/SMISO
P1.5/SMOSI
P1.4/SCLK
P1.3/SSEL
P1.2
V
DD
P1.1
P1.0
CY7C60123
40引脚PDIP
V
DD
P4.1
P4.0
P2.7
P2.6
P2.5
P2.4
P2.3
P2.2
P2.1
P2.0
P0.7
T1O1/P0.6
TIO0/P0.5
INT2/P0.4
INT1/P0.3
INT0/P0.2
CLKOUT/P0.1
CLKIN/P0.0
V
SS
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
40
39
38
37
36
35
34
33
32
31
30
29
28
27
26
25
24
23
22
21
V
SS
P4.3
P4.2
P3.7
P3.6
P3.5
P3.4
P3.3
P3.2
P3.1
P3.0
P1.7
P1.6/SMISO
P1.5/SMOSI
P1.4/SCLK
P1.3/SSEL
P1.2
V
DD
P1.1
P1.0
CY7C60123
48引脚SSOP
NC
NC
NC
NC
V
DD
P4.1
P4.0
P2.7
P2.6
P2.5
P2.4
P2.3
P2.2
P2.1
P2.0
P0.7
TIO1/P0.6
TIO0/PO.5
INT2/P0.4
INT1/P0.3
INT0/P0.2
CLKOUT/P0.1
CLKIN/P0.0
V
SS
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
48
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
32
31
30
29
28
27
26
25
NC
NC
NC
NC
V
SS
P4.3
P4.2
P3.7
P3.6
P3.5
P3.4
P3.3
P3.2
P3.1
P3.0
P1.7
P1.6/SMISO
P1.5/SMOSI
P1.4/SCLK
P1.3/SSEL
P1.2
V
DD
P1.1
P1.0
文件38-16016牧师* C
第62 3
[+ ]反馈
CY7C601xx
CY7C602xx
引脚分配
表1.引脚分配
48
40
28
24
24
SSOP PDIP SSOP QSOP SOIC
7
6
42
43
34
35
36
37
38
39
40
41
15
14
13
12
11
10
9
8
25
26
28
29
30
31
32
33
23
3
2
38
39
30
31
32
33
34
35
36
37
11
10
9
8
7
6
5
4
21
22
24
25
26
27
28
29
19
5
4
3
2
15
16
18
19
20
21
22
23
13
14
15
17
18
21
22
23
24
9
13
14
16
17
20
21
22
23
9
20
21
23
24
3
4
5
6
16
24
25
26
27
11
10
11
10
18
17
19
20
18
19
1
2
24
PDIP
名字
P4.0
P4.1
P4.2
P4.3
P3.0
P3.1
P3.2
P3.3
P3.4
P3.5
P3.6
P3.7
P2.0
P2.1
P2.2
P2.3
P2.4
P2.5
P2.6
P2.7
P1.0
P1.1
P1.2
P1.3/SSEL
P1.4/SCLK
P1.5/SMOSI
P1.6/SMISO
P1.7
P0.0/CLKIN
GPIO口位0
GPIO口位1
GPIO口位2
GPIO口位3单独配置。
复用功能是SPI总线的SSEL信号
GPIO口位4分别配置。
复用功能是SPI总线的SCLK信号
GPIO口位分别5配置。
复用功能是SPI总线SMOSI信号
GPIO端口1位独立6配置。
复用功能是SPI总线SMISO信号
GPIO端口1位独立7配置。 TTL电压阈值
GPIO端口0位0分别配置。
在CY7C601xx ,可选的时钟输入,当外部振荡器
当外部振荡器被禁止或外部振荡器输入
启用。
在CY7C602xx ,振荡器输入当配置为时钟输入
如果此引脚用作通用输出将借鉴
电流。该引脚应配置为输入,以减少
电流消耗。
GPIO端口2配置为一组(字节)
GPIO端口3设置为一组(字节)
描述
GPIO端口4配置为一组(半字节)
文件38-16016牧师* C
第62 4
[+ ]反馈
CY7C601xx
CY7C602xx
表1.引脚分配
(续)
48
40
28
24
24
SSOP PDIP SSOP QSOP SOIC
22
18
12
8
8
24
PDIP
15
名字
描述
P0.1 / CLKOUT GPIO端口0位单独1配置
在CY7C601xx ,可选的时钟输出,当外部振荡器
禁用或外部振荡器的输出驱动器时,外部振荡
荡器被启用。
在CY7C602xx ,振荡器的输出当配置为时钟输出。
如果此引脚用作通用输出将借鉴
电流。该引脚应配置为输入,以减少
电流消耗。
P0.2/INT0
P0.3/INT1
P0.4/INT2
P0.5/TIO0
P0.6/TIO1
P0.7
NC
NC
V
DD
GPIO端口0位独立2配置
可选择上升沿中断INT0
GPIO端口0位独立3配置
可选择上升沿中断INT1
GPIO端口0位独立4配置
可选择上升沿中断INT2
GPIO端口0位独立5配置
复用功能定时器捕捉输入或定时器输出TIO0
GPIO端口0位独立6配置
复用功能定时器捕捉输入或定时器输出TIO1
GPIO端口0位独立7配置
无连接
无连接
动力
21
20
19
18
17
16
1,2,3,
4
45,46,
47,48
5
27
44
24
17
16
15
14
13
12
11
10
9
8
7
6
7
6
5
4
3
2
1
12
7
6
5
4
3
2
1
24
14
13
12
11
10
9
7
8
1
23
40
20
17
1
14
28
16
13
15
12
22
19
V
SS
文件38-16016牧师* C
第62 5
[+ ]反馈
CY7C601xx , CY7C602xx
的enCoRe II低电压微控制器
1.产品特点
enCoRe II低电压(的enCoRe II LV) - 增强型
减少组件
国内非晶振荡器的可选支持
外部时钟或外部晶体或谐振器
可配置的I / O ,无需外部真实世界的接口
组件
增强型8位微控制器
哈佛架构
M8C CPU速度可达12 MHz或来源由外部
晶振,谐振器或时钟信号
内部存储器
256字节的随机存取存储器(RAM)的
8 KB闪存,包括电可擦除只读存储器
( EEROM )仿真
低功耗
通常情况下2.25毫安在3 MHz
5
A
睡觉
在系统重新编程
可方便固件更新
通用I / O( GPIO )端口
多达36个GPIO引脚
所有GPIO引脚2 mA的电流源
每个引脚的电流吸收器可配置8或50毫安指定
引脚
每个GPIO端口支持高阻抗输入,
可配置的上拉,开漏输出,互补
金属氧化物半导体(CMOS) ,和
晶体管 - 晶体管逻辑(TTL )输入,输出和CMOS输出
可屏蔽中断的所有I / O引脚
SPI串行通信
主机或从机操作
可配置高达每秒传输的2 Mbit
支持半双工单一数据线模式,光
传感器
2通道8位或1通道16位定时器捕捉寄存器,
其中存储上升沿和下降沿时间
每两个寄存器的两个输入引脚
独立的寄存器上升沿和下降沿捕获
简化接口以射频(RF )输入,用于无线
应用
内部低功耗唤醒定时器在挂起模式
周期性唤醒,无需外部元件
可编程间隔定时器中断
减少RF辐射在27 MHz和96 MHz的
看门狗定时器( WDT )
低电压检测( LVD )和用户可选的门限
电压
改进的输出驱动器,以减少电磁干扰
(EMI)的
工作电压范围为2.7 V至3.6 V DC
操作温度为0℃至70℃
可提供40引脚塑料双列直插式封装( PDIP ) , 24针
小外形集成电路( SOIC ) , 24引脚四方小
外形封装( QSOP )和收缩型小外形封装
( SSOP ) ,48引脚SSOP
基于赛普拉斯的PSoC先进的开发工具
工具
行业标准的编程支持
2.逻辑框图
打断
控制
4 SPI / GPIO
引脚
16扩展
I / O引脚
16个GPIO
引脚
唤醒
定时器
国内
12兆赫
振荡器
时钟
控制
水晶
振荡器
只有CY7C601xx
M8C CPU
内存
256字节
FL灰
8 KB
12位定时器
CAPTURE
计时器
POR /
低电压
检测
V
DD
看门狗
定时器
赛普拉斯半导体公司
文件38-16016牧师*
198冠军苑
美国加州圣何塞95134-1709
408-943-2600
修订后的2011年6月6日
CY7C601xx , CY7C602xx
3.内容
应用................................................. ..................... 3
简介................................................. ...................... 3
约定................................................. ..................... 3
引脚分配................................................. ............................. 4
引脚分配................................................ .......... 5
注册摘要................................................ ............ 7
CPU体系结构................................................ .............. 9
CPU寄存器................................................ ................... 9
标志登记................................................ ............. 9
寻址方式................................................ ..... 11
指令集摘要............................................... 13
存储器结构................................................ ..... 15
闪存程序存储器组织....................... 15
数据存储器....................................... 16
闪存................................................. ......................... 16
SROM ................................................. ....................... 16
SROM功能说明.................................... 17
SROM读表说明................................. 20
时钟................................................. ......................... 22
调整值的IOSCTR注册....................... 22
时钟体系结构描述.................................. 23
CPU时钟在休眠模式下................................. 30
复位................................................. ............................... 31
上电复位............................................... ......... 32
看门狗定时器复位.............................................. 32
睡眠模式................................................ ...................... 32
睡眠序列................................................ ........ 33
唤醒序列................................................ .... 34
低电压检测控制......................................... 35
POR比较国家............................................... .. 36
ECO调整寄存器............................................... ..... 36
通用I / O端口........................................... .. 37
数据寄存器端口............................................... .... 37
GPIO端口配置........................................... 38
串行外设接口( SPI ) .................................... 45
SPI数据寄存器............................................... ....... 46
SPI配置寄存器............................................. 46
SPI接口引脚............................................... ....... 48
定时寄存器................................................ .............. 48
寄存器................................................. .................. 48
中断控制器................................................ ......... 55
建筑说明........................................... 56
中断处理................................................ .. 56
中断延迟................................................ ....... 56
中断寄存器................................................ ..... 57
绝对最大额定值.......................................... 60
直流特性................................................ .... 60
AC特征................................................ .... 61
订购信息................................................ ...... 64
包处理................................................ ........... 64
包图................................................ .......... 65
文档历史记录页............................................... .. 67
销售,解决方案和法律信息...................... 68
文件38-16016牧师*
第68 2
CY7C601xx , CY7C602xx
4.应用
该CY7C601xx和CY7C602xx是针对以下
应用范围:
PC的无线人机接口设备( HID )
小鼠(光学机械,光学,轨迹球)
键盘
演示工具
赌博
操纵杆
游戏手柄
通用无线应用
遥控器
条码扫描器
POS终端
消费类电子产品
玩具
此外,安可II LV包括一个看门狗定时器,一个向量中断
控制器, 16位自由运行定时器捕获寄存器,并
一个12位的可编程间隔计时器。上电复位( POR )
电路检测当电源被施加到所述装置中,将复位
逻辑到已知状态,并执行在闪存地址的说明
0×0000 。当电量低于可编程门限电压时,
产生复位或者被配置成生成一个中断。那里
是LVD电路检测当V
CC
下降到低于
可编程的触发电压。这是可配置的,以产生一个
LVD中断通知处理器对低压
事件。 POR和LVD共享同一个中断;没有
单独的中断为每个。该WDT确保固件
永远不会被锁定在一个无限循环。
该微控制器支持17可屏蔽中断
向量中断控制器。所有的中断可以被屏蔽。
中断源包括LVR或上电复位,可编程间隔
计时器,从标称1.024毫秒可编程输出
自由运行的定时器,两个捕捉定时器, 5个GPIO端口,三个
GPIO引脚,两个SPI , 16位自由运行定时器包,和一个
内部唤醒定时器中断。唤醒定时器的原因
当启用周期性的中断。捕捉定时器中断
每当一个新的计时器的值被保存,由于所选的GPIO
边缘事件。共有8个GPIO中断支持TTL或
CMOS阈值。对于额外的灵活性,对边沿敏感
GPIO引脚,中断极性可编程为任
上升或下降。
自由运行的定时器产生中断,在1024 s率。它
还产生一个中断时,自由运行计数器
溢出 - 每16.384毫秒。事件的持续时间
在固件控制下被读出计时器的测量
启动以及事件的结束,然后计算该差
这两个值之间。两个8位定时器捕捉寄存器
保存自由运行的定时器,当一个可编程的8位范围
在两个捕捉引脚( P0.5和P0.6 )一个GPIO边缘发生。
两个8位捕获寄存器伙同成一个单一的16位
捕捉寄存器。
安可II LV通过支持在系统编程
P1.0和P1.1引脚作为串行编程模式接口。
5.简介
安可II LV系列提供的功能和好处
的enCoRe II非USB应用。安可II系列具有
一个集成的振荡器,消除了外部晶振或
谐振器中,降低了整体成本。其它外部元件,
如唤醒电路,还集成了该芯片。
安可II LV是一个低电压,低成本的8位
闪存可编程微控制器。
安可II LV拥有多达36个GPIO引脚。在I / O引脚
分成五个端口(端口0 4)。在端口0和1的销
被分别配置,当在端口2,3的引脚,和图4是
只有配置为一组。每个GPIO端口支持
高阻抗输入,可配置的上拉,开漏输出,
CMOS和TTL输入和CMOS输出多达五个引脚
那支持可编程驱动强度可达50 mA的水槽
电流。此外,每个I / O引脚被用来生成一个GPIO
中断单片机。每个GPIO端口都有自己的GPIO
中断向量除GPIO端口0 GPIO端口0
有,除了该端口的中断矢量,三个专用引脚
有独立的中断向量( P0.2 - P0.4 ) 。
安可II LV设有一个内部振荡器。任选地,一个
外部1兆赫至24兆赫晶体被用来提供更高的
精密基准。安可II LV还支持外接
时钟。
安可II LV对用户代码8 KB的闪存和256字节
内存的堆栈空间和用户变量。
6.约定
在本文档中,在寄存器的位位置被遮蔽,以
这表明安可II LV家族的成员实施
的位。
在所有的enCoRe II LV家族成员
只有CY7C601xx
文件38-16016牧师*
第68 3
CY7C601xx , CY7C602xx
7.插脚引线
图7-1 。包配置
顶视图
CY7C60223
24引脚SOIC
NC
P0.7
TIO1/P0.6
TIO0/P0.5
INT2/P0.4
INT1/P0.3
INT0/P0.2
CLKOUT\P0.1
CLKIN\P0.0
P2.1
P2.0
V
SS
1
2
3
4
5
6
7
8
9
10
11
12
24
23
22
21
20
19
18
17
16
15
14
13
NC
P1.7
P1.6/SMISO
P1.5/SMOSI
P1.4/SCLK
P3.1
P3.0
P1.3/SSEL
P1.2
V
DD
P1.1
P1.0
CY7C60223
24引脚QSOP
NC
P0.7
TIO1/P0.6
TIO0/P0.5
INT2/P0.4
INT1/P0.3
INT0/P0.2
CLKOUT\P0.1
CLKIN\P0.0
P2.1
P2.0
NC
1
2
3
4
5
6
7
8
9
10
11
12
24
23
22
21
20
19
18
17
16
15
14
13
P1.7
P1.6/SMISO
P1.5/SMOSI
P1.4/SCLK
P3.1
P3.0
P1.3/SSEL
P1.2
V
DD
P1.1
P1.0
V
SS
CY7C60123
40引脚PDIP
V
DD
P4.1
P4.0
P2.7
P2.6
P2.5
P2.4
P2.3
P2.2
P2.1
P2.0
P0.7
T1O1/P0.6
TIO0/P0.5
INT2/P0.4
INT1/P0.3
INT0/P0.2
CLKOUT/P0.1
CLKIN/P0.0
V
SS
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
40
39
38
37
36
35
34
33
32
31
30
29
28
27
26
25
24
23
22
21
V
SS
P4.3
P4.2
P3.7
P3.6
P3.5
P3.4
P3.3
P3.2
P3.1
P3.0
P1.7
P1.6/SMISO
P1.5/SMOSI
P1.4/SCLK
P1.3/SSEL
P1.2
V
DD
P1.1
P1.0
CY7C60123
48引脚SSOP
NC
NC
NC
NC
V
DD
P4.1
P4.0
P2.7
P2.6
P2.5
P2.4
P2.3
P2.2
P2.1
P2.0
P0.7
TIO1/P0.6
TIO0/PO.5
INT2/P0.4
INT1/P0.3
INT0/P0.2
CLKOUT/P0.1
CLKIN/P0.0
V
SS
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
48
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
32
31
30
29
28
27
26
25
NC
NC
NC
NC
V
SS
P4.3
P4.2
P3.7
P3.6
P3.5
P3.4
P3.3
P3.2
P3.1
P3.0
P1.7
P1.6/SMISO
P1.5/SMOSI
P1.4/SCLK
P1.3/SSEL
P1.2
V
DD
P1.1
P1.0
文件38-16016牧师*
第68 4
CY7C601xx , CY7C602xx
7.1引脚分配
表7-1 。引脚分配
48
40
24
24
SSOP PDIP QSOP SOIC
7
6
42
43
34
35
36
37
38
39
40
41
15
14
13
12
11
10
9
8
25
3
2
38
39
30
31
32
33
34
35
36
37
11
10
9
8
7
6
5
4
21
19
20
11
10
14
18
19
11
10
13
名字
P4.0
P4.1
P4.2
P4.3
P3.0
P3.1
P3.2
P3.3
P3.4
P3.5
P3.6
P3.7
P2.0
P2.1
P2.2
P2.3
P2.4
P2.5
P2.6
P2.7
P1.0
GPIO端口1位0 / ISSP - SCLK
如果此引脚用作通用输出它汲取电流。中,因此,
配置为输入,以减少电流消耗。
GPIO端口1位1 / ISSP - SDATA
如果此引脚用作通用输出它汲取电流。中,因此,
配置为输入,以减少电流消耗。
GPIO口位2
GPIO口位分别3配置
复用功能是SPI总线的SSEL信号。
GPIO端口1位独立4配置
复用功能是SPI总线的SCLK信号。
GPIO口位分别5配置
复用功能是SPI总线的SMOSI信号。
GPIO端口1位独立6配置
复用功能是SPI总线的SMISO信号。
GPIO端口1位独立7配置
TTL电压阈值。
GPIO端口0位0分别配置
在CY7C601xx ,可选的时钟输入,当外部振荡器被禁止或外部
当外部振荡器被使能振荡器输入。
在CY7C602xx ,振荡器输入当配置为时钟输入。
GPIO端口2配置为一组(字节)
GPIO端口3设置为一组(字节)
描述
GPIO端口4配置为一组(半字节)
26
22
15
14
P1.1
28
29
30
31
32
33
23
24
25
26
27
28
29
19
17
18
21
22
23
24
9
16
17
20
21
22
23
9
P1.2
P1.3/SSEL
P1.4/SCLK
P1.5/SMOSI
P1.6/SMISO
P1.7
P0.0/CLKIN
文件38-16016牧师*
第68 5
CY7C601xx , CY7C602xx
的enCoRe II低电压微控制器
1.产品特点
的enCoRe II低电压(的enCoRe II LV) - 增强
减少组件
国内非晶振荡器可选克斯特支持
内部时钟或外部晶体或谐振器
可配置IO为没有外部的COM真实世界的接口
ponents
增强型8位微控制器
哈佛架构
M8C CPU速度可达12 MHz或来源由外部
晶振,谐振器或时钟信号
内部存储器
256字节的RAM
8 KB的闪存,包括EEROM仿真
低功耗
通常情况下2.25毫安在3 MHz
5
μA
睡觉
在系统重新编程
可以方便的固件更新
通用IO口
多达36个通用IO ( GPIO)引脚
所有GPIO引脚2 mA输出电流。可配置8个或
每个引脚的电流吸收器50毫安在指定的销
每个GPIO端口支持高阻抗输入, config-
urable拉起,开漏输出, CMOS和TTL输入,
CMOS输出
可屏蔽中断所有的IO引脚
SPI串行通信
主机或从机操作
可配置高达每秒传输的2 Mbit
支持半双工单根数据线模式,光学传感器
2通道8位或1通道16位定时器捕捉寄存器。
捕捉定时器寄存器保存上升沿和下降沿时间
每两个寄存器的两个输入引脚
独立的寄存器上升沿和下降沿捕获
简化了接口到RF输入用于无线应用
在挂起模式内部低功耗唤醒定时器
周期性唤醒,无需外部元件
可编程间隔定时器中断
减少RF辐射在27 MHz和96 MHz的
看门狗定时器( WDT )
低电压检测与用户选择的阈值电压
改进的输出驱动器,以降低EMI
2.7V至3.6V的直流工作电压
从0-70 ° C工作温度
采用24和40引脚PDIP , 24引脚SOIC , 24引脚QSOP
和SSOP , 28引脚SSOP和48引脚SSOP
基于赛普拉斯的PSoC先进的开发工具
工具
行业标准的编程支持
2.逻辑框图
打断
控制
4 SPI / GPIO
引脚
16扩展
I / O引脚
16个GPIO
引脚
唤醒
定时器
国内
12兆赫
振荡器
时钟
控制
水晶
振荡器
只有CY7C601xx
M8C CPU
内存
256字节
FL灰
8K字节
CAPTURE
计时器
12位定时器
POR /
低电压
检测
VDD
看门狗
定时器
赛普拉斯半导体公司
文件38-16016牧师* E
198冠军苑
圣荷西
,
CA 95134-1709
408-943-2600
修订后的2008年12月8日
[+ ]反馈
CY7C601xx , CY7C602xx
3.应用
该CY7C601xx和CY7C602xx是针对以下
应用范围:
PC无线HID设备
小鼠(光学机械,光学,轨迹球)
键盘
演示工具
赌博
操纵杆
游戏手柄
通用无线应用
遥控器
条码扫描器
POS终端
消费类电子产品
玩具
此外,安可II LV包括一个看门狗定时器,一个向量
中断控制器, 16位自由运行定时器捕获
寄存器,和一个12位可编程间隔计时器。电源
上电复位电路检测当电源被施加到器件上,
复位逻辑到一个已知的状态,并且在执行指令
Flash地址为0x0000 。当电量低于可编程
触发电压时,它产生一个复位或者被配置成生成
中断。有一个低电压检测电路,其检测当
V
CC
低于可编程的触发电压。这被配置
urable以产生LVD中断通知处理器大约
低电压事件。 POR和LVD共享同一个中断;
还有就是每个没有单独的中断。看门狗定时器
确保固件永远不会被锁定在一个无限循环。
该微控制器支持17可屏蔽中断
向量中断控制器。所有的中断可以被屏蔽。
中断源包括LVR或上电复位,可编程间隔
计时器,从自由标称1.024毫秒可编程输出
运行的定时器,两个捕捉定时器, 5个GPIO端口,三个GPIO
销,两个SPI ,一个16位自由运行的定时器包住,和一个内部
唤醒定时器中断。唤醒定时器产生周期性的接口
启用时,中断产生。捕捉定时器中断每当
新的定时器值保存由于所选的GPIO边沿事件。一
共有八个GPIO的中断同时支持TTL或CMOS
阈值。对于额外的灵活性,对边沿敏感GPIO
引脚,中断极性可编程为上升沿或
坠落。
自由运行的定时器产生中断1024
μs
率。它
还产生一个中断时,自由运行计数器
发生-每16.384毫秒溢出。事件的持续时间
在固件控制下被读出计时器的测量
启动以及事件的结束,然后计算该差
这两个值之间。两个8位定时器捕捉寄存器
保存自由运行的计时器,当一个可编程的8位范围
在两个捕捉引脚( P0.5和P0.6 )一个GPIO边缘发生。
两个8位捕获寄存器伙同成一个单一的16位
捕捉寄存器。
安可II LV通过支持在系统编程
P1.0和P1.1引脚作为串行编程模式接口。
4.简介
安可II LV系列提供的功能和好处
的enCoRe II非USB应用。安可II系列有
集成振荡器,消除了外部晶振或
谐振器中,降低了整体成本。其它外部元件,
如唤醒电路,还集成了该芯片。
安可II LV是一款低电压,低成本8位闪存编程
梅布尔微控制器。
安可II LV拥有多达36个GPIO引脚。在IO引脚
分成五个端口(端口0 4)。在端口0和1的销
被分别配置,当在端口2 ,3和4的插针
仅配置为一组。每个GPIO端口支持高
阻抗输入,可配置的上拉,开漏输出,
CMOS和TTL输入和CMOS输出最多五个引脚
支持高达50 mA灌电流的可编程驱动强度。
此外,每个IO管脚被用于生成一个GPIO中断
微控制器。每个GPIO端口都有自己的GPIO的中断
矢量除GPIO端口0 GPIO端口0了,在
除了端口的中断矢量,三个专用引脚
有独立的中断向量( P0.2 - P0.4 ) 。
安可II LV设有一个内部振荡器。任选地,一个
外部1兆赫至24兆赫晶体被用来提供更高的
精密基准。安可II LV还支持外接
时钟。
安可II LV有8 KB的闪存用户代码和256
字节的RAM堆栈空间和用户变量。
5.约定
在本文档中,在寄存器的位位置被遮蔽,以
这表明安可II LV家族的成员实施
的位。
在所有的enCoRe II LV家族成员
只有CY7C601xx
文件38-16016牧师* E
第68 2
[+ ]反馈
CY7C601xx , CY7C602xx
6.插脚引线
图6-1 。包配置
顶视图
CY7C60223
24引脚PDIP
P3.0
P3.1
SCLK/P1.4
SMOSI/P1.5
SMISO/P1.6
P1.7
NC
NC
P0.7
TIO1/P0.6
TIO0/P0.5
INT2/P0.4
1
2
3
4
5
6
7
8
9
10
11
12
24
23
22
21
20
19
18
17
16
15
14
13
P1.3/SSEL
P1.2
V
DD
P1.1
P1.0
V
SS
P2.0
P2.1
P0.0/CLKIN
P0.1/CLKOUT
P0.2/INT0
P0.3/INT1
CY7C60223
24引脚SOIC
NC
P0.7
TIO1/P0.6
TIO0/P0.5
INT2/P0.4
INT1/P0.3
INT0/P0.2
CLKOUT\P0.1
CLKIN\P0.0
P2.1
P2.0
V
SS
1
2
3
4
5
6
7
8
9
10
11
12
24
23
22
21
20
19
18
17
16
15
14
13
NC
P1.7
P1.6/SMISO
P1.5/SMOSI
P1.4/SCLK
P3.1
P3.0
P1.3/SSEL
P1.2
V
DD
P1.1
P1.0
CY7C60223
24引脚QSOP
NC
P0.7
TIO1/P0.6
TIO0/P0.5
INT2/P0.4
INT1/P0.3
INT0/P0.2
CLKOUT\P0.1
CLKIN\P0.0
P2.1
P2.0
NC
1
2
3
4
5
6
7
8
9
10
11
12
24
23
22
21
20
19
18
17
16
15
14
13
P1.7
P1.6/SMISO
P1.5/SMOSI
P1.4/SCLK
P3.1
P3.0
P1.3/SSEL
P1.2
V
DD
P1.1
P1.0
V
SS
CY7C60113
28引脚SSOP
V
DD
P2.7
P2.6
P2.5
P2.4
P0.7
TIO1/P0.6
TIO0/P0.5
INT2/P0.4
INT1/P0.3
INT0/P0.2
CLKOUT/P0.1
CLKIN/P0.0
V
SS
1
2
3
4
5
6
7
8
9
10
11
12
13
14
28
27
26
25
24
23
22
21
20
19
18
17
16
15
V
SS
P3.7
P3.6
P3.5
P3.4
P1.7
P1.6/SMISO
P1.5/SMOSI
P1.4/SCLK
P1.3/SSEL
P1.2
V
DD
P1.1
P1.0
CY7C60123
40引脚PDIP
V
DD
P4.1
P4.0
P2.7
P2.6
P2.5
P2.4
P2.3
P2.2
P2.1
P2.0
P0.7
T1O1/P0.6
TIO0/P0.5
INT2/P0.4
INT1/P0.3
INT0/P0.2
CLKOUT/P0.1
CLKIN/P0.0
V
SS
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
40
39
38
37
36
35
34
33
32
31
30
29
28
27
26
25
24
23
22
21
V
SS
P4.3
P4.2
P3.7
P3.6
P3.5
P3.4
P3.3
P3.2
P3.1
P3.0
P1.7
P1.6/SMISO
P1.5/SMOSI
P1.4/SCLK
P1.3/SSEL
P1.2
V
DD
P1.1
P1.0
CY7C60123
48引脚SSOP
NC
NC
NC
NC
V
DD
P4.1
P4.0
P2.7
P2.6
P2.5
P2.4
P2.3
P2.2
P2.1
P2.0
P0.7
TIO1/P0.6
TIO0/PO.5
INT2/P0.4
INT1/P0.3
INT0/P0.2
CLKOUT/P0.1
CLKIN/P0.0
V
SS
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
48
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
32
31
30
29
28
27
26
25
NC
NC
NC
NC
V
SS
P4.3
P4.2
P3.7
P3.6
P3.5
P3.4
P3.3
P3.2
P3.1
P3.0
P1.7
P1.6/SMISO
P1.5/SMOSI
P1.4/SCLK
P1.3/SSEL
P1.2
V
DD
P1.1
P1.0
文件38-16016牧师* E
第68 3
[+ ]反馈
CY7C601xx , CY7C602xx
6.1引脚分配
表6-1 。引脚分配
48
40
28
24
24
SSOP PDIP SSOP QSOP SOIC
7
6
42
43
34
35
36
37
38
39
40
41
15
14
13
12
11
10
9
8
25
3
2
38
39
30
31
32
33
34
35
36
37
11
10
9
8
7
6
5
4
21
5
4
3
2
15
14
13
20
24
25
26
27
11
10
11
10
18
17
19
20
18
19
1
2
24
PDIP
名字
P4.0
P4.1
P4.2
P4.3
P3.0
P3.1
P3.2
P3.3
P3.4
P3.5
P3.6
P3.7
P2.0
P2.1
P2.2
P2.3
P2.4
P2.5
P2.6
P2.7
P1.0
GPIO口位0
如果此引脚用作通用输出它汲取电流。
据,因此,被配置为输入,以减少电流消耗。
GPIO口位1
如果此引脚用作通用输出它汲取电流。
据,因此,被配置为输入,以减少电流消耗。
GPIO口位2
GPIO口位分别3配置
复用功能是SPI总线的SSEL信号。
GPIO端口1位独立4配置
复用功能是SPI总线的SCLK信号。
GPIO口位分别5配置
复用功能是SPI总线的SMOSI信号。
GPIO端口1位独立6配置
复用功能是SPI总线的SMISO信号。
GPIO端口1位独立7配置
TTL电压阈值。
GPIO端口2配置为一组(字节)
GPIO端口3设置为一组(字节)
描述
GPIO端口4配置为一组(半字节)
26
22
16
15
14
21
P1.1
28
29
30
31
32
33
24
25
26
27
28
29
18
19
20
21
22
23
17
18
21
22
23
24
16
17
20
21
22
23
23
24
3
4
5
6
P1.2
P1.3/SSEL
P1.4/SCLK
P1.5/SMOSI
P1.6/SMISO
P1.7
文件38-16016牧师* E
第68 4
[+ ]反馈
CY7C601xx , CY7C602xx
表6-1 。引脚分配
(续)
48
40
28
24
24
SSOP PDIP SSOP QSOP SOIC
23
19
13
9
9
24
PDIP
16
名字
P0.0/CLKIN
描述
GPIO端口0位0分别配置
在CY7C601xx ,可选的时钟输入,当外部振荡器
当外部振荡器被禁止或外部振荡器输入
启用。
在CY7C602xx ,振荡器输入当配置为时钟输入。
22
18
12
8
8
15
P0.1 / CLKOUT GPIO端口0位单独1配置
在CY7C601xx ,可选的时钟输出,当外部振荡器
禁用或外部振荡器的输出驱动器时,外部振荡
荡器被启用。
在CY7C602xx ,振荡器的输出当配置为时钟输出。
P0.2/INT0
P0.3/INT1
P0.4/INT2
P0.5/TIO0
P0.6/TIO1
P0.7
NC
NC
V
DD
GPIO端口0位独立2配置
可选择上升沿触发中断INT0 。
GPIO端口0位独立3配置
可选择上升沿触发中断INT1 。
GPIO端口0位独立4配置
可选择上升沿触发中断INT2 。
GPIO端口0位独立5配置
复用功能定时器捕捉输入或定时器输出TIO0 。
GPIO端口0位独立6配置
复用功能定时器捕捉输入或定时器输出TIO1 。
GPIO端口0位独立7配置
无连接
无连接
动力
21
20
19
18
17
16
1,2,3,
4
45,46,
47,48
5
27
44
24
17
16
15
14
13
12
11
10
9
8
7
6
7
6
5
4
3
2
1
12
7
6
5
4
3
2
1
24
14
13
12
11
10
9
7
8
1
23
40
20
17
1
14
28
16
13
15
12
22
19
V
SS
文件38-16016牧师* E
第68 5
[+ ]反馈
CY7C601xx , CY7C602xx
的enCoRe II低电压微控制器
1.产品特点
的enCoRe II低电压(的enCoRe II LV) - 增强
减少组件
国内非晶振荡器可选克斯特支持
内部时钟或外部晶体或谐振器
可配置的I / O ,无需外部的COM真实世界的接口
ponents
增强型8位微控制器
哈佛架构
M8C CPU速度可达12 MHz或来源由外部
晶振,谐振器或时钟信号
内部存储器
256字节的RAM
8 KB的闪存,包括EEROM仿真
低功耗
通常情况下2.25毫安在3 MHz
5
μA
睡觉
在系统重新编程
可方便固件更新
通用I / O端口
多达36个GPIO引脚
所有GPIO引脚2 mA输出电流。
每个引脚的电流吸收器可配置8或50毫安指定
引脚
每个GPIO端口支持高阻抗输入, config-
urable拉起,开漏输出, CMOS和TTL输入,
CMOS输出
可屏蔽中断的所有I / O引脚
SPI串行通信
主机或从机操作
可配置高达每秒传输的2 Mbit
支持半双工单根数据线模式,光学传感器
2通道8位或1通道16位定时器捕捉寄存器,
其中存储上升沿和下降沿时间
每两个寄存器的两个输入引脚
独立的寄存器上升沿和下降沿捕获
简化了接口到RF输入用于无线应用
在挂起模式内部低功耗唤醒定时器
周期性唤醒,无需外部元件
可编程间隔定时器中断
减少RF辐射在27 MHz和96 MHz的
看门狗定时器( WDT )
低电压检测与用户可选门限
电压
改进的输出驱动器,以降低EMI
2.7V至3.6V的直流工作电压
工作温度0 70C
采用24和40引脚PDIP , 24引脚SOIC , 24引脚QSOP
和SSOP , 28引脚SSOP和48引脚SSOP
基于赛普拉斯的PSoC先进的开发工具
工具
行业标准的编程支持
2.逻辑框图
打断
控制
4 SPI / GPIO
引脚
16扩展
I / O引脚
16个GPIO
引脚
唤醒
定时器
国内
12兆赫
振荡器
时钟
控制
水晶
振荡器
只有CY7C601xx
M8C CPU
内存
256字节
FL灰
8K字节
CAPTURE
计时器
12位定时器
POR /
低电压
检测
VDD
看门狗
定时器
赛普拉斯半导体公司
文件38-16016牧师* F
198冠军苑
圣何塞,加利福尼亚95134-1709
408-943-2600
修订后的2009年9月4日
[+ ]反馈
CY7C601xx , CY7C602xx
3.应用
该CY7C601xx和CY7C602xx是针对以下
应用范围:
PC无线HID设备
小鼠(光学机械,光学,轨迹球)
键盘
演示工具
赌博
操纵杆
游戏手柄
通用无线应用
遥控器
条码扫描器
POS终端
消费类电子产品
玩具
此外,安可II LV包括一个看门狗定时器,一个向量
中断控制器, 16位自由运行定时器捕获
寄存器,和一个12位可编程间隔计时器。电源
上电复位电路检测当电源被施加到器件上,
复位逻辑到一个已知的状态,并且在执行指令
Flash地址为0x0000 。当电量低于可编程
触发电压时,它产生一个复位或者被配置成生成
中断。有一个低电压检测电路,其检测当
V
CC
低于可编程的触发电压。这被配置
urable以产生LVD中断通知处理器大约
低电压事件。 POR和LVD共享同一个中断;
还有就是每个没有单独的中断。看门狗定时器
确保固件永远不会被锁定在一个无限循环。
该微控制器支持17可屏蔽中断
向量中断控制器。所有的中断可以被屏蔽。
中断源包括LVR或上电复位,可编程间隔
计时器,从自由标称1.024毫秒可编程输出
运行的定时器,两个捕捉定时器, 5个GPIO端口,三个GPIO
销,两个SPI ,一个16位自由运行的定时器包住,和一个内部
唤醒定时器中断。唤醒定时器产生周期性的接口
启用时,中断产生。捕捉定时器中断每当
新的定时器值保存由于所选的GPIO边沿事件。一
共有八个GPIO的中断同时支持TTL或CMOS
阈值。对于额外的灵活性,对边沿敏感GPIO
引脚,中断极性可编程为上升沿或
坠落。
自由运行的定时器产生中断1024
μs
率。它
还产生一个中断时,自由运行计数器
发生-每16.384毫秒溢出。事件的持续时间
在固件控制下被读出计时器的测量
启动以及事件的结束,然后计算该差
这两个值之间。两个8位定时器捕捉寄存器
保存自由运行的计时器,当一个可编程的8位范围
在两个捕捉引脚( P0.5和P0.6 )一个GPIO边缘发生。
两个8位捕获寄存器伙同成一个单一的16位
捕捉寄存器。
安可II LV通过支持在系统编程
P1.0和P1.1引脚作为串行编程模式接口。
4.简介
安可II LV系列提供的功能和好处
的enCoRe II非USB应用。安可II系列有
集成振荡器,消除了外部晶振或
谐振器中,降低了整体成本。其它外部元件,
如唤醒电路,还集成了该芯片。
安可II LV是一款低电压,低成本8位闪存编程
梅布尔微控制器。
安可II LV拥有多达36个GPIO引脚。在I / O引脚
分成五个端口(端口0 4)。在端口0和1的销
被分别配置,当在端口2 ,3和4的插针
仅配置为一组。每个GPIO端口支持高
阻抗输入,可配置的上拉,开漏输出,
CMOS和TTL输入和CMOS输出最多五个引脚
支持高达50 mA灌电流的可编程驱动强度。
此外,每个I / O引脚被用于生成一个GPIO中断
微控制器。每个GPIO端口都有自己的GPIO的中断
矢量除GPIO端口0 GPIO端口0了,在
除了端口的中断矢量,三个专用引脚
有独立的中断向量( P0.2 - P0.4 ) 。
安可II LV设有一个内部振荡器。任选地,一个
外部1兆赫至24兆赫晶体被用来提供更高的
精密基准。安可II LV还支持外接
时钟。
安可II LV有8 KB的闪存用户代码和256
字节的RAM堆栈空间和用户变量。
5.约定
在本文档中,在寄存器的位位置被遮蔽,以
这表明安可II LV家族的成员实施
的位。
在所有的enCoRe II LV家族成员
只有CY7C601xx
文件38-16016牧师* F
第68 2
[+ ]反馈
CY7C601xx , CY7C602xx
6.插脚引线
图6-1 。包配置
顶视图
CY7C60223
24引脚PDIP
P3.0
P3.1
SCLK/P1.4
SMOSI/P1.5
SMISO/P1.6
P1.7
NC
NC
P0.7
TIO1/P0.6
TIO0/P0.5
INT2/P0.4
1
2
3
4
5
6
7
8
9
10
11
12
24
23
22
21
20
19
18
17
16
15
14
13
P1.3/SSEL
P1.2
V
DD
P1.1
P1.0
V
SS
P2.0
P2.1
P0.0/CLKIN
P0.1/CLKOUT
P0.2/INT0
P0.3/INT1
CY7C60223
24引脚SOIC
NC
P0.7
TIO1/P0.6
TIO0/P0.5
INT2/P0.4
INT1/P0.3
INT0/P0.2
CLKOUT\P0.1
CLKIN\P0.0
P2.1
P2.0
V
SS
1
2
3
4
5
6
7
8
9
10
11
12
24
23
22
21
20
19
18
17
16
15
14
13
NC
P1.7
P1.6/SMISO
P1.5/SMOSI
P1.4/SCLK
P3.1
P3.0
P1.3/SSEL
P1.2
V
DD
P1.1
P1.0
CY7C60223
24引脚QSOP
NC
P0.7
TIO1/P0.6
TIO0/P0.5
INT2/P0.4
INT1/P0.3
INT0/P0.2
CLKOUT\P0.1
CLKIN\P0.0
P2.1
P2.0
NC
1
2
3
4
5
6
7
8
9
10
11
12
24
23
22
21
20
19
18
17
16
15
14
13
P1.7
P1.6/SMISO
P1.5/SMOSI
P1.4/SCLK
P3.1
P3.0
P1.3/SSEL
P1.2
V
DD
P1.1
P1.0
V
SS
CY7C60113
28引脚SSOP
V
DD
P2.7
P2.6
P2.5
P2.4
P0.7
TIO1/P0.6
TIO0/P0.5
INT2/P0.4
INT1/P0.3
INT0/P0.2
CLKOUT/P0.1
CLKIN/P0.0
V
SS
1
2
3
4
5
6
7
8
9
10
11
12
13
14
28
27
26
25
24
23
22
21
20
19
18
17
16
15
V
SS
P3.7
P3.6
P3.5
P3.4
P1.7
P1.6/SMISO
P1.5/SMOSI
P1.4/SCLK
P1.3/SSEL
P1.2
V
DD
P1.1
P1.0
CY7C60123
40引脚PDIP
V
DD
P4.1
P4.0
P2.7
P2.6
P2.5
P2.4
P2.3
P2.2
P2.1
P2.0
P0.7
T1O1/P0.6
TIO0/P0.5
INT2/P0.4
INT1/P0.3
INT0/P0.2
CLKOUT/P0.1
CLKIN/P0.0
V
SS
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
40
39
38
37
36
35
34
33
32
31
30
29
28
27
26
25
24
23
22
21
V
SS
P4.3
P4.2
P3.7
P3.6
P3.5
P3.4
P3.3
P3.2
P3.1
P3.0
P1.7
P1.6/SMISO
P1.5/SMOSI
P1.4/SCLK
P1.3/SSEL
P1.2
V
DD
P1.1
P1.0
CY7C60123
48引脚SSOP
NC
NC
NC
NC
V
DD
P4.1
P4.0
P2.7
P2.6
P2.5
P2.4
P2.3
P2.2
P2.1
P2.0
P0.7
TIO1/P0.6
TIO0/PO.5
INT2/P0.4
INT1/P0.3
INT0/P0.2
CLKOUT/P0.1
CLKIN/P0.0
V
SS
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
48
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
32
31
30
29
28
27
26
25
NC
NC
NC
NC
V
SS
P4.3
P4.2
P3.7
P3.6
P3.5
P3.4
P3.3
P3.2
P3.1
P3.0
P1.7
P1.6/SMISO
P1.5/SMOSI
P1.4/SCLK
P1.3/SSEL
P1.2
V
DD
P1.1
P1.0
文件38-16016牧师* F
第68 3
[+ ]反馈
CY7C601xx , CY7C602xx
6.1引脚分配
表6-1 。引脚分配
48
40
28
24
24
SSOP PDIP SSOP QSOP SOIC
7
6
42
43
34
35
36
37
38
39
40
41
15
14
13
12
11
10
9
8
25
3
2
38
39
30
31
32
33
34
35
36
37
11
10
9
8
7
6
5
4
21
5
4
3
2
15
14
13
20
24
25
26
27
11
10
11
10
18
17
19
20
18
19
1
2
24
PDIP
名字
P4.0
P4.1
P4.2
P4.3
P3.0
P3.1
P3.2
P3.3
P3.4
P3.5
P3.6
P3.7
P2.0
P2.1
P2.2
P2.3
P2.4
P2.5
P2.6
P2.7
P1.0
GPIO口位0
如果此引脚用作通用输出它汲取电流。
据,因此,被配置为输入,以减少电流消耗。
GPIO口位1
如果此引脚用作通用输出它汲取电流。
据,因此,被配置为输入,以减少电流消耗。
GPIO口位2
GPIO口位分别3配置
复用功能是SPI总线的SSEL信号。
GPIO端口1位独立4配置
复用功能是SPI总线的SCLK信号。
GPIO口位分别5配置
复用功能是SPI总线的SMOSI信号。
GPIO端口1位独立6配置
复用功能是SPI总线的SMISO信号。
GPIO端口1位独立7配置
TTL电压阈值。
GPIO端口0位0分别配置
在CY7C601xx ,可选的时钟输入,当外部振荡器
当外部振荡器被禁止或外部振荡器输入
启用。
在CY7C602xx ,振荡器输入当配置为时钟输入。
GPIO端口2配置为一组(字节)
GPIO端口3设置为一组(字节)
描述
GPIO端口4配置为一组(半字节)
26
22
16
15
14
21
P1.1
28
29
30
31
32
33
24
25
26
27
28
29
18
19
20
21
22
23
17
18
21
22
23
24
16
17
20
21
22
23
23
24
3
4
5
6
P1.2
P1.3/SSEL
P1.4/SCLK
P1.5/SMOSI
P1.6/SMISO
P1.7
23
19
13
9
9
16
P0.0/CLKIN
文件38-16016牧师* F
第68 4
[+ ]反馈
CY7C601xx , CY7C602xx
表6-1 。引脚分配
(续)
48
40
28
24
24
SSOP PDIP SSOP QSOP SOIC
22
18
12
8
8
24
PDIP
15
名字
描述
P0.1 / CLKOUT GPIO端口0位单独1配置
在CY7C601xx ,可选的时钟输出,当外部振荡器
禁用或外部振荡器的输出驱动器时,外部振荡
荡器被启用。
在CY7C602xx ,振荡器的输出当配置为时钟输出。
P0.2/INT0
P0.3/INT1
P0.4/INT2
P0.5/TIO0
P0.6/TIO1
P0.7
NC
NC
V
DD
GPIO端口0位独立2配置
可选择上升沿触发中断INT0 。
GPIO端口0位独立3配置
可选择上升沿触发中断INT1 。
GPIO端口0位独立4配置
可选择上升沿触发中断INT2 。
GPIO端口0位独立5配置
复用功能定时器捕捉输入或定时器输出TIO0 。
GPIO端口0位独立6配置
复用功能定时器捕捉输入或定时器输出TIO1 。
GPIO端口0位独立7配置
无连接
无连接
动力
21
20
19
18
17
16
1,2,3,
4
45,46,
47,48
5
27
44
24
17
16
15
14
13
12
11
10
9
8
7
6
7
6
5
4
3
2
1
12
7
6
5
4
3
2
1
24
14
13
12
11
10
9
7
8
1
23
40
20
17
1
14
28
16
13
15
12
22
19
V
SS
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