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位置：首页 > IC型号导航 > 首字符C型号页 > 首字符C的型号第1109页 > CY7C342B-15JI
使用ULTRA37000
TM
为
所有新设计
CY7C342B
128宏单元MAX
EPLD
特点
128个宏单元的八个逻辑阵列模块（LAB ）
八专用输入， 52个双向I / O引脚
可编程互连阵列
先进的0.65微米CMOS技术，以提高
性能
提供68引脚HLCC ， PLCC ，和PGA封装
100％的用户可配置的，从而允许该装置以适应
各种独立的逻辑功能。
的128个宏单元中的CY7C342B被分成8
实验室，每个实验室16 。有256个扩展乘积项， 32
每个LAB ，所使用并通过在每个宏小区共享
LAB 。
每个LAB的互连可编程互连
阵列，从而允许所有的信号可以在整个芯片进行路由。
该CY7C342B的速度和密度使其能够在一个使用
广泛的应用范围，从置换的大量
7400系列TTL逻辑，到复杂的控制器和多功能
芯片。用20针的PLD大于25倍的功能，
在CY7C342B允许更换50 TTL器件。
通过更换大量的逻辑，在CY7C342B降低电路板
空间，部件数量，并增加了系统的可靠性。
功能说明
该CY7C342B是可擦除可编程逻辑器件
（ EPLD ），其中的CMOS EPROM单元，用于配置
在装置内的逻辑功能。最大
架构
逻辑框图
1 (B6)
2 (A6)
32 (L4)
34 (L5)
输入/ CLK
输入
输入
输入
输入
输入
输入
输入
(A7)
(A8)
(L6)
(K6)
68
66
36
35
系统时钟
实验室中
MACROCELL 1
MACROCELL 2
MACROCELL 3
MACROCELL 4
宏小区5
宏小区6
MACROCELL 7
MACROCELL 8
MACROCELL 9-16
LAB B
MACROCELL 17
MACROCELL 18
MACROCELL 19
MACROCELL 20
MACROCELL 21
MACROCELL 22-32
P
I
A
LAB
MACROCELL 120
MACROCELL 119
MACROCELL 118
MACROCELL 117
MACROCELL 116
MACROCELL 115
MACROCELL 114
MACROCELL 113
MACROCELL 121-128
LAB摹
MACROCELL 101
MACROCELL 100
MACROCELL 99
MACROCELL 98
MACROCELL 97
MACROCELL 102-112
(B8) 65
(A9) 64
(B9) 63
(A10) 62
(B10) 61
(B11) 60
(C11) 59
(C10) 58
4 (A5)
5 (B4)
6 (A4)
7 (B3)
8 (A3)
9 (A2)
10 (B2)
11 (B1)
12 (C2)
13 (C1)
14 (D2)
15 (D1)
17 (E1)
(D11) 57
(D10) 56
(E11) 55
(F11) 53
(F10) 52
18 (F2)
19 (F1)
21 (G1)
22 (H2)
23 (H1)
LAB
MACROCELL 33
MACROCELL 34
MACROCELL 35
MACROCELL 36
MACROCELL 37
MACROCELL 38-48
LAB F
MACROCELL 85
MACROCELL 84
MACROCELL 83
MACROCELL 82
MACROCELL 81
MACROCELL 86-96
(G11) 51
(H11) 49
(H10) 48
(J11) 47
(J10) 46
24 (J2)
25 (J1)
26 (K1)
27 (K2)
28 (L2)
29 (K3)
30 (L3)
31 (K4)
LAB
MACROCELL 49
MACROCELL 50
MACROCELL 51
MACROCELL 52
MACROCELL 53
MACROCELL 54
MACROCELL 55
MACROCELL 56
MACROCELL 57-64
3 ， 20 ， 37 ， 54 （ B5 ， G2 ， K7 ， E10 ）
16 ， 33 ， 50 ， 67 （ E2 ， K5 ， G10 ， B7 ）
V
CC
GND
LAB ê
MACROCELL 72
MACROCELL 71
MACROCELL 70
MACROCELL 69
MACROCELL 68
MACROCELL 67
MACROCELL 66
MACROCELL 65
MACROCELL 73-80
(K11) 45
(K10) 44
(L10) 43
(L9) 42
(K9) 41
(L8) 40
(K8) 39
(L7) 38
（ ） - 涉及到68针PGA封装
赛普拉斯半导体公司
文件编号： 38-03014牧师* B
3901北一街
圣荷西
,
CA 95134
408-943-2600
修订后的2004年4月22日
使用ULTRA37000
TM
为
所有新设计
选购指南
7C342B-15
最大访问时间
15
7C342B-20
20
7C342B-25
25
7C342B-30
30
CY7C342B
7C342B-35
35
单位
ns
销刀豆网络gurations
HLCC ， PLCC
顶视图
输入/ CLK
输入
PGA
底部视图
输入
输入
L
I / O
I / O
I / O
I / O
I / O
I / O
I / O
输入输入输入
I / O
I / O
I / O
I / O
GND
I / O
I / O
I / O
I / O
I / O
I / O
V CC
K
9
I / O
I / O
I / O
I / O
I / O
I / O
GND
I / O
I / O
I / O
V
CC
I / O
I / O
I / O
I / O
I / O
I / O
10
11
12
13
14
15
16
17
18
19
20
21
22
23
7C342B
8
7
6
5
4
3
2
1 68 67 66 65 64 63 62 61
60
59
58
57
56
55
54
53
52
51
50
49
48
47
46
I / O
I / O
I / O
I / O
I / O
I / O
V
CC
I / O
I / O
I / O
GND
I / O
I / O
I / O
I / O
I / O
I / O
C
J
I / O
I / O
I / O
I / O
GND
输入
V
CC
I / O
I / O
I / O
I / O
I / O
I / O
I / O
I / O
H
I / O
I / O
I / O
I / O
G
I / O
V
CC
GND
I / O
F
I / O
I / O
7C342B
I / O
I / O
E
I / O
GND
V
CC
I / O
D
I / O
I / O
I / O
I / O
24
45
25
26 27 28 29 30 31 32 33 34 35 36 37 38 39 40 41 42 4344
输入
输入
输入
V CC
GND
I / O
I / O
I / O
I / O
I / O
I / O
I / O
I / O
I / O
I / O
输入
I / O
I / O
I / O
输入/
GND
CLK
I / O
I / O
B
I / O
I / O
I / O
I / O
V
CC
I / O
I / O
I / O
I / O
A
1
I / O
I / O
I / O
I / O
输入输入输入
I / O
I / O
2
3
4
5
6
7
8
9
10
11
文件编号： 38-03014牧师* B
第14页2
使用ULTRA37000
TM
为
所有新设计
逻辑阵列模块
有在CY7C342B 8逻辑阵列块。每个LAB
由包含16个宏单元中，一个宏小区阵列
扩展乘积项阵列包含32个扩展器，以及
I / O模块。该实验室由可编程互连喂
阵列和专用输入总线。所有的宏单元反馈去
到宏蜂窝阵列，膨胀阵列和编程
梅布尔互联阵列。扩展养活自己和
宏单元。所有的I / O反馈到可编程
互连阵列，以便它们可以由宏来访问
细胞在其他实验室，以及在实验室中宏在
它们坐落。
从外部看， CY7C342B提供八个专用输入，
其中之一可被用作系统时钟。有52个I / O
管脚可被单独地配置为输入，输出或
双向数据流。
CY7C342B
需要一个可编程的布局和布线迭代
门阵列来实现设计的时序目标。
时序延迟
在CY7C342B内定时延迟可以容易地确定
运用
经
,
经
专业 ，或
经
企业
软件通过在所示的模型
图1 。
该CY7C342B有
固定的内部延迟时间，从而允许用户确定
最坏情况下的时间延迟任何设计。
设计建议
同条件下本文中所描述的装置的操作
上述“绝对最大值”，可能会导致
永久损坏设备。这是一个额定值
该器件在这些或任何其他与功能操作
上述这些条件的业务部门所标明
这个数据表是不是暗示。暴露在绝对最大
收视条件长时间可能会影响
器件的可靠性。该CY7C342B包含电路保护
高静电压或电场的器件引脚，但
一般应采取预防措施，以避免应用程序的任何
电压大于最大额定电压更高。
对于正确的操作，输入和输出引脚必须
约束的范围内GND < （Ⅴ
IN
或V
OUT
） ＆ LT ; V
CC
。未使用
输入必须始终被捆绑到一个适当的逻辑电平
（无论是V
CC
或GND ） 。每一组的V
CC
和GND引脚必须
在该装置被连接到一起，直接。电源
至少0.2的去耦电容
F
必须连接
V之间
CC
和GND 。对于最有效的去耦，
每个V
CC
引脚应分别去耦至GND
直接在设备。去耦电容应
良好的频率响应，如单片陶瓷型
有。
可编程互连阵列
可编程互连阵列（ PIA ）来解决跨
通过路由只需要由每个信号连接限制
逻辑阵列块。的输入， PIA是每个的输出
设备和每一个的I / O引脚的反馈中宏
销的装置上。
不同于掩蔽或可编程门阵列，这引起
可变延迟依赖于路由，在PIA有固定的延时。
这消除了其中的逻辑信号不需要的时滞那可就
导致在内部或外部的逻辑毛刺。固定延迟，
无论可编程互连阵列配置的，
通过确保内部信号歪斜或简化设计
避免了比赛。其结果是简化设计implemen-
塔季翁，往往在一个信号传递，而不多个内部逻辑
扩展器
延迟
t
EXP
逻辑阵列
控制延迟
t
LAC
输入
延迟
t
IN
逻辑阵列
延迟
t
LAD
注册
产量
延迟
产量
t
RD
t
OD
t
XZ
t
ZX
输入
t
CLR
t
PRE
t
RSU
t
RH
t
梳子
t
LATCH
系统时钟延时T
ICS
时钟
延迟
t
IC
反馈
延迟
t
FD
I / O延迟
t
IO
PIA
延迟
t
PIA
图1. CY7C342B内部时序模型
文件编号： 38-03014牧师* B
第14页3
使用ULTRA37000
TM
为
所有新设计
设计安全性
该CY7C342B包含一个可编程的安全设计
功能，控制接入到编程到数据
该设备。如果此可编程功能被使用时，一个专用的
在该设备中实现的设计不能被复制或
检索。这使得能够设计控制的高水平是
EPROM细胞内的自编程获得的数据是
无形。控制此功能，以及所有其他的位
程序数据时，可以通过擦除整个简单地复位
装置。
该CY7C342B完全功能测试，保证
通过每个可编程EPROM位的完整的测试
和所有的内部逻辑单元从而保证了100 ％
规划产量。
这些装置的可擦除特性允许测试程序
可以使用与在生产流程的早期阶段擦除。
该器件还包含板载逻辑测试电路，以允许
验证功能和AC规格一次封装
迟来的非窗口封装。
CY7C342B
输出驱动电流
I
O
输出电流（ mA）典型值
250
I
OL
200
150
100
I
OH
50
V
CC
= 5.0V
房间温度。
0
1
2
3
4
5
V
O
输出电压（V）
典型的我
CC
与F
最大
400
时序注意事项
除非另有说明，传播延迟不包括
扩展。当使用扩展器，加的最大
扩展延时T
EXP
整体延迟。类似地，有一个
另外吨
PIA
拖延输入从I / O引脚时，
相比于从直的输入引脚的信号。
在计算同步频率，使用吨
SU
如果所有的
输入是在专用输入引脚。当扩展逻辑
在数据路径中使用时，添加适当的最大膨胀
延迟，T
EXP
给T
S1
。确定其中1 / （吨
WH
+ t
WL
), 1/t
CO1
,
或1 /（吨
EXP
+ t
S1
）为最低频率。这些最低
频率为所述最大数据路径频率
同步配置。
在计算外部异步频率，使用
t
AS1
如果所有的投入都在专用输入引脚。
当膨胀器逻辑用于在数据路径中，添加相应
priate最大时延扩展，T
EXP
给T
AS1
。确定
其中1 /（吨
AWH
+ t
AWL
), 1/t
ACO1
种，或1 / （吨
EXP
+ t
AS1
）是
最低频率。这些频率中的最低的
对于异步config-最大数据路径频率
uration 。
参数t
OH
表示此系统的兼容性
器件具有积极的推动等同步逻辑时，
输入保持时间，这是由同一控制
同步时钟。如果T
OH
大于最小
随后的同步所需的输入保持时间
逻辑，那么设备，保证正常运行
根据最坏情况下的公共时钟同步
环境及供给电压的条件。
I
CC
ACTIVE （ mA）的典型值。
300
V
CC
= 5.0V
房间温度。
200
100
0
100赫兹
1千赫
10千赫
100千赫
1兆赫10兆赫
50兆赫
最大频率
文件编号： 38-03014牧师* B
第14页4
使用ULTRA37000
TM
为
所有新设计
最大额定值
（以上其中有用寿命可能受到损害。对于用户指南 -
线，没有测试。 ）
存储温度-65 ................................
°
C至+135
°
C
环境温度与
电源应用............................................ -65
°
C至+135
°
C
最高结温
（偏） .............................................. .................... 150
°
C
电源电压对地电位............- 2.0V至+ 7.0V
[1]
CY7C342B
每个引脚的直流输出电流
[1]
................... -25 mA至25毫安
直流输入电压
[1]
.........................................- 2.0V至+ 7.0V
工作范围
范围
广告
产业
环境温度
0
°
C至+70
°
C
–40
°
C至+ 85
°
C
V
CC
5V
±
5%
5V
±
10%
电气特性
在整个工作范围
参数
V
CC
V
OH
V
OL
V
IH
V
IL
I
IX
I
OZ
t
R
t
F
描述
电源电压
输出高电压
输出低电压
输入高电压
输入低电压
输入电流
输出漏电流
推荐的输入上升时间
推荐的输入下降时间
V
I
= V
CC
或接地
V
O
= V
CC
或接地
测试条件
最大V
CC
上升时间为10毫秒
I
OH
= -4毫安DC
[2]
I
OL
= 8毫安DC
[2]
2.0
–0.3
–10
–40
分钟。
4.75(4.5)
2.4
0.45
V
CC
+ 0.3
0.8
+10
+40
100
100
马克斯。
5.25(5.5)
单位
V
V
V
V
V
A
A
ns
ns
电容
参数
C
IN
C
OUT
描述
输入电容
输出电容
测试条件
V
IN
= 0V ， F = 1.0 MHz的
V
OUT
= 0V ， F = 1.0 MHz的
马克斯。
10
20
单位
pF
pF
交流测试负载和波形
R1 464
5V
产量
50 pF的
INCLUDING
夹具
范围
R2
250
5V
产量
5 pF的
INCLUDING
夹具
范围
R2
250
3.0V
10%
GND
≤
6纳秒
R1 464
所有的输入脉冲
90%
90%
10%
≤
6纳秒
(a)
(b)
相当于：
产量
戴维南等效（商用/军用）
163
1.75V
注意事项：
1.最小DC输入为-0.3V 。在交易中，输入可下冲至-2.0V或过冲至7.0V的输入电流小于百毫安和周期更短
超过20纳秒。
2.我
OH
参数指的是高层次的TTL输出电流;在我
OL
参数指的是低电平TTL输出电流。
文件编号： 38-03014牧师* B
第14页5
使用ULTRA37000
TM
为
所有新设计
CY7C342B
128宏单元MAX
EPLD
特点
128个宏单元的八个逻辑阵列模块（LAB ）
八专用输入， 52个双向I / O引脚
可编程互连阵列
先进的0.65微米CMOS技术，以提高
性能
提供68引脚HLCC ， PLCC ，和PGA封装
100％的用户可配置的，从而允许该装置以适应
各种独立的逻辑功能。
的128个宏单元中的CY7C342B被分成8
实验室，每个实验室16 。有256个扩展乘积项， 32
每个LAB ，所使用并通过在每个宏小区共享
LAB 。
每个LAB的互连可编程互连
阵列，从而允许所有的信号可以在整个芯片进行路由。
该CY7C342B的速度和密度使其能够在一个使用
广泛的应用范围，从置换的大量
7400系列TTL逻辑，到复杂的控制器和多功能
芯片。用20针的PLD大于25倍的功能，
在CY7C342B允许更换50 TTL器件。
通过更换大量的逻辑，在CY7C342B降低电路板
空间，部件数量，并增加了系统的可靠性。
功能说明
该CY7C342B是可擦除可编程逻辑器件
（ EPLD ），其中的CMOS EPROM单元，用于配置
在装置内的逻辑功能。最大
架构
逻辑框图
1 (B6)
2 (A6)
32 (L4)
34 (L5)
输入/ CLK
输入
输入
输入
输入
输入
输入
输入
(A7)
(A8)
(L6)
(K6)
68
66
36
35
系统时钟
实验室中
MACROCELL 1
MACROCELL 2
MACROCELL 3
MACROCELL 4
宏小区5
宏小区6
MACROCELL 7
MACROCELL 8
MACROCELL 9-16
LAB B
MACROCELL 17
MACROCELL 18
MACROCELL 19
MACROCELL 20
MACROCELL 21
MACROCELL 22-32
P
I
A
LAB
MACROCELL 120
MACROCELL 119
MACROCELL 118
MACROCELL 117
MACROCELL 116
MACROCELL 115
MACROCELL 114
MACROCELL 113
MACROCELL 121-128
LAB摹
MACROCELL 101
MACROCELL 100
MACROCELL 99
MACROCELL 98
MACROCELL 97
MACROCELL 102-112
(B8) 65
(A9) 64
(B9) 63
(A10) 62
(B10) 61
(B11) 60
(C11) 59
(C10) 58
4 (A5)
5 (B4)
6 (A4)
7 (B3)
8 (A3)
9 (A2)
10 (B2)
11 (B1)
12 (C2)
13 (C1)
14 (D2)
15 (D1)
17 (E1)
(D11) 57
(D10) 56
(E11) 55
(F11) 53
(F10) 52
18 (F2)
19 (F1)
21 (G1)
22 (H2)
23 (H1)
LAB
MACROCELL 33
MACROCELL 34
MACROCELL 35
MACROCELL 36
MACROCELL 37
MACROCELL 38-48
LAB F
MACROCELL 85
MACROCELL 84
MACROCELL 83
MACROCELL 82
MACROCELL 81
MACROCELL 86-96
(G11) 51
(H11) 49
(H10) 48
(J11) 47
(J10) 46
24 (J2)
25 (J1)
26 (K1)
27 (K2)
28 (L2)
29 (K3)
30 (L3)
31 (K4)
LAB
MACROCELL 49
MACROCELL 50
MACROCELL 51
MACROCELL 52
MACROCELL 53
MACROCELL 54
MACROCELL 55
MACROCELL 56
MACROCELL 57-64
3 ， 20 ， 37 ， 54 （ B5 ， G2 ， K7 ， E10 ）
16 ， 33 ， 50 ， 67 （ E2 ， K5 ， G10 ， B7 ）
V
CC
GND
LAB ê
MACROCELL 72
MACROCELL 71
MACROCELL 70
MACROCELL 69
MACROCELL 68
MACROCELL 67
MACROCELL 66
MACROCELL 65
MACROCELL 73-80
(K11) 45
(K10) 44
(L10) 43
(L9) 42
(K9) 41
(L8) 40
(K8) 39
(L7) 38
（ ） - 涉及到68针PGA封装
赛普拉斯半导体公司
文件编号： 38-03014牧师* B
3901北一街
圣荷西
,
CA 95134
408-943-2600
修订后的2004年4月22日
使用ULTRA37000
TM
为
所有新设计
选购指南
7C342B-15
最大访问时间
15
7C342B-20
20
7C342B-25
25
7C342B-30
30
CY7C342B
7C342B-35
35
单位
ns
销刀豆网络gurations
HLCC ， PLCC
顶视图
输入/ CLK
输入
PGA
底部视图
输入
输入
L
I / O
I / O
I / O
I / O
I / O
I / O
I / O
输入输入输入
I / O
I / O
I / O
I / O
GND
I / O
I / O
I / O
I / O
I / O
I / O
V CC
K
9
I / O
I / O
I / O
I / O
I / O
I / O
GND
I / O
I / O
I / O
V
CC
I / O
I / O
I / O
I / O
I / O
I / O
10
11
12
13
14
15
16
17
18
19
20
21
22
23
7C342B
8
7
6
5
4
3
2
1 68 67 66 65 64 63 62 61
60
59
58
57
56
55
54
53
52
51
50
49
48
47
46
I / O
I / O
I / O
I / O
I / O
I / O
V
CC
I / O
I / O
I / O
GND
I / O
I / O
I / O
I / O
I / O
I / O
C
J
I / O
I / O
I / O
I / O
GND
输入
V
CC
I / O
I / O
I / O
I / O
I / O
I / O
I / O
I / O
H
I / O
I / O
I / O
I / O
G
I / O
V
CC
GND
I / O
F
I / O
I / O
7C342B
I / O
I / O
E
I / O
GND
V
CC
I / O
D
I / O
I / O
I / O
I / O
24
45
25
26 27 28 29 30 31 32 33 34 35 36 37 38 39 40 41 42 4344
输入
输入
输入
V CC
GND
I / O
I / O
I / O
I / O
I / O
I / O
I / O
I / O
I / O
I / O
输入
I / O
I / O
I / O
输入/
GND
CLK
I / O
I / O
B
I / O
I / O
I / O
I / O
V
CC
I / O
I / O
I / O
I / O
A
1
I / O
I / O
I / O
I / O
输入输入输入
I / O
I / O
2
3
4
5
6
7
8
9
10
11
文件编号： 38-03014牧师* B
第14页2
使用ULTRA37000
TM
为
所有新设计
逻辑阵列模块
有在CY7C342B 8逻辑阵列块。每个LAB
由包含16个宏单元中，一个宏小区阵列
扩展乘积项阵列包含32个扩展器，以及
I / O模块。该实验室由可编程互连喂
阵列和专用输入总线。所有的宏单元反馈去
到宏蜂窝阵列，膨胀阵列和编程
梅布尔互联阵列。扩展养活自己和
宏单元。所有的I / O反馈到可编程
互连阵列，以便它们可以由宏来访问
细胞在其他实验室，以及在实验室中宏在
它们坐落。
从外部看， CY7C342B提供八个专用输入，
其中之一可被用作系统时钟。有52个I / O
管脚可被单独地配置为输入，输出或
双向数据流。
CY7C342B
需要一个可编程的布局和布线迭代
门阵列来实现设计的时序目标。
时序延迟
在CY7C342B内定时延迟可以容易地确定
运用
经
,
经
专业 ，或
经
企业
软件通过在所示的模型
图1 。
该CY7C342B有
固定的内部延迟时间，从而允许用户确定
最坏情况下的时间延迟任何设计。
设计建议
同条件下本文中所描述的装置的操作
上述“绝对最大值”，可能会导致
永久损坏设备。这是一个额定值
该器件在这些或任何其他与功能操作
上述这些条件的业务部门所标明
这个数据表是不是暗示。暴露在绝对最大
收视条件长时间可能会影响
器件的可靠性。该CY7C342B包含电路保护
高静电压或电场的器件引脚，但
一般应采取预防措施，以避免应用程序的任何
电压大于最大额定电压更高。
对于正确的操作，输入和输出引脚必须
约束的范围内GND < （Ⅴ
IN
或V
OUT
） ＆ LT ; V
CC
。未使用
输入必须始终被捆绑到一个适当的逻辑电平
（无论是V
CC
或GND ） 。每一组的V
CC
和GND引脚必须
在该装置被连接到一起，直接。电源
至少0.2的去耦电容
F
必须连接
V之间
CC
和GND 。对于最有效的去耦，
每个V
CC
引脚应分别去耦至GND
直接在设备。去耦电容应
良好的频率响应，如单片陶瓷型
有。
可编程互连阵列
可编程互连阵列（ PIA ）来解决跨
通过路由只需要由每个信号连接限制
逻辑阵列块。的输入， PIA是每个的输出
设备和每一个的I / O引脚的反馈中宏
销的装置上。
不同于掩蔽或可编程门阵列，这引起
可变延迟依赖于路由，在PIA有固定的延时。
这消除了其中的逻辑信号不需要的时滞那可就
导致在内部或外部的逻辑毛刺。固定延迟，
无论可编程互连阵列配置的，
通过确保内部信号歪斜或简化设计
避免了比赛。其结果是简化设计implemen-
塔季翁，往往在一个信号传递，而不多个内部逻辑
扩展器
延迟
t
EXP
逻辑阵列
控制延迟
t
LAC
输入
延迟
t
IN
逻辑阵列
延迟
t
LAD
注册
产量
延迟
产量
t
RD
t
OD
t
XZ
t
ZX
输入
t
CLR
t
PRE
t
RSU
t
RH
t
梳子
t
LATCH
系统时钟延时T
ICS
时钟
延迟
t
IC
反馈
延迟
t
FD
I / O延迟
t
IO
PIA
延迟
t
PIA
图1. CY7C342B内部时序模型
文件编号： 38-03014牧师* B
第14页3
使用ULTRA37000
TM
为
所有新设计
设计安全性
该CY7C342B包含一个可编程的安全设计
功能，控制接入到编程到数据
该设备。如果此可编程功能被使用时，一个专用的
在该设备中实现的设计不能被复制或
检索。这使得能够设计控制的高水平是
EPROM细胞内的自编程获得的数据是
无形。控制此功能，以及所有其他的位
程序数据时，可以通过擦除整个简单地复位
装置。
该CY7C342B完全功能测试，保证
通过每个可编程EPROM位的完整的测试
和所有的内部逻辑单元从而保证了100 ％
规划产量。
这些装置的可擦除特性允许测试程序
可以使用与在生产流程的早期阶段擦除。
该器件还包含板载逻辑测试电路，以允许
验证功能和AC规格一次封装
迟来的非窗口封装。
CY7C342B
输出驱动电流
I
O
输出电流（ mA）典型值
250
I
OL
200
150
100
I
OH
50
V
CC
= 5.0V
房间温度。
0
1
2
3
4
5
V
O
输出电压（V）
典型的我
CC
与F
最大
400
时序注意事项
除非另有说明，传播延迟不包括
扩展。当使用扩展器，加的最大
扩展延时T
EXP
整体延迟。类似地，有一个
另外吨
PIA
拖延输入从I / O引脚时，
相比于从直的输入引脚的信号。
在计算同步频率，使用吨
SU
如果所有的
输入是在专用输入引脚。当扩展逻辑
在数据路径中使用时，添加适当的最大膨胀
延迟，T
EXP
给T
S1
。确定其中1 / （吨
WH
+ t
WL
), 1/t
CO1
,
或1 /（吨
EXP
+ t
S1
）为最低频率。这些最低
频率为所述最大数据路径频率
同步配置。
在计算外部异步频率，使用
t
AS1
如果所有的投入都在专用输入引脚。
当膨胀器逻辑用于在数据路径中，添加相应
priate最大时延扩展，T
EXP
给T
AS1
。确定
其中1 /（吨
AWH
+ t
AWL
), 1/t
ACO1
种，或1 / （吨
EXP
+ t
AS1
）是
最低频率。这些频率中的最低的
对于异步config-最大数据路径频率
uration 。
参数t
OH
表示此系统的兼容性
器件具有积极的推动等同步逻辑时，
输入保持时间，这是由同一控制
同步时钟。如果T
OH
大于最小
随后的同步所需的输入保持时间
逻辑，那么设备，保证正常运行
根据最坏情况下的公共时钟同步
环境及供给电压的条件。
I
CC
ACTIVE （ mA）的典型值。
300
V
CC
= 5.0V
房间温度。
200
100
0
100赫兹
1千赫
10千赫
100千赫
1兆赫10兆赫
50兆赫
最大频率
文件编号： 38-03014牧师* B
第14页4
使用ULTRA37000
TM
为
所有新设计
最大额定值
（以上其中有用寿命可能受到损害。对于用户指南 -
线，没有测试。 ）
存储温度-65 ................................
°
C至+135
°
C
环境温度与
电源应用............................................ -65
°
C至+135
°
C
最高结温
（偏） .............................................. .................... 150
°
C
电源电压对地电位............- 2.0V至+ 7.0V
[1]
CY7C342B
每个引脚的直流输出电流
[1]
................... -25 mA至25毫安
直流输入电压
[1]
.........................................- 2.0V至+ 7.0V
工作范围
范围
广告
产业
环境温度
0
°
C至+70
°
C
–40
°
C至+ 85
°
C
V
CC
5V
±
5%
5V
±
10%
电气特性
在整个工作范围
参数
V
CC
V
OH
V
OL
V
IH
V
IL
I
IX
I
OZ
t
R
t
F
描述
电源电压
输出高电压
输出低电压
输入高电压
输入低电压
输入电流
输出漏电流
推荐的输入上升时间
推荐的输入下降时间
V
I
= V
CC
或接地
V
O
= V
CC
或接地
测试条件
最大V
CC
上升时间为10毫秒
I
OH
= -4毫安DC
[2]
I
OL
= 8毫安DC
[2]
2.0
–0.3
–10
–40
分钟。
4.75(4.5)
2.4
0.45
V
CC
+ 0.3
0.8
+10
+40
100
100
马克斯。
5.25(5.5)
单位
V
V
V
V
V
A
A
ns
ns
电容
参数
C
IN
C
OUT
描述
输入电容
输出电容
测试条件
V
IN
= 0V ， F = 1.0 MHz的
V
OUT
= 0V ， F = 1.0 MHz的
马克斯。
10
20
单位
pF
pF
交流测试负载和波形
R1 464
5V
产量
50 pF的
INCLUDING
夹具
范围
R2
250
5V
产量
5 pF的
INCLUDING
夹具
范围
R2
250
3.0V
10%
GND
≤
6纳秒
R1 464
所有的输入脉冲
90%
90%
10%
≤
6纳秒
(a)
(b)
相当于：
产量
戴维南等效（商用/军用）
163
1.75V
注意事项：
1.最小DC输入为-0.3V 。在交易中，输入可下冲至-2.0V或过冲至7.0V的输入电流小于百毫安和周期更短
超过20纳秒。
2.我
OH
参数指的是高层次的TTL输出电流;在我
OL
参数指的是低电平TTL输出电流。
文件编号： 38-03014牧师* B
第14页5
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