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位置：首页 > IC型号导航 > 首字符C型号页 > 首字符C的型号第918页 > CY7C1382F
CY7C1380D ， CY7C1380F
CY7C1382D ， CY7C1382F
18兆位（ 512K ×36 / 1M ×18 ）流水线SRAM
特点
支持总线运行在高达250MHz的
- 可用的速度等级是250 ， 200 ，和167 MHz的
注册的输入和输出的流水线操作
3.3V核心供电
2.5V或3.3V IO电源
快速时钟到输出时间
- 2.6纳秒（ 250 MHz器件）
提供高性能3-1-1-1接入速率
用户可选的突发计数器支持Intel
奔腾
交错式或线性突发序列
独立的处理器和控制器地址选通
同步自定时写
异步输出使能
单周期芯片取消
CY7C1380D / CY7C1382D在JEDEC标准的可
无铅100引脚TQFP封装，无铅和无无铅165球
FBGA封装。 CY7C1380F / CY7C1382F可用
无铅和无无铅119球BGA封装
IEEE 1149.1 JTAG兼容的边界扫描
ZZ睡眠模式选项
功能说明
[1]
该
CY7C1380D/CY7C1382D/CY7C1380F/CY7C1382F
SRAM集成524,288 ×36和1048576 ×18的SRAM
细胞与先进同步外围电路和
2位的计数器，用于内部突发操作。所有同步
输入端通过由正边沿控制寄存器控
触发时钟输入（CLK） 。同步输入包括
所有地址，所有的数据输入，地址流水线芯片使能
（ CE
1
） ，深度扩展芯片启用（ CE
2
和CE
3 [2]
） ，突发
控制输入（ ADSC ， ADSP和ADV ） ，写入启用（ BW
X
,
和BWE ）和全局写（ GW ） 。异步输入
包括输出使能（ OE ）和ZZ引脚。
地址和芯片使注册在上升沿
时钟在地址选通处理器（ ADSP ）或地址
频闪控制器（ ADSC ）是活动的。随后爆
地址可以内部产生，因为它们被控制
通过提前销（ ADV ） 。
地址，数据输入，并写入控制记录片
启动自定时写cycle.This部分支持字节写
行动（见
引脚定义第6页
和
真值表
[4,
5, 6, 7, 8]
第9页
对于进一步的细节） 。写周期可以是一个
给两个或四个字节宽的字节写入控制作为控制
输入。 GW时，低电平有效使写入所有字节。
该
CY7C1380D/CY7C1382D/CY7C1380F/CY7C1382F
从+ 3.3V核心供电，而所有输出工作
工作于2.5或+ 3.3V电源。所有的输入和
输出为JEDEC标准和JESD8-5兼容。
选购指南
250兆赫
最大访问时间
最大工作电流
最大的CMOS待机电流
2.6
350
70
200兆赫
3.0
300
70
167兆赫
3.4
275
70
单位
ns
mA
mA
注意事项：
1.为了达到最佳做法或建议，请参考赛普拉斯应用笔记AN1064 ，
SRAM系统设计指南
on
www.cypress.com 。
2. CE
3,
CE
2
对于TQFP只有165 FBGA封装。 119 BGA仅在1芯片使能提供。
赛普拉斯半导体公司
文件编号： 38-05543牧师* E
198冠军苑
圣荷西
,
CA 95134-1709
408-943-2600
修订后的二月07 ， 2007
CY7C1380D ， CY7C1380F
CY7C1382D ， CY7C1382F
逻辑框图 - CY7C1380D / CY7C1380F
[3]
（ 512K ×36 ）
A0, A1, A
地址
注册
2
A
[1:0]
模式
ADV
CLK
Q1
ADSC
ADSP
BW
D
DQ
D ,
DQP
D
字节
写注册
DQ
C ,
DQP
C
字节
写注册
DQ
B ,
DQP
B
字节
写注册
DQ
A ,
DQP
A
字节
写注册
BURST
计数器
CLR
和
逻辑
Q0
DQ
D
， DQP
D
字节
写入驱动器
DQ
C ,
DQP
C
字节
写入驱动器
DQ
B ,
DQP
B
字节
写入驱动器
DQ
A ,
DQP
A
字节
写入驱动器
BW
C
内存
ARRAY
SENSE
安培
产量
注册
产量
缓冲器
E
BW
B
的DQ
DQP
A
DQP
B
DQP
C
DQP
D
BW
A
BWE
GW
CE
1
CE
2
CE
3
OE
启用
注册
流水线
启用
输入
注册
ZZ
睡觉
控制
逻辑框图 - CY7C1382D / CY7C1382F
[3]
（ 1M ×18 ）
A0, A1, A
地址
注册
2
ADV
CLK
BURST Q1
计数器
逻辑
ADSC
BW
B
DQ
B,
DQP
B
写注册
DQ
B,
DQP
B
写入驱动器
内存
ARRAY
SENSE
产量
产量
缓冲器
BW
A
BWE
GW
CE
1
CE2
CE3
OE
DQ
A,
DQP
A
写注册
DQ
A,
DQP
A
写入驱动器
的DQ
DQP
A
DQP
B
输入
启用
注册
流水线
启用
ZZ
睡觉
控制
注意：
3. CY7C1380F和CY7C1382F只有1个芯片使能（ CE
1
).
文件编号： 38-05543牧师* E
分页： 30 2
CY7C1380D ， CY7C1380F
CY7C1382D ， CY7C1382F
销刀豆网络gurations
100引脚TQFP引脚（ 3芯片使能）
A
A
CE
1
CE
2
BW
D
BW
C
BW
B
BW
A
CE
3
V
DD
V
SS
CLK
GW
BWE
OE
ADSC
ADSP
ADV
A
A
100
99
98
97
96
95
94
93
92
91
90
89
88
87
86
85
84
83
82
81
DQP
C
DQ
C
DQC
V
DDQ
V
SSQ
DQ
C
DQ
C
DQ
C
DQ
C
V
SSQ
V
DDQ
DQ
C
DQ
C
NC
V
DD
NC
V
SS
DQ
D
DQ
D
V
DDQ
V
SSQ
DQ
D
DQ
D
DQ
D
DQ
D
V
SSQ
V
DDQ
DQ
D
DQ
D
DQP
D
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
CY7C1380D
（ 512K ×36 ）
80
79
78
77
76
75
74
73
72
71
70
69
68
67
66
65
64
63
62
61
60
59
58
57
56
55
54
53
52
51
DQP
B
DQ
B
DQ
B
V
DDQ
V
SSQ
DQ
B
DQ
B
DQ
B
DQ
B
V
SSQ
V
DDQ
DQ
B
DQ
B
V
SS
NC
V
DD
ZZ
DQ
A
DQ
A
V
DDQ
V
SSQ
DQ
A
DQ
A
DQ
A
DQ
A
V
SSQ
V
DDQ
DQ
A
DQ
A
DQP
A
NC
NC
NC
V
DDQ
V
SSQ
NC
NC
DQ
B
DQ
B
V
SSQ
V
DDQ
DQ
B
DQ
B
NC
V
DD
NC
V
SS
DQ
B
DQ
B
V
DDQ
V
SSQ
DQ
B
DQ
B
DQP
B
NC
V
SSQ
V
DDQ
NC
NC
NC
100
99
98
97
96
95
94
93
92
91
90
89
88
87
86
85
84
83
82
81
A
A
CE
1
CE
2
NC
NC
BW
B
BW
A
CE
3
V
DD
V
SS
CLK
GW
BWE
OE
ADSC
ADSP
ADV
A
A
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
CY7C1382D
（ 1兆位×18 ）
80
79
78
77
76
75
74
73
72
71
70
69
68
67
66
65
64
63
62
61
60
59
58
57
56
55
54
53
52
51
A
NC
NC
V
DDQ
V
SSQ
NC
DQP
A
DQ
A
DQ
A
V
SSQ
V
DDQ
DQ
A
DQ
A
V
SS
NC
V
DD
ZZ
DQ
A
DQ
A
V
DDQ
V
SSQ
DQ
A
DQ
A
NC
NC
V
SSQ
V
DDQ
NC
NC
NC
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
模式
A
A
A
A
A
1
A
0
NC/72M
NC/36M
V
SS
V
DD
A
A
A
A
A
A
A
A
A
模式
A
A
A
A
A
1
A
0
NC/72M
NC/36M
V
SS
V
DD
文件编号： 38-05543牧师* E
A
A
A
A
A
A
A
A
A
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
第30 3
CY7C1380D ， CY7C1380F
CY7C1382D ， CY7C1382F
销刀豆网络gurations
（续）
119球BGA引脚
CY7C1380F （ 512K ×36 ）
1
A
B
C
D
E
F
G
H
J
K
L
M
N
P
R
T
U
V
DDQ
NC/288M
NC/144M
DQ
C
DQ
C
V
DDQ
DQ
C
DQ
C
V
DDQ
DQ
D
DQ
D
V
DDQ
DQ
D
DQ
D
NC
NC
V
DDQ
2
A
A
A
DQP
C
DQ
C
DQ
C
DQ
C
DQ
C
V
DD
DQ
D
DQ
D
DQ
D
DQ
D
DQP
D
A
NC/72M
TMS
3
A
A
A
V
SS
V
SS
V
SS
BW
C
V
SS
NC
V
SS
BW
D
V
SS
V
SS
V
SS
模式
A
TDI
4
ADSP
ADSC
V
DD
NC
CE
1
OE
ADV
GW
V
DD
CLK
NC
BWE
A1
A0
V
DD
A
TCK
5
A
A
A
V
SS
V
SS
V
SS
BW
B
V
SS
NC
V
SS
BW
A
V
SS
V
SS
V
SS
NC
A
TDO
6
A
A
A
DQP
B
DQ
B
DQ
B
DQ
B
DQ
B
V
DD
DQ
A
DQ
A
DQ
A
DQ
A
DQP
A
A
NC/36M
NC
7
V
DDQ
NC/576M
NC/1G
DQ
B
DQ
B
V
DDQ
DQ
B
DQ
B
V
DDQ
DQ
A
DQ
A
V
DDQ
DQ
A
DQ
A
NC
ZZ
V
DDQ
CY7C1382F （ 1M ×18 ）
1
A
B
C
D
E
F
G
H
J
K
L
M
N
P
R
T
U
V
DDQ
NC/288M
NC/144M
DQ
B
NC
V
DDQ
NC
DQ
B
V
DDQ
NC
DQ
B
V
DDQ
DQ
B
NC
NC
NC/72M
V
DDQ
2
A
A
A
NC
DQ
B
NC
DQ
B
NC
V
DD
DQ
B
NC
DQ
B
NC
DQP
B
A
A
TMS
3
A
A
A
V
SS
V
SS
V
SS
BW
B
V
SS
NC
V
SS
NC
V
SS
V
SS
V
SS
模式
A
TDI
4
ADSP
ADSC
V
DD
NC
CE
1
OE
ADV
GW
V
DD
CLK
NC
BWE
A1
A0
V
DD
NC/36M
TCK
5
A
A
A
V
SS
V
SS
V
SS
NC
V
SS
NC
V
SS
BW
A
V
SS
V
SS
V
SS
NC
A
TDO
6
A
A
A
DQP
A
NC
DQ
A
NC
DQ
A
V
DD
NC
DQ
A
NC
DQ
A
NC
A
A
NC
7
V
DDQ
NC/576M
NC/1G
NC
DQ
A
V
DDQ
DQ
A
NC
V
DDQ
DQ
A
NC
V
DDQ
NC
DQ
A
NC
ZZ
V
DDQ
文件编号： 38-05543牧师* E
第30 4
CY7C1380D ， CY7C1380F
CY7C1382D ， CY7C1382F
销刀豆网络gurations
（续）
165球FBGA引脚（ 3芯片使能）
CY7C1380D （ 512K ×36 ）
1
A
B
C
D
E
F
G
H
J
K
L
M
N
P
R
NC/288M
NC/144M
DQP
C
DQ
C
DQ
C
DQ
C
DQ
C
NC
DQ
D
DQ
D
DQ
D
DQ
D
DQP
D
NC
模式
2
A
A
NC
DQ
C
DQ
C
DQ
C
DQ
C
NC
DQ
D
DQ
D
DQ
D
DQ
D
NC
NC/72M
NC/36M
3
CE
1
CE2
V
DDQ
V
DDQ
V
DDQ
V
DDQ
V
DDQ
NC
V
DDQ
V
DDQ
V
DDQ
V
DDQ
V
DDQ
A
A
4
BW
C
BW
D
V
SS
V
DD
V
DD
V
DD
V
DD
V
DD
V
DD
V
DD
V
DD
V
DD
V
SS
A
5
BW
B
BW
A
V
SS
V
SS
V
SS
V
SS
V
SS
V
SS
V
SS
V
SS
V
SS
V
SS
NC
TDI
TMS
6
CE
3
CLK
7
BWE
GW
V
SS
8
ADSC
OE
9
ADV
ADSP
V
DDQ
10
A
A
NC/1G
DQ
B
DQ
B
DQ
B
DQ
B
NC
DQ
A
DQ
A
DQ
A
DQ
A
NC
A
A
11
NC
NC/576M
DQP
B
DQ
B
DQ
B
DQ
B
DQ
B
ZZ
DQ
A
DQ
A
DQ
A
DQ
A
DQP
A
A
A
V
SS
V
SS
V
SS
V
SS
V
SS
V
SS
V
SS
V
SS
V
SS
V
SS
A
A1
A0
V
SS
V
SS
V
SS
V
SS
V
SS
V
SS
V
SS
V
SS
V
SS
NC
TDO
TCK
V
SS
V
DD
V
DD
V
DD
V
DD
V
DD
V
DD
V
DD
V
DD
V
DD
V
SS
A
V
DDQ
V
DDQ
V
DDQ
V
DDQ
NC
V
DDQ
V
DDQ
V
DDQ
V
DDQ
V
DDQ
A
A
A
A
CY7C1382D （ 1M ×18 ）
1
A
B
C
D
E
F
G
H
J
K
L
M
N
P
R
NC/288M
NC/144M
NC
NC
NC
NC
NC
NC
DQ
B
DQ
B
DQ
B
DQ
B
DQP
B
NC
模式
2
A
A
NC
DQ
B
DQ
B
DQ
B
DQ
B
NC
NC
NC
NC
NC
NC
NC/72M
NC/36M
3
CE
1
CE2
V
DDQ
V
DDQ
V
DDQ
V
DDQ
V
DDQ
NC
V
DDQ
V
DDQ
V
DDQ
V
DDQ
V
DDQ
A
A
4
BW
B
NC
V
SS
V
DD
V
DD
V
DD
V
DD
V
DD
V
DD
V
DD
V
DD
V
DD
V
SS
A
5
NC
BW
A
V
SS
V
SS
V
SS
V
SS
V
SS
V
SS
V
SS
V
SS
V
SS
V
SS
NC
TDI
TMS
6
CE
3
CLK
7
BWE
GW
8
ADSC
OE
9
ADV
ADSP
10
A
A
NC/1G
NC
NC
NC
NC
NC
DQ
A
DQ
A
DQ
A
DQ
A
NC
A
A
11
A
NC/576M
DQP
A
DQ
A
DQ
A
DQ
A
DQ
A
ZZ
NC
NC
NC
NC
NC
A
A
V
SS
V
SS
V
SS
V
SS
V
SS
V
SS
V
SS
V
SS
V
SS
V
SS
A
A1
A0
V
SS
V
SS
V
SS
V
SS
V
SS
V
SS
V
SS
V
SS
V
SS
V
SS
NC
TDO
TCK
V
SS
V
DD
V
DD
V
DD
V
DD
V
DD
V
DD
V
DD
V
DD
V
DD
V
SS
A
V
DDQ
V
DDQ
V
DDQ
V
DDQ
V
DDQ
NC
V
DDQ
V
DDQ
V
DDQ
V
DDQ
V
DDQ
A
A
A
A
文件编号： 38-05543牧师* E
第30个5
CY7C1380D ， CY7C1382D
CY7C1380F ， CY7C1382F
18兆位（ 512K的× 36/1米× 18 ）
流水线SRAM
18兆位（ 512K的× 36/1米× 18 ）流水线式SRAM
特点
■
■
■
■
■
■
功能说明
该
CY7C1380D/CY7C1382D/CY7C1380F/CY7C1382F
[1]
SRAM集成524,288 × 36和1048576 × 18的SRAM单元
有先进同步外围电路和一个二位
计数器内部突发操作。所有的同步输入是
由上升沿触发时钟控制寄存器控
输入（CLK） 。同步输入包括所有地址，全
数据输入，地址流水线芯片使能（ CE
1
),
深度扩展芯片启用（ CE
2
和CE
3 [2]
） ，突发控制
输入（ ADSC ， ADSP和ADV ） ，写入启用（ BW
X
和BWE ）
与全局写（GW） 。异步输入包括输出
启用（ OE ）和ZZ引脚。
地址和芯片使注册在上升沿
时钟在地址选通处理器（ ADSP ）或地址选通
控制器（ ADSC）是活动的。随后一阵地址可以
在内部产生，因为它们是由预先引脚控制
（ ADV ） 。
地址，数据输入，并写入控制记录片
启动自定时写cycle.This部分支持字节写
行动（见
表1第7页
和
“真值表”
第11页
对于进一步的细节） 。写周期可以是一到两个或四个字节
宽字节写控制输入的控制。 GW时
低电平有效使写入所有字节。
该
CY7C1380D/CY7C1382D/CY7C1380F/CY7C1382F
从+ 3.3V核心供电，而所有输出工作
工作于+2.5或+ 3.3V电源。所有的输入和
输出为JEDEC标准和JESD8-5兼容。
支持总线运行在高达250MHz的
可用速度等级是250 ， 200 ，和167 MHz的
注册的输入和输出的流水线操作
3.3 V核心供电
2.5 V或3.3 V的I / O电源
快时钟到输出时间
2.6纳秒（ 250 MHz器件）
提供高性能3-1-1-1接入速率
用户可选的突发计数器支持Intel
奔腾
交错式或线性突发序列
独立的处理器和控制器地址选通
同步自定时写
异步输出使能
单周期芯片取消
CY7C1380D / CY7C1382D可在符合JEDEC标准
无铅100引脚TQFP封装，无铅和无无铅165球
FPBGA封装; CY7C1380F / CY7C1382F是可用
JEDEC标准的无铅100引脚TQFP无铅和无
无铅的119球BGA和165球FPBGA封装
IEEE 1149.1 JTAG兼容的边界扫描
ZZ睡眠模式选项
■
■
■
■
■
■
■
■
■
选购指南
描述
最大访问时间
最大工作电流
最大的CMOS待机电流
250兆赫
2.6
350
70
200兆赫
3.0
300
70
167兆赫
3.4
275
70
单位
ns
mA
mA
笔记
1.为了达到最佳做法或建议，请参考赛普拉斯应用笔记AN1064 ，
SRAM系统设计指南
on
www.cypress.com 。
2. CE
3,
CE
2
对于TQFP只有165 FPBGA包。 119 BGA仅在1芯片使能提供。
赛普拉斯半导体公司
文件编号： 38-05543牧师* I
198冠军苑
圣荷西
,
CA 95134-1709
408-943-2600
修订后的2011年2月3日
[+ ]反馈
CY7C1380D ， CY7C1382D
CY7C1380F ， CY7C1382F
逻辑框图 - CY7C1380D / CY7C1380F
[3]
(512 K × 36)
A0, A1, A
地址
注册
2
A
[1:0]
模式
ADV
CLK
Q1
ADSC
ADSP
BW
D
DQ
D ,
DQP
D
字节
写注册
DQ
C ,
DQP
C
字节
写注册
DQ
B ,
DQP
B
字节
写注册
DQ
A ,
DQP
A
字节
写注册
BURST
计数器
CLR
和
逻辑
Q0
DQ
D
， DQP
D
字节
写入驱动器
DQ
C ,
DQP
C
字节
写入驱动器
DQ
B ,
DQP
B
字节
写入驱动器
DQ
A ,
DQP
A
字节
写入驱动器
BW
C
内存
ARRAY
SENSE
安培
产量
注册
产量
缓冲器
E
BW
B
的DQ
DQP
A
DQP
B
DQP
C
DQP
D
BW
A
BWE
GW
CE
1
CE
2
CE
3
OE
启用
注册
流水线
启用
输入
注册
ZZ
睡觉
控制
逻辑框图 - CY7C1382D / CY7C1382F
[3]
(1 M × 18)
A0, A1, A
地址
注册
2
ADV
CLK
BURST Q1
计数器
逻辑
ADSC
BW
B
DQ
B,
DQP
B
写注册
DQ
B,
DQP
B
写入驱动器
内存
ARRAY
SENSE
产量
产量
缓冲器
BW
A
BWE
GW
CE
1
CE2
CE3
OE
DQ
A,
DQP
A
写注册
DQ
A,
DQP
A
写入驱动器
的DQ
DQP
A
DQP
B
输入
启用
注册
流水线
启用
ZZ
睡觉
控制
记
3. CY7C1380F和CY7C1382F的119球BGA封装只有1个芯片使能（ CE
1
).
文件编号： 38-05543牧师* I
第33 2
[+ ]反馈
CY7C1380D ， CY7C1382D
CY7C1380F ， CY7C1382F
目录
引脚配置................................................ ........... 4
100引脚TQFP引脚（ 3芯片使能） ........................ 4
119球BGA引脚............................................. 5 .......
165球FBGA引脚（ 3芯片使能） ....................... 6
功能概述................................................ ........ 9
单一的读访问............................................... 9
单写访问发起的ADSP ................... 9
单写访问ADSC发起................... 9
突发序列................................................ ....... 10
睡眠模式................................................ ............... 10
真值表................................................ ...................... 11
真值表进行读/写............................................ 12
真值表进行读/写............................................ 12
IEEE 1149.1串行边界扫描（ JTAG ） .................. 13
禁用JTAG特性...................................... 13
TAP控制器状态图....................................... 13
测试访问端口（ TAP ） ............................................ 13
TAP控制器框图...................................... 13
执行TAP复位.................................. 13
TAP寄存器................................................ ...... 13
TAP指令集............................................... .... 14
保留................................................. .................. 15
TAP时序................................................ ...................... 15
TAP交流开关特性............................... 15
3.3 V TAP交流测试条件....................................... 16
2.5 V TAP交流测试条件....................................... 16
TAP直流电气特性和
工作条件................................................ ..... 16
识别寄存器定义................................ 17
扫描寄存器大小............................................... ........ 17
识别码................................................ ....... 17
119球BGA边界扫描顺序............................ 18
165球BGA边界扫描顺序............................ 19
最大额定值................................................ ........... 20
经营范围................................................ ............. 20
电气特性............................................... 20
电容................................................. ................... 21
热阻................................................ ........ 21
开关特性.............................................. 22
开关波形................................................ .... 23
订购信息................................................ ...... 27
订购代码定义......................................... 27
包图................................................ .......... 28
与缩略语................................................. ....................... 31
文档约定................................................ 31
计量单位............................................... ........ 31
文档历史记录页............................................... .. 32
销售，解决方案和法律信息...................... 33
全球销售和设计支持....................... 33
产品................................................. ................... 33
的PSoC解决方案................................................ ......... 33
文件编号： 38-05543牧师* I
第33 3
[+ ]反馈
CY7C1380D ， CY7C1382D
CY7C1380F ， CY7C1382F
销刀豆网络gurations
100引脚TQFP引脚（ 3芯片使能）
图1. CY7C1380D ， CY7C1380F （ 512K的× 36 ）
图2. CY7C1382D ， CY7C1382F （1μM ×18 ）
文件编号： 38-05543牧师* I
第33 4
[+ ]反馈
CY7C1380D ， CY7C1382D
CY7C1380F ， CY7C1382F
119球BGA引脚
1
A
B
C
D
E
F
G
H
J
K
L
M
N
P
R
T
U
V
DDQ
NC/288M
NC/144M
DQ
C
DQ
C
V
DDQ
DQ
C
DQ
C
V
DDQ
DQ
D
DQ
D
V
DDQ
DQ
D
DQ
D
NC
NC
V
DDQ
图3. CY7C1380F （ 512K的× 36 ）
2
3
4
5
A
A
A
ADSP
A
A
DQP
C
DQ
C
DQ
C
DQ
C
DQ
C
V
DD
DQ
D
DQ
D
DQ
D
DQ
D
DQP
D
A
NC/72M
TMS
A
A
V
SS
V
SS
V
SS
BW
C
V
SS
NC
V
SS
BW
D
V
SS
V
SS
V
SS
模式
A
TDI
ADSC
V
DD
NC
CE
1
OE
ADV
GW
V
DD
CLK
NC
BWE
A1
A0
V
DD
A
TCK
A
A
V
SS
V
SS
V
SS
BW
B
V
SS
NC
V
SS
BW
A
V
SS
V
SS
V
SS
NC
A
TDO
6
A
A
A
DQP
B
DQ
B
DQ
B
DQ
B
DQ
B
V
DD
DQ
A
DQ
A
DQ
A
DQ
A
DQP
A
A
NC/36M
NC
7
V
DDQ
NC/576M
NC/1G
DQ
B
DQ
B
V
DDQ
DQ
B
DQ
B
V
DDQ
DQ
A
DQ
A
V
DDQ
DQ
A
DQ
A
NC
ZZ
V
DDQ
图4. CY7C1382F （1μM ×18 ）
1
A
B
C
D
E
F
G
H
J
K
L
M
N
P
R
T
U
V
DDQ
NC/288M
NC/144M
DQ
B
NC
V
DDQ
NC
DQ
B
V
DDQ
NC
DQ
B
V
DDQ
DQ
B
NC
NC
NC/72M
V
DDQ
2
A
A
A
NC
DQ
B
NC
DQ
B
NC
V
DD
DQ
B
NC
DQ
B
NC
DQP
B
A
A
TMS
3
A
A
A
V
SS
V
SS
V
SS
BW
B
V
SS
NC
V
SS
NC
V
SS
V
SS
V
SS
模式
A
TDI
4
ADSP
ADSC
V
DD
NC
CE
1
OE
ADV
GW
V
DD
CLK
NC
BWE
A1
A0
V
DD
NC/36M
TCK
5
A
A
A
V
SS
V
SS
V
SS
NC
V
SS
NC
V
SS
BW
A
V
SS
V
SS
V
SS
NC
A
TDO
6
A
A
A
DQP
A
NC
DQ
A
NC
DQ
A
V
DD
NC
DQ
A
NC
DQ
A
NC
A
A
NC
7
V
DDQ
NC/576M
NC/1G
NC
DQ
A
V
DDQ
DQ
A
NC
V
DDQ
DQ
A
NC
V
DDQ
NC
DQ
A
NC
ZZ
V
DDQ
文件编号： 38-05543牧师* I
第33 5
[+ ]反馈
CY7C1380D ， CY7C1380F
CY7C1382D ， CY7C1382F
18兆位（ 512K ×36 / 1M ×18 ）流水线SRAM
特点
支持总线运行在高达250MHz的
- 可用的速度等级是250 ， 200 ，和167 MHz的
注册的输入和输出的流水线操作
3.3V核心供电
2.5V或3.3V IO电源
快速时钟到输出时间
- 2.6纳秒（ 250 MHz器件）
提供高性能3-1-1-1接入速率
用户可选的突发计数器支持Intel
奔腾
交错式或线性突发序列
独立的处理器和控制器地址选通
同步自定时写
异步输出使能
单周期芯片取消
CY7C1380D / CY7C1382D在JEDEC标准的可
无铅100引脚TQFP封装，无铅和无无铅165球
FBGA封装。 CY7C1380F / CY7C1382F可用
无铅和无无铅119球BGA封装
IEEE 1149.1 JTAG兼容的边界扫描
ZZ睡眠模式选项
功能说明
[1]
该
CY7C1380D/CY7C1382D/CY7C1380F/CY7C1382F
SRAM集成524,288 ×36和1048576 ×18的SRAM
细胞与先进同步外围电路和
2位的计数器，用于内部突发操作。所有同步
输入端通过由正边沿控制寄存器控
触发时钟输入（CLK） 。同步输入包括
所有地址，所有的数据输入，地址流水线芯片使能
（ CE
1
） ，深度扩展芯片启用（ CE
2
和CE
3 [2]
） ，突发
控制输入（ ADSC ， ADSP和ADV ） ，写入启用（ BW
X
,
和BWE ）和全局写（ GW ） 。异步输入
包括输出使能（ OE ）和ZZ引脚。
地址和芯片使注册在上升沿
时钟在地址选通处理器（ ADSP ）或地址
频闪控制器（ ADSC ）是活动的。随后爆
地址可以内部产生，因为它们被控制
通过提前销（ ADV ） 。
地址，数据输入，并写入控制记录片
启动自定时写cycle.This部分支持字节写
行动（见
引脚定义第6页
和
真值表
[4,
5, 6, 7, 8]
第9页
对于进一步的细节） 。写周期可以是一个
给两个或四个字节宽的字节写入控制作为控制
输入。 GW时，低电平有效使写入所有字节。
该
CY7C1380D/CY7C1382D/CY7C1380F/CY7C1382F
从+ 3.3V核心供电，而所有输出工作
工作于2.5或+ 3.3V电源。所有的输入和
输出为JEDEC标准和JESD8-5兼容。
选购指南
250兆赫
最大访问时间
最大工作电流
最大的CMOS待机电流
2.6
350
70
200兆赫
3.0
300
70
167兆赫
3.4
275
70
单位
ns
mA
mA
注意事项：
1.为了达到最佳做法或建议，请参考赛普拉斯应用笔记AN1064 ，
SRAM系统设计指南
on
www.cypress.com 。
2. CE
3,
CE
2
对于TQFP只有165 FBGA封装。 119 BGA仅在1芯片使能提供。
赛普拉斯半导体公司
文件编号： 38-05543牧师* E
198冠军苑
圣荷西
,
CA 95134-1709
408-943-2600
修订后的二月07 ， 2007
CY7C1380D ， CY7C1380F
CY7C1382D ， CY7C1382F
逻辑框图 - CY7C1380D / CY7C1380F
[3]
（ 512K ×36 ）
A0, A1, A
地址
注册
2
A
[1:0]
模式
ADV
CLK
Q1
ADSC
ADSP
BW
D
DQ
D ,
DQP
D
字节
写注册
DQ
C ,
DQP
C
字节
写注册
DQ
B ,
DQP
B
字节
写注册
DQ
A ,
DQP
A
字节
写注册
BURST
计数器
CLR
和
逻辑
Q0
DQ
D
， DQP
D
字节
写入驱动器
DQ
C ,
DQP
C
字节
写入驱动器
DQ
B ,
DQP
B
字节
写入驱动器
DQ
A ,
DQP
A
字节
写入驱动器
BW
C
内存
ARRAY
SENSE
安培
产量
注册
产量
缓冲器
E
BW
B
的DQ
DQP
A
DQP
B
DQP
C
DQP
D
BW
A
BWE
GW
CE
1
CE
2
CE
3
OE
启用
注册
流水线
启用
输入
注册
ZZ
睡觉
控制
逻辑框图 - CY7C1382D / CY7C1382F
[3]
（ 1M ×18 ）
A0, A1, A
地址
注册
2
ADV
CLK
BURST Q1
计数器
逻辑
ADSC
BW
B
DQ
B,
DQP
B
写注册
DQ
B,
DQP
B
写入驱动器
内存
ARRAY
SENSE
产量
产量
缓冲器
BW
A
BWE
GW
CE
1
CE2
CE3
OE
DQ
A,
DQP
A
写注册
DQ
A,
DQP
A
写入驱动器
的DQ
DQP
A
DQP
B
输入
启用
注册
流水线
启用
ZZ
睡觉
控制
注意：
3. CY7C1380F和CY7C1382F只有1个芯片使能（ CE
1
).
文件编号： 38-05543牧师* E
分页： 30 2
CY7C1380D ， CY7C1380F
CY7C1382D ， CY7C1382F
销刀豆网络gurations
100引脚TQFP引脚（ 3芯片使能）
A
A
CE
1
CE
2
BW
D
BW
C
BW
B
BW
A
CE
3
V
DD
V
SS
CLK
GW
BWE
OE
ADSC
ADSP
ADV
A
A
100
99
98
97
96
95
94
93
92
91
90
89
88
87
86
85
84
83
82
81
DQP
C
DQ
C
DQC
V
DDQ
V
SSQ
DQ
C
DQ
C
DQ
C
DQ
C
V
SSQ
V
DDQ
DQ
C
DQ
C
NC
V
DD
NC
V
SS
DQ
D
DQ
D
V
DDQ
V
SSQ
DQ
D
DQ
D
DQ
D
DQ
D
V
SSQ
V
DDQ
DQ
D
DQ
D
DQP
D
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
CY7C1380D
（ 512K ×36 ）
80
79
78
77
76
75
74
73
72
71
70
69
68
67
66
65
64
63
62
61
60
59
58
57
56
55
54
53
52
51
DQP
B
DQ
B
DQ
B
V
DDQ
V
SSQ
DQ
B
DQ
B
DQ
B
DQ
B
V
SSQ
V
DDQ
DQ
B
DQ
B
V
SS
NC
V
DD
ZZ
DQ
A
DQ
A
V
DDQ
V
SSQ
DQ
A
DQ
A
DQ
A
DQ
A
V
SSQ
V
DDQ
DQ
A
DQ
A
DQP
A
NC
NC
NC
V
DDQ
V
SSQ
NC
NC
DQ
B
DQ
B
V
SSQ
V
DDQ
DQ
B
DQ
B
NC
V
DD
NC
V
SS
DQ
B
DQ
B
V
DDQ
V
SSQ
DQ
B
DQ
B
DQP
B
NC
V
SSQ
V
DDQ
NC
NC
NC
100
99
98
97
96
95
94
93
92
91
90
89
88
87
86
85
84
83
82
81
A
A
CE
1
CE
2
NC
NC
BW
B
BW
A
CE
3
V
DD
V
SS
CLK
GW
BWE
OE
ADSC
ADSP
ADV
A
A
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
CY7C1382D
（ 1兆位×18 ）
80
79
78
77
76
75
74
73
72
71
70
69
68
67
66
65
64
63
62
61
60
59
58
57
56
55
54
53
52
51
A
NC
NC
V
DDQ
V
SSQ
NC
DQP
A
DQ
A
DQ
A
V
SSQ
V
DDQ
DQ
A
DQ
A
V
SS
NC
V
DD
ZZ
DQ
A
DQ
A
V
DDQ
V
SSQ
DQ
A
DQ
A
NC
NC
V
SSQ
V
DDQ
NC
NC
NC
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
模式
A
A
A
A
A
1
A
0
NC/72M
NC/36M
V
SS
V
DD
A
A
A
A
A
A
A
A
A
模式
A
A
A
A
A
1
A
0
NC/72M
NC/36M
V
SS
V
DD
文件编号： 38-05543牧师* E
A
A
A
A
A
A
A
A
A
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
第30 3
CY7C1380D ， CY7C1380F
CY7C1382D ， CY7C1382F
销刀豆网络gurations
（续）
119球BGA引脚
CY7C1380F （ 512K ×36 ）
1
A
B
C
D
E
F
G
H
J
K
L
M
N
P
R
T
U
V
DDQ
NC/288M
NC/144M
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C
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NC
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2
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A
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TMS
3
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CY7C1382F （ 1M ×18 ）
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NC/288M
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A
A
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CE
1
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SS
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A
NC
ZZ
V
DDQ
文件编号： 38-05543牧师* E
第30 4
CY7C1380D ， CY7C1380F
CY7C1382D ， CY7C1382F
销刀豆网络gurations
（续）
165球FBGA引脚（ 3芯片使能）
CY7C1380D （ 512K ×36 ）
1
A
B
C
D
E
F
G
H
J
K
L
M
N
P
R
NC/288M
NC/144M
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B
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A
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NC
NC/576M
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A
A1
A0
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A
A
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CY7C1382D （ 1M ×18 ）
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B
C
D
E
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G
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J
K
L
M
N
P
R
NC/288M
NC/144M
NC
NC
NC
NC
NC
NC
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A
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NC
NC
NC
NC
NC
NC/72M
NC/36M
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1
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DDQ
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DDQ
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A
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DD
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NC
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SS
V
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TMS
6
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ADSP
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A
A
NC/1G
NC
NC
NC
NC
NC
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DQ
A
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A
DQ
A
NC
A
A
11
A
NC/576M
DQP
A
DQ
A
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A
DQ
A
ZZ
NC
NC
NC
NC
NC
A
A
V
SS
V
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V
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V
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A
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A
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A
文件编号： 38-05543牧师* E
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CAA373
CO27NH12AC-02-10.000
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CATJ4-103J8
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CAT1021YI-30-T3
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COP8SGA528N7
CLL4697
CD54HC04M
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COP87L22CJ
CML3A1WT6Y
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    地址：深圳市福田区振兴路156号上步工业区405栋3层

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