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位置:首页 > IC型号导航 > 首字符C型号页 > 首字符C的型号第672页 > CY28378OC
CY28378
FTG奔腾4
和英特尔
845系列芯片组
特点
C
ompatible与英特尔
CK- Titan和CK- 408时钟
合成器/驱动器规格
系统频率合成器为Intel的Brookdale 845
和代尔 - 奔腾G 4
芯片组
可编程时钟输出频率低于
1 MHz的增量
集成的故障安全看门狗定时器系统
恢复
自动切换到HW选择或SW
可编程时钟频率时,看门狗定时器
超时
可编程3V66和PCI输出频率模式
能看门狗后,产生系统复位的
定时器超时或通过输出频率的变化
发生SMBus接口
支持读取字节的SMBus /写和块读/写
操作简化系统BIOS发展
厂商ID和版本ID的支持
可编程驱动强度的支持
可编程输出歪斜支持
电源管理控制输入
提供48引脚SSOP
表1.频率表
中央处理器
x3
3V66
x4
PCI
x 10
REF
x2
48M
x1
24_48M
x1
框图
X1
X2
引脚配置
[1]
VDD_REF
REF0 : 1
XTAL
OSC
PLL 1
PLL的参考频率
分频器
VDD_CPU
*MULTSEL1/REF1
CPUT [0:1 ] , CPUC [0: 1]
VDD_REF
CPU_ITP , CPU_ITP #
* FS0 : 4
VTT_PWRGD #
* MULTSEL0 : 1
PLL2
FRACT 。
定位仪
VDD_3V66
3V66_0:2
VDD_PCI
PCI_F0 : 2
2
PCI0 : 6
VDD_48MHz
3V66_3/48MHz_1
VDD_48MHz
48MHz_0
PWRDWN #
24_48MHz
2
SDATA
SCLK
SMBUS
逻辑
X1
X2
GND_PCI
*FS2/PCI_F0
*FS3/PCI_F1
PCI_F2
VDD_PCI
*FS4/PCI0
PCI1
PCI2
GND_PCI
PCI3
PCI4
PCI5
PCI6
VDD_PCI
VTT_PWRGD #
RESET#
GND_48MHz
*FS0/48MHz_0
*FS1/24_48MHz
VDD_48MHz
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
48
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
32
31
30
29
28
27
26
25
REF0/MULTSEL0**
GND_REF
VDD_CPU
CPU_ITP
CPU_ITP #
GND_CPU
PWRDWN # *
CPUT0
CPUC0
VDD_CPU
CPUT1
CPUC1
GNDC_CPU
IREF
VDD_CORE
GND_CORE
VDD_3V66
3V66_0
3V66_1
GND_3V66
3V66_2
3V66_3/48MHz_1
SCLK
SDATA
~
CY28378
RESET#
SSOP-48
注意:
标有“*”和1信号'**'具有内部上拉和下拉电阻,分别。
1.0版, 2006年11月20日
2200 LAURELWOOD路,圣克拉拉, CA 95054
联系电话: ( 408 ) 855-0555
传真: ( 408 ) 855-0550
分页: 21 1
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CY28378
引脚说明
针#
3
X1
名字
TYPE
I
描述
晶体连接或外部基准频率输入:
引脚具有双重功能。它可以被用作一个外部14.318 MHz的
水晶连接或作为外部参考频率输入。
水晶连接:
连接外部14.318 MHz的晶振。
如果使用外部基准时,该引脚必须悬空。
参考时钟0 /电流倍增器选择0 :
3.3V 14.318兆赫
时钟输出。该引脚也用作电源接通背带选项
确定当前的乘法器,用于CPU的时钟输出。该
MULTSEL1 :0定义如下:
MULTSEL1 : 0
00 = IOH是4× IREF
01 = IOH为5× IREF
10 = IOH为6× IREF
11 = IOH是7× IREF
150K内部上拉下来。
参考时钟1 /电流倍增器选择1 :
3.3V 14.318兆赫
时钟输出。该引脚也用作电源接通背带选项
确定当前的乘法器,用于CPU的时钟输出。该
MULTSEL1 :0定义如下:
MULTSEL1 : 0
00 = IOH是4× IREF
01 = IOH为5× IREF
10 = IOH为6× IREF
11 = IOH是7× IREF
150K内部上拉。
CPU时钟输出:
频率设定在FS0 : 4输入或通过
串行输入接口。
CPU时钟输出为ITP :
频率设定在FS0 : 4输入或
通过串行输入接口。
66MHz的时钟输出:
3.3V固定的66 - MHz时钟。
自由运行PCI输出0 /频率选择2 :
3.3V自由运行
PCI输出。该引脚也用作电源接通背带选项
确定为频描述器件的工作频率
选型表。 150K内部上拉。
自由运行PCI输出1 /频率选择3 :
3.3V自由运行
PCI输出。该引脚也用作电源接通背带选项
确定为在所描述的装置的工作频率
表2中。
150K内部上拉。
自由运行PCI输出2 :
3.3V自由运行的PCI输出。
PCI输出0 /频率选择4 :
PCI 3.3V输出。该引脚还
作为电带选项来确定设备的操作
如上述频率
表2中。
150K内部上拉。
PCI时钟输出1至6 :
3.3V PCI时钟输出。
48MHz的输出/频率选择0 :
3.3V固定的48 MHz的非扩展
光谱输出。该引脚也用作电源接通背带选项
确定如上述设备的工作频率
表2中。
这个输出将被用作参考时钟为USB主机控制器
英特尔845 (代尔)平台。对于英特尔代尔 - 摹平台,
这个输出将被用作VCH参考时钟。 150K内部上拉
了。
4
48
X2
REF0/MULTSEL0
O
I / O
1
REF1/MULTSEL1
I / O
41, 38, 40, 37
44, 45
31, 30, 28
6
CPUT (0 :1),
CPUC (0: 1)
CPU_ITP ,
CPU_ITP #
3V66_0:2
PCI_F0/FS2
O
O
O
I / O
7
PCI_F1/FS3
I / O
8
10
PCI_F2
PCI0/FS4
O
I / O
11, 12, 14, 15, 16,
17
22
PCI ( 1:6)
48MHz_0/FS0
O
I / O
1.0版, 2006年11月20日
第21 2
CY28378
引脚说明
针#
23
名字
24_48MHz/FS1
TYPE
I / O
描述
24或48MHz的输出/频率选择1 :
3.3V固定的24 MHz或
48 -MHz的非扩频输出。该引脚也可作为
上电带选项来确定设备的工作频率为
在描述
表2中。
这个输出将被用作参考时钟
在英特尔845 (代尔)平台SIO器件。对于Intel的Brookdale
- 平台上,该输出将被用作参考时钟为
USB主机控制器和SIO设备。我们建议系统设计
通过设置字节来配置此输出为48 MHz和“高驱动”
[5],位[ 0]和字节[9] ,位[7], respectively.150k内部上拉。
为48MHz或66MHz的输出:
3.3V输出。
掉电控制:
3.3V LVTTL兼容的输入,它使
器件在掉电模式下保持低电平。 150K内部上拉。
SMBus时钟输入:
时钟引脚用于串行接口。
SMBus数据输入:
数据引脚用于串行接口。
目前的参考CPU的输出:
精密电阻连接
到该引脚被连接到内部参考电流。
电源良好电压的稳压器模块( VRM ) :
3.3V LVTTL
输入。 VTT_PWRGD #是用来确定一个电平敏感的选通
当FS0 : 4和MULTSEL0 : 1输入是有效的,并确定进行采样
(低电平有效) 。一旦VTT_PWRGD #采样为低电平,在此状态
输入将被忽略。
3.3V电源连接:
电源为CPU输出缓冲器, 3V66
输出缓冲器, PCI输出缓冲器,基准输出缓冲器和
48 - MHz的输出缓冲器。连接到3.3V 。
27
42
26
25
20
35
19
3V66_3/48MHz_1
PWRDWN #
SCLK
SDATA
RESET#
IREF
VTT_PWRGD #
O
I
I
I / O
I
I
O(漏极开路)
系统复位输出:
漏极开路系统复位输出。
2 , 9 , 18 , 24 , 32 , 39 , VDD_REF ,
46
VDD _PCI ,
VDD_48MHz,
VDD_3V66,
VDD_CPU
5, 13, 21, 29, 36,
43, 47
GND_PCI ,
GND_48MHz,
GND_3V66,
GND_CPU ,
GND_REF ,
VDD_CORE
GND_CORE
P
G
接地连接:
连接所有接地引脚共同制度
接地平面。
34
33
P
G
3.3V模拟电源连接:
电源的核心逻辑, PLL
电路。连接到3.3V 。
模拟地连接:
地面的核心逻辑, PLL电路。
1.0版, 2006年11月20日
第21 3
CY28378
表2.频率选择表
输入条件
FS4
SEL4
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
FS3
SEL3
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1
FS2
SEL2
0
0
0
0
1
1
1
1
0
0
0
0
1
1
1
1
0
0
0
0
1
1
1
1
0
0
0
0
1
1
1
1
FS1
SEL1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
FS0
SEL0
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
中央处理器
100.7
100.9
108.0
101.2
114.0
117.0
120.0
123.0
125.7
130.3
133.9
134.2
134.5
148.0
152.0
156.0
160.0
164.0
167.4
170.0
175.0
180.0
185.0
190.0
166.8
100.2
133.6
200.4
166.6
100.0
200.0
133.3
3V66
67.1
67.3
72.0
67.5
76.0
78.0
80.0
82.0
62.9
65.1
67.0
67.1
67.3
74.0
76.0
78.0
80.0
82.0
66.9
68.0
70.0
72.0
74.0
76.0
66.7
66.8
66.8
66.8
66.6
66.6
66.6
66.6
PCI
33.6
33.6
36.0
33.7
38.0
39.0
40.0
41.0
31.4
32.6
33.5
33.6
33.6
37.0
38.0
39.0
40.0
41.0
33.5
34.0
35.0
36.0
37.0
38.0
33.4
33.4
33.4
33.4
33.3
33.3
33.3
33.3
402.80
403.60
432.00
404.80
456.00
468.00
480.00
492.00
377.12
390.80
401.70
402.60
403.50
444.00
456.00
468.00
480.00
492.00
334.80
340.00
350.00
360.00
370.00
380.00
333.60
400.80
400.80
400.80
333.33
400.00
400.00
400.00
输出频率
VCO
频率。
PLL齿轮
常量
(G)
47.99750
47.99750
47.99750
47.99750
47.99750
47.99750
47.99750
47.99750
63.99667
63.99667
63.99667
63.99667
63.99667
63.99667
63.99667
63.99667
63.99667
63.99667
95.99500
95.99500
95.99500
95.99500
95.99500
95.99500
95.99500
47.99750
63.99667
95.99500
95.99500
47.99750
95.99500
63.99667
秋千选择功能
MULTSEL1
0
1
MULTSEL0
0
0
董事会目标
跟踪/术语Z-
50
50
参考R, IREF =
VDD/(3*Rr)
产量
当前
I
OH
= 4 * IREF
I
OH
= 6 * IREF
V
OH
@ Z
1.0V @ 50
0.7V @ 50
Rr = 221 1%,
IREF = 5.00毫安
Rr = 475 1%,
IREF = 2.32毫安
串行数据接口
以提高的时钟合成器的灵活性和功能,
提供了一种双信号的串行接口。通过串口
数据接口( SDI)的各种设备的功能,如
单个时钟输出缓冲器等可以单独使能
或禁用。
1.0版, 2006年11月20日
第21 4
CY28378
与SDI相关的寄存器初始化为它的默认值
设置在上电时,并且因此使用该接口的是
可选。时钟器件寄存器的变化通常由
在系统初始化时,如果有的话是必需的。接口
也可用于电力系统的操作期间使用
管理功能。
数据协议
时钟驱动器的串行协议接收字节写,读字节,
从控制器的块写入和块读操作。为
块写入/读取操作,字节必须访问
按顺序从最低到最高字节(最显著
位在前)有能力停止后的任何完整的字节有
被转移。对于字节写和字节读取操作时,
系统控制器可以访问单个索引字节。该
被索引的字节的偏移被编码在命令代码,
如上述
表3中。
块写入和块读协议中概述
表4
表5
概述了相应的字节写和字节
读协议。
从机接收地址为11010010 ( D2H ) 。
表3.命令代码定义
7
6:0
0 =块读取或写入的块操作
1 =字节读取或字节写操作
字节偏移字节读取或字节写操作。块读或块写操作,这些
位应为' 0000000 ' 。
说明
表4块读取和块写入协议
块写入协议
1
2:8
9
10
11:18
19
20:27
28
29:36
37
38:45
46
....
....
....
....
....
....
开始
从地址 - 7位
写= 0
感谢来自SLAVE
命令代码 - 8位
' 00000000 '代表块操作
感谢来自SLAVE
字节数 - 8位
感谢来自SLAVE
数据字节1 - 8位
感谢来自SLAVE
数据字节2 - 8位
感谢来自SLAVE
......................
数据字节( N-1) -8位
感谢来自SLAVE
数据字节n -8位
感谢来自SLAVE
停止
描述
1
2:8
9
10
11:18
19
20
21:27
28
29
30:37
38
39:46
47
48:55
56
....
....
....
....
开始
从地址 - 7位
写= 0
感谢来自SLAVE
命令代码 - 8位
' 00000000 '代表块操作
感谢来自SLAVE
重复启动
从地址 - 7位
阅读= 1
感谢来自SLAVE
从奴隶字节数 - 8位
应答
从机的数据字节 - 8位
应答
从机的数据字节 - 8位
应答
从机的数据字节/应答
从机的数据字节N - 8位
无应答
停止
块读协议
描述
1.0版, 2006年11月20日
第21 5
CY28378
FTG奔腾4
和英特尔
845系列芯片组
特点
C
ompatible与英特尔
CK- Titan和CK- 408时钟
合成器/驱动器规格
系统频率合成器为Intel的Brookdale 845
和代尔 - 奔腾G 4
芯片组
可编程时钟输出频率小于
1 MHz的增量
集成的故障保护看门狗定时器系统
恢复
自动切换到HW选择或SW
可编程时钟频率时,看门狗定时器
超时
可编程3V66和PCI输出频率模式
能看门狗后,产生系统复位的
定时器超时或通过输出频率的变化
发生SMBus接口
支持读取字节的SMBus /写和块读/写
操作简化系统BIOS发展
厂商ID和版本ID的支持
可编程驱动强度的支持
可编程输出歪斜支持
电源管理控制输入
提供48引脚SSOP
表1.频率表
中央处理器
x3
3V66
x4
PCI
x 10
REF
x2
48M
x1
24_48M
x1
框图
X1
X2
引脚配置
[1]
VDD_REF
REF0 : 1
XTAL
OSC
PLL 1
PLL的参考频率
分频器
VDD_CPU
*MULTSEL1/REF1
CPUT [0:1 ] , CPUC [0: 1]
VDD_REF
CPU_ITP , CPU_ITP #
* FS0 : 4
VTT_PWRGD #
* MULTSEL0 : 1
PLL2
FRACT 。
定位仪
VDD_3V66
3V66_0:2
VDD_PCI
PCI_F0 : 2
2
PCI0 : 6
VDD_48MHz
3V66_3/48MHz_1
VDD_48MHz
48MHz_0
PWRDWN #
24_48MHz
2
SDATA
SCLK
SMBUS
逻辑
X1
X2
GND_PCI
*FS2/PCI_F0
*FS3/PCI_F1
PCI_F2
VDD_PCI
*FS4/PCI0
PCI1
PCI2
GND_PCI
PCI3
PCI4
PCI5
PCI6
VDD_PCI
VTT_PWRGD #
RESET#
GND_48MHz
*FS0/48MHz_0
*FS1/24_48MHz
VDD_48MHz
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
48
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
32
31
30
29
28
27
26
25
REF0/MULTSEL0**
GND_REF
VDD_CPU
CPU_ITP
CPU_ITP #
GND_CPU
PWRDWN # *
CPUT0
CPUC0
VDD_CPU
CPUT1
CPUC1
GNDC_CPU
IREF
VDD_CORE
GND_CORE
VDD_3V66
3V66_0
3V66_1
GND_3V66
3V66_2
3V66_3/48MHz_1
SCLK
SDATA
~
CY28378
RESET#
SSOP-48
注意:
标有“*”和1信号'**'具有内部上拉和下拉电阻,分别。
赛普拉斯半导体公司
文件编号: 38-07519牧师**
3901北一街
圣荷西
,
CA 95134
408-943-2600
修订后的二月28,2003
CY28378
引脚说明
针#
3
X1
名字
TYPE
I
描述
晶体连接或外部基准频率输入:
引脚具有双重功能。它可以被用作一个外部14.318 MHz的
水晶连接或作为外部参考频率输入。
水晶连接:
连接外部14.318 MHz的晶振。
如果使用外部基准时,该引脚必须悬空。
参考时钟0 /电流倍增器选择0 :
3.3V 14.318兆赫
时钟输出。该引脚也用作电源接通背带选项
确定当前的乘法器,用于CPU的时钟输出。该
MULTSEL1 :0定义如下:
MULTSEL1 : 0
00 = IOH是4× IREF
01 = IOH为5× IREF
10 = IOH为6× IREF
11 = IOH是7× IREF
150K内部上拉下来。
参考时钟1 /电流倍增器选择1 :
3.3V 14.318兆赫
时钟输出。该引脚也用作电源接通背带选项
确定当前的乘法器,用于CPU的时钟输出。该
MULTSEL1 :0定义如下:
MULTSEL1 : 0
00 = IOH是4× IREF
01 = IOH为5× IREF
10 = IOH为6× IREF
11 = IOH是7× IREF
150K内部上拉。
CPU时钟输出:
频率设定在FS0 : 4输入或通过
串行输入接口。
CPU时钟输出为ITP :
频率设定在FS0 : 4输入或
通过串行输入接口。
66MHz的时钟输出:
3.3V固定的66 - MHz时钟。
自由运行PCI输出0 /频率选择2 :
3.3V自由运行
PCI输出。该引脚也用作电源接通背带选项
确定为频描述器件的工作频率
选型表。 150K内部上拉。
自由运行PCI输出1 /频率选择3 :
3.3V自由运行
PCI输出。该引脚也用作电源接通背带选项
确定为在所描述的装置的工作频率
表2中。
150K内部上拉。
自由运行PCI输出2 :
3.3V自由运行的PCI输出。
PCI输出0 /频率选择4 :
PCI 3.3V输出。该引脚还
作为电带选项来确定设备的操作
如上述频率
表2中。
150K内部上拉。
PCI时钟输出1至6 :
3.3V PCI时钟输出。
48MHz的输出/频率选择0 :
3.3V固定的48 MHz的非扩展
光谱输出。该引脚也用作电源接通背带选项
确定如上述设备的工作频率
表2中。
这个输出将被用作参考时钟为USB主机控制器
英特尔845 (代尔)平台。对于英特尔代尔 - 摹平台,
这个输出将被用作VCH参考时钟。 150K内部上拉
了。
4
48
X2
REF0/MULTSEL0
O
I / O
1
REF1/MULTSEL1
I / O
41, 38, 40, 37
44, 45
31, 30, 28
6
CPUT (0 :1),
CPUC (0: 1)
CPU_ITP ,
CPU_ITP #
3V66_0:2
PCI_F0/FS2
O
O
O
I / O
7
PCI_F1/FS3
I / O
8
10
PCI_F2
PCI0/FS4
O
I / O
11, 12, 14, 15, 16,
17
22
PCI ( 1:6)
48MHz_0/FS0
O
I / O
文件编号: 38-07519牧师**
第22页2
CY28378
引脚说明
针#
23
名字
24_48MHz/FS1
TYPE
I / O
描述
24或48MHz的输出/频率选择1 :
3.3V固定的24 MHz或
48 -MHz的非扩频输出。该引脚也可作为
上电带选项来确定设备的工作频率为
在描述
表2中。
这个输出将被用作参考时钟
在英特尔845 (代尔)平台SIO器件。对于Intel的Brookdale
- 平台上,该输出将被用作参考时钟为
USB主机控制器和SIO设备。我们建议系统设计
通过设置字节来配置此输出为48 MHz和“高驱动”
[5],位[ 0]和字节[9] ,位[7], respectively.150k内部上拉。
为48MHz或66MHz的输出:
3.3V输出。
掉电控制:
3.3V LVTTL兼容的输入,它使
器件在掉电模式下保持低电平。 150K内部上拉。
SMBus时钟输入:
时钟引脚用于串行接口。
SMBus数据输入:
数据引脚用于串行接口。
目前的参考CPU的输出:
精密电阻连接
到该引脚被连接到内部参考电流。
电源良好电压的稳压器模块( VRM ) :
3.3V LVTTL
输入。 VTT_PWRGD #是用来确定一个电平敏感的选通
当FS0 : 4和MULTSEL0 : 1输入是有效的,并确定进行采样
(低电平有效) 。一旦VTT_PWRGD #采样为低电平,在此状态
输入将被忽略。
3.3V电源连接:
电源为CPU输出缓冲器, 3V66
输出缓冲器, PCI输出缓冲器,基准输出缓冲器和
48 - MHz的输出缓冲器。连接到3.3V 。
27
42
26
25
20
35
19
3V66_3/48MHz_1
PWRDWN #
SCLK
SDATA
RESET#
IREF
VTT_PWRGD #
O
I
I
I / O
I
I
O(漏极开路)
系统复位输出:
漏极开路系统复位输出。
2 , 9 , 18 , 24 , 32 , 39 , VDD_REF ,
46
VDD _PCI ,
VDD_48MHz,
VDD_3V66,
VDD_CPU
5, 13, 21, 29, 36,
43, 47
GND_PCI ,
GND_48MHz,
GND_3V66,
GND_CPU ,
GND_REF ,
VDD_CORE
GND_CORE
P
G
接地连接:
连接所有接地引脚共同制度
接地平面。
34
33
P
G
3.3V模拟电源连接:
电源的核心逻辑, PLL
电路。连接到3.3V 。
模拟地连接:
地面的核心逻辑, PLL电路。
文件编号: 38-07519牧师**
第22页3
CY28378
表2.频率选择表
输入条件
FS4
SEL4
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
FS3
SEL3
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1
FS2
SEL2
0
0
0
0
1
1
1
1
0
0
0
0
1
1
1
1
0
0
0
0
1
1
1
1
0
0
0
0
1
1
1
1
FS1
SEL1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
FS0
SEL0
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
中央处理器
100.7
100.9
108.0
101.2
114.0
117.0
120.0
123.0
125.7
130.3
133.9
134.2
134.5
148.0
152.0
156.0
160.0
164.0
167.4
170.0
175.0
180.0
185.0
190.0
166.8
100.2
133.6
200.4
166.6
100.0
200.0
133.3
3V66
67.1
67.3
72.0
67.5
76.0
78.0
80.0
82.0
62.9
65.1
67.0
67.1
67.3
74.0
76.0
78.0
80.0
82.0
66.9
68.0
70.0
72.0
74.0
76.0
66.7
66.8
66.8
66.8
66.6
66.6
66.6
66.6
PCI
33.6
33.6
36.0
33.7
38.0
39.0
40.0
41.0
31.4
32.6
33.5
33.6
33.6
37.0
38.0
39.0
40.0
41.0
33.5
34.0
35.0
36.0
37.0
38.0
33.4
33.4
33.4
33.4
33.3
33.3
33.3
33.3
402.80
403.60
432.00
404.80
456.00
468.00
480.00
492.00
377.12
390.80
401.70
402.60
403.50
444.00
456.00
468.00
480.00
492.00
334.80
340.00
350.00
360.00
370.00
380.00
333.60
400.80
400.80
400.80
333.33
400.00
400.00
400.00
输出频率
VCO
频率。
PLL齿轮
常量
(G)
47.99750
47.99750
47.99750
47.99750
47.99750
47.99750
47.99750
47.99750
63.99667
63.99667
63.99667
63.99667
63.99667
63.99667
63.99667
63.99667
63.99667
63.99667
95.99500
95.99500
95.99500
95.99500
95.99500
95.99500
95.99500
47.99750
63.99667
95.99500
95.99500
47.99750
95.99500
63.99667
秋千选择功能
MULTSEL1
0
1
MULTSEL0
0
0
董事会目标
跟踪/术语Z-
50
50
参考R, IREF =
VDD/(3*Rr)
产量
当前
I
OH
= 4 * IREF
I
OH
= 6 * IREF
V
OH
@ Z
1.0V @ 50
0.7V @ 50
Rr = 221 1%,
IREF = 5.00毫安
Rr = 475 1%,
IREF = 2.32毫安
文件编号: 38-07519牧师**
第22页4
CY28378
串行数据接口
以提高的时钟合成器的灵活性和功能,
提供了一种双信号的串行接口。通过串口
数据接口( SDI)的各种设备的功能,如
单个时钟输出缓冲器等可以单独使能
或禁用。
与SDI相关的寄存器初始化为它的默认值
设置在上电时,并且因此使用该接口的是
可选。时钟器件寄存器的变化通常由
在系统初始化时,如果有的话是必需的。接口
也可用于电力系统的操作期间使用
管理功能。
数据协议
时钟驱动器的串行协议接收字节写,读字节,
从控制器的块写入和块读操作。为
块写入/读取操作,字节必须访问
按顺序从最低到最高字节(最显著
位在前)有能力停止后的任何完整的字节有
被转移。对于字节写和字节读取操作时,
系统控制器可以访问单个索引字节。该
被索引的字节的偏移被编码在命令代码,
如上述
表3中。
块写入和块读协议中概述
表4
表5
概述了相应的字节写和字节
读协议。
从机接收地址为11010010 ( D2H ) 。
表3.命令代码定义
7
6:0
0 =块读取或写入的块操作
1 =字节读取或字节写操作
字节偏移字节读取或字节写操作。块读或块写操作,这些
位应为' 0000000 ' 。
说明
表4块读取和块写入协议
块写入协议
1
2:8
9
10
11:18
19
20:27
28
29:36
37
38:45
46
....
....
....
....
....
....
开始
从地址 - 7位
写= 0
感谢来自SLAVE
命令代码 - 8位
' 00000000 '代表块操作
感谢来自SLAVE
字节数 - 8位
感谢来自SLAVE
数据字节1 - 8位
感谢来自SLAVE
数据字节2 - 8位
感谢来自SLAVE
......................
数据字节( N-1) -8位
感谢来自SLAVE
数据字节n -8位
感谢来自SLAVE
停止
描述
1
2:8
9
10
11:18
19
20
21:27
28
29
30:37
38
39:46
47
48:55
56
....
....
....
....
开始
从地址 - 7位
写= 0
感谢来自SLAVE
命令代码 - 8位
' 00000000 '代表块操作
感谢来自SLAVE
重复启动
从地址 - 7位
阅读= 1
感谢来自SLAVE
从奴隶字节数 - 8位
应答
从机的数据字节 - 8位
应答
从机的数据字节 - 8位
应答
从机的数据字节/应答
从机的数据字节N - 8位
无应答
停止
块读协议
描述
文件编号: 38-07519牧师**
第22页5
CY28378
FTG奔腾4
和英特尔
845系列芯片组
特点
C
ompatible与英特尔
CK- Titan和CK- 408时钟
合成器/驱动器规格
系统频率合成器为Intel的Brookdale 845
和代尔 - 奔腾G 4
芯片组
可编程时钟输出频率小于
1 MHz的增量
集成的故障保护看门狗定时器系统
恢复
自动切换到HW选择或SW
可编程时钟频率时,看门狗定时器
超时
可编程3V66和PCI输出频率模式
能看门狗后,产生系统复位的
定时器超时或通过输出频率的变化
发生SMBus接口
支持读取字节的SMBus /写和块读/写
操作简化系统BIOS发展
厂商ID和版本ID的支持
可编程驱动强度的支持
可编程输出歪斜支持
电源管理控制输入
提供48引脚SSOP
表1.频率表
中央处理器
x3
3V66
x4
PCI
x 10
REF
x2
48M
x1
24_48M
x1
框图
X1
X2
引脚配置
[1]
VDD_REF
REF0 : 1
XTAL
OSC
PLL 1
PLL的参考频率
分频器
VDD_CPU
*MULTSEL1/REF1
CPUT [0:1 ] , CPUC [0: 1]
VDD_REF
CPU_ITP , CPU_ITP #
* FS0 : 4
VTT_PWRGD #
* MULTSEL0 : 1
PLL2
FRACT 。
定位仪
VDD_3V66
3V66_0:2
VDD_PCI
PCI_F0 : 2
2
PCI0 : 6
VDD_48MHz
3V66_3/48MHz_1
VDD_48MHz
48MHz_0
PWRDWN #
24_48MHz
2
SDATA
SCLK
SMBUS
逻辑
X1
X2
GND_PCI
*FS2/PCI_F0
*FS3/PCI_F1
PCI_F2
VDD_PCI
*FS4/PCI0
PCI1
PCI2
GND_PCI
PCI3
PCI4
PCI5
PCI6
VDD_PCI
VTT_PWRGD #
RESET#
GND_48MHz
*FS0/48MHz_0
*FS1/24_48MHz
VDD_48MHz
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
48
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
32
31
30
29
28
27
26
25
REF0/MULTSEL0**
GND_REF
VDD_CPU
CPU_ITP
CPU_ITP #
GND_CPU
PWRDWN # *
CPUT0
CPUC0
VDD_CPU
CPUT1
CPUC1
GNDC_CPU
IREF
VDD_CORE
GND_CORE
VDD_3V66
3V66_0
3V66_1
GND_3V66
3V66_2
3V66_3/48MHz_1
SCLK
SDATA
~
CY28378
RESET#
SSOP-48
注意:
标有“*”和1信号'**'具有内部上拉和下拉电阻,分别。
赛普拉斯半导体公司
文件编号: 38-07519牧师**
3901北一街
圣荷西
,
CA 95134
408-943-2600
修订后的二月28,2003
CY28378
引脚说明
针#
3
X1
名字
TYPE
I
描述
晶体连接或外部基准频率输入:
引脚具有双重功能。它可以被用作一个外部14.318 MHz的
水晶连接或作为外部参考频率输入。
水晶连接:
连接外部14.318 MHz的晶振。
如果使用外部基准时,该引脚必须悬空。
参考时钟0 /电流倍增器选择0 :
3.3V 14.318兆赫
时钟输出。该引脚也用作电源接通背带选项
确定当前的乘法器,用于CPU的时钟输出。该
MULTSEL1 :0定义如下:
MULTSEL1 : 0
00 = IOH是4× IREF
01 = IOH为5× IREF
10 = IOH为6× IREF
11 = IOH是7× IREF
150K内部上拉下来。
参考时钟1 /电流倍增器选择1 :
3.3V 14.318兆赫
时钟输出。该引脚也用作电源接通背带选项
确定当前的乘法器,用于CPU的时钟输出。该
MULTSEL1 :0定义如下:
MULTSEL1 : 0
00 = IOH是4× IREF
01 = IOH为5× IREF
10 = IOH为6× IREF
11 = IOH是7× IREF
150K内部上拉。
CPU时钟输出:
频率设定在FS0 : 4输入或通过
串行输入接口。
CPU时钟输出为ITP :
频率设定在FS0 : 4输入或
通过串行输入接口。
66MHz的时钟输出:
3.3V固定的66 - MHz时钟。
自由运行PCI输出0 /频率选择2 :
3.3V自由运行
PCI输出。该引脚也用作电源接通背带选项
确定为频描述器件的工作频率
选型表。 150K内部上拉。
自由运行PCI输出1 /频率选择3 :
3.3V自由运行
PCI输出。该引脚也用作电源接通背带选项
确定为在所描述的装置的工作频率
表2中。
150K内部上拉。
自由运行PCI输出2 :
3.3V自由运行的PCI输出。
PCI输出0 /频率选择4 :
PCI 3.3V输出。该引脚还
作为电带选项来确定设备的操作
如上述频率
表2中。
150K内部上拉。
PCI时钟输出1至6 :
3.3V PCI时钟输出。
48MHz的输出/频率选择0 :
3.3V固定的48 MHz的非扩展
光谱输出。该引脚也用作电源接通背带选项
确定如上述设备的工作频率
表2中。
这个输出将被用作参考时钟为USB主机控制器
英特尔845 (代尔)平台。对于英特尔代尔 - 摹平台,
这个输出将被用作VCH参考时钟。 150K内部上拉
了。
4
48
X2
REF0/MULTSEL0
O
I / O
1
REF1/MULTSEL1
I / O
41, 38, 40, 37
44, 45
31, 30, 28
6
CPUT (0 :1),
CPUC (0: 1)
CPU_ITP ,
CPU_ITP #
3V66_0:2
PCI_F0/FS2
O
O
O
I / O
7
PCI_F1/FS3
I / O
8
10
PCI_F2
PCI0/FS4
O
I / O
11, 12, 14, 15, 16,
17
22
PCI ( 1:6)
48MHz_0/FS0
O
I / O
文件编号: 38-07519牧师**
第22页2
CY28378
引脚说明
针#
23
名字
24_48MHz/FS1
TYPE
I / O
描述
24或48MHz的输出/频率选择1 :
3.3V固定的24 MHz或
48 -MHz的非扩频输出。该引脚也可作为
上电带选项来确定设备的工作频率为
在描述
表2中。
这个输出将被用作参考时钟
在英特尔845 (代尔)平台SIO器件。对于Intel的Brookdale
- 平台上,该输出将被用作参考时钟为
USB主机控制器和SIO设备。我们建议系统设计
通过设置字节来配置此输出为48 MHz和“高驱动”
[5],位[ 0]和字节[9] ,位[7], respectively.150k内部上拉。
为48MHz或66MHz的输出:
3.3V输出。
掉电控制:
3.3V LVTTL兼容的输入,它使
器件在掉电模式下保持低电平。 150K内部上拉。
SMBus时钟输入:
时钟引脚用于串行接口。
SMBus数据输入:
数据引脚用于串行接口。
目前的参考CPU的输出:
精密电阻连接
到该引脚被连接到内部参考电流。
电源良好电压的稳压器模块( VRM ) :
3.3V LVTTL
输入。 VTT_PWRGD #是用来确定一个电平敏感的选通
当FS0 : 4和MULTSEL0 : 1输入是有效的,并确定进行采样
(低电平有效) 。一旦VTT_PWRGD #采样为低电平,在此状态
输入将被忽略。
3.3V电源连接:
电源为CPU输出缓冲器, 3V66
输出缓冲器, PCI输出缓冲器,基准输出缓冲器和
48 - MHz的输出缓冲器。连接到3.3V 。
27
42
26
25
20
35
19
3V66_3/48MHz_1
PWRDWN #
SCLK
SDATA
RESET#
IREF
VTT_PWRGD #
O
I
I
I / O
I
I
O(漏极开路)
系统复位输出:
漏极开路系统复位输出。
2 , 9 , 18 , 24 , 32 , 39 , VDD_REF ,
46
VDD _PCI ,
VDD_48MHz,
VDD_3V66,
VDD_CPU
5, 13, 21, 29, 36,
43, 47
GND_PCI ,
GND_48MHz,
GND_3V66,
GND_CPU ,
GND_REF ,
VDD_CORE
GND_CORE
P
G
接地连接:
连接所有接地引脚共同制度
接地平面。
34
33
P
G
3.3V模拟电源连接:
电源的核心逻辑, PLL
电路。连接到3.3V 。
模拟地连接:
地面的核心逻辑, PLL电路。
文件编号: 38-07519牧师**
第22页3
CY28378
表2.频率选择表
输入条件
FS4
SEL4
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
FS3
SEL3
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1
FS2
SEL2
0
0
0
0
1
1
1
1
0
0
0
0
1
1
1
1
0
0
0
0
1
1
1
1
0
0
0
0
1
1
1
1
FS1
SEL1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
FS0
SEL0
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
中央处理器
100.7
100.9
108.0
101.2
114.0
117.0
120.0
123.0
125.7
130.3
133.9
134.2
134.5
148.0
152.0
156.0
160.0
164.0
167.4
170.0
175.0
180.0
185.0
190.0
166.8
100.2
133.6
200.4
166.6
100.0
200.0
133.3
3V66
67.1
67.3
72.0
67.5
76.0
78.0
80.0
82.0
62.9
65.1
67.0
67.1
67.3
74.0
76.0
78.0
80.0
82.0
66.9
68.0
70.0
72.0
74.0
76.0
66.7
66.8
66.8
66.8
66.6
66.6
66.6
66.6
PCI
33.6
33.6
36.0
33.7
38.0
39.0
40.0
41.0
31.4
32.6
33.5
33.6
33.6
37.0
38.0
39.0
40.0
41.0
33.5
34.0
35.0
36.0
37.0
38.0
33.4
33.4
33.4
33.4
33.3
33.3
33.3
33.3
402.80
403.60
432.00
404.80
456.00
468.00
480.00
492.00
377.12
390.80
401.70
402.60
403.50
444.00
456.00
468.00
480.00
492.00
334.80
340.00
350.00
360.00
370.00
380.00
333.60
400.80
400.80
400.80
333.33
400.00
400.00
400.00
输出频率
VCO
频率。
PLL齿轮
常量
(G)
47.99750
47.99750
47.99750
47.99750
47.99750
47.99750
47.99750
47.99750
63.99667
63.99667
63.99667
63.99667
63.99667
63.99667
63.99667
63.99667
63.99667
63.99667
95.99500
95.99500
95.99500
95.99500
95.99500
95.99500
95.99500
47.99750
63.99667
95.99500
95.99500
47.99750
95.99500
63.99667
秋千选择功能
MULTSEL1
0
1
MULTSEL0
0
0
董事会目标
跟踪/术语Z-
50
50
参考R, IREF =
VDD/(3*Rr)
产量
当前
I
OH
= 4 * IREF
I
OH
= 6 * IREF
V
OH
@ Z
1.0V @ 50
0.7V @ 50
Rr = 221 1%,
IREF = 5.00毫安
Rr = 475 1%,
IREF = 2.32毫安
文件编号: 38-07519牧师**
第22页4
CY28378
串行数据接口
以提高的时钟合成器的灵活性和功能,
提供了一种双信号的串行接口。通过串口
数据接口( SDI)的各种设备的功能,如
单个时钟输出缓冲器等可以单独使能
或禁用。
与SDI相关的寄存器初始化为它的默认值
设置在上电时,并且因此使用该接口的是
可选。时钟器件寄存器的变化通常由
在系统初始化时,如果有的话是必需的。接口
也可用于电力系统的操作期间使用
管理功能。
数据协议
时钟驱动器的串行协议接收字节写,读字节,
从控制器的块写入和块读操作。为
块写入/读取操作,字节必须访问
按顺序从最低到最高字节(最显著
位在前)有能力停止后的任何完整的字节有
被转移。对于字节写和字节读取操作时,
系统控制器可以访问单个索引字节。该
被索引的字节的偏移被编码在命令代码,
如上述
表3中。
块写入和块读协议中概述
表4
表5
概述了相应的字节写和字节
读协议。
从机接收地址为11010010 ( D2H ) 。
表3.命令代码定义
7
6:0
0 =块读取或写入的块操作
1 =字节读取或字节写操作
字节偏移字节读取或字节写操作。块读或块写操作,这些
位应为' 0000000 ' 。
说明
表4块读取和块写入协议
块写入协议
1
2:8
9
10
11:18
19
20:27
28
29:36
37
38:45
46
....
....
....
....
....
....
开始
从地址 - 7位
写= 0
感谢来自SLAVE
命令代码 - 8位
' 00000000 '代表块操作
感谢来自SLAVE
字节数 - 8位
感谢来自SLAVE
数据字节1 - 8位
感谢来自SLAVE
数据字节2 - 8位
感谢来自SLAVE
......................
数据字节( N-1) -8位
感谢来自SLAVE
数据字节n -8位
感谢来自SLAVE
停止
描述
1
2:8
9
10
11:18
19
20
21:27
28
29
30:37
38
39:46
47
48:55
56
....
....
....
....
开始
从地址 - 7位
写= 0
感谢来自SLAVE
命令代码 - 8位
' 00000000 '代表块操作
感谢来自SLAVE
重复启动
从地址 - 7位
阅读= 1
感谢来自SLAVE
从奴隶字节数 - 8位
应答
从机的数据字节 - 8位
应答
从机的数据字节 - 8位
应答
从机的数据字节/应答
从机的数据字节N - 8位
无应答
停止
块读协议
描述
文件编号: 38-07519牧师**
第22页5
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