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CY28372
矽统746的AMD Athlon / AMD的Duron 时钟合成器
特点
支持AMD Athlon / Duron CPU
3.3V和2.5V电源
八份PCI时钟
一个48 MHz的USB时钟
两份ZCLK时钟
一个48兆赫/ 24 - MHz的可编程时钟SIO
一个差分CPU时钟(漏极开路)
一个单端CPU时钟(漏极开路)
SMBus支持与回读功能
扩频电磁干扰( EMI )
减少
48引脚SSOP封装
中央处理器
x2
ZCLK
x2
REF
x3
PCI
x8
AGP
x2
IOAPIC
x2
48M
x1
24_48M
x1
框图
XIN
XOUT
引脚配置
PLL的参考频率
分频器
VDD_REF
REF0 : 2
VDD_CPU
CPUT1
CPUT0 , CPUC0
VDD_Z
ZCLK0 : 1
XTAL
OSC
PLL 1
** FS0 : 3
CPU_STP #
VDD_APIC
APIC0 : 1
VDD_PCI
PCIF0 : 1
PCI0 : 5
2
PCI_STP #
FRACT 。
定位仪
VDD_AGP
AGP0 : 1
PLL2
PD #
VDD_48
48兆赫
24_48MHz
2
VDD_REF
**FS0/REF0
**FS1/REF1
REF2
GND_REF
XIN
XOUT
GND_Z
ZCLK0
ZCLK1
VDD_Z
* PCI_STP #
VDD_PCI
**FS2/PCIF0
*FS3/PCIF1
PCI0
PCI1
GND_PCI
VDD_PCI
PCI2
PCI3
PCI4
PCI5
GND_PCI
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
48
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
32
31
30
29
28
27
26
25
VDD_APIC
IOAPIC1
IOAPIC0
GND_APIC
CPU_STP # *
CPUT1
VDD_CPU
GND_CPU
CPUT0
CPUC0
VDD_CPU
GNDA
VDDA
SCLK
SDATA
PD # *
GND_AGP
AGP0
AGP1
VDD_AGP
VDD_48
48MHZ
24_48MHZ
GND_48
~
SDATA
SCLK
I2C
逻辑
SSOP-48
*:内部上拉150K
** :内部下拉150K
赛普拉斯半导体公司
文件编号: 38-07533修订版**
3901北一街
圣荷西
,
CA 95134
408-943-2600
修订后的2004年9月20日
CY28372
CY28372
引脚说明
针# 。
6
名字
XIN
TYPE
I
描述
晶体连接或外部参考频率输入。
该引脚具有双重
功能。它可以被用作一个外部14.318 MHz的晶体振荡器连接,或作为
外部参考频率输入。
水晶连接。
连接外部14.318 MHz的晶振。如果使用
外部参考时,该引脚必须悬空。
参考时钟。
14.31818参考输出。
参考时钟。
14.31818参考输出。
频率选择。
上电后,确定设备的工作频率进行采样。
自由运行PCI 。
独立的PCI_STP # 。
频率选择。
上电后,确定设备的工作频率进行采样。
PCI时钟。
PCI停止。
停止所有PCI时钟
差分CPU输出。
“真”
差分CPU输出的时钟。
对于芯片组的主机总线
CPU停止。
停止所有的CPU时钟
MuTIOL时钟输出。
IOAPIC 。
2.5 V时钟输出
48 - MHz时钟。
USB时钟输出
24 MHz或48 MHz的时钟。
可选的SIO时钟输出。默认输出频率
24兆赫,但可以通过我被配置为48兆赫
2
C.
AGP时钟。
I
2
C数据。
5V容限
I
2
Clock.5v
宽容
断电控制。
关闭所有的时钟输出和关闭设备
3.3V模拟电源/接地。
电源的核心逻辑, PLL电路
3.3V电源和接地。
电源用于各输出缓冲器。
7
4
2, 3
14, 15
16, 17, 20,
21, 22, 23
12
40
39
43
44
9, 10
46, 47
27
26
31, 30
34
35
33
36
37
1, 5, 8, 11,
13, 18, 19,
24, 25, 28,
29, 32
XOUT
REF2
文献[ 0 : 1 ] /
FS [ 0 : 1 ]
PCIF [0:1 ] /
FS [ 2 :3]
PCI [0: 5]
PCI_STP #
CPUT0
CPUC0
CPUT1
CPU_STP #
ZCLK [0:1 ]
IOAPIC [0:1 ]
48MHz
24_48MHz
AGP [0:1 ]
SDATA
SCLK
PD #
VDDA
GNDA
VDD_REF ,
GND_REF ,
GND_Z ,
VDD_Z ,
VDD_PCI ,
GND_PCI ,
GND_48,
VDD_48,
VDD_AGP ,
GND_AGP
VDD_CPU ,
GND_CPU ,
VDD_APIC ,
GND_APIC
O
O
O
I
O
I
O
I
O
O
I
O
O
O
O
O
I / O
I
I
PWR
PWR
PWR
38, 41, 42
48, 45
PWR
2.5V电源和接地。
电源用于各输出缓冲器。
文件编号: 38-07533修订版**
第18页2
CY28372
表1.频率选择表
输入条件
选项
( 4个字节,第2位)
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
(默认)
I
2
C
FS( 3:0 )
0000
0001
0010
0011
0100
0101
0110
0111
1000
1001
1010
1011
1100
1101
1110
1111
0000
0001
0010
0011
0100
0101
0110
0111
1000
1001
1010
1011
1100
1101
1110
1111
中央处理器
(兆赫)
133.3
133.3
133.3
133.3
133.3
133.3
133.3
133.3
100.0
100.0
100.0
100.0
100.0
100.0
111.0
111.0
114.5
120.0
133.3
133.3
133.3
145.7
150.0
166.6
111.1
137.4
144.9
150.0
155.1
166.6
180.1
200.0
输出频率
ZCLK
(兆赫)
66.7
66.7
100.0
100.0
133.3
133.3
166.6
166.6
66.7
66.7
100.0
100.0
133.3
133.3
166.5
166.5
95.4
100.0
83.3
111.1
133.3
116.6
100.0
111.1
133.3
137.4
144.9
150.0
124.1
133.3
135.1
133.3
AGP
(兆赫)
66.7
50.0
66.7
50.0
66.7
50.0
66.7
55.5
66.7
50.0
66.7
50.0
66.7
50.0
66.6
55.5
63.6
66.7
66.7
74.1
83.3
64.8
66.7
66.7
66.7
68.7
64.4
66.7
68.9
66.7
67.6
66.7
PCI
(兆赫)
33.3
33.3
33.3
33.3
33.3
33.3
33.3
33.3
33.3
33.3
33.3
33.3
33.3
33.3
33.3
33.3
31.8
33.3
33.3
33.3
33.3
32.4
33.3
33.3
33.3
34.4
32.2
33.3
34.5
33.3
33.8
33.3
VCO
频率。
(兆赫)
400.0
400.0
400.0
400.0
400.0
400.0
666.5
666.5
400.0
400.0
400.0
400.0
400.0
400.0
666.1
666.1
572.5
600.0
666.5
666.5
666.5
582.8
600.0
666.5
666.5
549.6
579.5
600.0
620.3
666.5
540.4
400.0
串行数据接口
以提高的时钟合成器的灵活性和功能,
提供了一种双信号的串行接口。通过串口
数据接口,各种设备的功能,如个人
时钟输出缓冲器,可以单独启用或禁用。
与串行数据接口相关的寄存器
初始化为它们的默认设置上电时,并且因此
使用此接口是可选的。时钟器件的寄存器变化
在系统初始化时,通常制成,如果有的话是
所需。该接口也可制过程中使用的
操作的功率管理功能。
数据协议
时钟驱动器的串行协议接收字节写,读字节,
块写入和块从控制器读取操作。为
块写入/读取操作,字节必须访问
按顺序从最低到最高字节(最显著
位在前)有能力停止后的任何完整的字节有
被转移。对于字节写和字节读取操作时,
系统控制器可以访问单独的索引字节。该
被索引的字节的偏移被编码在命令代码,
如上述
表2中。
文件编号: 38-07533修订版**
第18页3
CY28372
块写入和块读协议中概述
表3
表4
概述了相应的字节写和字节
读协议。从机接收地址为11010010 ( D2H ) 。
表2.命令代码定义
7
(6:0)
描述
0 =块读取或块写操作, 1 =字节
读或字节写操作
字节偏移字节读取或字节写操作。
块读或块写操作,这些位
应为' 0000000 '
表3块读取和块写入协议
块写入协议
1
2:8
9
10
11:18
19
20:27
28
29:36
37
38:45
46
....
....
....
....
....
....
开始
从地址 - 7位
写= 0
感谢来自SLAVE
命令代码 - 8位
' 00000000 '代表块操作
感谢来自SLAVE
字节数 - 8位
感谢来自SLAVE
数据字节1 - 8位
感谢来自SLAVE
数据字节2 - 8位
感谢来自SLAVE
......................
数据字节( N-1) -8位
感谢来自SLAVE
数据字节n -8位
感谢来自SLAVE
停止
描述
1
2:8
9
10
11:18
19
20
21:27
28
29
30:37
38
39:46
47
48:55
56
....
....
....
....
表4字节读和字节写入协议
字节写入协议
1
2:8
9
10
11:18
开始
从地址 - 7位
写= 0
感谢来自SLAVE
命令代码 - 8位
“ 1XXXXXXX '代表字节操作,位[ 6 : 0 ]的
该字节到命令码表示的偏移量
访问
感谢来自SLAVE
从主数据字节 - 8位
描述
1
2:8
9
10
11:18
开始
从地址 - 7位
写= 0
感谢来自SLAVE
命令代码 - 8位
“ 1XXXXXXX '代表字节操作,位[ 6 : 0 ]的
该字节到命令码表示的偏移量
访问
感谢来自SLAVE
重复启动
字节读协议
描述
开始
从地址 - 7位
写= 0
感谢来自SLAVE
命令代码 - 8位
' 00000000 '代表块操作
感谢来自SLAVE
重复启动
从地址 - 7位
阅读= 1
感谢来自SLAVE
从奴隶字节数 - 8位
应答
从机的数据字节 - 8位
应答
从机的数据字节 - 8位
应答
从机的数据字节/应答
从机的数据字节N - 8位
无应答
停止
块读协议
描述
19
20:27
19
20
文件编号: 38-07533修订版**
第18页4
CY28372
表4字节读和字节写入协议
(续)
字节写入协议
28
29
停止
描述
感谢来自SLAVE
21:27
28
29
30:37
38
39
阅读= 1
感谢来自SLAVE
从机的数据字节 - 8位
无应答
停止
字节读协议
描述
从地址 - 7位
设备配置地图
数据字节0到3 :保留ZDB寄存器
4个字节
第7位
第6位
第5位
4位
@Pup
1
0
0
0
名字
频率选择寄存器
(FS3)
频率选择寄存器
(FS2)
频率选择寄存器
(FS1)
频率选择寄存器
(FS0)
[7..4]
位2 - 0
0000
0001
0010
0011
0100
0101
0110
0111
1000
1001
1010
1011
1100
1101
1110
1111
位2 = 1
0000
0001
0010
0011
0100
0101
0110
0111
1000
1001
1010
1011
1100
1101
1110
1111
114.5
120.0
133.3
133.3
133.3
145.7
150.0
166.6
111.1
137.4
144.9
150.0
155.1
166.6
180.1
200.0
95.4
100.0
83.3
111.1
133.3
116.6
100.0
111.1
133.3
137.4
144.9
150.0
124.1
133.3
135.1
133.3
63.631.8
66.733.3
66.733.3
74.133.3
83.333.3
64.832.4
66.733.3
66.733.3
66.733.3
68.734.4
64.432.2
66.733.3
68.934.5
66.733.3
67.633.8
66.733.3
133.3
133.3
133.3
133.3
133.3
133.3
133.3
133.3
100.0
100.0
100.0
100.0
100.0
100.0
111.0
111.0
66.7
66.7
100.0
100.0
133.3
133.3
166.6
166.6
66.7
66.7
100.0
100.0
133.3
133.3
166.5
166.5
66.733.3
50.033.3
66.733.3
50.033.3
66.733.3
50.033.3
66.733.3
55.533.3
66.733.3
50.033.3
66.733.3
50.033.3
66.733.3
50.033.3
66.633.3
55.533.3
描述
中央处理器
ZCLK
AGPPCI
第3位
0
FS_Override
频率选择来源:
0 =选择通过硬件捆扎,锁存输入
1 =选择通过I
2
C
0 =正常, 1 =扩频启用
0 =正常, 1 =三态输出全部
第2位
第1位
位0
BYTE 5
第7位
第6位
第5位
4位
0
1
0
频率选择我注册最显著位
2
C频率选择寄存器
扩频控制
输出禁用
@Pup
0
0
0
0
版权所有
版权所有
版权所有
版权所有
名字
版权所有
版权所有
版权所有
版权所有
描述
文件编号: 38-07533修订版**
第18页5
CY28372
矽统746的AMD Athlon / AMD的Duron 时钟合成器
特点
支持AMD Athlon / Duron的
3.3V和2.5V电源
八份PCI时钟
一个48 MHz的USB时钟
两份ZCLK时钟
一个48兆赫/ 24 MHz的可编程时钟SIO
中央处理器
x2
ZCLK
x2
REF
x3
PCI
x8
AGP
x2
IOAPIC
x2
48M
x1
24_48M
x1
一个差分CPU时钟(漏极开路)
中央处理器
一个单端CPU时钟(漏极开路)
SMBus支持与回读功能
扩频电磁干扰( EMI )
减少
48引脚SSOP封装
框图
XIN
XOUT
引脚配置
VDD_REF
REF0 : 2
XTAL
OSC
PLL的参考频率
分频器
VDD_CPU
CPUT1
CPUT0 , CPUC0
VDD_Z
ZCLK0 : 1
PLL 1
** FS0 : 3
CPU_STP #
VDD_APIC
APIC0 : 1
VDD_PCI
PCIF0 : 1
2
PCI0 : 5
PCI_STP #
FRACT 。
定位仪
VDD_AGP
AGP0 : 1
PLL2
PD #
VDD_48
48兆赫
24_48MHz
2
VDD_REF
**FS0/REF0
**FS1/REF1
REF2
GND_REF
XIN
XOUT
GND_Z
ZCLK0
ZCLK1
VDD_Z
* PCI_STP #
VDD_PCI
**FS2/PCIF0
*FS3/PCIF1
PCI0
PCI1
GND_PCI
VDD_PCI
PCI2
PCI3
PCI4
PCI5
GND_PCI
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
48
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
32
31
30
29
28
27
26
25
VDD_APIC
IOAPIC1
IOAPIC0
GND_APIC
CPU_STP # *
CPUT1
VDD_CPU
GND_CPU
CPUT0
CPUC0
VDD_CPU
GNDA
VDDA
SCLK
SDATA
PD # *
GND_AGP
AGP0
AGP1
VDD_AGP
VDD_48
48MHZ
24_48MHZ
GND_48
~
SDATA
SCLK
I2C
逻辑
SSOP-48
*:内部上拉150K
** :内部下拉150K
CY28372
1.0版, 2006年11月20日
2200 LAURELWOOD路,圣克拉拉, CA 95054
联系电话: ( 408 ) 855-0555
传真: ( 408 ) 855-0550
第17页1
www.SpectraLinear.com
CY28372
引脚说明
针# 。
6
名字
XIN
TYPE
I
描述
晶体连接或外部参考频率输入。
该引脚具有双重
功能。它可以被用作一个外部14.318 MHz的晶体振荡器连接,或作为
外部参考频率输入。
水晶连接。
连接外部14.318 MHz的晶振。如果使用
外部参考时,该引脚必须悬空。
参考时钟。
14.31818参考输出。
参考时钟。
14.31818参考输出。
频率选择。
上电后,确定设备的工作频率进行采样。
自由运行PCI 。
独立的PCI_STP # 。
频率选择。
上电后,确定设备的工作频率进行采样。
PCI时钟。
PCI停止。
停止所有PCI时钟
差分CPU输出。
“真”
差分CPU输出的时钟。
对于芯片组的主机总线
CPU停止。
停止所有的CPU时钟
MuTIOL时钟输出。
IOAPIC 。
2.5 V时钟输出
48 MHz时钟。
USB时钟输出
24 MHz或48 MHz的时钟。
可选的SIO时钟输出。默认输出频率
24兆赫,但可以通过我被配置为48兆赫
2
C.
AGP时钟。
I
2
C数据。
5V容限
I
2
Clock.5v
宽容
断电控制。
关闭所有的时钟输出和关闭设备
3.3V模拟电源/接地。
电源的核心逻辑, PLL电路
3.3V电源和接地。
电源用于各输出缓冲器。
7
4
2, 3
14, 15
16, 17, 20,
21, 22, 23
12
40
39
43
44
9, 10
46, 47
27
26
31, 30
34
35
33
36
37
1, 5, 8, 11,
13, 18, 19,
24, 25, 28,
29, 32
XOUT
REF2
文献[ 0 : 1 ] /
FS [ 0 : 1 ]
PCIF [0:1 ] /
FS [ 2 :3]
PCI [0: 5]
PCI_STP #
CPUT0
CPUC0
CPUT1
CPU_STP #
ZCLK [0:1 ]
IOAPIC [0:1 ]
48MHz
24_48MHz
AGP [0:1 ]
SDATA
SCLK
PD #
VDDA
GNDA
VDD_REF ,
GND_REF ,
GND_Z ,
VDD_Z ,
VDD_PCI ,
GND_PCI ,
GND_48,
VDD_48,
VDD_AGP ,
GND_AGP
VDD_CPU ,
GND_CPU ,
VDD_APIC ,
GND_APIC
O
O
O
I
O
I
O
I
O
O
I
O
O
O
O
O
I / O
I
I
PWR
PWR
PWR
38, 41, 42
48, 45
PWR
2.5V电源和接地。
电源用于各输出缓冲器。
1.0版, 2006年11月20日
第17页2
CY28372
表1.频率选择表
输入条件
选项
( 4个字节,第2位)
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
(默认)
I
2
C
FS( 3:0 )
0000
0001
0010
0011
0100
0101
0110
0111
1000
1001
1010
1011
1100
1101
1110
1111
0000
0001
0010
0011
0100
0101
0110
0111
1000
1001
1010
1011
1100
1101
1110
1111
中央处理器
(兆赫)
133.3
133.3
133.3
133.3
133.3
133.3
133.3
133.3
100.0
100.0
100.0
100.0
100.0
100.0
111.0
111.0
114.5
120.0
133.3
133.3
133.3
145.7
150.0
166.6
111.1
137.4
144.9
150.0
155.1
166.6
180.1
200.0
输出频率
ZCLK
(兆赫)
66.7
66.7
100.0
100.0
133.3
133.3
166.6
166.6
66.7
66.7
100.0
100.0
133.3
133.3
166.5
166.5
95.4
100.0
83.3
111.1
133.3
116.6
100.0
111.1
133.3
137.4
144.9
150.0
124.1
133.3
135.1
133.3
AGP
(兆赫)
66.7
50.0
66.7
50.0
66.7
50.0
66.7
55.5
66.7
50.0
66.7
50.0
66.7
50.0
66.6
55.5
63.6
66.7
66.7
74.1
83.3
64.8
66.7
66.7
66.7
68.7
64.4
66.7
68.9
66.7
67.6
66.7
PCI
(兆赫)
33.3
33.3
33.3
33.3
33.3
33.3
33.3
33.3
33.3
33.3
33.3
33.3
33.3
33.3
33.3
33.3
31.8
33.3
33.3
33.3
33.3
32.4
33.3
33.3
33.3
34.4
32.2
33.3
34.5
33.3
33.8
33.3
VCO
频率。
(兆赫)
400.0
400.0
400.0
400.0
400.0
400.0
666.5
666.5
400.0
400.0
400.0
400.0
400.0
400.0
666.1
666.1
572.5
600.0
666.5
666.5
666.5
582.8
600.0
666.5
666.5
549.6
579.5
600.0
620.3
666.5
540.4
400.0
串行数据接口
以提高的时钟合成器的灵活性和功能,
提供了一种双信号的串行接口。通过串口
数据接口,各种设备的功能,如个人
时钟输出缓冲器,可以单独启用或禁用。
与串行数据接口相关的寄存器
初始化为它们的默认设置上电时,并且因此
使用此接口是可选的。时钟器件的寄存器变化
在系统初始化时,通常制成,如果有的话是
所需。该接口也可制过程中使用的
操作的功率管理功能。
数据协议
时钟驱动器的串行协议接收字节写,读字节,
块写入和块从控制器读取操作。为
块写入/读取操作,字节必须访问
按顺序从最低到最高字节(最显著
位在前)有能力停止后的任何完整的字节有
被转移。对于字节写和字节读取操作时,
系统控制器可以访问单独的索引字节。该
被索引的字节的偏移被编码在命令代码,
如上述
表2中。
1.0版, 2006年11月20日
第17页3
CY28372
块写入和块读协议中概述
表3
表4
概述了相应的字节写和字节
读协议。从机接收地址为11010010 ( D2H ) 。
表2.命令代码定义
7
(6:0)
描述
0 =块读取或块写操作, 1 =字节
读或字节写操作
字节偏移字节读取或字节写操作。
块读或块写操作,这些位
应为' 0000000 '
表3块读取和块写入协议
块写入协议
1
2:8
9
10
11:18
19
20:27
28
29:36
37
38:45
46
....
....
....
....
....
....
开始
从地址 - 7位
写= 0
感谢来自SLAVE
命令代码 - 8位
' 00000000 '代表块操作
感谢来自SLAVE
字节数 - 8位
感谢来自SLAVE
数据字节1 - 8位
感谢来自SLAVE
数据字节2 - 8位
感谢来自SLAVE
......................
数据字节( N-1) -8位
感谢来自SLAVE
数据字节n -8位
感谢来自SLAVE
停止
描述
1
2:8
9
10
11:18
19
20
21:27
28
29
30:37
38
39:46
47
48:55
56
....
....
....
....
表4字节读和字节写入协议
字节写入协议
1
2:8
9
10
11:18
开始
从地址 - 7位
写= 0
感谢来自SLAVE
命令代码 - 8位
“ 1XXXXXXX '代表字节操作,位[ 6 : 0 ]的
该字节到命令码表示的偏移量
访问
感谢来自SLAVE
从主数据字节 - 8位
描述
1
2:8
9
10
11:18
开始
从地址 - 7位
写= 0
感谢来自SLAVE
命令代码 - 8位
“ 1XXXXXXX '代表字节操作,位[ 6 : 0 ]的
该字节到命令码表示的偏移量
访问
感谢来自SLAVE
重复启动
字节读协议
描述
开始
从地址 - 7位
写= 0
感谢来自SLAVE
命令代码 - 8位
' 00000000 '代表块操作
感谢来自SLAVE
重复启动
从地址 - 7位
阅读= 1
感谢来自SLAVE
从奴隶字节数 - 8位
应答
从机的数据字节 - 8位
应答
从机的数据字节 - 8位
应答
从机的数据字节/应答
从机的数据字节N - 8位
无应答
停止
块读协议
描述
19
20:27
19
20
1.0版, 2006年11月20日
第17页4
CY28372
表4字节读和字节写入协议
(续)
字节写入协议
28
29
停止
描述
感谢来自SLAVE
21:27
28
29
30:37
38
39
阅读= 1
感谢来自SLAVE
从机的数据字节 - 8位
无应答
停止
字节读协议
描述
从地址 - 7位
设备配置地图
数据字节0到3 :保留ZDB寄存器
4个字节
第7位
第6位
第5位
4位
@Pup
1
0
0
0
名字
频率选择寄存器
(FS3)
频率选择寄存器
(FS2)
频率选择寄存器
(FS1)
频率选择寄存器
(FS0)
[7..4]
位2 - 0
0000
0001
0010
0011
0100
0101
0110
0111
1000
1001
1010
1011
1100
1101
1110
1111
位2 = 1
0000
0001
0010
0011
0100
0101
0110
0111
1000
1001
1010
1011
1100
1101
1110
1111
114.5
120.0
133.3
133.3
133.3
145.7
150.0
166.6
111.1
137.4
144.9
150.0
155.1
166.6
180.1
200.0
95.4
100.0
83.3
111.1
133.3
116.6
100.0
111.1
133.3
137.4
144.9
150.0
124.1
133.3
135.1
133.3
63.631.8
66.733.3
66.733.3
74.133.3
83.333.3
64.832.4
66.733.3
66.733.3
66.733.3
68.734.4
64.432.2
66.733.3
68.934.5
66.733.3
67.633.8
66.733.3
133.3
133.3
133.3
133.3
133.3
133.3
133.3
133.3
100.0
100.0
100.0
100.0
100.0
100.0
111.0
111.0
66.7
66.7
100.0
100.0
133.3
133.3
166.6
166.6
66.7
66.7
100.0
100.0
133.3
133.3
166.5
166.5
66.733.3
50.033.3
66.733.3
50.033.3
66.733.3
50.033.3
66.733.3
55.533.3
66.733.3
50.033.3
66.733.3
50.033.3
66.733.3
50.033.3
66.633.3
55.533.3
描述
中央处理器
ZCLK
AGPPCI
第3位
0
FS_Override
频率选择来源:
0 =选择通过硬件捆扎,锁存输入
1 =选择通过I
2
C
0 =正常, 1 =扩频启用
0 =正常, 1 =三态输出全部
第2位
第1位
位0
BYTE 5
第7位
第6位
第5位
4位
0
1
0
频率选择我注册最显著位
2
C频率选择寄存器
扩频控制
输出禁用
@Pup
0
0
0
0
版权所有
版权所有
版权所有
版权所有
名字
版权所有
版权所有
版权所有
版权所有
描述
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第17页5
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