初步
CY28324
FTG英特尔
奔腾
4 CPU和芯片组
特点
兼容英特尔
CK- 00 ，CK-泰坦& CK- 408的时钟
合成器/驱动器规格
系统频率合成器为Intel 850 ，代尔
（ 845 ）和代尔 - 奔腾G
4芯片组
可编程时钟输出频率小于1
MHz的增量
集成的故障安全看门狗定时器系统
恢复
自动切换到HW选择或SW
可编程时钟频率时，看门狗定时器
超时
能看门狗后，产生系统复位的
定时器超时后或输出频率的变化
通过SMBus接口
支持SMBus的字节读/写和块读/写
操作简化系统BIOS发展
厂商ID和版本ID的支持
可编程驱动强度的支持
可编程输出歪斜支持
电源管理控制输入
提供48引脚SSOP
中央处理器
x2
3V66
x4
PCI
x 10
REF
x2
48M
x1
24_48M
x1
框图
X1
X2
引脚配置
VDD_REF
REF0 ： 1
XTAL
OSC
PLL 1
SSOP-48
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
48
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
32
31
30
29
28
27
26
25
REF0/MULTSEL0*
GND_REF
VDD_MREF
3VMREF/CPU_STP#*
3VMREF#/PCI_STP#*
GND_MREF
PWR_DWN ＃
CPU0
CPU0#
VDD_CPU
CPU1
CPU1#
GND_CPU
IREF
VDD_CORE
GND_CORE
VDD_3V66
3V66_0
3V66_1
GND_3V66
3V66_2
3V66_3
SCLK
SDATA
PLL的参考频率
分频器
网
停止
时钟
控制
* FS0 ： 4
VTT_PWRGD ＃
* CPU_STP ＃
* MULTSEL0 ： 1
PWR_DWN ＃
停止
时钟
控制
* PCI_STP ＃
*MULTSEL1/REF1
VDD_REF
X1
X2
GND_PCI
*FS2/PCI_F0
*FS3/PCI_F1
VDD_MREF
3VMREF ， 3VMREF ＃
*MODE/PCI_F2
VDD_PCI
VDD_3V66
*FS4/PCI0
3V66_0:3
PCI1
PCI2
GND_PCI
VDD_PCI
PCI3
PCI_F0 ： 2
PCI4
PCI0 ： 6
PCI5
PCI6
VDD_PCI
VTT_PWRGD ＃
RST ＃
GND_48MHz
*FS0/48MHz
*FS1/24_48MHz
VDD_48MHz
VDD_48MHz
VDD_CPU
CPU0 ：1， CPU0 ： 1 ＃
48MHz
~
CY28324
PLL2
24_48MHz
2
注意：
标有“*” 1.信号具有内部上拉电阻。
SDATA
SCLK
SMBUS
逻辑
RST ＃
Intel和Pentium是Intel Corporation的注册商标。
赛普拉斯半导体公司
文件编号： 38-07002修订版**
3901北一街
圣荷西
CA 95134 408-943-2600
修订后的二○○一年十一月十四日
初步
引脚德网络nitions
引脚名称
X1
PIN号
3
针
TYPE
I
引脚说明
CY28324
晶体连接或外部基准频率输入：
该引脚有
双重功能。它可以被用作一个外部14.318 MHz的晶体振荡器连接
或作为外部参考频率输入。
水晶连接：
连接外部14.318 MHz的晶振。如果使用
外部基准电压源，该引脚必须悬空。
参考时钟0 /电流倍增器选择0 ：
3.3V 14.318 MHz的时钟
输出。该引脚也用作电源接通背带选项来确定当前
乘法器，用于CPU的时钟输出。该MULTSEL1 ： 0的定义是按下列方法
低点：
MULTSEL1 ： 0
00 = I
OH
是4× IREF
01 = I
OH
是5× IREF
10 = I
OH
是6× IREF
11 = I
OH
是7× IREF
参考时钟1 /电流倍增器选择1 ：
3.3V 14.318 MHz的时钟
输出。该引脚也用作电源接通背带选项来确定当前
乘法器，用于CPU的时钟输出。该MULTSEL1 ： 0的定义是按下列方法
低点：
MULTSEL1 ： 0
00 = IOH是4× IREF
01 = I
OH
是5× IREF
10 = I
OH
是6× IREF
11 = I
OH
是7× IREF
CPU时钟输出：
频率被设定在FS0 ： 4个输入或通过串行
输入接口。
内存参考时钟/ CPU输出控制：
这个引脚的功能
由模式输入引脚控制。当输入模式是在高采样
上电复位时，该引脚将被配置为3VMREF输出。当模式
在上电复位时，该引脚将被配置为输入采样为低电平
CPU_STP ＃的输入。
3VMREF是3.3V输出为CPU输出时钟频率的一半运行。
CPU_STP ＃是3.3V LVTTL兼容的输入禁用CPU0 ， CPU0 ＃ ，
CPU1和CPU1 ＃输出。
内存参考时钟/ PCI输出控制：
这个引脚的功能
由模式输入引脚控制。当输入模式是在高采样
上电复位时，该引脚将被配置为3VMREF ＃输出。当模式
在上电复位时，该引脚将被配置为输入采样为低电平
PCI_STP ＃的输入。
3VMREF ＃是3.3V输出运行在CPU输出频率的一半
时钟。 3VMREF ＃是180度异相的相对于3VMREF 。
PCI_STP ＃是3.3V LVTTL兼容的输入禁用PCI0 ： 6输出。
66 - MHz时钟输出：
3.3V固定的66 - MHz时钟。
自由运行PCI输出0 /频率选择2 ：
3.3V自由运行的PCI输出
放。该引脚也可作为电带选项来确定设备OP-
如在频率选择表中所述展业务的频率。
自由运行PCI输出1 /频率选择3 ：
3.3V自由运行的PCI输出
放。该引脚也可作为电带选项来确定设备OP-
如在频率选择表中所述展业务的频率。
X2
REF0/MULTSEL0
4
48
O
I / O
REF1/MULTSEL1
1
I / O
CPU0 ：1， CPU0 ： 1 ＃
3VMREF/CPU_STP
#
41, 38, 40, 37
45
O
I / O
3VMREF#/PCI_STP
#
44
I / O
3V66_0:3
PCI_F0/FS2
31, 30, 28, 27
6
O
I / O
PCI_F1/FS3
7
I / O
文件编号： 38-07002修订版**
第23页2
初步
引脚德网络nitions
（续）
引脚名称
PCI_F2/Mode
PIN号
8
针
TYPE
I / O
引脚说明
CY28324
自由运行PCI输出2 /模式选择：
3.3V自由运行的PCI输出。
该引脚也用作电源接通背带选项来确定的功能
3VMREF / CPU_STP ＃和3VMREF ＃ / PCI_STP ＃ 。
当模式输入时采样到高电平上电复位，
3VMREF / CPU_STP ＃和3VMREF ＃ / PCI_STP ＃将被配置为
3VMREF和3VMREF ＃输出分别。
当模式输入时采样到低电平上电复位，
3VMREF / CPU_STP ＃和3VMREF ＃ / PCI_STP ＃将被配置为
CPU_STP ＃和PCI_STP ＃的输入，分别。
PCI输出0 /频率选择4 ：
PCI 3.3V输出。该引脚也可作为
如所述上电带选项来确定器件的工作频率
在频率选择表。
PCI时钟输出1至6 ：
3.3V PCI时钟输出。
48MHz的输出/频率选择0 ：
3.3V固定的48 MHz的非扩散光谱
特鲁姆输出。该引脚也用作电源接通背带选项确定
如上述设备的工作频率
表4 。
这个输出将被用作参考时钟用于在英特尔USB主机控制器
845 （代尔）平台。对于英特尔代尔 - 摹平台，该输出
用作VCH参考时钟。
24或48 MHz输出/频率选择1 ：
3.3V固定的24 MHz或48 MHz的
非扩频输出。该引脚也可作为电带选项
如上述，以确定设备的工作频率
表4 。
这个输出将被用作在英特尔845串口设备的基准时钟
（代尔）平台。为英特尔代尔 - 平台，这个输出是
用作参考时钟为USB主机控制器和SIO设备。我们
建议系统设计人员配置该输出为48 MHz和“ HIGH
驱动器“通过设定字节[5]，位[ 0]和字节[9] ，位[7]，分别。
掉电控制：
3.3V LVTTL兼容的输入，它使器件
掉电模式时保持低电平。
SMBus时钟输入：
时钟引脚用于串行接口。
SMBus数据输入：
数据引脚用于串行接口。
系统复位输出：
漏极开路系统复位输出。
PCI0/FS4
10
I / O
PCI1 ： 6
48MHz/FS0
11, 12, 14, 15,
16, 17
22
O
I / O
24_48MHz/FS1
23
I / O
PWR_DWN ＃
SCLK
SDATA
RST ＃
42
26
25
20
I
I
I / O
O
（开
漏）
I
I
IREF
VTT_PWRGD ＃
35
19
目前的参考CPU的输出：
精密电阻连接到该
销，其连接到所述内部参考电流。
电源良好电压的稳压器模块（ VRM ） ：
3.3V LVTTL输入。
VTT_PWRGD ＃是用于确定何时FS0电平敏感频闪：4，
MODE和MULTSEL0 ： 1输入是有效的，并确定进行采样（低电平有效） 。
一旦VTT_PWRGD ＃采样为低电平时，该输入的状态将被忽略。
3.3V电源连接：
电源为CPU输出缓冲器， 3V66输出
缓冲剂， PCI输出缓冲器中，参考输出缓冲器和48 -MHz的输出缓冲器。
连接到3.3V 。
VDD_REF ，
VDD _PCI ，
VDD_48MHz,
VDD_3V66,
VDD_CPU
VDD_MREF
2, 9, 18, 24,
32, 39, 46
P
文件编号： 38-07002修订版**
第23页3
初步
CY28324
FTG英特尔
奔腾
4 CPU和芯片组
特点
兼容英特尔
CK- 00 ，CK-泰坦& CK- 408的时钟
合成器/驱动器规格
系统频率合成器为Intel 850 ，代尔
（ 845 ）和代尔 - 奔腾G
4芯片组
可编程时钟输出频率小于1
MHz的增量
集成的故障安全看门狗定时器系统
恢复
自动切换到HW选择或SW
可编程时钟频率时，看门狗定时器
超时
能看门狗后，产生系统复位的
定时器超时后或输出频率的变化
通过SMBus接口
支持SMBus的字节读/写和块读/写
操作简化系统BIOS发展
厂商ID和版本ID的支持
可编程驱动强度的支持
可编程输出歪斜支持
电源管理控制输入
提供48引脚SSOP
中央处理器
x2
3V66
x4
PCI
x 10
REF
x2
48M
x1
24_48M
x1
框图
X1
X2
引脚配置
VDD_REF
REF0 ： 1
XTAL
OSC
PLL 1
SSOP-48
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
48
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
32
31
30
29
28
27
26
25
REF0/MULTSEL0*
GND_REF
VDD_MREF
3VMREF/CPU_STP#*
3VMREF#/PCI_STP#*
GND_MREF
PWR_DWN ＃
CPU0
CPU0#
VDD_CPU
CPU1
CPU1#
GND_CPU
IREF
VDD_CORE
GND_CORE
VDD_3V66
3V66_0
3V66_1
GND_3V66
3V66_2
3V66_3
SCLK
SDATA
PLL的参考频率
分频器
网
停止
时钟
控制
* FS0 ： 4
VTT_PWRGD ＃
* CPU_STP ＃
* MULTSEL0 ： 1
PWR_DWN ＃
停止
时钟
控制
* PCI_STP ＃
*MULTSEL1/REF1
VDD_REF
X1
X2
GND_PCI
*FS2/PCI_F0
*FS3/PCI_F1
VDD_MREF
3VMREF ， 3VMREF ＃
*MODE/PCI_F2
VDD_PCI
VDD_3V66
*FS4/PCI0
3V66_0:3
PCI1
PCI2
GND_PCI
VDD_PCI
PCI3
PCI_F0 ： 2
PCI4
PCI0 ： 6
PCI5
PCI6
VDD_PCI
VTT_PWRGD ＃
RST ＃
GND_48MHz
*FS0/48MHz
*FS1/24_48MHz
VDD_48MHz
VDD_48MHz
VDD_CPU
CPU0 ：1， CPU0 ： 1 ＃
48MHz
~
CY28324
PLL2
24_48MHz
2
注意：
标有“*” 1.信号具有内部上拉电阻。
SDATA
SCLK
SMBUS
逻辑
RST ＃
Intel和Pentium是Intel Corporation的注册商标。
赛普拉斯半导体公司
文件编号： 38-07002牧师* B
3901北一街
圣荷西
CA 95134 408-943-2600
修订后的2002年12月14日
初步
引脚德网络nitions
引脚名称
X1
PIN号
3
针
TYPE
I
引脚说明
CY28324
晶体连接或外部基准频率输入：
该引脚有
双重功能。它可以被用作一个外部14.318 MHz的晶体振荡器连接
或作为外部参考频率输入。
水晶连接：
连接外部14.318 MHz的晶振。如果使用
外部基准电压源，该引脚必须悬空。
参考时钟0 /电流倍增器选择0 ：
3.3V 14.318 MHz的时钟
输出。该引脚也用作电源接通背带选项来确定当前
乘法器，用于CPU的时钟输出。该MULTSEL1 ： 0的定义是按下列方法
低点：
MULTSEL1 ： 0
00 = I
OH
是4× IREF
01 = I
OH
是5× IREF
10 = I
OH
是6× IREF
11 = I
OH
是7× IREF
参考时钟1 /电流倍增器选择1 ：
3.3V 14.318 MHz的时钟
输出。该引脚也用作电源接通背带选项来确定当前
乘法器，用于CPU的时钟输出。该MULTSEL1 ： 0的定义是按下列方法
低点：
MULTSEL1 ： 0
00 = IOH是4× IREF
01 = I
OH
是5× IREF
10 = I
OH
是6× IREF
11 = I
OH
是7× IREF
CPU时钟输出：
频率被设定在FS0 ： 4个输入或通过串行
输入接口。
内存参考时钟/ CPU输出控制：
这个引脚的功能
由模式输入引脚控制。当输入模式是在高采样
上电复位时，该引脚将被配置为3VMREF输出。当模式
在上电复位时，该引脚将被配置为输入采样为低电平
CPU_STP ＃的输入。
3VMREF是3.3V输出为CPU输出时钟频率的一半运行。
CPU_STP ＃是3.3V LVTTL兼容的输入禁用CPU0 ， CPU0 ＃ ，
CPU1和CPU1 ＃输出。
内存参考时钟/ PCI输出控制：
这个引脚的功能
由模式输入引脚控制。当输入模式是在高采样
上电复位时，该引脚将被配置为3VMREF ＃输出。当模式
在上电复位时，该引脚将被配置为输入采样为低电平
PCI_STP ＃的输入。
3VMREF ＃是3.3V输出运行在CPU输出频率的一半
时钟。 3VMREF ＃是180度异相的相对于3VMREF 。
PCI_STP ＃是3.3V LVTTL兼容的输入禁用PCI0 ： 6输出。
66 - MHz时钟输出：
3.3V固定的66 - MHz时钟。
自由运行PCI输出0 /频率选择2 ：
3.3V自由运行的PCI输出
放。该引脚也可作为电带选项来确定设备OP-
如在频率选择表中所述展业务的频率。
自由运行PCI输出1 /频率选择3 ：
3.3V自由运行的PCI输出
放。该引脚也可作为电带选项来确定设备OP-
如在频率选择表中所述展业务的频率。
X2
REF0/MULTSEL0
4
48
O
I / O
REF1/MULTSEL1
1
I / O
CPU0 ：1， CPU0 ： 1 ＃
3VMREF/CPU_STP
#
41, 38, 40, 37
45
O
I / O
3VMREF#/PCI_STP
#
44
I / O
3V66_0:3
PCI_F0/FS2
31, 30, 28, 27
6
O
I / O
PCI_F1/FS3
7
I / O
文件编号： 38-07002牧师* B
第23页2
初步
引脚德网络nitions
（续）
引脚名称
PCI_F2/Mode
PIN号
8
针
TYPE
I / O
引脚说明
CY28324
自由运行PCI输出2 /模式选择：
3.3V自由运行的PCI输出。
该引脚也用作电源接通背带选项来确定的功能
3VMREF / CPU_STP ＃和3VMREF ＃ / PCI_STP ＃ 。
当模式输入时采样到高电平上电复位，
3VMREF / CPU_STP ＃和3VMREF ＃ / PCI_STP ＃将被配置为
3VMREF和3VMREF ＃输出分别。
当模式输入时采样到低电平上电复位，
3VMREF / CPU_STP ＃和3VMREF ＃ / PCI_STP ＃将被配置为
CPU_STP ＃和PCI_STP ＃的输入，分别。
PCI输出0 /频率选择4 ：
PCI 3.3V输出。该引脚也可作为
如所述上电带选项来确定器件的工作频率
在频率选择表。
PCI时钟输出1至6 ：
3.3V PCI时钟输出。
48MHz的输出/频率选择0 ：
3.3V固定的48 MHz的非扩散光谱
特鲁姆输出。该引脚也用作电源接通背带选项确定
如上述设备的工作频率
表4 。
这个输出将被用作参考时钟用于在英特尔USB主机控制器
845 （代尔）平台。对于英特尔代尔 - 摹平台，该输出
用作VCH参考时钟。
24或48 MHz输出/频率选择1 ：
3.3V固定的24 MHz或48 MHz的
非扩频输出。该引脚也可作为电带选项
如上述，以确定设备的工作频率
表4 。
这个输出将被用作在英特尔845串口设备的基准时钟
（代尔）平台。为英特尔代尔 - 平台，这个输出是
用作参考时钟为USB主机控制器和SIO设备。我们
建议系统设计人员配置该输出为48 MHz和“ HIGH
驱动器“通过设定字节[5]，位[ 0]和字节[9] ，位[7]，分别。
掉电控制：
3.3V LVTTL兼容的输入，它使器件
掉电模式时保持低电平。
SMBus时钟输入：
时钟引脚用于串行接口。
SMBus数据输入：
数据引脚用于串行接口。
系统复位输出：
漏极开路系统复位输出。
PCI0/FS4
10
I / O
PCI1 ： 6
48MHz/FS0
11, 12, 14, 15,
16, 17
22
O
I / O
24_48MHz/FS1
23
I / O
PWR_DWN ＃
SCLK
SDATA
RST ＃
42
26
25
20
I
I
I / O
O
（开
漏）
I
I
IREF
VTT_PWRGD ＃
35
19
目前的参考CPU的输出：
精密电阻连接到该
销，其连接到所述内部参考电流。
电源良好电压的稳压器模块（ VRM ） ：
3.3V LVTTL输入。
VTT_PWRGD ＃是用于确定何时FS0电平敏感频闪：4，
MODE和MULTSEL0 ： 1输入是有效的，并确定进行采样（低电平有效） 。
一旦VTT_PWRGD ＃采样为低电平时，该输入的状态将被忽略。
3.3V电源连接：
电源为CPU输出缓冲器， 3V66输出
缓冲剂， PCI输出缓冲器中，参考输出缓冲器和48 -MHz的输出缓冲器。
连接到3.3V 。
VDD_REF ，
VDD _PCI ，
VDD_48MHz,
VDD_3V66,
VDD_CPU
VDD_MREF
2, 9, 18, 24,
32, 39, 46
P
文件编号： 38-07002牧师* B
第23页3
CY28324
FTG英特尔
奔腾
4 CPU和芯片组
特点
兼容英特尔
CK- 00 ，CK-泰坦& CK- 408的时钟
合成器/驱动器规格
系统频率合成器为Intel 850 ，代尔
（ 845 ）和代尔 - 奔腾G
4芯片组
可编程时钟输出频率小于1
MHz的增量
集成的故障安全看门狗定时器系统
恢复
自动切换到HW选择或SW
可编程时钟频率时，看门狗定时器
超时
能看门狗后，产生系统复位的
定时器超时后或输出频率的变化
通过SMBus接口
支持SMBus的字节读/写和块读/写
操作简化系统BIOS发展
厂商ID和版本ID的支持
可编程驱动强度的支持
可编程输出歪斜支持
电源管理控制输入
可提供48引脚SSOP
中央处理器
x2
3V66
x4
PCI
x 10
REF
x2
48M
x1
24_48M
x1
框图
X1
X2
引脚配置
VDD_REF
REF0 ： 1
XTAL
OSC
PLL 1
SSOP-48
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
48
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
32
31
30
29
28
27
26
25
REF0/MULTSEL0*
GND_REF
VDD_MREF
3VMREF/CPU_STP#*
3VMREF#/PCI_STP#*
GND_MREF
PWR_DWN ＃
CPU0
CPU0#
VDD_CPU
CPU1
CPU1#
GND_CPU
IREF
VDD_CORE
GND_CORE
VDD_3V66
3V66_0
3V66_1
GND_3V66
3V66_2
3V66_3
SCLK
SDATA
PLL的参考频率
分频器
网
停止
时钟
控制
* FS0 ： 4
VTT_PWRGD ＃
* CPU_STP ＃
* MULTSEL0 ： 1
PWR_DWN ＃
停止
时钟
控制
* PCI_STP ＃
*MULTSEL1/REF1
VDD_REF
X1
X2
GND_PCI
*FS2/PCI_F0
*FS3/PCI_F1
VDD_MREF
3VMREF ， 3VMREF ＃
*MODE/PCI_F2
VDD_PCI
VDD_3V66
*FS4/PCI0
3V66_0:3
PCI1
PCI2
GND_PCI
VDD_PCI
PCI3
PCI_F0 ： 2
PCI4
PCI0 ： 6
PCI5
PCI6
VDD_PCI
VTT_PWRGD ＃
RST ＃
GND_48MHz
*FS0/48MHz
*FS1/24_48MHz
VDD_48MHz
VDD_48MHz
VDD_CPU
CPU0 ：1， CPU0 ： 1 ＃
48MHz
~
CY28324
PLL2
24_48MHz
2
注意：
标有“*” 1.信号具有内部上拉电阻。
SDATA
SCLK
SMBUS
逻辑
RST ＃
Intel和Pentium是Intel Corporation的注册商标。
1.0版， 2006年11月20日
2200 LAURELWOOD路，圣克拉拉， CA 95054
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CY28324
引脚德网络nitions
引脚名称
X1
PIN号
3
针
TYPE
I
引脚说明
晶体连接或外部基准频率输入：
该引脚有
双重功能。它可以被用作一个外部14.318 MHz的晶体连接或
作为外部参考频率输入。
水晶连接：
连接外部14.318 MHz的晶振。如果使用
外部基准电压源，该引脚必须悬空。
参考时钟0 /电流倍增器选择0 ：
3.3V 14.318 MHz的时钟
输出。该引脚也用作电源接通背带选项来确定当前
乘法器，用于CPU的时钟输出。该MULTSEL1 ： 0定义为
如下所示：
MULTSEL1 ： 0
00 = I
OH
是4× IREF
01 = I
OH
是5× IREF
10 = I
OH
是6× IREF
11 = I
OH
是7× IREF
X2
REF0/MULTSEL0
4
48
O
I / O
REF1/MULTSEL1
1
I / O
参考时钟1 /电流倍增器选择1 ：
3.3V 14.318 MHz的时钟
输出。该引脚也用作电源接通背带选项来确定当前
乘法器，用于CPU的时钟输出。该MULTSEL1 ： 0定义为
如下所示：
MULTSEL1 ： 0
00 = IOH是4× IREF
01 = I
OH
是5× IREF
10 = I
OH
是6× IREF
11 = I
OH
是7× IREF
CPU时钟输出：
频率被设定在FS0 ： 4个输入或通过串行
输入接口。
内存参考时钟/ CPU输出控制：
这个引脚的功能
由模式输入引脚控制。当输入模式是在高采样
上电复位时，该引脚将被配置为3VMREF输出。当输入模式
在上电复位时被采样为低电平时，该引脚将被配置为
CPU_STP ＃的输入。
3VMREF是3.3V输出为CPU输出时钟频率的一半运行。
CPU_STP ＃是3.3V LVTTL兼容的输入禁用CPU0 ， CPU0 ＃ ，
CPU1和CPU1 ＃输出。
内存参考时钟/ PCI输出控制：
这个引脚的功能
由模式输入引脚控制。当输入模式是在高采样
上电复位时，该引脚将被配置为3VMREF ＃输出。当模式
在上电复位时，该引脚将被配置为输入采样为低电平
PCI_STP ＃的输入。
3VMREF ＃是3.3V输出运行在CPU输出频率的一半
时钟。 3VMREF ＃是180度异相的相对于3VMREF 。
PCI_STP ＃是3.3V LVTTL兼容的输入禁用PCI0 ： 6输出。
66 - MHz时钟输出：
3.3V固定的66 - MHz时钟。
自由运行PCI输出0 /频率选择2 ：
3.3V自由运行PCI
输出。该引脚也可作为电带选项来确定设备
如在频率选择表中描述的工作频率。
自由运行PCI输出1 /频率选择3 ：
3.3V自由运行PCI
输出。该引脚也可作为电带选项来确定设备
如在频率选择表中描述的工作频率。
自由运行PCI输出2 /模式选择：
3.3V自由运行的PCI输出。
该引脚也用作电源接通背带选项来确定的功能
3VMREF / CPU_STP ＃和3VMREF ＃ / PCI_STP ＃ 。
当模式输入时采样到高电平上电复位，
3VMREF / CPU_STP ＃和3VMREF ＃ / PCI_STP ＃将被配置为3VMREF
和3VMREF ＃输出分别。
当模式输入时采样到低电平上电复位，
3VMREF / CPU_STP ＃和3VMREF ＃ / PCI_STP ＃将被配置为
CPU_STP ＃和PCI_STP ＃的输入，分别。
CPU0 ：1， CPU0 ： 1 ＃
3VMREF/CPU_STP
#
41, 38, 40, 37
45
O
I / O
3VMREF#/PCI_STP
#
44
I / O
3V66_0:3
PCI_F0/FS2
31, 30, 28, 27
6
O
I / O
PCI_F1/FS3
7
I / O
PCI_F2/Mode
8
I / O
1.0版， 2006年11月20日
第21 2
CY28324
引脚德网络nitions
（续）
引脚名称
PCI0/FS4
PIN号
10
针
TYPE
I / O
引脚说明
PCI输出0 /频率选择4 ：
PCI 3.3V输出。该引脚也可作为
如所述上电带选项来确定器件的工作频率
在频率选择表。
PCI时钟输出1至6 ：
3.3V PCI时钟输出。
48MHz的输出/频率选择0 ：
3.3V固定的48 MHz的非扩展
光谱输出。该引脚也用作电源接通背带选项确定
如上述设备的工作频率
表4 。
这个输出将被用作参考时钟用于在英特尔USB主机控制器
845 （代尔）平台。对于英特尔代尔 - 摹平台，该输出
用作VCH参考时钟。
24或48 MHz输出/频率选择1 ：
3.3V固定的24 MHz或48 MHz的
非扩频输出。该引脚也可作为电带选项
如上述，以确定设备的工作频率
表4 。
这个输出将被用作在英特尔845串口设备的基准时钟
（代尔）平台。为英特尔代尔 - 平台，这个输出是
用作参考时钟为USB主机控制器和SIO设备。我们
建议系统设计人员配置该输出为48 MHz和“ HIGH
驱动器“通过设定字节[5]，位[ 0]和字节[9] ，位[7]，分别。
掉电控制：
3.3V LVTTL兼容的输入，它使器件
掉电模式时保持低电平。
SMBus时钟输入：
时钟引脚用于串行接口。
SMBus数据输入：
数据引脚用于串行接口。
系统复位输出：
漏极开路系统复位输出。
PCI1 ： 6
48MHz/FS0
11, 12, 14, 15,
16, 17
22
O
I / O
24_48MHz/FS1
23
I / O
PWR_DWN ＃
SCLK
SDATA
RST ＃
42
26
25
20
I
I
I / O
O
（开
漏）
I
I
IREF
VTT_PWRGD ＃
35
19
目前的参考CPU的输出：
精密电阻连接到该
销，其连接到所述内部参考电流。
电源良好电压的稳压器模块（ VRM ） ：
3.3V LVTTL输入。
VTT_PWRGD ＃是用于确定何时FS0电平敏感频闪：4，
MODE和MULTSEL0 ： 1输入是有效的，并确定进行采样（低电平有效） 。
一旦VTT_PWRGD ＃采样为低电平时，该输入的状态将被忽略。
3.3V电源连接：
电源为CPU输出缓冲器， 3V66输出
缓冲剂， PCI输出缓冲器中，参考输出缓冲器和48 -MHz的输出
缓冲区。连接到3.3V 。
VDD_REF ，
VDD _PCI ，
VDD_48MHz,
VDD_3V66,
VDD_CPU
VDD_MREF
GND_PCI ，
GND_48MHz,
GND_3V66,
GND_CPU ，
GND_MREF ，
GND_REF ，
VDD_CORE
GND_CORE
2, 9, 18, 24,
32, 39, 46
P
5, 13, 21, 29,
36, 43, 47
G
接地连接：
连接所有接地引脚到公共系统地
平面。
34
33
P
G
3.3V模拟电源连接：
电源的核心逻辑， PLL电路。
连接到3.3V 。
模拟地连接：
地面的核心逻辑， PLL电路。
1.0版， 2006年11月20日
第21 3
CY28324
串行数据接口
以提高的时钟合成器的灵活性和功能，
提供了一种双信号的串行接口。通过串口
数据接口，各种设备的功能，如个人
时钟输出缓冲液等，可以单独使能或
禁用。
与串行数据接口相关的寄存器
初始化为它们的默认设置上电时，并且因此
使用此接口是可选的。时钟器件的寄存器变化
在系统初始化时，通常制成，如果有的话是
所需。该接口也可制过程中使用的
操作的功率管理功能。
数据协议
时钟驱动器的串行协议接收字节写，读字节，
块写入和块读操作的控制器。为
块写入/读取操作，字节必须访问
按顺序从最低到最高字节（最显著
位在前）有能力停止后的任何完整的字节有
被转移。对于字节写和字节读取操作时，
系统控制器可以访问单个索引字节。该
被索引的字节的偏移被编码在命令代码，
如上述
表1中。
块写入和块读协议中概述
表2
而
表2
概述了相应的字节写和字节
读协议。
从机接收地址为11010010 （ D2H ） 。
表1.命令代码定义
位
7
6:0
0 =块读取或写入的块操作
1 =字节读取或字节写操作
字节偏移字节读取或字节写操作。块读或块写操作，这些
位应为' 0000000 ' 。
说明
表2块读取和块写入协议
块写入协议
位
1
2:8
9
10
11:18
19
20:27
28
29:36
37
38:45
46
...
...
...
...
开始
从地址 - 7位
写
感谢来自SLAVE
命令代码 - 8位
' 00000000 '代表块操作
感谢来自SLAVE
字节数 - 8位
感谢来自SLAVE
数据字节0 - 8位
感谢来自SLAVE
数据字节1 - 8位
感谢来自SLAVE
数据字节N /从机应答...
数据字节N - 8位
感谢来自SLAVE
停止
描述
位
1
2:8
9
10
11:18
19
20
21:27
28
29
30:37
38
39:46
47
48:55
56
...
...
...
...
开始
从地址 - 7位
写
感谢来自SLAVE
命令代码 - 8位
' 00000000 '代表块操作
感谢来自SLAVE
重复启动
从地址 - 7位
读
感谢来自SLAVE
从奴隶字节数 - 8位
应答
从机的数据字节 - 8位
应答
从机的数据字节 - 8位
应答
从机的数据字节/应答
从机的数据字节N - 8位
无应答
停止
块读协议
描述
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第21 5
QQ：2880707522 复制
