【初步CY24212MediaClock MPEG时钟发生器与VCXO特点集成的锁相环（ PLL ）低】,IC型号CY24212SXC-5T,CY24212SXC-5T PDF资料,CY24212SXC-5T经销商,ic,电子元器件-51电子网

初步

CY24212

MediaClock

MPEG时钟发生器与VCXO

特点

集成的锁相环（ PLL ）

低抖动，高精度输出

VCXO模拟调整

3.3V工作电压

产品型号

CY24212-1

CY24212-2

CY24212-3

CY24212-5

输出

输入频率范围

13.5兆赫/ 27兆赫（可选）

27兆赫

两个副本中的27兆赫

27兆赫/ 27.027兆赫（ -1 PPM ）

27兆赫/ 27.027兆赫（ 0 PPM ）

好处

最高性能的PLL专为多媒体应用

会见在复杂系统设计的关键时序要求

大± 150 ppm范围内，更好的线性度

使应用程序的兼容性

输出频率

逻辑框图

XIN

XOUT

产量

分频器

OSC

VCO

CLKA （ 27兆赫）

27兆赫（-2）

27 / 27.027兆赫（ -3 ）

VCXO

PLL

FSEL

VDD

VSS

销刀豆网络gurations

CY24212-1

8引脚SOIC

XIN

VDD

VCXO

VSS

XOUT

VSS

FSEL

CLKA 27兆赫

XIN

VDD

VCXO

VSS

CY24212-2

8引脚SOIC

XOUT

CLKB 27兆赫

FSEL

CLKA 27兆赫

XIN

VDD

VCXO

VSS

CY24212-3,-5

8引脚SOIC

XOUT

CLKB （ 27 / 27.027兆赫）

FSEL

CLKA 27兆赫

表1. CY24212 （ -1，-2 ）频率选择选项

FSEL

参考

13.5兆赫

27兆赫

CLKA / CLKB

27兆赫

表2. CY24212 （ -3 ， -5 ）频率选择选项

FSEL

参考

27兆赫

CLKA

27兆赫

CLKB

27兆赫

27.027兆赫

赛普拉斯半导体公司

文件编号： 38-07402牧师* C

3901北一街

圣荷西

CA 95134

408-943-2600

修订后的2005年4月6日

初步

引脚说明

名字

XIN

VDD

VCXO

VSS

CLKA

FSEL （-1 ，-2）

引脚数

描述

参考输入。

电源电压。

输入的模拟控制VCXO 。

地面上。

27 MHz的时钟输出。

输入频率选择，内部弱上拉了起来。

FSEL = 0 ， XIN = 13.5兆赫

FSEL = 1 ， XIN = 27 MHz的

输出频率选择，内部弱上拉了起来。

FSEL = 0 ， CLKA = 27 MHz时， CLKB = 27 MHz的

FSEL = 1 ， CLKA = 27 MHz时， CLKB = 27.027兆赫

地面上。

27兆赫。

27兆赫/ 27.027兆赫。

参考输出。

CY24212

FSEL （ -3 ， -5 ）

VSS （-1）的

CLKB （-2 ）

CLKB （ -3，-5 ）

XOUT

[1]

可牵引水晶规格

参数

负载

C0/C1

ESR

水晶精度

等效串联电阻

工作温度

水晶精度

随温度和老化稳定性

名字

晶体负载电容

分钟。

典型值。

240

± 20

± 50

°C

PPM

马克斯。

单位

绝对最大条件

参数

描述

电源电压

储存温度

[2]

结温

数字输入

静电放电

– 0.3

分钟。

–0.5

–65

马克斯。

7.0

125

+ 0.3

单位

°C

推荐工作条件

参数

负载

REF

描述

工作电压

环境温度

马克斯。负载电容

参考频率

13.5

分钟。

3.135

典型值。

3.3

马克斯。

3.465

单位

°C

兆赫

注意事项：

1.浮动XOUT XIN如果是外部驱动。

2.额定十年。

文件编号： 38-07402牧师* C

第2 6

初步

DC电气规格

参数

ΔXO

VCXO

名字

输出高电流

输出低电流

输入电容

输入高电流

输入低电平电流

VCXO Pullability范围

VCXO输入范围

电源电流

输入高电压

输入低电压

上拉电阻的输入

核心和输出电流之和

CMOS电平，V 70％

CMOS电平，V 30％

= 3.14到3.47V ，测得V

= 0V

100

0.7

= V

= 0V

–

±150

–

描述

= V

– 0.5, V

= 3.3V （源）

= 0.5, V

= 3.3V （汇）

民

典型值

CY24212

最大

单位

0.3

150

PPM

AC电气规格（V

= 3.3V)

参数

[3]

名字

输出占空比

上升沿率

下降沿率

时钟抖动

PLL锁定时间

描述

占空比被定义

图1中，

Ⅴ的50％的

输出时钟边沿速率，从20％实测

到80 ％的V

, C

负载

= 15 pF的。看

图2中。

输出时钟边沿速率， 80 ％的测量

到V 20％

, C

负载

= 15 pF的。看

图2中。

峰 - 峰值周期抖动

民

0.8

典型值

1.4

300

最大

单位

V / ns的

测试和测量设置

DDS

0.1

DUT

输出

负载

GND

注意：

3.未经100％测试。

文件编号： 38-07402牧师* C

第3页6

初步

电压和时序定义

Ⅴ的50％的

时钟

产量

CY24212

图1.占空比的定义

80 ％的V

时钟

产量

Ⅴ的20％的

图2. ER = （ 0.6× V

） / T3 ， EF = （ 0.6× V

) /t4

订购信息

订购代码

CY24212SC-1

CY24212SC-1T

CY24212SC-2

CY24212SC-2T

CY24212SC-3

CY24212SC-3T

CY24212SC-5

CY24212SC-5T

LEAD -FREE

CY24212SXC-5

CY24212SXC-5T

8引脚SOIC

8引脚SOIC -tape和卷轴

3.3V

包名称

套餐类型

8引脚SOIC

8引脚SOIC -tape和卷轴

8引脚SOIC

8引脚SOIC -tape和卷轴

8引脚SOIC

8引脚SOIC -tape和卷轴

8引脚SOIC

8引脚SOIC -tape和卷轴

工作范围

工作电压

3.3V

文件编号： 38-07402牧师* C

第4 6

初步

封装图纸和尺寸

8引脚（ 150 mil）的SOIC S8

8引脚（ 150 mil）的SOIC - S08

引脚1号

CY24212

1.尺寸以英寸[MM ] MIN 。

马克斯。

2. PIN 1 ID是可选的，

ROUND单引线框架

矩形矩阵引线框架

3.参考JEDEC MS- 012

0.230[5.842]

0.244[6.197]

0.150[3.810]

0.157[3.987]

4.包装重量0.07gms

产品编号

S08.15标准PKG 。

SZ08.15 LEAD FREE PKG 。

0.189[4.800]

0.196[4.978]

飞机座位

0.010[0.254]

0.016[0.406]

X 45°

0.061[1.549]

0.068[1.727]

0.004[0.102]

0.050[1.270]

BSC

0.004[0.102]

0.0098[0.249]

0°~8°

0.016[0.406]

0.035[0.889]

0.0075[0.190]

0.0098[0.249]

0.0138[0.350]

0.0192[0.487]

51-85066-*C

MediaClock是赛普拉斯半导体公司的商标。本文档中提及的所有产品和公司名称

可能是其各自所有者的商标。

文件编号： 38-07402牧师* C

分页： 5 6

赛普拉斯半导体公司，是2005年。本文所含信息如有更改，恕不另行通知。赛普拉斯半导体公司对使用任何责任

比电路体现在赛普拉斯产品以外的任何电路。它也没有传达或暗示根据专利或其他权利的任何许可。赛普拉斯产品不保证，也不打算成为

用于医疗，生命支持，救生，关键控制或安全应用程序，除非根据与赛普拉斯签订明确的书面协议。此外，赛普拉斯不授权将其

产品用作生命支持系统故障或故障可合理地预期会导致显著的伤害到用户的关键组成部分。赛普拉斯的

产品用于生命支持系统中，则表示制造商应承担因使用的所有风险，并赔偿赛普拉斯由此产生的一切费用。

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