CY2412
MPEG时钟发生器与VCXO
特点
集成的锁相环( PLL )
低抖动,高精度输出
VCXO模拟调整
3.3V工作电压
产品型号
CY2412
CY2412-2
输出
3
3
输入频率范围
好处
最高性能的PLL专为多媒体应用
会见在复杂系统设计的关键时序要求
大± 150 ppm范围内,更好的线性度
使应用程序的兼容性
输出频率
每两个27 MHz的输出13.5 MHz的可牵引晶振输入,一个54 MHz的输出( 3.3V )
赛普拉斯规格
每27 MHz的13.5 MHz的可牵引晶体输入, 13.5兆赫, 54兆赫( 3.3V )
赛普拉斯规格
逻辑框图
引脚配置
CY2412,-2
8引脚SOIC
XIN
VDD
VCXO
VSS
1
2
3
4
8
7
6
5
XOUT
CLKC
CLKB
CLKA
CLKC
13.5 XIN
OSC
XOUT
Q
Φ
VCO
P
产量
分频器
CLKB
CLKA
VCXO
PLL
VDD
VSS
赛普拉斯半导体公司
文件编号: 38-07227修订版**
3901北一街
圣荷西
CA 95134 408-943-2600
修订后的2002年3月13日
CY2412
t1
t2
CLK
50%
50%
图1.占空比的定义; DC = T2 / T1
t3
80%
t4
CLK
20%
图2.上升和下降时间定义
包图
8引脚( 150 mil)的SOIC S8
51-85066-A
所有产品和公司名称本文档中提及的可能是其各自所有者的商标。
文件编号: 38-07227修订版**
第4 5
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CY2412
文档标题: CY2412 MPEG时钟发生器与VCXO
文件编号: 38-07227
启示录
**
*A
ECN号
110492
112457
问题
日期
10/28/01
03/14/02
原稿。的
变化
SZV
CKN
变化的说明
变化从规格编号: 38-00898到38-07227
添加CY2412-2数据表
文件编号: 38-07227修订版**
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