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位置：首页 > IC型号导航 > 首字符C型号页 > 首字符C的型号第1289页 > CY23EP09ZXI-1HT
CY23EP09
2.5 V或3.3 V ， 10-220兆赫，低抖动，
9路输出零延迟缓冲器
特点
■
■
■
功能说明
该CY23EP09是2.5 V或3.3 V零延迟缓冲器设计
分配高速时钟，并采用16引脚SOIC或
TSSOP封装。该-1H版本可在高达220 （ 200 ） MHz的
频率为3.3伏（ 2.5伏），并具有较高的驱动比-1
设备。所有部件具有片上的PLL该锁定到输入时钟
REF引脚。的锁相环（PLL）的反馈是
片上，并从CLKOUT垫被获得。
有两个存储体的每四个输出端，它可以是
通过如图所示的“选择输入的选择输入端的控制
解码“第4页上的表。如果所有的输出时钟是不需要的，
BankB可三态的。选择输入还允许输入
时钟被直接施加到输出端为芯片和系统
测试目的。
PLL进入掉电模式时，有没有上涨
边缘上的REF输入（小于 2兆赫） 。在这种状态下，
输出三态并且PLL被关断，从而导致
小于25
A
的电流消耗。
在特殊情况下，当S2： S1为1：0 ， PLL被旁路和
REF为从DC输出到所允许的最大频率。该
部的行为就像在此模式中的非零延迟缓冲器，并且
输出不为三态的。
该CY23EP09是在不同的配置，如图所示
在订货信息表。该CY23EP09-1是基
的一部分。该CY23EP09-1H是-1的高驱动版本，
它的上升和下降时间比-1快得多。
这些部件不能用于5 V输入容错的应用
10 MHz至220 MHz的最高工作范围
零输入输出传输延迟，可调，装上
CLKOUT引脚
多个低抖动输出
- 45 ps的典型输出，输出偏斜
- 一个输入驱动器9输出，归纳为4 + 4 + 1
■
■
■
■
25 ps的典型周期到周期抖动
15 ps的典型周期抖动
标准和高驱动能力的选择
提供节省空间的16引脚150密耳小外形
集成电路（ SOIC ）或4.4毫米的超薄紧缩小型
封装（ TSSOP ）封装
3.3 V或2.5 V工作电压
提供工业级温度
■
■
框图
PLL
REF
MUX
CLKOUT
CLKA1
CLKA2
CLKA3
CLKA4
S2
选择输入
解码
S1
CLKB1
CLKB2
CLKB3
CLKB4
赛普拉斯半导体公司
文件编号： 38-07760牧师* C
198冠军苑
圣荷西
,
CA 95134-1709
408-943-2600
修订后的2011年6月1日
[+ ]反馈
CY23EP09
目录
引脚配置................................................ ............. 3
针脚定义................................................ .................... 4
选择输入解码............................................... 4 .......
零延迟和偏移控制.......................................... 4
绝对最大条件....................................... 5
工作条件................................................ 5 .......
3.3 V直流电气规格................................... 5
2.5 V直流电气规格................................... 6
3.3 V和2.5 V AC电气规格.................. 6
开关波形................................................ ...... 8
测试电路................................................ ...................... 8
补充参数信息............................ 9
订购代码定义........................................... 13
封装图纸和尺寸............................... 14
与缩略语................................................. ....................... 15
文档约定................................................ 15
计量单位............................................... ........ 15
文档历史记录页............................................... .. 16
销售，解决方案和法律信息...................... 17
全球销售和设计支持....................... 17
产品................................................. ................... 17
的PSoC解决方案................................................ ......... 17
文件编号： 38-07760牧师* C
第17页2
[+ ]反馈
CY23EP09
引脚配置
顶视图
REF
CLKA1
CLKA2
V
DD
GND
CLKB1
CLKB2
S2
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
CLKOUT
CLKA4
CLKA3
V
DD
GND
CLKB4
CLKB3
S1
文件编号： 38-07760牧师* C
第17页3
[+ ]反馈
CY23EP09
引脚德网络nition
针
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
REF
[1]
CLKA1
[2]
CLKA2
[2]
V
DD
GND
CLKB1
[2]
CLKB2
[2]
S2
[3]
S1
[3]
CLKB3
[2]
CLKB4
GND
V
DD
CLKA3
[2]
CLKA4
[2]
CLKOUT
[2]
[2]
信号
输入参考频率
缓冲时钟输出， A银行
缓冲时钟输出， A银行
3.3 V或2.5 V电源
地
缓冲时钟输出， B银行
缓冲时钟输出， B银行
选择输入， 2位
选择输入， 1位
缓冲时钟输出， B银行
缓冲时钟输出， B银行
地
3.3 V或2.5 V电源
缓冲时钟输出， A银行
缓冲时钟输出， A银行
描述
缓冲输出，在这个引脚内部反馈
选择输入解码
S2
0
0
1
1
S1
0
1
0
1
时钟A1A4
三态
驱动的
驱动的
驱动的
时钟B1B4
三态
三态
驱动的
驱动的
CLKOUT
[4]
驱动的
驱动的
驱动的
驱动的
输出源
PLL
PLL
参考
PLL
PLL关闭
N
N
Y
N
零延迟和偏移控制
所有输出应均匀加载，实现零延迟
在输入和输出之间。由于CLKOUT引脚是
内部反馈到PLL ，它的相对负载可调节
输入 - 输出延迟。
输出驱动CLKOUT引脚将被驱动的总负荷
5 pF的加任何额外的外部负载连接到该引脚。为
要求零输入 - 输出延迟，在总负荷的应用
每个输出引脚（包括CLKOUT）必须相同。如果
输入 - 输出延迟的调整是必需的， CLKOUT的负载
可以被改变，以改变REF输入之间的延迟和
剩下的输出。
对于零输出，输出偏斜时，一定要加载的所有输出一样。
欲了解更多信息，请参考应用笔记标题
“ CY2305和CY2309作为PCI和SDRAM缓冲区” 。
笔记
1.弱上拉了下来。
对所有输出2.弱上拉了下来。
在这些输入3.弱上拉。
4.该输出被驱动并具有用于PLL的内部反馈。在此输出上的负载可以被调节以改变基准和输出之间的偏移。
文件编号： 38-07760牧师* C
第17页4
[+ ]反馈
CY23EP09
绝对最大条件
电源电压为地电位.................- 0.5 V至4.6 V
直流输入电压..................................... V
SS
- 0.5 V至4.6 V
存储温度................................... -65℃ 150℃
结温................................................ .. 150℃
静电放电电压
（每MIL -STD -883方法3015 ............................. > 2000伏
民
3.0
2.3
0
–40
–
–
–
–
–
–
–
–
1–1.5
0.8
29
41
37
41
0.01
95
70
58
48
50
最大
3.6
2.7
70
85
30
30
22
22
15
15
15
5
单位
V
V
°C
°C
pF
pF
pF
pF
pF
pF
pF
pF
兆赫
兆赫
ms
° C / W
° C / W
° C / W
° C / W
工作条件
参数
V
DD3.3
V
DD2.5
T
A
C
L[5]
3.3 V电源电压
2.5 V电源电压
工作温度（环境温度） - 商用
工作温度（环境温度） - 工业
负载电容， <100兆赫， 3.3 V
负载电容， <100兆赫， 2.5 V高驱动器
负载电容， <133.3兆赫， 3.3 V
负载电容， <133.3兆赫， 2.5 V高驱动器
负载电容， <133.3兆赫， 2.5 V与标准驱动器
负载电容， >133.3兆赫， 3.3 V
负载电容， >133.3兆赫， 2.5 V高驱动器
C
IN
BW
R
OUT
输入电容
[6]
闭环带宽（典型值） ， 3.3 V
闭环带宽（典型值） ， 2.5 V
输出阻抗（典型值） ， 3.3 V高驱动器
输出阻抗（典型值） ， 3.3 V标准的驱动器
输出阻抗（典型值） ， 2.5 V高驱动器
输出阻抗（典型值） ， 2.5 V标准的驱动器
t
PU
的Theta JA
[7]
西塔JC
[7]
上电时所有VDD的达到指定的最低电压
（功率坡道必须是单调）
耗散，结到环境， 16引脚SOIC
耗散，结到环境，采用16引脚TSSOP
耗散，结到外壳， 16引脚SOIC
耗散，结到外壳，采用16引脚TSSOP
描述
3.3 V直流电气规格
参数
V
DD
V
IL
V
IH
I
IL
I
IH
V
OL
V
OH
I
DD
（ PD模式）
I
DD
描述
电源电压
输入低电压
输入高电压
输入漏电流
输入高电流
输出低电压
输出高电压
掉电电源电流
电源电流
0℃， V
IN
＆ LT ; V
IL
V
IN
= V
DD
I
OL
= 8毫安（标准驱动器）
I
OL
= 12 MA（高驱动器）
I
OH
= -8毫安（标准驱动器）
I
OH
= -12毫安（高驱动器）
REF = 0兆赫（商业）
REF = 0兆赫（工业）
空载输出， 66 - MHz的REF
笔记
5.适用于测试电路＃ 1 。
6.同时适用于参考时钟和CLKOUT内部反馈路径。
7.西塔JA， EIA JEDEC 51测试板条件， 2S2P ;西塔的Jc军规883E方法1012.1 。
测试条件
民
3.0
–
2.0
–
–
–
–
2.4
2.4
–
–
–
最大
3.6
0.8
V
DD
+0.3
±10
100
0.4
0.4
–
–
12
25
30
单位
V
V
V
A
A
V
V
V
V
A
A
mA
文件编号： 38-07760牧师* C
第17页5
[+ ]反馈
CY23EP09
2.5V或3.3V ， 10-220兆赫，低抖动， 9路输出
零延迟缓冲器
特点
最高10 MHz至220 MHz的工作范围
零输入输出传输延迟，可调
加载CLKOUT引脚
多低偏移输出
- 45 ps的典型输出，输出偏斜
- 一个输入驱动器9输出，归纳为4 + 4 + 1
25 ps的典型周期到周期抖动
15 ps的典型周期抖动
标准和高驱动能力的选择
提供节省空间的16引脚150密耳SOIC或
4.4毫米TSSOP封装
3.3V或2.5V操作
工业应用温度
功能说明
该CY23EP09是2.5V或3.3V的零延迟缓冲器设计
分配高速时钟，并且可以在一个16针
SOIC和TSSOP封装。该-1H版本可在高达220
（ 200 ） MHz的频率在3.3V （ 2.5V ） ，并具有更高的驱动
比-1的设备。所有部件都有片上锁相环的锁定到
REF引脚输入时钟。 PLL反馈是芯片和
从CLKOUT垫被获得。
有两个存储体的每四个输出端，它可以是
通过如图所示的“选择输入的选择输入端的控制
解码“第2页上的表。如果所有的输出时钟是不需要的，
BankB可三态的。选择输入还允许
输入时钟被直接施加到所述输出端对芯片和
系统测试目的。
PLL进入掉电模式时，有没有上涨
边缘上的REF输入（小于 2兆赫） 。在这种状态下，
输出三态并且PLL被关断，从而导致
小于25
A
的电流消耗。
在特殊情况下，当S2 ： S1为1 ： 0 ， PLL被旁路
和REF是从DC输出到所允许的最大
频率。的一部分的行为就像在此非零延迟缓冲器
模式，并在输出端没有三态的。
该CY23EP09是在不同的配置，如
在订货信息表中所示。该CY23EP09-1是
基部。该CY23EP09-1H是高驱版
的-1，它的上升和下降时间比-1快得多。
这些部件不能用于5V输入容限的应用
框图
PLL
REF
CLKOUT
CLKA1
CLKA2
CLKA3
CLKA4
CLKB1
选择输入
解码
S1
CLKB2
CLKB3
CLKB4
引脚配置
MUX
顶视图
REF
CLKA1
CLKA2
V
DD
GND
CLKB1
CLKB2
S2
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
CLKOUT
CLKA4
CLKA3
V
DD
GND
CLKB4
CLKB3
S1
S2
赛普拉斯半导体公司
文件编号： 38-07760牧师* B
198冠军苑
圣荷西
,
CA 95134-1709
408-943-2600
修订后的2005年10月5日
CY23EP09
引脚德网络nition
针
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
REF
[1]
CLKA1
V
DD
GND
CLKB1
[2]
CLKB2
[2]
S2
[3]
S1
[3]
CLKB3
GND
V
DD
CLKA3
[2]
CLKA4
[2]
CLKOUT
[2]
[2]
[2]
信号
输入参考频率
缓冲时钟输出， A银行
缓冲时钟输出， A银行
3.3V或2.5V电源
地
缓冲时钟输出， B银行
缓冲时钟输出， B银行
选择输入， 2位
选择输入， 1位
缓冲时钟输出， B银行
缓冲时钟输出， B银行
地
3.3V或2.5V电源
缓冲时钟输出， A银行
缓冲时钟输出， A银行
描述
CLKA2
[2]
CLKB4
[2]
缓冲输出，在这个引脚内部反馈
选择输入解码
S2
0
0
1
1
S1
0
1
0
1
时钟A1A4
三态
驱动的
驱动的
驱动的
时钟B1B4
三态
三态
驱动的
驱动的
CLKOUT
[4]
驱动的
驱动的
驱动的
驱动的
输出源
PLL
PLL
参考
PLL
PLL关闭
N
N
Y
N
零延迟和偏移控制
所有输出应均匀加载，实现零延迟
在输入和输出之间。由于CLKOUT引脚是
内部反馈到PLL ，它的相对负载可调节
输入 - 输出延迟。
输出驱动CLKOUT引脚将被驱动的负载总
一个5 pF加任何额外负载外部连接到本
引脚。对于需要零输入输出延时的应用，总
负载上的每个输出引脚（包括CLKOUT）必须是
同样的。如果需要的输入 - 输出延迟的调整，其
CLKOUT的负载可以被改变，以改变之间的延迟
REF输入和输出剩余。
对于零输出，输出偏斜时，一定要加载所有输出
同样。欲了解更多信息，请参考应用笔记
题为“ CY2305和CY2309作为PCI和SDRAM缓冲区” 。
注意事项：
1.弱上拉了下来。
对所有输出2.弱上拉了下来。
在这些输入3.弱上拉。
4.该输出被驱动并具有用于PLL的内部反馈。在此输出上的负载可以被调节以改变基准和输出之间的偏移。
文件编号： 38-07760牧师* B
分页： 13 2
CY23EP09
绝对最大条件
电源电压对地电位................. -0.5V至4.6V
直流输入电压...................................... V
SS
- 0.5V至4.6V
存储温度.................................... -65℃ 150℃
结温................................................ .. 150℃
静电放电电压
（每MIL -STD -883方法3015 .............................. > 2000V
分钟。
3.0
2.3
0
–40
–
–
–
–
–
–
–
–
1–1.5
0.8
29
41
37
41
0.01
95
70
58
48
50
马克斯。
3.6
2.7
70
85
30
30
22
22
15
15
15
5
单位
V
V
°C
°C
pF
pF
pF
pF
pF
pF
pF
pF
兆赫
兆赫
ms
° C / W
° C / W
° C / W
° C / W
工作条件
参数
V
DD3.3
V
DD2.5
T
A
C
L[5]
3.3V电源电压
2.5V电源电压
工作温度（环境温度） - 商用
工作温度（环境温度） - 工业
负载电容， <100兆赫， 3.3V
负载电容， <100兆赫， 2.5V与高驱动
负载电容， <133.3兆赫， 3.3V
负载电容， <133.3兆赫， 2.5V高驱动器
负载电容， <133.3兆赫， 2.5V与标准驱动器
负载电容， >133.3兆赫， 3.3V
负载电容， >133.3兆赫， 2.5V高驱动器
C
IN
BW
R
OUT
输入
电容
[6]
闭环带宽（典型值） ， 3.3V
闭环带宽（典型值） ， 2.5V
输出阻抗（典型值） ， 3.3V高驱动
输出阻抗（典型值） ， 3.3V标准的驱动器
输出阻抗（典型值） ， 2.5V高驱动
输出阻抗（典型值） ， 2.5V标准的驱动器
t
PU
的Theta JA
[7]
THETA
Jc
[7]
上电时所有VDD的达到指定的最低电压
（功率坡道必须是单调）
耗散，结到环境， 16引脚SOIC
耗散，结到环境，采用16引脚TSSOP
耗散，结到外壳， 16引脚SOIC
耗散，结到外壳，采用16引脚TSSOP
描述
3.3V DC电气规格
参数
V
DD
V
IL
V
IH
I
IL
I
IH
V
OL
V
OH
I
DD
（ PD模式）
I
DD
描述
电源电压
输入低电压
输入高电压
输入漏电流
输入高电流
输出低电压
输出高电压
0℃， V
IN
＆ LT ; V
IL
V
IN
= V
DD
I
OL
= 8毫安（标准驱动器）
I
OL
= 12 MA（高驱动器）
I
OH
= -8毫安（标准驱动器）
I
OH
= -12毫安（高驱动器）
REF = 0兆赫（工业）
电源电流
空载输出， 66 - MHz的REF
注意事项：
5.适用于测试电路＃ 1 。
6.同时适用于参考时钟和CLKOUT内部反馈路径。
7.西塔JA， EIA JEDEC 51测试板条件， 2S2P ;西塔的Jc军规883E方法1012.1 。
测试条件
分钟。
3.0
–
2.0
–
–
–
–
2.4
2.4
–
–
–
马克斯。
3.6
0.8
V
DD
+0.3
±10
100
0.4
0.4
–
–
12
25
30
单位
V
V
V
A
A
V
V
V
V
A
A
mA
掉电电源电流REF = 0兆赫（商业）
文件编号： 38-07760牧师* B
第13 3
CY23EP09
2.5V DC电气规格
参数
V
DD
V
IL
V
IH
I
IL
I
IH
V
OL
V
OH
I
DD
（ PD模式）
I
DD
描述
电源电压
输入低电压
输入高电压
输入漏电流
输入高电流
输出低电压
输出高电压
0<V
IN
＆ LT ; V
DD
V
IN
= V
DD
I
OL
= 8毫安（标准驱动器）
I
OL
= 12 MA（高驱动器）
I
OH
= -8毫安（标准驱动器）
I
OH
= -12毫安（高驱动器）
REF = 0兆赫（工业）
电源电流
空载输出， 66 - MHz的REF
测试条件
分钟。
2.3
–
1.7
–
–
–
–
V
DD
– 0.6
V
DD
– 0.6
–
–
–
马克斯。
2.7
0.7
V
DD
+ 0.3
10
100
0.5
0.5
–
–
12
25
45
单位
V
V
V
A
A
V
V
V
V
A
A
mA
掉电电源电流REF = 0兆赫（商业）
3.3V和2.5V AC电气规格
参数
1/t
1
描述
最大频率
[8]
（输入/输出）
3.3V高驱动
3.3V标准的驱动器
2.5V高驱动
2.5V标准的驱动器
T
IDC
t
2
÷
t
1
t
3,
t
4
输入占空比
输出占空比
周期
[9]
<133.3兆赫
>133.3兆赫
<133.3兆赫
>133.3兆赫
上升，下降时间（ 3.3V ）
[9]
标准的车程， CL = 30 pF的， <100兆赫
标准的车程， CL = 22 pF的， <133.3兆赫
标准的车程， CL = 15 pF的， <167兆赫
高驱动， CL = 30 pF的， <100兆赫
高驱动， CL = 22 pF的， <133.3兆赫
高驱动， CL = 15 pF的， >133.3兆赫
t
3,
t
4
上升，下降时间（ 2.5V ）
[9]
标准的车程， CL = 15 pF的， <133.33兆赫
高驱动， CL = 30 pF的， <100兆赫
高驱动， CL = 22 pF的， <133.3兆赫
高驱动， CL = 15 pF的， >133.3兆赫
t
5
输出到输出偏斜
[9]
测试条件
分钟。
10
10
10
10
25
40
47
45
–
–
–
–
–
–
–
–
–
–
–
–
1.5
–100
–200
–
–
典型值。
–
–
–
–
–
–
–
–
–
–
–
–
–
–
–
–
–
–
45
–
–
–
–
–
–
马克斯。
220
167
200
133
75
60
53
55
1.6
1.6
0.6
1.2
1.2
0.5
1.5
2.1
1.3
1.2
100
110
4.4
100
200
±150
±300
单位
兆赫
兆赫
兆赫
兆赫
%
%
%
%
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ps
ps
ns
ps
ps
ps
ps
所有输出同样装， 3.3V电源，
2.5电源标准的驱动器
所有输出同样装， 2.5V电源驱动高
t
6
延迟，楼盘上升沿PLL旁路模式
CLKOUT上升沿
[9]
使能PLL @ 3.3V
使能PLL @ 2.5V
一部分一部分
SKEW
[9]
测量V
DD
/2.
任何输出到任何输出， 3.3V电源
测量V
DD
/2.
任何输出到任何输出， 2.5V电源
t
7
注意事项：
8.对于给定的最大负载条件。请参阅C
L
在工作条件表。
9.参数是通过设计和特性保证。不是100 ％生产测试。
文件编号： 38-07760牧师* B
第13 4
CY23EP09
3.3V和2.5V AC电气规格
（续）
参数
t
LOCK
T
JCC[9,10]
描述
PLL锁定时间
[9]
测试条件
稳定的电源，有效的时钟上呈现
REF和CLKOUT引脚
3.3V电源， >66兆赫， <30 pF的，标准的驱动器
3.3V电源， >66兆赫， <30 PF，高驱动
2.5V电源， >66兆赫， <15 pF的，标准的驱动器
2.5V电源， >66兆赫， <15 PF，高驱动
2.5V电源， >66兆赫， <30 PF，高驱动
S2： S1 = 1：0模式，3.3V， <15pF ，标准驱动
S2： S1 = 1：0模式，3.3V， <15pF ，高驱动
S2： S1 = 1：0模式，2.5V， <15pF ，标准驱动
S2： S1 = 1：0模式，2.5V， <15pF ，高驱动
T
PER[9,10]
周期抖动，山顶
3.3V电源， 66-100兆赫， <15 pF的
3.3V电源， >100兆赫， <15 pF的
3.3V电源， >66兆赫， <30 pF的，标准的驱动器
3.3V电源， >66兆赫， <30 PF，高驱动
2.5V电源， >66兆赫， <15 pF的，标准的驱动器
2.5V电源， 66-100兆赫， <15 PF，高驱动
2.5V电源， >100兆赫， <15 PF，高驱动
S2： S1 = 1：0模式，3.3V， <15pF ，标准驱动
S2： S1 = 1：0模式，3.3V， <15pF ，高驱动
S2： S1 = 1：0模式，2.5V， <15pF ，标准驱动
S2： S1 = 1：0模式，2.5V， <15pF ，高驱动
分钟。
–
–
–
–
–
–
–
–
–
–
–
–
–
–
–
–
–
–
–
–
–
–
典型值。
–
25
65
53
35
30
75
16
14
23
22
20
15
40
30
25
25
15
28
24
40
37
马克斯。
1.0
55
125
100
95
65
145
–
–
–
–
75
45
100
70
60
60
45
–
–
–
–
单位
ms
ps
ps
ps
ps
ps
ps
ps
ps
ps
ps
ps
ps
ps
ps
ps
ps
ps
ps
ps
ps
ps
周期到周期的抖动，山顶3.3V电源， >66兆赫， <15 pF的
注意：
10.典型抖动的测量是在3.3V或2.5V ， 29 ° C，所有输出驱动到指定的最大负载。关于抖动规范的更多信息可
在应用笔记中找到“理解数据表抖动规范赛普拉斯时钟产品。 ”
开关波形
占空比时序
t
1
t
2
V
DD
/2
V
DD
/2
V
DD
/2
所有输出上升/下降时间
输出2.0V （ 1.8V ）
0.8V(0.6V)
t
3
2.0V(1.8V)
0.8V(0.6V)
t
4
3.3V(2.5V)
0V
文件编号： 38-07760牧师* B
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