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位置：首页 > IC型号导航 > 首字符C型号页 > 首字符C的型号第902页 > CY2309CSXC-1T
初步
CY2305C
CY2309C
3.3V零延迟时钟缓冲器
特点
■
■
■
■
■
■
■
■
10 MHz至100-133 MHz的工作范围内，与CPU的兼容
和PCI总线频率
零输入和输出的传播延迟
多个低输出偏斜
一个输入驱动五个输出（ CY2305C ）
一个输入驱动器9输出，归纳为4 + 4 + 1 （ CY2309C ）
50 ps的典型的循环周期抖动（ 15 PF， 66兆赫）
测试模式到旁路相位锁定回路（PLL ）（ CY2309C ）仅
SEE
“选择输入解码的CY2309C ”
第3页上
提供节省空间的16引脚1.5亿SOIC或4.4毫米
TSSOP封装（ CY2309C ） ，以及8引脚， 1.5亿SOIC
包（ CY2305C ）
3.3V操作
提供工业级温度
CY2309C 。它接受一个参考输入，驱动了5次低
歪斜的时钟。每个器件的-1H版本操作达
100-133 MHz的频率和有动力比越高-1
设备。所有部件具有片上PLL的哪个锁定到输入时钟
REF引脚。 PLL反馈是在芯片上，并获得
从CLKOUT垫。
该CY2309C有各自的四个输出两个银行
通过选择输入端的控制，如图中的
“选择输入
解码的CY2309C “
第3页上如果所有的输出时钟都没有
需要BankB处于三态。输入时钟是直接
由选择输入，用于芯片和系统应用到输出
测试目的。
该CY2305C和CY2309C的PLL进入掉电模式
当有对REF输入没有上升沿。在这种状态下，
的输出三态并且PLL被关断。这
结果在小于12.0
μA
电流消耗为商业的
温装置和25.0
μA
工业温度
件。该CY2309C PLL在一个额外的情况下关闭
在所示的
“选择输入解码的CY2309C ”
第3页。
在特殊情况下，当S2： S1为1：0 ， PLL被旁路和
REF为从DC输出到所允许的最大频率。该
部的行为就像在此模式中的非零延迟缓冲器和
输出没有三态。
该CY2305C或CY2309C有两个或三个不同的
构如图中
“订货信息”
on
第11页的CY2305C -1或CY2309C -1是基础部件。该
CY2305-1H或CY2309-1H是-1的高驱动版本。其
上升和下降时间比-1的速度要快得多。
■
■
功能说明
该CY2305C和CY2309C是模具更换部件
CY2305和CY2309 。
该CY2309C是设计成一种低成本3.3V零延迟缓冲器
分配高速时钟，并采用16引脚SOIC或
TSSOP封装。该CY2305C是的8引脚版本
逻辑框图CY2309C
PLL
REF
MUX
CLKOUT
CLKA1
CLKA2
CLKA3
CLKA4
CLKB1
选择输入
解码
S1
CLKB2
CLKB3
CLKB4
S2
赛普拉斯半导体公司
文件编号： 38-07672牧师* F
198冠军苑
圣荷西
,
CA 95134-1709
408-943-2600
修订后的2007年7月5日
[+ ]反馈
初步
CY2305C
CY2309C
逻辑框图CY2305C
REF
PLL
CLKOUT
CLK1
CLK2
CLK3
CLK4
文件编号： 38-07672牧师* F
第14页2
[+ ]反馈
初步
CY2305C
CY2309C
引脚配置
CY2309C
图1.引脚图 - 16引脚SOIC / TSSOP
SOIC / TSSOP
顶视图
REF
CLKA1
CLKA2
V
DD
GND
CLKB1
CLKB2
S2
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
CY2309C
CLKOUT
CLKA4
CLKA3
V
DD
GND
CLKB4
CLKB3
S1
表1.引脚定义 - 16引脚SOIC / TSSOP
针
信号
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
REF
[1]
CLKA1
[2]
CLKA2
[2]
V
DD
GND
CLKB1
[2]
CLKB2
[2]
S2
[3]
S1
[3]
CLKB3
[2]
CLKB4
[2]
GND
V
DD
CLKA3
[2]
CLKA4
[2]
CLKOUT
[2]
输入参考频率
缓冲时钟输出， A银行
缓冲时钟输出， A银行
3.3V电源
地
缓冲时钟输出， B银行
缓冲时钟输出， B银行
选择输入， 2位
选择输入， 1位
缓冲时钟输出， B银行
缓冲时钟输出， B银行
地
3.3V电源
缓冲时钟输出， A银行
缓冲时钟输出， A银行
描述
缓冲输出，在这个引脚内部反馈
表2.选择输入解码的CY2309C
S2
0
0
1
1
S1
0
1
0
1
时钟A1A4
三个国家
驱动的
驱动的
驱动的
时钟B1B4
三个国家
三个国家
驱动的
驱动的
CLKOUT
[4]
驱动的
驱动的
驱动的
驱动的
输出源
PLL
PLL
参考
PLL
PLL关闭
N
N
Y
N
笔记
1.弱上拉了下来。
2.弱上拉下来的所有输出。
3.弱上拉跌宕这些输入。
4.该输出被驱动并具有用于PLL的内部反馈。在此输出的负载调节来改变参考和输出之间的偏移。
文件编号： 38-07672牧师* F
第14页3
[+ ]反馈
初步
CY2305C
CY2309C
CY2305C
图2.引脚图 - 8引脚SOIC
SOIC
顶视图
REF
CLK2
CLK1
GND
1
2
3
4
CY2305C
8
7
6
5
CLKOUT
CLK4
V
DD
CLK3
表3.引脚说明 - 8引脚SOIC
针
1
2
3
4
5
6
7
8
REF
[1]
CLK2
[2]
CLK1
[2]
GND
CLK3
[2]
V
DD
CLK4
[2]
信号
输入参考频率
缓冲时钟输出
缓冲时钟输出
地
缓冲时钟输出
3.3V电源
缓冲时钟输出
描述
CLKOUT
[2]
缓冲时钟输出，在这个引脚内部反馈
零延迟和偏移控制
所有输出应均匀加载，实现零延迟的输入和输出之间。由于CLKOUT引脚是内部
反馈到PLL ，它的相对负载可以调整输入或输出延迟。
对于需要零输入或输出延迟的应用程序，所有的输出包括CLKOUT同样加载。即使不使用CLKOUT ，
它必须有一个容性负载等于在其它输出用于获得零输入或输出延迟。
对于零输出或输出歪斜，所有的输出同样加载。欲了解更多信息，请参考应用笔记题为“ CY2305
和CY2309作为PCI和SDRAM缓冲区“ 。
文件编号： 38-07672牧师* F
第14页4
[+ ]反馈
初步
CY2305C
CY2309C
绝对最大条件
电源电压对地电位................- 0.5V至+ 4.6V
直流输入电压（ REF除外） ............ -0.5V到V
DD
+ 0.5V
直流输入电压REF ........................... -0.5V到V
DD
+ 0.5V
存储温度................................. -65 ° C至+ 150°C
结温................................................ 。 150℃
静电放电电压
（每MIL -STD -883方法3015 ） ........................... > 2,000V
工作条件CY2305CSXC -XX和CY2309CSXC -XX
操作条件表CY2305CSXC -XX和CY2309CSXC -XX商用温度的设备。
参数
V
DD
T
A
C
L
C
L
C
IN
t
PU
电源电压
工作温度（环境温度）
负载电容，低于100 MHz的
负载电容，从100 MHz到133 MHz的
输入电容
上电时所有V
DD
s到达到指定的最低电压
（功率坡道是单调）
0.05
描述
民
3.0
0
最大
3.6
70
30
10
7
50
单位
V
°C
pF
pF
pF
ms
电气特性CY2305CSXC -XX和CY2309CSXC -XX
电气特性表CY2305CSXC -XX和CY2309CSXC -XX商用温度的设备。
参数
V
IL
V
IH
I
IL
I
IH
V
OL
V
OH
I
DD
（ PD模式）
I
DD
描述
输入低电压
[5]
输入高电压
[5]
输入低电平电流
输入高电流
输出低
电压
[6]
V
IN
= 0V
V
IN
= V
DD
I
OL
= 8 MA（ -1 ）
I
OH =
12毫安（ -1H ）
I
OH
= -8毫安（ -1 ）
I
OL
= -12毫安（ -1H ）
REF = 0兆赫
在66.67 MHz的空载输出，
SEL输入在V
DD
测试条件
民
–0.3
2.0
–
–
–
2.4
–
–
最大
0.8
V
DD
+ 0.3
50
100
0.4
–
12.0
32
单位
V
V
μA
μA
V
V
μA
mA
输出高电压
[6]
掉电电源电流
电源电流
笔记
5. .REF输入为V的阈值电压
DD
/2.
6.参数是通过设计和特性保证。不是100 ％生产测试。
文件编号： 38-07672牧师* F
第14页5
[+ ]反馈
CY2305C
CY2309C
3.3 V零延迟时钟缓冲器
特点
■
■
■
■
■
■
■
■
10 MHz至100-133兆赫的工作范围
零输入和输出的传播延迟
多个低输出偏斜
一个输入驱动五个输出（ CY2305C ）
一个输入驱动器9输出，归纳为4 + 4 + 1 （ CY2309C ）
50 ps的典型周期到周期抖动（ 15 PF， 66兆赫）
测试模式到旁路相位锁定回路（PLL ）（ CY2309C ）仅
SEE
选择输入解码的CY2309C第5页
提供节省空间的16引脚150军用小外形
集成电路（ SOIC ）涨幅4.4毫米的超薄紧缩小型
封装（ TSSOP ）封装（ CY2309C ） ，以及8引脚， 1.5亿
SOIC封装（ CY2305C ）
3.3 V工作电压
商用，工业和汽车-A提供流动
100-133 MHz的频率和有动力比越高-1
设备。所有部件都片上锁相环（ PLL）的哪
锁定到REF引脚的输入时钟。该PLL反馈
片上，并从CLKOUT垫被获得。
该CY2309C有各自的四个输出两个银行
通过选择输入端的控制，如图中的
选择输入
解码的CY2309C第5页。
如果所有的输出时钟都没有
要求B银行处于三态。输入时钟是直接
由选择输入，用于芯片和系统应用到输出
测试目的。
该CY2305C和CY2309C的PLL进入掉电模式
当有对REF输入没有上升沿。在这种状态下，
的输出三态并且PLL被关断。这
结果在小于12.0
A
电流消耗为商业的
温装置和25.0
A
用于工业和汽车-A
温度部分。该CY2309C PLL在一个关闭
如图所示，附加的情况下
选择输入的解码
CY2309C第5页。
在特殊情况下，当S2： S1为1：0 ， PLL被旁路和
REF为从DC输出到所允许的最大频率。该
部表现为在该模式下非零延迟缓冲器和
输出没有三态。
该CY2305C或CY2309C有两个或三个不同的
构如图中
订购第11页上的信息。
该CY2305C -1或CY2309C -1是基础部件。该CY2305-1H
或CY2309-1H是-1的高驱动版本。它的兴衰
倍比-1快得多。
■
■
功能说明
该CY2305C和CY2309C是模具更换部件
CY2305和CY2309 。
该CY2309C是一种低成本的3.3伏的零延迟缓冲器设计为
分配高速时钟，并采用16引脚SOIC或
TSSOP封装。该CY2305C是的8引脚版本
CY2309C 。它接受一个参考输入，驱动了5次低
歪斜的时钟。每个器件的-1H版本操作达
逻辑框图CY2305C
REF
PLL
CLKOUT
CLK1
CLK2
CLK3
CLK4
赛普拉斯半导体公司
文件编号： 38-07672牧师* K
198冠军苑
圣荷西
,
CA 95134-1709
408-943-2600
修订后的2011年2月3日
[+ ]反馈
CY2305C
CY2309C
逻辑框图CY2309C
PLL
REF
MUX
CLKOUT
CLKA1
CLKA2
CLKA3
CLKA4
S2
选择输入
解码
S1
CLKB1
CLKB2
CLKB3
CLKB4
文件编号： 38-07672牧师* K
第17页2
[+ ]反馈
CY2305C
CY2309C
目录
引脚分配................................................. ............................. 4
零延迟和偏移控制.......................................... 5
绝对最大条件....................................... 6
工作条件CY2305CSXC -XX和
CY2309CSXC -XX ............................................... ................ 6
工作条件CY2305CSXI -XX ，
CY2305CSXA -XX和CY2309CSXI - XX ........................... 6
电气特性CY2305CSXC -XX和
CY2309CSXC -XX ............................................... ................ 6
开关特性的CY2305CSXC -XX和
CY2309CSXC -XX ............................................... ................ 7
开关特性的CY2305CSXI -XX ，
CY2305CSXA -XX和CY2309CSXI -XX ........................... 8
开关特性表CY2305CSXI - 1H ，
CY2305CSXA - 1H和CY2309CSXI - 1H ........................... 9
开关波形................................................ ...... 9
测试电路................................................ .................... 10
订购信息................................................ ...... 11
订购代码定义........................................... 12
封装图纸和尺寸............................... 13
与缩略语................................................. ....................... 15
文档约定................................................ 15
计量单位............................................... ........ 15
文档历史记录页............................................... .. 16
销售，解决方案和法律信息...................... 17
全球销售和设计支持....................... 17
产品................................................. ................... 17
的PSoC解决方案................................................ ......... 17
文件编号： 38-07672牧师* K
第17页3
[+ ]反馈
CY2305C
CY2309C
引脚配置
CY2305C
图1.引脚图 - 8引脚SOIC （顶视图）
REF
CLK2
CLK1
GND
1
2
3
4
CY2305C
8
7
6
5
CLKOUT
CLK4
V
DD
CLK3
表1.引脚说明 - 8引脚SOIC
针
1
2
3
4
5
6
7
8
REF
[1]
CLK2
[2]
CLK1
[2]
GND
CLK3
[2]
V
DD
CLK4
[2]
CLKOUT
[2]
信号
输入参考频率
缓冲时钟输出
缓冲时钟输出
地
缓冲时钟输出
3.3 V电源
缓冲时钟输出
描述
缓冲时钟输出，在这个引脚内部反馈
CY2309C
图2.引脚图 - 16引脚SOIC / TSSOP （顶视图）
REF
CLKA1
CLKA2
V
DD
GND
CLKB1
CLKB2
S2
1
2
3
4
5
6
7
8
16
CY2309C
15
14
13
12
11
10
9
CLKOUT
CLKA4
CLKA3
V
DD
GND
CLKB4
CLKB3
S1
表2.引脚定义 - 16引脚SOIC / TSSOP
针
1
2
3
4
5
6
7
8
REF
[1]
CLKA1
[2]
CLKA2
[2]
V
DD
GND
CLKB1
[2]
CLKB2
[2]
S2
[3]
信号
输入参考频率
缓冲时钟输出， A银行
缓冲时钟输出， A银行
3.3 V电源
地
缓冲时钟输出， B银行
缓冲时钟输出， B银行
选择输入， 2位
描述
笔记
1.弱上拉了下来。
2.弱上拉下来的所有输出。
在这些输入3.弱上拉跌宕
文件编号： 38-07672牧师* K
第17页4
[+ ]反馈
CY2305C
CY2309C
表2.引脚定义 - 16引脚SOIC / TSSOP
（续）
针
9
10
11
12
13
14
15
16
S1
[4]
CLKB3
[5]
CLKB4
[5]
GND
V
DD
CLKA3
[5]
CLKA4
[5]
信号
选择输入， 1位
缓冲时钟输出， B银行
缓冲时钟输出， B银行
地
3.3 V电源
缓冲时钟输出， A银行
缓冲时钟输出， A银行
描述
CLKOUT
[5]
缓冲输出，在这个引脚内部反馈
表3.选择输入解码的CY2309C
S2
0
0
1
1
S1
0
1
0
1
时钟A1A4
三个国家
驱动的
驱动的
驱动的
时钟B1B4
三个国家
三个国家
驱动的
驱动的
CLKOUT
[6]
驱动的
驱动的
驱动的
驱动的
输出源
PLL
PLL
参考
PLL
PLL关闭
N
N
Y
N
零延迟和偏移控制
所有输出必须均匀加载，实现零延迟
在输入和输出之间。由于CLKOUT引脚是
内部反馈到PLL ，它的相对负载可调节
输入或输出延迟。
对于需要零输入或输出延迟，所有输出的应用
包括CLKOUT也同样装载。即使CLKOUT不
用过的，它必须有一个容性负载等于在其他
输出用于获得零输入或输出延迟。
对于零输出到输出偏斜，所有输出必须加载
同样。
笔记
4.弱上拉跌宕这些输入。
5.弱上拉下来的所有输出。
6.这个输出被驱动并具有用于PLL的内部反馈。在此输出的负载调节来改变参考和输出之间的偏移。
文件编号： 38-07672牧师* K
第17页5
[+ ]反馈
CY2305C
CY2309C
3.3V零延迟时钟缓冲器
特点
■
■
■
■
■
■
■
■
10 MHz至100-133兆赫的工作范围
零输入和输出的传播延迟
多个低输出偏斜
一个输入驱动五个输出（ CY2305C ）
一个输入驱动器9输出，归纳为4 + 4 + 1 （ CY2309C ）
50 ps的典型的循环周期抖动（ 15 PF， 66兆赫）
测试模式到旁路相位锁定回路（PLL ）（ CY2309C ）仅
SEE
“选择输入解码的CY2309C ”
第3页上
提供节省空间的16引脚1.5亿SOIC或4.4毫米
TSSOP封装（ CY2309C ） ，以及8引脚， 1.5亿SOIC
包（ CY2305C ）
3.3V操作
商用，工业和汽车-A提供流动
歪斜的时钟。每个器件的-1H版本操作达
100-133 MHz的频率和有动力比越高-1
设备。所有部件具有片上PLL的哪个锁定到输入时钟
REF引脚。 PLL反馈是在芯片上，并获得
从CLKOUT垫。
该CY2309C有各自的四个输出两个银行
通过选择输入端的控制，如图中的
“选择输入
解码的CY2309C “
第3页上如果所有的输出时钟都没有
需要BankB处于三态。输入时钟是直接
由选择输入，用于芯片和系统应用到输出
测试目的。
该CY2305C和CY2309C的PLL进入掉电模式
当有对REF输入没有上升沿。在这种状态下，
的输出三态并且PLL被关断。这
结果在小于12.0
μA
电流消耗为商业的
温装置和25.0
μA
用于工业和汽车-A
温度部分。该CY2309C PLL在一个关闭
如图所示，附加的情况下
“选择输入的解码
CY2309C”
第3页。
在特殊情况下，当S2： S1为1：0 ， PLL被旁路和
REF为从DC输出到所允许的最大频率。该
部表现为在该模式下非零延迟缓冲器和
输出没有三态。
该CY2305C或CY2309C有两个或三个不同的
构如图中
“订货信息”
第9页。
该CY2305C -1或CY2309C -1是基础部件。该CY2305-1H
或CY2309-1H是-1的高驱动版本。它的兴衰
倍比-1快得多。
■
■
功能说明
该CY2305C和CY2309C是模具更换部件
CY2305和CY2309 。
该CY2309C是设计成一种低成本3.3V零延迟缓冲器
分配高速时钟，并采用16引脚SOIC或
TSSOP封装。该CY2305C是的8引脚版本
CY2309C 。它接受一个参考输入，驱动了5次低
逻辑框图CY2305C
REF
PLL
CLKOUT
CLK1
CLK2
CLK3
CLK4
赛普拉斯半导体公司
文件编号： 38-07672牧师* H
198冠军苑
圣荷西
,
CA 95134-1709
408-943-2600
修订后的2008年8月27日
[+ ]反馈
CY2305C
CY2309C
逻辑框图CY2309C
PLL
REF
MUX
CLKOUT
CLKA1
CLKA2
CLKA3
CLKA4
S2
选择输入
解码
S1
CLKB1
CLKB2
CLKB3
CLKB4
引脚配置
CY2305C
图1.引脚图 - 8引脚SOIC
顶视图
REF
CLK2
CLK1
GND
1
2
3
4
CY2305C
8
7
6
5
CLKOUT
CLK4
V
DD
CLK3
表1.引脚说明 - 8引脚SOIC
针
1
2
3
4
5
6
7
8
REF
[1]
CLK2
[2]
CLK1
[2]
GND
CLK3
[2]
V
DD
CLK4
[2]
CLKOUT
[2]
信号
输入参考频率
缓冲时钟输出
缓冲时钟输出
地
缓冲时钟输出
3.3V电源
缓冲时钟输出
缓冲时钟输出，在这个引脚内部反馈
描述
笔记
1.弱上拉了下来。
2.弱上拉下来的所有输出。
文件编号： 38-07672牧师* H
第12页2
[+ ]反馈
CY2305C
CY2309C
CY2309C
图2.引脚图 - 16引脚SOIC / TSSOP
顶视图
REF
CLKA1
CLKA2
V
DD
GND
CLKB1
CLKB2
S2
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
CY2309C
CLKOUT
CLKA4
CLKA3
V
DD
GND
CLKB4
CLKB3
S1
表2.引脚定义 - 16引脚SOIC / TSSOP
针
信号
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
REF
[1]
CLKA1
[2]
CLKA2
[2]
V
DD
GND
CLKB1
[2]
CLKB2
[2]
S2
[3]
S1
[3]
CLKB3
[2]
CLKB4
[2]
GND
V
DD
CLKA3
[2]
CLKA4
[2]
CLKOUT
[2]
输入参考频率
缓冲时钟输出， A银行
缓冲时钟输出， A银行
3.3V电源
地
缓冲时钟输出， B银行
缓冲时钟输出， B银行
选择输入， 2位
选择输入， 1位
缓冲时钟输出， B银行
缓冲时钟输出， B银行
地
3.3V电源
缓冲时钟输出， A银行
缓冲时钟输出， A银行
描述
缓冲输出，在这个引脚内部反馈
表3.选择输入解码的CY2309C
S2
0
0
1
1
S1
0
1
0
1
时钟A1A4
三个国家
驱动的
驱动的
驱动的
时钟B1B4
三个国家
三个国家
驱动的
驱动的
CLKOUT
[4]
驱动的
驱动的
驱动的
驱动的
输出源
PLL
PLL
参考
PLL
PLL关闭
N
N
Y
N
零延迟和偏移控制
所有的输出必须被均匀地加载，实现零延迟的输入和输出之间。由于CLKOUT引脚是内部
反馈到PLL ，它的相对负载可以调整输入或输出延迟。
对于需要零输入或输出延迟的应用程序，所有的输出包括CLKOUT同样加载。即使不使用CLKOUT ，
它必须有一个容性负载等于在其它输出用于获得零输入或输出延迟。
对于零输出或输出歪斜，所有的输出同样加载。欲了解更多信息，请参考应用笔记题为“ CY2305
和CY2309作为PCI和SDRAM缓冲区“ 。
笔记
3.弱上拉跌宕这些输入。
4.该输出被驱动并具有用于PLL的内部反馈。在此输出的负载调节来改变参考和输出之间的偏移。
文件编号： 38-07672牧师* H
第12页3
[+ ]反馈
CY2305C
CY2309C
绝对最大条件
电源电压对地电位................- 0.5V至+ 4.6V
直流输入电压（ REF除外） ............ -0.5V到V
DD
+ 0.5V
直流输入电压REF ........................... -0.5V到V
DD
+ 0.5V
存储温度................................. -65 ° C至+ 150°C
结温................................................ 。 150℃
静电放电电压
（每MIL -STD -883方法3015 ） ........................... > 2,000V
工作条件CY2305CSXC -XX和CY2309CSXC -XX
操作条件表CY2305CSXC -XX和CY2309CSXC -XX商用温度的设备。
参数
V
DD
T
A
C
L
C
L
C
IN
t
PU
电源电压
工作温度（环境温度）
负载电容，低于100 MHz的
负载电容，从100 MHz到133 MHz的
输入电容
上电时所有V
DD
s到达到指定的最低电压
（功率坡道是单调）
0.05
描述
民
3.0
0
最大
3.6
70
30
10
7
50
单位
V
°C
pF
pF
pF
ms
工作条件CY2305CSXI -XX ， CY2305CSXA -XX和CY2309CSXI -XX
操作条件表CY2305CSXI -XX ， CY2305CSXA -XX和CY2309CSXI -XX工业/汽车-A温
设备。
参数
V
DD
T
A
C
L
C
L
C
IN
t
PU
电源电压
工作温度（环境温度）
负载电容，低于100 MHz的
负载电容，从100 MHz到133 MHz的
输入电容
上电时所有V
DD
s到达到指定的最低电压
（功率坡道是单调）
描述
民
3.0
–40
–
–
–
0.05
最大
3.6
85
30
10
7
50
单位
V
°C
pF
pF
pF
ms
电气特性CY2305CSXC -XX和CY2309CSXC -XX
电气特性表CY2305CSXC -XX和CY2309CSXC -XX商用温度的设备。
参数
V
IL
V
IH
I
IL
I
IH
V
OL
V
OH
I
DD
（ PD模式）
I
DD
描述
输入低电压
[5]
输入高电压
[5]
输入低电平电流
输入高电流
输出低电压
[6]
输出高电压
[6]
掉电电源电流
电源电流
V
IN
= 0V
V
IN
= V
DD
I
OL
= 8 MA（ -1 ）
I
OH =
12毫安（ -1H ）
I
OH
= -8毫安（ -1 ）
I
OL
= -12毫安（ -1H ）
REF = 0兆赫
在66.67 MHz的空载输出，
SEL输入在V
DD
测试条件
民
–0.3
2.0
–
–
–
2.4
–
–
最大
0.8
V
DD
+ 0.3
50
100
0.4
–
12
32
单位
V
V
μA
μA
V
V
μA
mA
笔记
5. .REF输入为V的阈值电压
DD
/2.
6.参数是通过设计和特性保证。不是100 ％生产测试。
文件编号： 38-07672牧师* H
第12页4
[+ ]反馈
CY2305C
CY2309C
电气特性CY2305CSXI -XX ， CY2305CSXA -XX和CY2309CSXI -XX
电气特性表CY2305CSXI -XX ， CY2305CSXA -XX和CY2309CSXI -XX工业/汽车-A温
设备。
参数
V
IL
V
IH
I
IL
I
IH
V
OL
V
OH
描述
输入低电压
[5]
输入高电压
[5]
输入低电平电流
输入高电流
输出低
电压
[6]
V
IN
= 0V
V
IN
= V
DD
I
OL
= 8 MA（ -1 ）
I
OH
= 12 MA（ -1H ）
I
OH
= -8毫安（ -1 ）
I
OL
= -12毫安（ -1H ）
REF = 0兆赫
在66.67 MHz的空载输出，
SEL输入在V
DD
测试条件
民
–0.3
2.0
–
–
–
2.4
–
–
最大
0.8
V
DD
+ 0.3
50
100
0.4
–
25
35
单位
V
V
μA
μA
V
V
μA
mA
输出高电压
[6]
I
DD
（ PD模式）掉电电源电流
I
DD
电源电流
开关特性的CY2305CSXC -XX和CY2309CSXC -XX
开关特性表CY2305CSXC -1和CY2309CSXC - 1商用温度的设备。所有的参数都
与负载输出指定。
参数
名字
测试条件
民
典型值
最大
单位
t
1
t
DC
t
3
t
4
t
5
t
6A
t
6B
t
7
t
J
t
LOCK
输出频率
30 pF负载
10 pF负载
测量1.4V ，女
OUT
≤
50兆赫
上升时间
[6]
下降时间
[6]
输出到输出偏斜
[6]
测量0.8V和2.0V之间
测量0.8V和2.0V之间
所有输出同样装
10
10
40
45
–
–
–
–
1
–
–
–
–
50
50
–
–
–
0
5
0
50
–
100
133.33
60
55
2.25
2.25
200
±350
8.7
700
175
1.0
兆赫
兆赫
%
%
ns
ns
ps
ps
ns
ps
ps
ms
输出占空比
[6]
= t
2
÷
t
1
测量1.4V ，女
OUT
> 50兆赫
延迟，楼盘上升沿测量V
DD
/2
CLKOUT上升沿
[6]
延迟，楼盘上升沿测量V
DD
/ 2 。测量PLL
CLKOUT上升沿
[6]
旁路模式， CY2309C设备只。
设备到设备斜
[6]
测量V
DD
/ 2上的CLKOUT引脚
器件
稳定的电源，有效的时钟
呈现在REF引脚
循环周期抖动，峰值
[6]
测得66.67兆赫，输出装
PLL锁定时间
[6]
开关特性表CY2305CSXC - 1H和CY2309CSXC - 1H商用温度的设备。所有的参数都
与负载输出指定。
参数
t
1
t
DC
t
3
t
4
t
5
名字
输出频率
30 pF负载
10 pF负载
测量1.4V ，女
OUT
≤
50兆赫
上升时间
[6]
下降时间
[6]
输出到输出偏斜
[6]
测量0.8V和2.0V之间
测量0.8V和2.0V之间
所有输出同样装
描述
民
10
10
40
45
–
–
–
典型值
–
50
50
–
–
–
最大
100
133.33
60
55
1.5
1.5
200
单位
兆赫
兆赫
%
%
ns
ns
ps
输出占空比
[6]
= t
2
÷
t
1
测量1.4V ，女
OUT
> 50兆赫
文件编号： 38-07672牧师* H
第12页5
[+ ]反馈
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