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位置：首页 > IC型号导航 > 首字符C型号页 > 首字符C的型号第700页 > CXL1518N
CXL1517N/1518N
CMOS ， CCD信号处理器
描述
该CXL1517N / 1518N是CMOS ， CCD信号
处理器开发的CCD相机互补
滤色器阵列处理系统。
CXL1517N
452.5-bit
×
2 ， 453.5位1H CCD延迟线
CXL1518N
300.5-bit
×
2 ， 301.5位1H CCD延迟线
特点
单5V电源
低功耗（典型值）。
CXL1517N
120mW
CXL1518N
75mW
内置外围电路
内置的CDS（相关双采样）电路
功能
时钟驱动器
Autobias电路（中心和黑色）的
基座钳位电路
CDS电路
溢出防止电路
绝对最大额定值
（ TA = 25°C ）
电源电压
V
DD
6
工作温度
TOPR
-10至+65
储存温度
TSTG
-55到+150
允许功耗
P
D
350
推荐工作电压范围
（ TA = 25°C ）
电源电压
V
DD
4.6 5.25
24引脚SSOP （塑胶）
结构
CMOS ， CCD
V
°C
°C
毫瓦（ SSOP封装）
V
项
时钟电压低
时钟电压高
时钟
频率
CXL1517N
CXL1518N
符号
V
L
V
H
f
CL
f
CL
分钟。
V
SS
0.7
×
V
DD
典型值。
马克斯。
0.3
×
V
DD
V
DD
单位
V
V
兆赫
兆赫
备注
7.16
4.77
NTSC ： 455f
H
CCIR ： 454f
H
NTSC ： 910F
H
/3
CCIR ： 908F
H
/3
索尼保留更改产品规格，恕不另行通知。本资料概不转让任何许可
任何专利或其他权利的任何暗示或其他方式。示出了应用电路，如果有的话，是示出典型的实施例
该装置的操作。索尼公司不承担因使用这些电路中的任何问题负责。
–1–
E91778A78-PS
CXL1517N/1518N
框图和引脚配置
（ TOP VIEW ）
XDL1
XDL2
V
DD
V
DD
V
DD
V
SS
19
18
5
V
SS
8
20
1
V
SS
16
2
17
时序产生器
ABBL 4
A.B.
黑
A.B.
中心
司机
预充电
漏
PG 。 GEN 。
IN-A 23
电
（N位）
DL
A
PG 。 GEN 。
IN- B 3
电
（N位）
DL
B
PG 。 GEN 。
IN- C 6
电
第（n + 1位）
DL
C
CDS输出
电路
9 -C
CDS输出
电路
11 OUT -B
CDS输出
电路
14 OUT -A
ABCN 21
电脉冲
将军
溢流
预防
电路
22
潜力
控制
CDS
7
10
15
ABOVF
V
SS
1
V
SS
2
IN- B 3
ABBL 4
V
DD
5
IN- C 6
中电7
V
DD
8
OUT -C 9
V
GG
10
OUT -B 11
NC 12
24 NC
23 IN-A
22 ABOVF
21 ABCN
20 V
DD
19 XDL1
18 XDL2
17 V
SS
16 V
SS
15 CDS
14 OUT -A
13 NC
–2–
CDS
电
V
GG
V
SS
CXL1517N/1518N
引脚说明
PIN号
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
符号
V
SS
V
SS
IN -B
ABBL
V
DD
IN -C
电
V
DD
OUT -C
V
GG
OUT -B
NC
NC
OUT -A
CDS
V
SS
V
SS
XDL2
XDL1
V
DD
ABCN
ABOVF
IN-A
NC
I / O
—
—
I
O
—
I
I
—
O
O
O
—
—
O
O
—
—
I
I
—
O
O
I
—
GND
信号输入B通道（ Y）
对于Y信号Autobias直流输出
电源
信号输入C通道（ Y）
钳位脉冲输入
电源
信号输出C通道
输出电路的直流偏置输出
信号输出B通道
—
—
信号输出的通道
对于CDS直流输出
GND
GND
时钟脉冲输入2
时钟脉冲输入1
电源
对于C信号Autobias直流输出
溢出防止电路Autobias直流输出
信号输入的通道（C ）
—
中心水平偏差
在无钳
＆ GT ;
100k
输出电路
定时
＆ GT ;
100k
＆ GT ;
100k
定时
黑电平偏移
类似物
黑电平偏移
在无钳
＆ GT ;
100k
＆ GT ;
100k
输出电路
类似物
描述
评论
–3–
电气特性
TA = 25C ，V
DD
= 5.0V, V
SS
= 0V
SW条件
评级
条件
分钟。典型值。马克斯。
4.2
3.9
2.6
1.2
0.3
V
1
—
—
V
6
20日志
f
CL
= 7.16MHz （ CXL1517N ）
f
CL
= 4.77MHz （ CXL1518N ）
BIAS
条件
E1
4.6
4.3
3.0
2.3
0.8
24
15
–4.5 –3.5
项
SW4
SW1 SW2 SW3
6
a
a
a
a
a
b
a
a
a
a
a
a
a
a
a
b
a
a
b
a
a
b
a
a
TEST
符号
点
V
1
V
2
V
3
V
4
V
5
A
1
4.8
4.5
3.3
3.5
3.0
35
25
—
—
—
0
5
12
单位
Autobias中心级别
ABCN
V
V
V
V
V
mA
Autobias黑电平
ABBL
溢出防止电路
Autobias水平
ABOVF
CDS源级别
CDS
输出电路的偏置电平
V
GG
当前
供应
b
b
a
A
→
V
1
B，C
→
V
2
+ 0.25V
↓
20日志
CXL1517N
I
DD
CXL1518N
输出幅度（ MVP -P ）
输入幅度（SIN 100kHz时， 100mVp -P ）
–4–
V
6
b
a
b
↑
↓
c
b
b
a
注1 ）
V
6
a
to
c
a
to
c
a
to
c
注2 ）
注3 ）
V
6
b
b
a
to
c
a
↑
↓
b
A
→
V
1
B，C
→
V
2
+ 0.25V
注4 ）
插入增益
IG
dB
频率
响应
CXL1517N
f
G
CXL1518N
输出幅度（SIN 1MHz时， 100mVp -P ）
–1.5 –0.4
输出幅度（SIN 100kHz时， 100mVp -P ）
–1.8 –0.8
dB
线性
林。
%
插入增益差
G
通道之间
0
0
5
1
12
5
%
%
线性度差
通道之间
BCH
L
BC
→
CCH
CRT通道之间的串扰
0
1
3
%
CXL1517N/1518N
标准值是CXL1517N和CXL1518N之间不同。
CXL1517N/1518N
注意事项）
1 ）线性度测试
第一0.2V ，然后将其设置为ABCN和ABCN + 0.2V - 对于一个通道，设置输入偏置ABCN 。然后输入
正弦波100kHz和100mVp -的p，并比较这三个输出振幅。对于B通道和C
通道，设置输入偏置ABBL + 0.45V第一，然后将其设置为ABBL + 0.25V和ABBL + 0.05V 。然后
输入正弦波100kHz和100mVp -的p，并比较这三个输出振幅。最大
输出振幅为各自的A，B和C信道被取为Sout的最大和最小输出
幅度为Sout的分。各信道的线性度被定义为：
林。 = Sout的最大值 - Sout的分
×
200 [%]
SOUT MAX + Sout的分
插入增益差2 ）计算
作为间A中的最大插入增益，B和C信道被取为Gmax的和最小的GMIN ，
信道之间的插入增益差
G
如：
G
=
|
1 – 10
–
(
Gmax20 GMIN
)
| ×
100 [%]
线性度差的3）的计算
定义B通道的线性度为L
B
和C通道linearily为L
C
我们得到的差
L
BC
如：
L
BC
=
|
L
B
– L
C
|
[%]
4 ）串扰计算
CRTA
：一个信道的串扰值，当B和C的信道被输入
：通道的输出值当通道的输入
OUT
A
-
a
SW3 -一个， SW4 -一个， SW5 ， 6 -B的
OUT
A
-
bc
：通道的输出值时， B和C通道输入
（串扰分量）
SW3 -一个， SW4 -b中SW5 ，6-一
CRTA =
OUT
A
-
bc
OUT
A
-
a
×
100 [%]
时钟时序波形
(140)
210ns
(52.5)
87.5ns
10ns
10ns
90%
XDL1
50%
10%
90%
50%
10%
17.5ns
10ns
(52.5)
87.5ns
10ns
90%
XDL2
50%
10%
90%
50%
10%
–5–
括号内的数值是CXL1517N 。
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推荐型号
C451PC1
CD74HCT93F
CCL300DC1-TTD2
C0603C104C1UAC
CPL-WB-02D3
CD74HC11H
CAT93C66P-1.8
CG0402MLA-26ME
C512G102C1G5CA
CTDLP2012F-700
CCL225DL1-ACP1
CAT93C46VI-TE13
CLS-TC11A12250Y
CXOH-4FD-25.000
CA1bS-12V-N-5
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    CXL1518N
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