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CXA1982Q
射频信号处理伺服放大器的CD播放器
对于这款产品的供货情况,请联系销售办事处。
描述
该CXA1982Q是双极集成电路具有内置的射频
信号处理和各种伺服集成电路。一个CD
伺服玩家可以通过使用本IC , DSP配置
和驱动程序。
特点
低工作电压(V
CC
– V
EE
= 2.8 4.0V )
低功耗( 36MW ,V
CC
= 3.0V)
支持两种电流输出,电压皮卡
产量
支持追踪系统平衡调节
EXTERNALLY
单电源供电,正/负双
电源
应用
RF I- V放大器,射频放大器
聚焦和跟踪误差放大器
APC电路
镜检测电路
缺陷检测和预防电路
聚焦伺服控制
跟踪伺服控制
雪橇伺服控制
结构
双极硅单片IC
绝对最大额定值
( TA = 25°C )
12
电源电压
V
CC
工作温度Topr
-20至+75
储存温度
TSTG
-65到+150
833
允许功耗
P
D
48引脚QFP (塑料)
V
°C
°C
mW
推荐运行条件
工作电源电压
V
CC
– V
EE
2.8 4.0
V
索尼保留更改产品规格,恕不另行通知。本资料概不转让任何许可
任何专利或其他权利的任何暗示或其他方式。示出了应用电路,如果有的话,是示出典型的实施例
该装置的操作。索尼公司不承担因使用这些电路中的任何问题负责。
–1–
E97215-PS
CXA1982Q
框图
PHD1
RF_M
PHD2
RF_O
RF_I
36
35
34
33
32
31
30
29
28
27
CC1
PD
LD
CP
26
25
APC
S级
我IL
24 SENS
CB
CC2
TTL
23 C.OUT
RF IV AMP1
MIRR
DFCT
TTL
RF IV AMP2
FE_BIAS 37
TTL
我IL数据寄存器输入移位寄存器
ADRESS.DECODER
20 XLT
22 XRST
21 DATA
我IL
F 38
FE AMP
F四AMP
我IL
输出解码器
19 CLK
E 39
四AMP
EI 40
TE AMP
FZC COMP
FS1 4
TG1 2
TM1 7
PS1到4
18 VCC
追踪
相位补偿
V
EE
41
TEO 42
TG1
TM5
TM4
TZC COMP
NC 43
TEI 44
ATSC 45
TZC 46
TDFCT 47
DFCT
VC 48
FS4
窗口COMP 。
ATSC
FS2
DFCT
TM1
FCS相位补偿
FS1
TM7
TM3
TM6
我SET
17 ISET
16 SL_O
15 SL_M
TM2
14 SL_P
13 TA_O
1
2
3
4
5
6
7
8
9
10
11
F置
TG2
12
FEO
FDFCT
TG2
FEI
FLB
FE_M
FSET
FGD
SRCH
以方框图的开关状态是初始复位。
开关转向°侧1和
在串行数据真值表方0 。
DFCT开关转向°侧时,缺陷信号产生的缺陷= E串行数据真值表。
TG1开关转向°侧, TG2开关处于打开状态时, TG1和TG2 (地址1 : D3 )为1 。
–2–
TA_M
FE_O
TGU
CXA1982Q
引脚说明
符号
I / O
等效电路
描述
25p
147
1
174k
51k
300
10k
9k
1
FEO
O
聚焦误差放大器的输出。
内部连接到FZC
比较器的输入。
2
FEI
I
2
147
100k
147
聚焦错误输入。
3
FDFCT
I
3
电容器连接端子的缺陷
时间常数。
68k
147
4
FGD
I
4
130k
20
通过电容接地此引脚
当减小聚焦伺服
高频增益。
5
FLB
I
40k
5
外部时间常数设定引脚
为了提高聚焦伺服的低
频率。
6
FE_O
O
6
对焦驱动输出。
13
TA_O
O
13
16
跟踪驱动器输出。
16
SL_O
O
250
雪橇驱动输出。
147
90k
7
FE_M
I
7
50k
重点放大器反相输入。
–3–
CXA1982Q
符号
I / O
等效电路
描述
147
8
SRCH
I
8
50k
11
外部时间常数设置引脚
产生聚焦伺服波形。
110k
9
TGU
I
20k
9
82k
外部时间常数设置引脚
切换跟踪高频
获得。
10
TG2
I
10
470k
2
外部时间常数设置引脚
切换跟踪高频
获得。
147k
11
FSET
I
11
15k
15k
高截止频率设置引脚
聚焦和跟踪相位
补偿放大器。
100k
12
TA_M
I
147
12
11
追踪放大器反相输入。
14
SL_P
I
147
14
雪橇放大器非反相输入端。
147
15
SL_M
I
15
22
雪橇放大器反相输入。
–4–
CXA1982Q
符号
I / O
等效电路
描述
147
17
ISET
I
17
设置引脚聚焦搜索,追踪
跳,踢雪橇电流。
19
20
21
22
CLK
XLT
数据
XRST
I
15
从串行数据传输时钟输入
中央处理器。 (无上拉电阻)
从CPU锁存输入。
(无上拉电阻)
从CPU的串行数据输入。
(无上拉电阻)
复位输入;复位时低。
(无上拉电阻)
I
I
I
19
20
21
22
147
1k
23
C.出
O
20k
147
23
24
磁道数计数信号输出。
24
SENS
O
100k
输出FZC , DFCT , TZC ,增益,
根据平衡,及其它
从CPU中的命令。
20k
25
O
147
25
40k
集中行比较器输出。
100k
26
CC2
I
147
28
147
27
输入的缺损底端保持
与输出电容耦合。
27
CC1
O
缺陷下保持输出。
147
26
28
CB
I
连接端子底部缺陷
保持电容。
–5–
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