集成
电路
系统公司
ICS98ULPA877A
超前信息
1.8V低功耗宽范围频率时钟驱动器
推荐应用：
DDR2内存模块/零延迟板扇出
提供完整的DDR2 DIMM逻辑解决方案
产品介绍/产品特点：
低偏移，低抖动PLL时钟驱动器
1至10差分时钟分配（ SSTL_18 ）
反馈引脚输入到输出的同步
扩频宽容投入
自动PD当输入信号是指在一定的逻辑状态
开关特性：
周期抖动： 40ps的（ DDR2-400 / 533 ）
30PS （ DDR2-667 / 800 ）
半周期抖动： 60ps的（ DDR2-400 / 533 ）
50ps的（ DDR2-667 / 800 ）
输出 - 输出偏斜： 40ps的（ DDR2-400 / 533 ）
30PS （ DDR2-667 / 800 ）
周期 - 周期抖动40ps的
引脚配置
1
A
B
C
D
E
F
G
H
J
K
2
3
4
5
6
52球BGA
顶视图
A
B
C
D
E
F
G
H
J
K
1
CLKT1
CLKC1
CLKC2
CLKT2
CLK_INT
CLK_INC
AGND
AVDD
CLKT3
CLKC3
2
CLKT0
GND
GND
VDDQ
VDDQ
VDDQ
VDDQ
GND
GND
CLKC4
CLKC1
CLKC0
CLKT1
框图
LD或OE
OE
OS
AV
DD
(1)
3
CLKC0
GND
NB
VDDQ
NB
NB
VDDQ
NB
GND
CLKT4
CLKC5
CLKT0
V
DDQ
4
CLKC5
GND
NB
VDDQ
NB
NB
VDDQ
NB
GND
CLKT9
CLKT5
CLKC6
CLKT6
5
CLKT5
GND
GND
OS
VDDQ
OE
VDDQ
GND
GND
CLKC9
V
DDQ
6
CLKT6
CLKC6
CLKC7
CLKT7
FB_INT
FB_INC
FB_OUTC
FB_OUTT
CLKT8
CLKC8
动力
下
和
LD ，操作系统，或OE
TEST
模式
PLL旁路
逻辑
LD
CLKT0
39
32
35
34
37
40
CLKT1
CLKC1
CLKT2
CLKC2
CLKT3
CLKC3
CLKT4
CLKC4
38
36
33
31
CLKC0
V
DDQ
CLKC2
CLKT2
CLK_INT
CLK_INC
V
DDQ
AGND
AV
DD
V
DDQ
GND
1
2
3
4
5
6
7
8
9
10
16
17
13
11
12
15
18
14
19
20
30
29
28
27
26
25
24
23
22
21
CLKC7
CLKT7
V
DDQ
FB_INT
FB_INC
FBOUTC
FBOUTT
V
DDQ
OE
OS
CLK_INT
CLK_INC
10KΩ - 100KΩ
FBIN_INT
FBIN_INC
PLL
CLKT5
CLKC5
CLKT6
CLKC6
CLKT7
CLKC7
CLKT8
V
DDQ
CLKT3
CLKT4
CLKC3
CLKC4
CLKT9
CLKC9
注意：
1.逻辑检测（ LD ）对设备断电。
当逻辑LOW同时适用于CLK_INT和
CLK_INC 。
FBOUTT
FBOUTC
40引脚MLF
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超前信息
文档包含在产品中形成或设计阶段的开发信息。特征数据和其他规格的设计目标。
ICS保留随时更改或恕不另行通知停止这些产品的权利。第三方的品牌和名称均为其各自所有者的财产。
CLKC9
CLKC8
CLKT9
CLKT8
V
DDQ
CLKC8
ICS98ULPA877A
超前信息
引脚说明
TE R M I N A L
名字
AGND
AV
DD
CLK_INT
CLK_INC
FB_INT
FB_INC
FB_OUTT
FB_OUTC
OE
OS
GND
V
DDQ
CLKT [0： 9]
CLKC [0： 9]
NB
模拟地
A N A L 克对流动é
C罗CK inputwitha （ 1 0的K - 1 0 0 KO HM ） pulldownresistor
Complentar Y时钟输入，一个（ 10K - 100K欧姆）下拉电阻
反馈时钟输入
互补反馈时钟输入
反馈时钟输出
互补反馈时钟输出
输出使能（异步）
输出选择（连接到GND或V
DDQ
)
地
逻辑和输出功率
时钟输出
互补的时钟输出
无装球
描述
电动
特征
地
1.8 V额定
差分输入
差分输入
差分输入
差分输入
迪FF erential输出
迪FF erential输出
LVCMOS输入
LVCMOS输入
地
1.8V标称
差分输出
差分输出
PLL时钟缓冲器，
ICS98ULPA877A,
被设计用于为V
DDQ
1.8 V，一个AV
DD
1.8 V和差分数据输入，
输出电平。封装选择包括塑料52球VFBGA和40引脚MLF 。
ICS98ULPA877A
是分配的差分时钟输入对（ CLK_INT ， CLK_INC ）十一个零延迟缓冲器
差分对时钟输出（ CLKT [0 ： 9 ] ， CLKC [ 0 ： 9 ] ）和一个差分对反馈时钟输出（ FB_OUTT ，
FBOUTC ） 。时钟输出由输入时钟（ CLK_INT ， CLK_INC ） ，反馈时钟进行控制（ FB_INT ，
FB_INC ）时， LVCMOS方案引脚（ OE ， OS ）和模拟电源输入（ AVDD ） 。当OE为低电平时，输出端（除
FB_OUTT / FB_OUTC ）被禁用，同时内部PLL继续保持其锁定的频率。 OS （输出
选择）是一个程序引脚必须连接到GND或V
DDQ
。当OS为高时，参考将功能如上所述。当
OS低， OE对CLKT7 / CLKC7没有影响（它们除了FB_OUTT / FB_OUTC自由运行） 。当AV
DD
接地， PLL被关闭，旁路用于测试目的。
当两个时钟信号（ CLK_INT ， CLK_INC ）为逻辑低电平时，器件将进入低功耗模式。输入逻辑
在差分输入检测电路中，独立于输入缓冲器，将检测到逻辑低电平，并执行
低功率状态下，所有的输出，反馈和PLL被关闭。当从两者都是逻辑输入过渡
低到为差分信号时，PLL将被重新打开时，输入和输出将被启用和PLL
将得到的反馈时钟对（ FB_INT ， FB_INC ）与输入时钟对之间相位锁定（ CLK_INT ， CLK_INC ）
在规定的稳定时间t
刺
.
锁相环中
ICS98ULPA877A
时钟驱动器使用的输入时钟（ CLK_INT ， CLK_INC ）和反馈时钟（ FB_INT ，
FB_INC ），以提供高性能，低偏移，低抖动输出差分时钟（ CLKT [0 ： 9 ] ， CLKC [ 0 ： 9 ] ） 。
ICS98ULPA877A
还能够跟踪扩频时钟（ SSC ） ，从而降低EMI 。
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ICS98ULPA877A
超前信息
ICS98ULPA877A
在商用温度范围（ 0 ° C至70 ° C）和工业级温度范围（ -40°C可用
至+ 85 ℃）。详情请参阅订购信息
功能表
输入
AVDD
GND
GND
GND
GND
1.8V(nom)
1.8V(nom)
1.8V(nom)
1.8V(nom)
1.8V(nom)
1.8V(nom)
OE
H
H
L
L
L
L
H
H
X
X
OS
X
X
H
L
H
L
X
X
X
X
CLK_INT
L
H
L
H
L
H
L
H
L
H
CLK_INC
H
L
H
L
H
L
H
L
L
H
CLKT
L
H
* L （ Z）
* L （ Z）
CLKT7
活跃
* L （ Z）
* L （ Z）
CLKT7
活跃
L
H
* L （ Z）
CLKC
H
L
* L （ Z）
* L （ Z）
CLKC7
活跃
* L （ Z）
* L （ Z）
CLKC7
活跃
H
L
* L （ Z）
输出
PLL
FB_OUTT
L
H
L
H
L
H
FB_OUTC
H
L
H
L
旁路/关
旁路/关
旁路/关
旁路/关
H
L
On
On
L
H
* L （ Z）
RESER VED
H
L
* L （ Z）
On
On
关闭
* L （ Z）是指输出被禁止，以较低的陈述会议上我
ODL
极限。
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3
ICS98ULPA877A
超前信息
绝对最大额定值
电源电压（ VDDQ & AVDD ） 。 。 。 。 。 。 。 。 。
逻辑输入。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
工作环境温度。 。 。 。 。 。 。 。 。 。
储存温度。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
-0.5V至2.5V
GND - 0.5V至V
DDQ
+ 0.5V
-40 ° C至+ 85°C
-65 ° C至+ 150°C
超出上述上市
绝对最大额定值
可能对器件造成永久性损坏。这些
额定值仅应力的规格和装置的这些功能操作或上述任何其他情况
在规范的业务部门所列出的是不是暗示。暴露在绝对最大额定值条件
长时间可能会影响产品的可靠性。
电气特性 - 输入/电源/通用输出参数
商业： TA = 0 °C - 70 °C，工业： TA = -40°C - + 85°C ;
电源电压AVDDQ ， VDDQ = 1.8 V +/- 0.1V （除非另有说明）
符号
民
参数
条件
输入高电流
I
IH
V
I
= V
DDQ
或GND
（ CLK_INT ， CLK_INC ）
输入低电平电流（ OE ，
I
IL
V
I
= V
DDQ
或GND
操作系统， FB_INT ， FB_INC ）
禁止输出低
I
ODL
OE = L，V
ODL
= 100mV的
100
当前
C
L
= 0pF @ 410MHz
I
DD1.8
工作电源
当前
C
L
= 0pF
I
DDLD
V
IK
V
DDQ
= 1.7V Iin的= -18mA
输入钳位电压
V
DDQ
- 0.2
I
OH
= -100
μA
V
OH
高电平输出电压
I
OH
= -9毫安
1.1
I
OL
=100
μA
V
OL
低电平输出电压
I
OL
= 9毫安
1
V
I
= GND或V
DDQ
C
IN
2
输入电容
1
C
OUT
2
V
OUT
= GND或V
DDQ
输出电容
1
典型值
最大
±250
±10
单位
A
A
A
300
500
-1.2
1.45
0.25
0.10
0.6
3
3
mA
A
V
V
V
V
V
pF
pF
通过设计保证，而不是100 ％生产测试。
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ICS98ULPA877A
超前信息
推荐运行条件
（见注1）
商业： TA = 0 °C - 70 °C，工业： TA = -40°C - + 85°C ;
电源电压AVDDQ ， VDDQ = 1.8 V +/- 0.1V （除非另有说明）
参数
符号
条件
民
典型值
最大
单位
电源电压
V
DDQ
, A
VDD
1.7
1.8
1.9
V
CLK_INT ， CLK_INC ， FB_INC ，
0.35 x垂直
DDQ
V
FB_INT
低电平输入电压
V
IL
OE ， OS
0.35 x垂直
DDQ
V
CLK_INT ， CLK_INC ， FB_INC ，
0.65 * V
DDQ
V
FB_INT
高电平输入电压
V
IH
OE ， OS
0.65 * V
DDQ
V
直流输入信号电压
V
IN
-0.3
V
DDQ
+ 0.3
V
（注2 ）
DC - CLK_INT ， CLK_INC ，
0.3
V
DDQ
+ 0.4
V
差分输入信号
FB_INC ， FB_INT
V
ID
电压（注3）
AC - CLK_INT ， CLK_INC ，
V
0.6
V
DDQ
+ 0.4
FB_INC ， FB_INT
输出差分交叉
V
OX
V
DDQ
/2 - 0.10
V
DDQ
/2 + 0.10
V
电压（注4 ）
输入差分交叉
V
DDQ
/2 - 0.15 V
DD
/2 V
DDQ
2 + 0.15
V
V
IX
电压（注4 ）
高电平输出电流
I
OH
-9
mA
9
mA
低电平输出电流
I
OL
工作自由空气
T
A
-40
85
°C
温度
注意事项：
1.未使用的输入必须保持高电平或低电平，以防止它们飘浮。
2.直流输入信号电压用于差分输入的允许直流执行。
3.差分输入信号电压指定的差分电压[VTR - VCP ]
需要切换，其中VTR是真正的输入电平，并VCP是
互补的输入电平。
4.差分交叉点电压，预计跟踪V的变化
DDQ
并且是
电压，在该差分信号必须穿越。
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