82C55A
数据表
二零零六年十一月十六日
FN2969.10
CMOS可编程外设接口
Intersil的82C55A是一种高性能的CMOS版本的
行业标准8255A并通过一个制
自对准硅栅CMOS工艺（可缩放佐治Ⅳ） 。它
是一个通用的可编程I / O装置，该装置可
可以使用许多不同的微处理器。有24个
I / O引脚可在2组单独编程
12和用于操作的3个主要模式。高
的性能和行业标准CON组fi guration
82C55A使用80C86 ， 80C88它兼容
其它微处理器。
静态CMOS电路设计，保证了较低的工作功耗。 TTL
在整个军用温度范围内和公共汽车的兼容性
保持电路省去了上拉电阻。该
Intersil的先进佐治过程会导致性能等同
于或大于在现有的功能上等同的产品
功率的一小部分。
特点
无铅加退火有（符合RoHS ）
（参见订购信息）
引脚兼容NMOS 8255A
24个可编程I / O引脚
完全兼容TTL
高速，无“等待状态”操作同为5MHz和
8MHz的80C86和80C88
直接位设置/复位功能
增强的控制字阅读能力
L7流程
所有I / O端口2.5毫安驱动能力
低待机功耗（ ICCSB ） 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 .10μA
订购信息
产品编号
5MHz
CP82C55A-5
CP82C55A - 5Z （注）
部分
记号
CP82C55A-5
8MHz
CP82C55A
部分
记号
CP82C55A
CP82C55AZ
IP82C55A
IP82C55AZ
CS82C55A*
温度。
范围（° C）
0至+70
0至+70
-40至+85
-40至+85
0至+70
0至+70
-40至+85
-40至+85
0至+70
0至+70
-40至+85
-40至+85
-40至+85
-55到+125
SMD ＃
SMD ＃
44 Ld的CLCC
J44.A
包
40 Ld的PDIP
40 Ld的PDIP （无铅）
40 Ld的PDIP
40 Ld的PDIP （无铅）
44 Ld的PLCC
44 Ld的PLCC （无铅）
44 Ld的PLCC
44 Ld的PLCC （无铅）
44 Ld的MQFP
44 Ld的MQFP （无铅）
44 Ld的MQFP
44 Ld的MQFP （无铅）
40 Ld的CERDIP
F40.6
Q44.10x10
N44.65
PKG 。 DWG 。 ＃
E40.6
CP82C55A - 5Z CP82C55AZ （注）
IP82C55A
IP82C55AZ （注）
CS82C55A-5*
CS82C55A - 5Z * （注）
IS82C55A-5*
IS82C55A - 5Z * （注）
CS82C55A-5
CS82C55A*
CS82C55A - 5Z CS82C55AZ * （注） CS82C55AZ
IS82C55A-5
IS82C55A-5Z
IS82C55A*
IS82C55AZ * （注）
CQ82C55A*
CQ82C55AZ （注）
IQ82C55A*
IQ82C55AZ * （注）
ID82C55A
MD82C55A/B
8406602QA
8406602XA
IS82C55A*
IS82C55AZ
CQ82C55A*
CQ82C55AZ
IQ82C55A*
IQ82C55AZ
ID82C55A
MD82C55A/B
8406602QA
8406602XA
*添加“ 96 ”后缀的零件编号为磁带和卷轴包装。
注： Intersil无铅产品采用特殊的无铅材料制成，模塑料/晶片的附属材料和100 ％雾锡板终止
完成，这是符合RoHS标准，既锡铅和无铅焊接操作兼容。 Intersil无铅产品分类MSL在有铅
达到或超过IPC / JEDEC J STD- 020对无铅要求的无铅峰值回流温度。
1
注意：这些器件对静电放电敏感;遵循正确的IC处理程序。
1-888- INTERSIL或1-888-468-3774
|
Intersil公司（和设计）是Intersil Americas Inc.公司的注册商标。
版权所有Intersil公司美洲2002年， 2005年， 2006年版权所有
提及的所有其他商标均为其各自所有者的财产。
82C55A
引脚配置
82C55A （ PDIP ， CERDIP ）
顶视图
PA0
PA3
PA2
PA1
PA0
RD
CS
GND
A1
A0
PC7
PC6
PC5
PC4
PC0
PC1
PC2
PC3
PB0
PB1
PB2
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
40
39
38
37
36
35
34
33
32
31
30
29
28
27
26
25
24
23
22
21
PA4
PA5
PA6
PA7
WR
RESET
D0
D1
D2
D3
D4
D5
D6
D7
V
CC
PB7
PB6
PB5
PB4
PB3
RD
CS
82C55A （ CLCC ）
顶视图
PA1
PA2
PA3
PA4
PA5
PA6
PA7
V
CC
WR
39 NC
38 RESET
37 D0
36 D1
35 D2
34 D3
33 D4
32 D5
31 D6
30 D7
29 NC
18 19 20 21 22 23 24 25 26 27 28
PC3
PB0
PB1
PB2
PB3
PB4
PB5
PB6
PB7
NC
WR
PA7
6 5 4 3
GND
NC
A1
A0
PC7
PC6
PC5
PC4
PC0
PC1
PC2
7
8
9
10
11
12
13
14
15
16
17
2 1 44 43 42 41 40
82C55A （ PLCC ）
顶视图
RD
PA0
PA1
PA2
PA3
NC
PA4
PA5
PA6
PA7
WR
PA0
PA1
RD
82C55A （ MQFP ）
顶视图
PA2
PA3
PA4
PA5
PA6
NC
6 5 4 3 2 1 44 43 42 41 40
CS
GND
A1
A0
PC7
NC
PC6
PC5
PC4
PC0
PC1
7
8
9
10
11
12
13
14
15
16
17
18 1920 21 22 23 24 25 26 27 28
PC2
PC3
PB0
PB1
PB2
NC
PB3
PB4
PB5
PB6
PB7
39
38
37
36
35
34
33
32
31
30
29
RESET
D0
D1
D2
D3
NC
D4
D5
D6
D7
V
CC
44 43 42 41 40 39 38 37 36 35 34
33
2
32
3
4
5
6
7
8
9
10
31
30
29
28
27
26
25
24
CS
GND
A1
A0
PC7
PC6
PC5
PC4
PC0
PC1
PC2
1
RESET
D0
D1
D2
D3
D4
D5
D6
D7
V
CC
PB7
11
23
12 13 14 15 16 17 18 19 20 21 22
PC3
PB0
PB1
PB2
PB3
PB4
PB5
PB6
NC
NC
2
NC
FN2969.10
二零零六年十一月十六日
82C55A
引脚说明
符号
V
CC
GND
D0-D7
RESET
CS
RD
WR
A0-A1
I / O
I
I
I
I
I
TYPE
描述
V
CC
：在+ 5V电源引脚。 V之间的0.1μF电容
CC
和GND推荐脱钩。
地
数据总线：数据总线线是双向三态引脚连接到系统数据总线。
RESET ：高在此输入清除控制寄存器和所有端口（A ， B，C ）设置为输入模式与“公交车
持有“电路接通。
片选信号：片选是一个积极的低投入使用，使82C55A到数据总线的CPU
通信。
READ ：读取是使用由CPU来读取经由数据总线的状态信息或数据的有效低输入控制信号。
写：写入是由CPU使用的加载控制字和数据插入82C55A的有源低输入控制信号。
地址：这些输入信号，在与RD和WR输入端的同时，控制三个中的一个的选择
端口或控制字寄存器。 A0，A1的正常连接到所述地址总线的至少显著位
A0, A1.
PORT A ： 8位输入和输出端口。这两种总线高举和总线保持较低的电路都存在这个端口上。
端口B： 8位的输入和输出端口。总线保持较高的电路存在这个端口上。
端口C： 8位的输入和输出端口。总线保持电路存在这个端口上。
PA0-PA7
PB0-PB7
PC0-PC7
I / O
I / O
I / O
工作原理图
动力
耗材
+5V
GND
A组
控制
A组
端口A
(8)
I / O
PA7-PA0
双向
数据总线
D7-D0
数据总线
卜FF器
8-BIT
国内
数据总线
A组
端口C
上
(4)
B组
端口C
低
(4)
I / O
PC7-PC4
I / O
PC3-PC0
RD
WR
A1
A0
RESET
读
写
控制
逻辑
B组
控制
B组
端口B
(8)
I / O
PB7-PB0
CS
3
FN2969.10
二零零六年十一月十六日
82C55A
功能说明
数据总线缓冲器
这三态双向8位缓冲器用于连接
该82C55A到系统数据总线。数据被发送或
在执行输入或输出的接收缓冲器
由CPU的指令。控制字和状态
信息是通过数据总线缓冲器还可传送。
动力
耗材
+5V
GND
A组
控制
A组
端口A
(8)
I / O
PA7-
PA0
读/写控制逻辑
此块的功能是管理所有的内部和
数据和控制或状态字的外部传输。
它接受来自CPU的地址和控制总线的输入
并且又，发出命令到这两个控制组。
（ CS ）
片选。该输入引脚上的“低”使
该82C55A和CPU之间的通信。
（ RD ）
阅读。该输入引脚上的“低”使82C55A送
的数据或状态信息发送到数据总线上的CPU 。在
本质上，它允许CPU向82C55A “读取” 。
（WR）
写。该输入引脚上的“低”使CPU
写入数据或控制字写入82C55A 。
（ A0和A1 ）
端口选择0和端口1，选择这些输入
信号，在与RD和WR输入端的同时，控制
三个端口中的一个的选择或控制字
注册。它们通常连接到最显着的
地址总线的位（ A0和A1 ） 。
82C55A基本操作
A1
0
0
1
1
A0
0
1
0
1
RD
0
0
0
0
WR
1
1
1
1
CS
0
0
0
0
输入操作
（READ ）
端口A
→
数据总线
端口B
→
数据总线
端口C
→
数据总线
控制字
→
数据总线
输出操作
（写）
0
0
1
1
0
1
0
1
1
1
1
1
0
0
0
0
0
0
0
0
数据总线
→
端口A
数据总线
→
端口B
数据总线
→
端口C
数据总线
→
控制
禁用功能
X
X
X
X
X
1
X
1
1
0
数据总线
→
三态
数据总线
→
三态
双向
数据总线
数据
公共汽车
D7-D0
卜FF器
A组
端口C
上
(4)
8-BIT
国内
数据总线
B组
端口C
低
(4)
I / O
PC7-
PC4
I / O
PC3-
PC0
RD
WR
A1
A0
RESET
读
写
控制
逻辑
B组
控制
B组
端口B
(8)
I / O
PB7-
PB0
CS
图1. 82C55A框图。数据总线缓冲器，
读/写， A组& B控制逻辑
功能
A和组B组控制
每个端口的功能配置是通过编程
该系统软件。在本质上，在CPU “产出”一
控制字的82C55A 。控制字中包含
信息，如“模式”，“位设置”，“位复位”等，即
初始化82C55A的功能结构。
每一个控制块（ A组和B组）的接受
从读“命令” /写控制逻辑，接收
从内部数据总线，并发出“控制字”
适当的指令到其相关联的端口。
对照A组 - 端口A和端口C上（ C7 - C4 ）
控制B组 - 端口B和端口C的低（ C3 - C0 ）
控制字寄存器可以同时写入和读出的
在“基本操作”表中。图4示出了
用于读取和写入操作控制字格式。
当控制字被读出， D7位永远是一个逻辑
“1” ，因为这意味着控制字模式信息。
端口A， B和C
该82C55A包含三个8位端口（A ，B和C） 。所有能
被配置成各种各样的功能特征
由系统软件，但每个人都有自己的特色
或“个性化” ，以进一步提高功率和灵活性
在82C55A 。
端口A
一个8位的数据输出锁存器/缓冲器和一个8位的数据
输入锁存。既“拉”和“拉式”总线保持设备
存在于端口A.参见图2A 。
端口B
一个8位的数据输入/输出锁存器/缓冲器和一个8位
数据输入缓冲器。参见图2B 。
端口C
一个8位的数据输出锁存器/缓冲器和一个8位的数据
输入缓冲器（不锁存器，用于输入）。该端口可分为
（ RESET ）
复位。在此输入“高”初始化控制
寄存器部9Bh和所有端口（A ， B，C ）设置为输入
模式。 “总线保持”装置内部的82C55A将举行
在I / O端口输入到一个逻辑“1”状态以最大保持
电流400μA的。
4
FN2969.10
二零零六年十一月十六日
82C55A
模式控制下的两个4位的端口。每4位端口
包含一个4位锁存器，它可用于控制信号
与端口A的输出和状态信号输入结合
和B见图2b 。
输入模式
主
RESET
OR模式
变化
国内
DATA IN
国内
数据输出
（锁定）
输出模式
外
端口A引脚
模式0
RD ， WR
D7-D0
82C55A
C
B
8
I / O
4
I / O
4
I / O
A
8
I / O
A0-A1
CS
地址总线
控制总线
数据总线
PB7-PB0
模式1
PC3-PC0
C
PC7-PC4
PA7-PA0
图2A 。 PORT总线，保存配置
B
8
P
PB7-PB0
模式2
国内
DATA IN
国内
数据输出
（锁定）
输出模式
外
端口B ，C
针
控制控制
或I / O
或I / O
C
I / O
PA7-PA0
I / O
A
8
I / O
RESET
OR模式
变化
V
CC
B
8
A
双
定向
PB7-PB0
控制
PA7-PA0
图2B 。端口B和C总线保持配置
图2.总线保持配置
图3.基本模式定义和总线接口
操作说明
模式选择
有三种基本操作模式相比可
选择由系统软件：
模式0 - 基本输入/输出
模式1 - 选通输入/输出
模式2 - 双向总线
当复位输入端变为“高”时，所有端口都被设置为
用逻辑“ 1 ”电平所持全部24个端口的线路输入模式
内部总线保持装置。复位被删除后，
82C55A可以保持在输入模式中，没有额外的
初始化所需。这消除了需要上拉或
下拉的全CMOS设计的电阻。控制字
寄存器将包含部9Bh 。在该系统的执行
方案中，任何其它模式中，可以利用所选
单输出指令。这允许单个82C55A到
用一个简单的软件服务的各种外围设备的
日常维护。编程为一个输出端口的任何
端口被初始化为全零，当该控制字被写入。
控制字
D7 D6 D5 D4 D3 D2 D1 D0
B组
端口C （下）
1 =输入
0 =输出
端口B
1 =输入
0 =输出
模式选择
0 = 0模式
1 = 1模式
A组
C口（上）
1 =输入
0 =输出
端口A
1 =输入
0 =输出
模式选择
00 - 模式0
01 - MODE 1
1X = MODE 2
模式设置标志
1 - 活动
图4.模式定义格式
5
FN2969.10
二零零六年十一月十六日
QQ：2880707522 复制
