CS5361

114分贝192千赫，多比特音频A / D转换器

特点

先进的多位Delta-Sigma结构

24位转换

114分贝动态范围

-105 dB的THD + N

系统采样率高达192 kHz

低于150 mW的功耗

高通滤波器或直流偏移校准

支持5至2.5V逻辑电平

差分模拟结构

线性相位数字抗混叠滤波

溢流检测

概述

的CS5361是一个完整的模拟 - 数字转换器，用于

数字音频系统。它具有采样，模拟 -

数字转换和抗混叠滤波，产生24

对于左，右输入以串行形式在比特值

采样率高达每通道192千赫。

该CS5361采用的是5阶，多位Δ-Σ

调制后的数字滤波和抽取，

从而无需外置抗混叠滤波器。

ADC使用差分结构，提供

卓越的噪声抑制。

该CS5361是理想的音频系统，要求广泛镝

动力学范围，高保真和低噪音，如

A / V接收机， DVD -R ， CD -R ，数字混音控制台，

和效果处理器。

订购信息

CS5361 -KS -10℃至70℃， 24引脚SOIC

CS5361 -BS -40°至85°C 24引脚SOIC

CS5361 - KZ -10℃至70℃，采用24引脚TSSOP

CS5361 - BZ -40°至85°C 24引脚TSSOP

CDB5361

评估板

VQ

REFGND

OVFL

V

L

SCLK

LRCK SDOUT

MCLK

FILT +

参考电压

串行输出接口

RST

I

2

S / LJ

M / S

高

通

滤波器

HPF

MDIV

AINL-

AINL +

S / H

+

-

LP滤波器

Σ

数字

抽取

滤波器

DAC

AINR-

AINR +

S / H

+

-

LP滤波器

Σ

数字

抽取

滤波器

高

通

滤波器

MODE0

MODE1

DAC

基本产品信息

P.O.箱17847 ，奥斯汀，德克萨斯州78760

（ 512 ） 445 7222传真： （ 512 ） 445 7581

http://www.cirrus.com

本文档中包含的信息为新的产品。

Cirrus Logic公司保留修改本产品，恕不另行通知。

版权

Cirrus Logic公司， 2002年公司

（版权所有）

八月'02

DS467PP2

1

CS5361

目录

1引脚说明................................................................................................................. 4

2典型连接图.............................................. ........................................... 5

3应用......................................................................................................................... 6

3.1操作模式/采样率范围选择.......................................... ........................ 6

3.2系统时钟................................................................................................................ 6

3.2.1主模式......................................................................................................... 7

3.2.2从模式........................................................................................................... 8

3.3上电顺序.......................................................................................................... 8

3.4模拟连接........................................................................................................... 8

3.5高通滤波器和直流偏移校准.......................................... ............................. 9

3.6溢出检测............................................................................................................. 9

3.6.1 OVFL输出时序............................................ ............................................... 10

3.7接地和电源去耦............................................ ........................... 10

3.8同步多个设备............................................. ................................... 10

4特性和规范.............................................. ......................... 11

模拟特性（ CS5361 - KS / KZ ） ......................................... ......................... 11

模拟特性（ CS5361 - BS / BZ ） ......................................... ......................... 12

数字滤波器特性............................................... ................................... 13

DC电气特性............................................... .................................. 16

数字化的特征................................................ ............................................... 16

热CHARACTERISTICS............................................................................................ 17

绝对最大额定值............................................... .......................................... 17

开关特性 - 串行音频端口............................................ ..... 18

5参数定义............................................... .................................................. .. 21

6包装尺寸..................................................................................................... 22

7附录............................................................................................................................ 24

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标志或它们各自所有者的服务标志。

2

CS5361

图列表

图1.典型的连接图............................................ ................................................ 5

图2. CS5361主模式时钟........................................... ............................................ 7

图3. CS5361推荐模拟输入缓冲器.......................................... ......................... 9

图4.单速度模式阻带抑制.......................................... ............................. 14

图5.单速模式的过渡频带.......................................... ................................... 14

图6.单速模式的过渡频带（详情） ....................................... .......................... 14

图7.单速模式通带纹波.......................................... ................................. 14

图8.双速模式阻带抑制.......................................... ............................ 14

图9.双速模式的过渡频带.......................................... .................................. 14

图10.双速模式的过渡频带（详情） ....................................... ...................... 15

图11.双速模式通带纹波.......................................... .............................. 15

图12.四速模式阻带抑制.......................................... ............................ 15

图13.四速模式的过渡频带.......................................... ................................... 15

图14.四速模式的过渡频带（详情） ....................................... ......................... 15

图15.四速模式通带纹波.......................................... ................................. 15

图16.主模式，左对齐SAI ......................................... .......................................... 19

图17.从模式，左对齐SAI ......................................... ............................................ 19

图18.主机模式，我

2

S SAI ................................................ .................................................. 19

图19.从模式，我

2

S SAI ................................................ .................................................. .. 19

图20. OVFL输出时序............................................ .................................................. ...... 19

图21.左对齐串行音频接口.......................................... ................................... 20

图22.我

2

s串行音频Interface............................................................................................. 20

图23. OVFL输出时序， I2S格式......................................... ....................................... 20

图24. OVFL输出时序，左对齐格式....................................... .......................... 20

图25. CS5351 / CS5361模拟输入缓冲器......................................... ................................. 24

表格清单

表1. CS5361模式控制............................................................................................................. 6

表2. CS5361常见的主时钟频率.......................................... .............................. 7

表3. CS5361从模式的时钟比率.......................................... ................................................ 8

3

CS5361

1

引脚说明

RST

M / S

LRCK

SCLK

MCLK

VD

GND

VL

SDOUT

MDIV

HPF

I

2

S / LJ

1

2

3

4

5

6

7

8

9

10

11

12

24

23

22

21

20

19

18

17

16

15

14

13

FILT +

REFGND

VQ

AINR +

AINR-

VA

GND

AINL-

AINL +

OVFL

M1

M0

引脚名称

RST

M / S

LRCK

SCLK

MCLK

VD

GND

VL

SDOUT

MDIV

HPF

I

2

S / LJ

M0

M1

OVFL

AINL +

AINL-

VA

AINR-

AINR +

VQ

REF_GND

FILT +

#

1

2

3

4

5

6

8

9

10

11

12

引脚说明

RESET

（输入） - 该器件进入低功耗模式时低。

主/从模式

（输入）

- 选择工作无论在时钟主站或从站。

向左向右时钟

（输入/输出） - 确定哪个通道，左或右，是对当前活动

串行音频数据线。

串行时钟

（输入/输出） - 串行时钟，串行音频接口。

主时钟

（输入） - 时钟源用于△-Σ调制器和数字滤波器。

数字电源

（输入）

-

正电源的数字部分。

7,18

地

（输入） - 接地参考。必须连接到模拟地。

逻辑电源

（输入）

-

正电源的数字输入/输出。

串行音频数据输出

（输出） - 输出为二的补码的串行音频数据。

MCLK分频

（输入）

-

通过这两个功能实现了主时钟分频。

高通滤波器启用

（输入）

-

启用数字高通滤波器。

串行音频接口格式选择

（输入） -Selects无论是左对齐或余

2

S格式的SAI 。

13,

模式选择

（输入） - 确定装置的操作模式。

14

15

溢流

（输出，开漏）

-

探测两个左和右声道上溢条件。

16,

差分左声道模拟输入

（输入） - 信号进行差分呈现给Δ-Σ

17

通过AINL +/-引脚调节。

19

模拟电源

（输入）

-

正电源的模拟部分。

20,

差分右声道模拟输入

（输入） -Signals中差异呈现给Δ-Σ

21

通过AINR +/-引脚调节。

22

23

24

静态电压

（输出）

-

为内部的静态参考电压滤波器连接。

参考地

（输入） - 为内部采样电路的参考地。

正参考电压

（输出）

-

正参考电压为内部采样电路。

4

CS5361

2

典型连接图

+5 V至3.3 V

1

F

+

0.1

F

0.1

F

+

+ 5V至2.5V

1

F

+5V

+

1

F

0.1

F

5.1

0.1

F

VA

FILT +

47

F

VD

VL

VL

+

0.1

F

REFGND

+

1

F

0.1

F

10 k

OVFL

RST

I

2

S / LJ

M / S

HPF

M0

M1

MDIV

掉电

和MODE

设置

VQ

类似物

输入

卜FF器

（图3）

AINL +

CS5361

A / D转换器

AINL-

SDOUT

音频数据

处理器

类似物

输入

卜FF器

（图3）

AINR +

LRCK

SCLK

MCLK

时序逻辑

和时钟

AINR-

GND

GND

图1.典型的连接图

5