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CS2300-CP
小数N分频时钟乘法器与内部LCO
特点
时钟倍频器/抖动降低
概述
该CS2300 -CP是一种非常通用的系统
计时装置,它利用一个可编程的相位
锁定环。的CS2300 -CP是基于混合模拟
登录数字PLL架构包括一个独特的
Δ-Σ分数N频率组合
合成器和数字锁相环。这种架构允许
用于发电的低抖动时钟相对于一个外部的一个
频率低最终嘈杂的同步时钟
为50赫兹。该CS2300 -CP支持IC和SPI
全软件控制。
该CS2300 -CP可在一个10引脚MSOP封装
年龄在商业( -10 ° C至+ 70 ° C)级。顾客
开发套件也可用于设备evalua-
化。请参阅
第31页的“订购信息”
完整的详细信息。
生成低抖动6 - 75 MHz时钟
从抖动或间歇50 Hz到30
MHz的时钟源
内部LC振荡器的定时参考
高精度PLL倍频因子
最大误差小于1ppm的高
分辨率模式
IC / SPI 控制端口
可配置的辅助输出
最小的电路板所需的空间
无需外部模拟环路滤波器
组件
3.3 V
频率参考
IC / SPI
软件控制
I2C / SPI
PLL输出
锁定指示
产量
LCO
小数N分频
频率合成器
6 75兆赫
PLL输出
N
50赫兹到30兆赫
频率
参考
输出输入
倍频
数字PLL &分数
N个逻辑
http://www.cirrus.com
版权
Cirrus Logic公司, 2009年公司
(版权所有)
AUG 09
DS843F1
CS2300-CP
目录
1.引脚说明................................................................................................................................. 4
2.典型连接图.....................................................................................................五
3.特性和规范............................................. ......................................... 6
推荐工作条件............................................... ..................................... 6
绝对最大额定值........................................................................................................ 6
DC电气特性............................................... ................................................. 6
AC电气特性............................................... ................................................. 7
PLL性能曲线............................................................................................................... 8
控制端口切换特征 - IC格式........................................... ........ 9
控制端口开关特性 - SPI格式........................................... .... 10
4.架构概述............................................................................................................. 11
4.1 Δ-Σ分数N频率合成器......................................... ................................ 11
4.2模数混合锁相环.......................................... .......................................... 11
5.应用................................................................................................................................... 13
5.1定时参考时钟................................................................................................................. 13
5.2频率参考时钟输入, CLK_IN ........................................... ........................................ 13
5.2.1 CLK_IN跳跃模式......................................................................................................... 13
5.2.2调整最小环路带宽的CLK_IN ........................................ .................... 15
5.3输出到输入频率比配置........................................... .................................. 16
5.3.1用户定义的比例(路德) ..................................................................................................... 16
5.3.2比例调节器( R- MOD) .......................................................................................................... 17
5.3.3有效率( REFF ) .......................................................................................................... 17
5.3.4比例配置摘要............................................ .................................................. 18
5.4 PLL时钟输出........................................................................................................................... 19
5.5辅助输出.............................................................................................................................. 19
5.6时钟输出稳定性考虑............................................. ............................................... 20
5.6.1输出开关................................................................................................................... 20
5.6.2 PLL解锁条件.......................................................................................................... 20
5.7要求的加电排序............................................. .................................................. ..... 20
6. SPI / IC控制端口................................................................................................................... 20
6.1 SPI控制..................................................................................................................................... 21
6.2 IC控制...................................................................................................................................... 21
6.3存储器地址指针............................................................................................................... 23
6.3.1地图自动递增.............................................................................................................. 23
7.注册快速参考........................................................................................................ 23
8.注册说明................................................................................................................ 24
8.1设备内径与修订(地址01H ) ............................................ ........................................... 24
8.1.1设备标识(设备[ 4 : 0 ] ) - 只读.................................. ................................... 24
8.1.2设备版本(修订版[ 2 : 0 ] ) - 只读.................................. ...................................... 24
8.2设备控制(地址02H ) ........................................................................................................ 24
8.2.1解锁指示灯(解锁) - 只读....................................... ........................................... 24
8.2.2辅助输出禁用( AuxOutDis ) ......................................... .......................................... 24
8.2.3 PLL时钟输出禁止( ClkOutDis ) ........................................ .......................................... 25
8.3设备配置1 (地址03H ) .......................................... ................................................. 25
8.3.1 R-国防部选择( RModSel [ 2 : 0 ] ) ................................... .................................................. ...... 25
8.3.2辅助输出源选择( AuxOutSrc [ 1 : 0 ] ) ................................... .......................... 25
8.3.3启用设备配置寄存器1 ( EnDevCfg1 ) ....................................... ................. 26
8.4全局配置(地址05H ) ........................................... .................................................. .. 26
8.4.1设备配置冻结(冻结) ......................................... ....................................... 26
8.4.2启用设备配置寄存器2 ( EnDevCfg2 ) ....................................... ................ 26
8.5比(地址06H - 09H ) .............................................................................................................. 26
8.6功能配置1 (地址16H) .......................................... .............................................. 27
2
DS843F1
CS2300-CP
8.6.1时钟跳过启用( ClkSkipEn ) ......................................... .................................................. .. 27
8.6.2辅助PLL锁定输出配置( AuxLockCfg ) ....................................... ....................... 27
8.6.3启用设备配置寄存器3 ( EnDevCfg3 ) ....................................... ................. 27
8.7功能配置2 (地址17H) .......................................... .............................................. 28
8.7.1启用PLL时钟上的开锁输出( ClkOutUnl ) ..................................... ........................... 28
8.7.2低频比配置( LFRatioCfg ) ....................................... ......................... 28
8.8功能配置3 (地址1EH ) .......................................... .............................................. 28
8.8.1时钟输入带宽( ClkIn_BW [ 2 : 0 ] ) .................................... ............................................ 28
9.计算用户定义的比率........................................... ......................................... 29
9.1高分辨率12.20格式....................................................................................................... 29
9.2乘高20.12格式............................................. .................................................. .... 29
10.包装尺寸..................................................................................................................三十
热特性.........................................................................................................三十
11.订购信息.............................................................................................................. 31
12.参考文献: .................................................................................................................................... 31
13.修订历史.......................................................................................................................... 32
图列表
图1.典型的连接图........................................................................................................五
图2. CLK_IN正弦抖动容限........................................... .................................................. 8
图3. CLK_IN正弦抖动传输........................................... .................................................. 8 ...
图4. CLK_IN随机抖动抑制和容忍......................................... ................................ 8
图5.控制端口时序 - IC格式......................................... .................................................. 9 .......
图6.控制端口时序 - SPI格式(只写) ..................................... ..................................... 10
图7. Δ-Σ分数N频率合成器....................................... .............................. 11
图8.混合模拟数字PLL .......................................................................................................... 12
图为LCO 9.外部组件要求.......................................... ................................... 13
图10.删除CLK_IN为> 2
23
LCO周期................................................ ................................... 14
图11.删除CLK_IN为< 2
23
LCO周期,但>吨
CS
.................................................................... 14
图12. CLK_IN删除了<吨
CS
....................................................................................................... 15
图13.低带宽和新的时钟域......................................... ........................................... 16
图14.高带宽CLK_IN域再利用....................................... .................................... 16
图15.比功能摘要........................................................................................................... 18
图16. PLL时钟输出选项....................................................................................................... 19
图17.辅助输出选择........................................................................................................ 19
图18.控制端口时序SPI模式......................................... .................................................. .. 21
图19.控制端口时序, IC写......................................... .................................................. ....... 22
图20.控制端口时序, IC中止写入+读取...................................... ................................. 22
表格清单
表1比修改.............................................................................................................................. 17
表2.示例12.20 R值............................................................................................................ 29
表3例20.12 R值............................................................................................................ 29
DS843F1
3
CS2300-CP
1.引脚说明
VD
GND
CLK_OUT
AUX_OUT
CLK_IN
1
2
3
4
5
10
9
8
7
6
SDA / CDIN
SCL / CCLK
AD0/CS
FILTN
FILTP
引脚名称
VD
GND
CLK_OUT
AUX_OUT
CLK_IN
FILTP
FILTN
AD0/CS
SCL / CCLK
SDA / CDIN
#
1
2
3
4
5
6
7
8
9
引脚说明
数字电源
(输入) - 为数字和模拟部分电源正极。
(输入) - 接地参考。
PLL时钟输出
(输出) - PLL时钟输出。
辅助输出
(输出) - 该引脚输出的输入或输出时钟中的一个缓冲版本,
或状态信号,根据寄存器的配置。
频率参考时钟输入
(输入) - 时钟输入数字PLL频率基准。
LCO过滤器的连接
(输入/输出) - 这些引脚的接口提供外部电源滤波
最终LC振荡器。
地址位0 ( IC ) /控制端口片选( SPI )
(输入) - AD0是IC芯片地址引脚
模式。 CS是在SPI模式下的片选信号。
控制端口时钟
(输入)
- SCL / CCLK是在IC和SPI串行控制端口的串行时钟
模式。
10
串行控制数据
(输入/输出) - SDA是IC模式下的数据I / O线。 CDIN是输入数据
线在SPI模式控制端口接口。
4
DS843F1
CS2300-CP
2.典型连接图
1
注意事项:
1.
电阻器
需要我
2
C
操作。
0.1 F
2 k
Ω
2 k
Ω
1 F
+3.3 V
VD
SCL / CCLK
系统微控制器
SDA / CDIN
AD0/CS
CS2300-CP
频率参考
CLK_IN
FILTP
AUX_OUT
FILTN
GND
CLK_OUT
的电路需要
一个低抖动时钟
与其它电路或
微控制器
0.1 F
图1.典型的连接图
DS843F1
5
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