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CS22220数据表
无线PCMCIA控制器
1
描述
Cirrus Logic的CS22220无线网络控制器实现高性能,每11兆位
为PCMCIA ,移动,嵌入式系统和其他成本第二数字无线数据连接
敏感的应用。
该CS22220是无线网络的支持高度集成的单芯片解决方案, PCMCIA
视频,音频,语音和数据业务。可编程控制器执行Cirrus Logic的
白浪 2的网络协议,它提供的Wi-Fi (802.11 )合规性,以及多媒体
和服务质量(QoS )支持的质量。该器件包含几个高性能的组件
包括一个ARM7TDMI RISC处理器核心,一个前向纠错(FEC )编解码器和一
无线电MAC ,支持高达11 Mbps的吞吐量。该CS22220采用最先进的技术
0.18微米CMOS工艺,并装在一个208 FPBGA小巧(尺寸仅为15mm× 15毫米)封装,
具有适合于高度集成的无线电应用的低引线电感。核心电源1.8
V具有3.3V ( 5.0V宽容)I / O ,以降低整体功耗。此外, CS22220
支持低功耗管理的主机和无线接口。
该CS22220被设计为一个PC卡(PCMCIA 2.1 / JEIDA 4.2)的一个组成部分。该
PCMCIA主机接口还支持小端和大端协议,简单的接口
微处理器在嵌入式系统中的应用普及。
PCMCIA主机或嵌入式CPU
网络数据
802.11b的兼容
2.4 GHz的
数字广播
PHY收发器
系统内存
SDRAM (最多4MB )
SRAM (最多256KB )
引导ROM /闪存
(高达1MB )
11 Mbps的
无线
基带I / F
CS22220
无线
PCMCIA
调节器
2.4 GHz直接序列
扩频
图1.系统框图
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特点
嵌入式ARM内核和系统支持逻辑
高性能的ARM7TDMI RISC处理器内核高达77MHz
4KB集成, 1路组相联的,统一的,写高速缓存
各中断对每个功能块
两个23位可编程(定期或单次),通用定时器
8 DWORD( 32位)内存的读写缓冲区对高系统性能
中止循环检测和报告进行调试
ARM的性能监控功能的系统微调
根据系统配置的可编程性能提升逻辑
增强型内存控制器单元
可编程存储器控制器单元支持SDRAM /异步SRAM的/ boot ROM /闪存
接口
具有12位地址的16位数据总线,支持高达4MB高达103兆赫
( 100 / 133MHz的SDRAM )
8位数据总线寻址支持高达引导ROM / 1MB闪存。
可编程的SDRAM的定时和尺寸参数诸如CAS等待时间和数量
银行,列和行
灵活独立的DMA引擎, PCMCIA和数字广播功能单元
FEC编解码器
高性能的里德 - 所罗门编码的纠错(255 : 239块编码)
减少了一个典型的10E- 3的误码率环境下的错误概率为10E- 9
可编程速率FEC引擎优化渠道效率
低延迟,全流水的硬件编码和解码。支持按字节单周期
吞吐量高达77MHz ,以77MBps的速度持续。
双缓冲(63双字的读/写缓冲液中) ,以提高系统的性能
数字无线MAC接口
胶较少接口的802.11b基带收发器
高达11Mbps的数据传输速率
32双字的发送/接收FIFO
支持空闲信道评估( CCA )
电源管理
主持人( PCMCIA )符合ACPI
ARM内核和系统低功耗管理的可编程定时关机
单个功能单元独立的电源管理控制
支持可变速率的无线发射,接收和备用无线电功率模式
时钟和PLL接口
单一的44MHz晶体振荡器的参考时钟
内部PLL产生内部和船上的时钟
PCMCIA接口
16位的PCMCIA I / O的目标设备支持内存映射或程序的I / O使用11位地址
独立的DMA控制器, PCMCIA和主存储器之间传送数据
完全符合PCMCIA 2.1 / JEIDA 4.2标准
支持big endian和little endian的(默认)数据格式
支持嵌入式应用的接口成为通用的自定义模式
存储器地址/数据接口
芯片加工及包装
艺术CMOS工艺的208 FPBGA封装, 0.18微米状态
1.8V内核实现低功耗。 3.3V的I / O - 5V容限I / O
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"Preliminary"产品信息描述了在生产中的产品,但其全面的特征数据尚未
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法律是出口或取出中华人民共和国。
采用半导体产品可能涉及死亡的潜在风险某些应用中,
人身伤害,或严重的财产或环境损害( "CRITICAL APPLICATIONS" ) 。
CIRRUS产品并非设计,授权或保证适合于使用在生命
支持设备或系统或其他关键应用。作者CIRRUS产品在包裹体
此类应用被理解为充分地在客户的风险。
Cirrus Logic公司,卷云,而Cirrus Logic公司的标志设计是Cirrus Logic ,Inc.的所有其他品牌和产品的商标。
本文档中的名称可能是其各自所有者的商标或服务标志。
在与MPEG - 2视频标准符合在ISO定义的任何方式使用本产品
文档IS 13818-1 (包括附件C, D,F ,J和K) , IS 13818-2 (包括附件A,B ,
C和D ,但不包括可伸缩的扩展) ,以及IS 13818-4 (只在需要的时候,以澄清IS
13818-2 )明确禁止未经在适用专利的MPEG - 2专利许可
投资组合,该许可证可从MPEG LA,LLC 250斯蒂尔街,套房300 ,丹佛,
科罗拉多州80296 。
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功能说明
主要功能单元如图2框图
内存/ ROM启动
调节器
ARBITER
DMA
DMA
PCMCIA
调节器
W / DMA Ctrl键
读/写缓冲器
ARM 7TDMI
打断
调节器
系统内存
JTAG /测试接口
PCMCIA
定时器
(2)
4KB
缓存
无线MAC
W / DMA Ctrl键
数字广播
接口
系统控制总线
睡觉
定时器
FEC编解码器
时钟/ PLL
晶体或
振荡器
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3.1
嵌入式ARM内核和系统支持逻辑
在CS22220的处理元件包括ARM7TDMI内核和其相关联的
系统控制逻辑。 ARM处理器和系统控制器包括一个存储器
管理单元,通过高速缓存控制器, 4 KB写入, 20 IRQ和4 FIRQ中断
控制器和2个通用定时器。 ARM处理器和集成系统
支持逻辑提供必要的执行引擎,以支持实时多任务
操作系统,网络协议栈,以及固件的服务。
内存管理单元
ARM指令和数据是从系统存储器中的高速缓存行(4/8取 - 段对齐
/可编程)的高速缓存时,接通时间。中的高速缓存行填充,临界字
数据,也就是说,导致错过的访问,被转发给ARM和也写入到
数据RAM的高速缓存。在该行的非关键字中取出后的临界字
然后写入到缓存上双字的基础上,因为他们成为可用。
内存写入发布到双4段对齐( 32位)内存写入缓冲器发布。写
帖子使用顺序寻址功能的存储器总线上。采用双缓冲的出
顺序写入将发布一个写缓冲,而其他缓冲区刷新到内存中。
有一个8Dword读缓冲区中的MEM块。该缓冲器用于两个缓存
和非可高速缓存空间。
中断控制器
中断控制器提供两个中断通道的ARM处理器。一
中断通道被呈现给ARM的其
nFIQ ,
和其他信道,提出
NIRQ
引脚。这些被称为FIQ通道和IRQ通道。两
渠道运作中相同,但独立的方式。该FIQ通道具有更高的
优先级比IRQ通道ARM处理器上。
中断控制器包括一个控制寄存器在ARM每个逻辑中断
复杂的。 CONTROL寄存器提供以下主要目的:
提供EXT_INT输入之间的映射(物理中断)和逻辑
打断
选择特定类型的信令预计在EXT_INT投入:水平,边缘,
有效电平高/低等等。
启用或禁用逻辑中断
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