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CDP68HC68S1

1994年4月

串行多路复用总线接口

描述

该CDP68HC6SS1串行总线接口芯片（备用信用证）提供

在小型局域网CON组fi guration接口的一种手段，

各种微型计算机（ MCU的）包含串行端口。这样

MCU的包括68HC05微控制器系列。该备用信用证

提供从MCU的串行通信连接

接口（ UART异步型接口）或串行外设

ERAL接口（同步）到中速异步

两线制差分信号总线设计，尽量减少电 -

磁干扰。此两线总线构成的网络总线

这是所有MCU的连接（通过SBI芯片）。参见图 -

茜1.每个MCU独立运作，可加入或

从总线上的总线操作几乎没有或没有影响，删除。

这样的公交车非常适合于跨微机通信

危险的电气环境，如汽车，飞机

或工业控制系统。

除了充当总线arbitor和接口microcom-

电脑SCI端口差分总线通讯，

CDP68HC68S1包含所有转换所需的全部电路

和同步不归零（NRZ）接收到的8位数据

差分总线和时钟的数据转换成微型计算机的上

SPL端口。同样地，数据由微型计算机的SPI发送

端口被追加开始转换为异步格式

并传送到其它微型计算机之前停止位。

请参阅数据手册CDP68HCO5C4额外

关于CDP68HCO5微型计算机和信息的

串行通信和串行外设接口。

该CDP68HC68S1是在一个14脚双列直插式塑料供应

包（E SUF科幻X），并在一个20引脚小外形塑料封装

年龄（M SUF网络X）。

从4V工作电压范围为7V和经营temper-

ATURE -40范围

C至+105

特点

差分总线为最小的EMl

高共模噪声抑制

适用于双绞线

数据冲突检测

总线仲裁

空闲检测

可编程时钟分频器

上电复位

订购信息

部分

数

CDP68HC68S1E

CDP68HC68S1M

温度

范围

-40

C至+105

-40

C至+105

包

14引脚PDIP

20引脚SOIC （ W）

引脚配置

CD68HC68S1 （ PDIP ）

顶视图

CLK 1

A 2

B 3

模式4

BUS + 5

BUS- 6

14 V

13控制

12 IDLE

11 CS

10 SCK

9 REC

8 XMIT

巴士 -

CLK

模式

BUS +

CD68HC68S1 （ SOIC ）

顶视图

20 V

19控制

18 NC

17 IDLE

16 CS

15 SCK

14 NC

13 NC

12 REC

11 XMIT

注意：这些器件对静电放电敏感;遵循正确的IC处理程序。

407-727-9207

版权

Intersil公司1999

网络文件编号

1918.3

6-84

CDP68HC68S1

框图

SCK

从

MCU

XMIT

REC

模式

时钟

分频器

字计数器

和

时钟

发电机

SPI / SCI

转变

空闲

发现

和

控制

仲裁

探测器

碰撞

探测器

BUS +

DIFFERNTIAL

驱动器/接收器

巴士 -

CLK

其他

SBI CHIPS

控制空闲

6-85

特定网络阳离子CDP68HC68S1

绝对最大额定值

电源电压（V

）。。。。。。。。。。。。。。。。。。。。。。。。。 -0.3V至+ 7.0V

输入电压（V

) . . . . . . . . . . . . . . . . . . V

-0.3V到V

+0.3V

DC输入电流（I

)

。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。 ± 10毫安

热信息

热阻

塑料DIP封装。。。。。。。。。。。。。。。。。。。。。。。。。。。。 100

C / W

塑料SOIC封装。。。。。。。。。。。。。。。。。。。。。。。。。。 120

C / W

存储温度范围（T

英镑

) . . . . . . . . . . . . -55

C至+ 125

引线温度（焊接10秒）。。。。。。。。。。。。。。。。。。。。 265

注意：如果运行条件超过上述“绝对最大额定值” ，可能对器件造成永久性损坏。这是一个压力只有额定值和运作

该设备在这些或以上的本规范的业务部门所标明的任何其他条件是不是暗示。

工作条件

工作温度（T

) . . . . . . . . . . . . . . . . . . -40

C至+105

直流工作电压范围（V

）。。。。。。。。。。。。。。。。 + 4V至+ 7V

直流电特定网络阳离子

参数

SIGNAL I / O部分

输出电压较高水平

输出电压低的水平

输入电压低电平

输入电压高电平

高输出驱动器（源）电流

（ REC引脚）

高输出驱动器（源）电流

（ IDLE ，控制引脚）

输出低电平驱动（灌）电流

（ IDLE ，控制， REC ）

= -40

C至+105

C除非另有说明。外部偏压（V

）应为1.8V至3.13V除非

另有说明。

符号

测试条件

民

最大

单位

开路

-0.05

0.7V

0.05

0.3V

= 4.6V, V

= 5V

= 4.6V, V

= 5V

= 0.4V, V

= 5V

-0.12

-0.04

0.36

差分收发器（见图4 ）变送器

BUS +

AOL

AOH

巴士 -

BOL

BOH

AOL

- I

BOL

MATCH

输出上升时间（ BUS + ）

输出下降时间（ BUS- ）

过渡匹配（ 50 ％点）

接收器

灵敏度差

IDH

IDL

滞后（在V

IDH

, V

IDL

极限）

传播延迟

超出范围

民

静态电流器件

时钟速度

= 2.5V ，R

= 120, V

= 5V

= 2.5V ，R

= 120, V

= 5V

= 2.5V ，R

= 120, V

= 5V

IDH

=为120mV ，V

= 5V

= 0V, V

= 2.5V

= 5, R

= 120, C

= 25PF

3.8

-10

120

700

1.2

待定

（注）

兆赫

= V

/2, R

= 120

= V

/2, R

= 120

= V

/2, R

= 120

= V

/2, R

= 120

= V

/2, R

= 120,

= 5V

±0.5V

= 5V ，C

= 25PF

= 5V ，C

= 25PF

= 5V ，C

= 25PF

2.75

-1.0

-50

1.0

-2.75

1.0

1.5

注意：虽然1MHz的一般使用，例如，在本数据表中，最大速度极限可以是较高的，取决于

根据用户的噪声容限要求。

6-86

CDP68HC68S1

的串行总线的IC为用户提供了三种可能的模式

操作去连接定义了表1 - SCL（注1 ）， SPL和缓冲的

ERED SPL 。此外，也有“三态模式”通过进入

CS引脚拉大，而在缓冲SPI模式。如

顾名思义，在SCL模式用于communicat-时

荷兰国际集团通过微电脑的SCl理论端口。在这种模式下，

异步NRZ数据格式（ 1个起始位， 8个数据位“最

显着的有点科幻RST' ， 1位停止位）和波特率保持

同样在每个“侧” SBLC ，即以与从微

并与从差动网络总线。

表1.模式和片选定义

SBI芯片模式

SCI

SPI

缓冲SPI

三态（注2 ）

注意事项：

1. SCI是一个68HCO5 MCU的UART接口。该

CDP68HC68S1是compatable与大多数UART器件。

2.三态模式下，使用缓冲的时候才输入的

SPI模式。在三态模式下，只有XMIT ， REC和

有三态SCK引脚。在控制和空闲引脚AL-

如何活跃。

模式引脚

CS引脚

公交车“监控” 。串行总线接口芯片处理总线

仲裁，数据冲突检测，并提供短路

保护。

一个68HC0S MCU的SPI端口可替代用于公交

通信。提供两种模式SPL操作

与SBIC - 一个实质上对地方的68HC05微

计算机在从模式和其他允许MCU

仍然是一个大师。在正常模式下的声压级的SBIC充当

主站和提供数据同步的串行时钟信号

以微（工作于从机模式）的转换

或流出微的8位SPL数据寄存器的数据。同样，

波特率是相同的SBLC的每一侧，但是，

用户必须反向发送的字节的位顺序或

通过SPI端口由于SPL的最显着的一点收到

科幻RST串行数据的性质。此外，由于用户microcom-

计算机工作在从模式下，信号必须履行机构

芯片（通过拉动控制线低）发起transmis-

锡永。作为在SCL模式，在数据传输时，字节

原本在SPI数据寄存器被替换的字节

再从佛罗里达州的巴士ected 。

发送和接收数据的缓冲的SPI模式

允许用户通过允许快速释放微的SPL端口

SPI端口之间的数据通信（1M比特/秒）的

和备用信用证。例如，如果微控制器正在发射时， SBLC

从MCU的SPL端口的数据流转换为

用于沿所述差分总线传输速度较慢

当总线空闲。数据速率转换

通过一个2字节（ 16位）数据缓冲区寄存器来实现resid-

荷兰国际集团在串行总线芯片。在这种模式下， MCU的操作为

一个主站和提供串行时钟信号到从属

备用信用证的外围。经过快速的数据已发送或接收

从SBIC ，微能拉备用信用证的CS引脚为高电平

（放置在三态模式的SBLC芯片），然后使用

在SPL端口访问其他SPL外设。

用户MCU和备用信用证中的所有传输

缓冲SPI模式由2个字节，即一个消息CON-

sists偶数个8位的传输。微型计算机

希望传输的负载2个字节写入串行总线IC资料

锡永。在传输过程中放入缓冲器中的2个字节

由两个重佛罗里达州ected字节从接收的将被替换

总线。每2个字节传送完毕后，用户应微

传送两个重佛罗里达州ected字节出缓冲器和接下来的的

2个字节将被发送到缓冲器中。

表2.时钟编程

期间的数据传输，而一个字节正在发送

从通过SBL芯片单片机到差分总线，

它也是重新佛罗里达州ected和同时接收的背面在

微，（如后面所述这需要总线仲裁）。

差分总线

SBI

SPI或SCI

时钟输入

分频系数

针

B引脚

MCU

图1.可能的网络配置 - 各种

使用SBI芯片COM-微型计算机

MUNICATE沿差动总线。

除了在SCI进行帧错误校验

模式，其它的优点得到了通过使用备用信用证（在任何

模式），包括更大的系统的EMl宽容和自动

6-87

CDP68HC68S1

功能引脚说明

引脚数

符号

CLK

IN / OUT

输入

描述

这是时钟输入端，由SBIC划分（如表2中所述）和使用

作为内部同步时钟。内部时钟，然后再除以128到DE-

termine波特率，即128内部时钟周期构成的1位长度。

编程的时钟分频器输入。这些输入连接到+ V

或V

根据

在外部时钟源的速度。（见表2 ）

这个输入应配合使用CS输入来定义的操作模式（见

表1）。它可以被永久地连接到+ V

或V

或驱动为高电平或低电平MCU的I / O

线。

这是两个线差分总线的I / O用于发送和接收数据，并从

差分总线。 BUS +既是响应，或者驱动正通过获取电流

外部建立偏置点。该采购目前的BUS- I / O的那颗匹配

电流。 BUS-既是响应，或者驱动阴性吸收电流从一个外部

建立应受偏置点。这种吸收电流匹配BUS + I / O的拉电流。

电源和接地参考被提供给通过这些引脚的装置。 V

是权力和

是地面。

在SCI模式下，该数据输入应来自微型计算机的标准NRZ异步

异步的通讯输出端口（ 68HC05 SCI端口引脚TXD）。在SPI模式下，它

13:29从微型计算机的同步输出端口（ 68HC05 SPI端口引脚

MOSl或MlSO ）。

在SCI模式下，该数据输出应送入单片机异步的COM

munications输入端口（ 68HC05 SCI端口引脚RXD）。在SPI模式应当被送入

微型计算机的同步输入端口（ 6805 SP1端口引脚MOSl或MISO ）。

在SCI模式下，该I / O不是必需的。在这两种SPI模式该引脚连接到

68HC05的SPI接口SCK引脚。在正常SPL模式下，备用信用证应当出示移位时钟

通过该引脚用于同步移位数据移入和移出微机的脉冲。在

在SPL缓冲模式下，该引脚为输入，微机将产生移位

时钟脉冲。图3显示了串行时钟信号和其他之间的关系

SBIC信号在SPI模式。

这个输入应配合使用的模式输入，并应被用作芯片

选择（见表1）。它可以被永久地连接到+ V

或V

或驱动为高电平或低电平

单片机I / O口线。

微计算机应监控该信号来确定总线状态和也拉

这条线低，产生中断。空闲信号变为低电平时，总线处于空闲状态（后

检测的消息结束状态）和高当总线处于活动状态。上电复位时，该引脚

被设置为逻辑零。

微机应在SPL模式监视此I / O引脚，处理和传输

接收数据。在SCI和SPI模式下，作为输出时，该引脚变为低电平，表示

一个数据字节在总线上当前激活的。在缓冲SPI模式控制引脚

表示用户微机是否有电流进入SBI芯片的内部2

字节缓冲区（由逻辑高电平控制引脚来表示）。在这两个SPI模式控制引脚

也是有效的作为输入。在这些模式下，控制引脚被拉低用户MI-

crocomputer由SBLC以启动发送操作。控制引脚通常是高

当总线处于非活动状态。复位时，该引脚设置为逻辑高电平。

2, 3

A和B

输入

模式

输入

5, 6

BUS +

和BUS-

输入/输出

14, 7

和

XMIT

输入

REC

产量

SCK

输入/输出

输入

空闲

输入/输出

控制

输入/输出

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