CDCU2A877
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SCAS827A - 2006年8月 - 修订2007年6月
1.8 -V锁相环时钟驱动器
特点
1.8 -V / 1.9 -V锁相环时钟驱动器，用于
双倍数据速率（ DDR II ）的应用
扩频时钟兼容
工作频率： 125 MHz至410 MHz的
应用频率： 160 MHz至410 MHz的
低抖动（循环周期） ：
±40
ps
低输出偏斜： 35 ps的
稳定时间<6
μs
分配一个差分时钟输入至10
差分输出
CDCUA877高驱版
52球mBGA封装（微星少年 BGA ，
0.65毫米间距）
外部反馈引脚（ FBIN ， FBIN ）是
用于将输出同步到输入
钟
达到或超过CUA877 / CUA878
PLL规范标准
PC2-3200/4300/5300/6400
故障安全输入
描述
该CDCU2A877是分配一个差分时钟高性能，低抖动，低偏移，零延迟缓冲器
输入对（ CK，CK ），以10个差分对时钟输出（ YN， YN ），以及一个差分对反馈时钟的
输出（ FBOUT ， FBOUT ） 。时钟输出由输入时钟（ CK，CK ） ，所述反馈时钟进行控制
（ FBIN ， FBIN ）时， LVCMOS控制引脚（ OE ， OS） ，和模拟电源输入（ AV
DD
） 。当OE为低电平时，
时钟输出，除了FBOUT / FBOUT ，被禁用，同时内部PLL继续保持其锁定在
频率。 OS （输出选择）是一个程序引脚必须连接到GND或V
DD
。当OS高， OE功能
如先前所述。当操作系统和操作环境都为低， OE还没有影响到Y7 / Y7 ，他们是自由运行。
当AV
DD
接地， PLL被关闭，旁路用于测试目的。
当两个时钟输入端（ CK，CK ）为逻辑低电平时，该设备进入低功率模式。输入逻辑检测
电路上的差分输入，独立于输入缓冲器，检测所述逻辑低电平，并且执行在低
电源状态，所有输出，反馈，和PLL处于关闭状态。当被时钟输入转换
逻辑低是差分信号， PLL重新开启时，输入和输出使能，
锁相环获得反馈时钟对（ FBIN ， FBIN ）和时钟输入对（ CK，CK ）内的锁相
指定的稳定时间。
该CDCU2A877能够跟踪扩频时钟（ SSC ） ，从而降低EMI 。该器件可工作
0℃至70℃。
可选项
T
A
0 ° C至70℃
(1)
52球BGA
(1)
CDCU2A877ZQL
对于最新的封装和订购信息，请参阅
封装选项附录本文档的末尾，或见
TI的网站：
www.ti.com 。
请注意，一个重要的通知有关可用性，标准保修，并在得克萨斯州的关键应用程序使用
仪器的半导体产品和免责条款及其出现在此数据表的末尾。
微星少年是德州仪器的商标。
PRODUCTION数据信息为出版日期。
产品符合占德州条款规范
仪器标准保修。生产加工过程中不
不一定包括所有参数进行测试。
2006-2007 ，德州仪器
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表1.端子功能
名字
AGND
AV
DD
CK
CK
FBIN
FBIN
FBOUT
FBOUT
OE
OS
GND
BGA
G1
H1
E1
F1
E6
F6
H6
G6
F5
D5
B2, B3, B4,
B5， C2，C5 ，
H2， H5 ，J2，J3 ，
J4, J5
D2, D3, D4,
E2， E5 ，F2
G2, G3, G4,
G5
MLF
7
8
4
5
27
26
24
25
22
21
10
I
I
I
I
O
O
I
I
I / O
模拟地
模拟电源
时钟输入了（从10kΩ 100 kΩ的）下拉电阻
互补时钟输入，一个（ 10 kΩ到100 kΩ的）下拉电阻
反馈时钟输入
互补反馈时钟输入
反馈时钟输出
互补反馈时钟输出
输出使能（异步）
输出选择（连接到GND或VDD ）
地
描述
V
DDQ
1, 6, 9, 15, 20,
23, 28, 31, 36
逻辑和输出功率
Y[0:9]
A2，A1 ，D1
38, 39, 3, 11, 14,
J1 ， K3 ， A5 ， A6 ， 34 ， 33 ， 29 ， 19 ， 16
D6 ，J6 K4
A3， B1，C1，
37, 40, 2, 12, 13,
K1，K2 ，A4
35, 32, 30, 18, 17
维生素B6， C6 ，K6， K5
O
时钟输出
Y[0:9]
O
互补的时钟输出
表2.功能表
输入
AV
DD
GND
GND
GND
GND
1.8 V Nomnal
1.8 V Nomnal
1.8 V Nomnal
1.8 V Nomnal
1.8 V Nomnal
X
OE
H
H
L
L
L
L
H
H
X
X
OS
X
X
H
L
H
L
X
X
X
X
CK
L
H
L
H
L
H
L
H
LH
H
CK
H
L
H
L
H
L
H
L
L
H
Y
L
H
L
Z
LZ
Y7活动
L
Z
LZ
Y7活动
L
H
L
Z
L
Z
LZ
Y7活动
L
Z
LZ
Y7活动
H
L
L
Z
输出
Y
FBOUT
L
H
L
H
L
H
L
H
L
Z
版权所有
FBOUT
H
L
H
L
H
L
H
L
L
Z
旁路/关
旁路/关
旁路/关
旁路/关
On
On
On
On
关闭
PLL
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图1.逻辑图（正逻辑）
绝对最大额定值
在工作自由空气的温度范围内（除非另有说明）
(1)
价值
V
DDQ
A
VDD
V
I
V
O
I
IK
I
OK
I
O
I
DDC
R
θJA
R
θJC
T
英镑
(1)
(2)
(3)
(4)
电源电压范围
输入电压范围
(2)
输出电压范围
(3)
单位
V
V
V
mA
mA
mA
mA
K / W
°C
-0.5 2.5
-0.5到V
DDQ
+ 0.5
-0.5到V
DDQ
+ 0.5
±50
±50
±50
±100
没有空气流动
Airllflow 150英尺/分钟
没有空气流动
151.9
146.1
102.4
-65到150
(2) (3)
输入钳位电流（V
I
＆ LT ; 0或V
I
＆ GT ; V
DDQ
)
输出钳位电压（V
O
＆ LT ; 0或V
O
＆ GT ; V
DDQ
)
连续输出电流（V
O
= 0至V
DDQ
)
连续电流通过每个V
DDQ
或GND
热阻，结到环境
(4)
热阻，结到外壳
存储温度范围
(4)
强调超越那些在列
绝对最大额定值
可能对器件造成永久性损坏。这些压力额定值
只和功能在这些或任何其他条件超出下所指示的设备的操作
推荐工作
条件
是不是暗示。暴露于长时间处于最大绝对额定情况下会影响器件的可靠性。
如果输入和输出钳位电流额定值是所观察到的输入和输出电压额定值可能被超过。
这个值被限制为2.5伏的最大值。
封装的热阻抗的计算按照JESD51和JEDEC2S1P （高K板） 。
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推荐工作条件
民
V
DDQ
AV
DD
V
IL
V
IH
I
OH
I
OL
V
IX
V
I
V
ID
T
A
(1)
(2)
输出电源电压
电源电压
(1)
喃
1.8
V
DDQ
最大
1.9
0.35
×
V
DDQ
单位
V
V
V
1.7
OE ，操作系统， CK ，
CK
OE ，操作系统， CK ，
CK
0.65
×
V
DDQ
低电平输入电压
(2)
高电平输入电压
(2)
高电平的输出电流（见
图2）
低电平输出电流（见
图2）
输入差分对的跨压
输入电压电平
输入差分电压
(2)
（见
图10）
工作自由空气的温度
–18
18
(V
DDQ
/2)-0.15
–0.3
DC
AC
0.3
0.6
0
(V
DDQ
/2)+0.15
V
DDQ
+0.3
V
DDQ
+0.4
V
DDQ
+0.4
70
mA
mA
V
V
V
V
°C
PLL被关闭并且被旁路时的AV用于测试目的
DD
被接地。在此测试模式，V
DDQ
保持内
推荐工作条件，也没有时间参数的保证。
V
ID
是在CK上的输入电平，并在CK上的输入电平之间的差的量值，见
图10
对于定义。 CK和
CK V
IH
和V
IL
界限决定的直流低电平和高电平的逻辑检测状态。
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1.8 -V锁相环时钟驱动器
特点
1.8 -V / 1.9 -V锁相环时钟驱动器，用于
双倍数据速率（ DDR II ）的应用
扩频时钟兼容
工作频率： 125 MHz至410 MHz的
应用频率： 160 MHz至410 MHz的
低抖动（循环周期） ：
±40
ps
低输出偏斜： 35 ps的
稳定时间<6
s
分配一个差分时钟输入至10
差分输出
CDCUA877高驱版
52球mBGA封装（微星少年 BGA ，
0.65毫米间距）
外部反馈引脚（ FBIN ， FBIN ）是
用于将输出同步到输入
钟
达到或超过CUA877 / CUA878
PLL规范标准
PC2-3200/4300/5300/6400
故障安全输入
描述
该CDCU2A877是分配一个差分时钟高性能，低抖动，低偏移，零延迟缓冲器
输入对（ CK，CK ），以10个差分对时钟输出（ YN， YN ），以及一个差分对反馈时钟的
输出（ FBOUT ， FBOUT ） 。时钟输出由输入时钟（ CK，CK ） ，所述反馈时钟进行控制
（ FBIN ， FBIN ）时， LVCMOS控制引脚（ OE ， OS） ，和模拟电源输入（ AV
DD
） 。当OE为低电平时，
时钟输出，除了FBOUT / FBOUT ，被禁用，同时内部PLL继续保持其锁定在
频率。 OS （输出选择）是一个程序引脚必须连接到GND或V
DD
。当OS高， OE功能
如先前所述。当操作系统和操作环境都为低， OE还没有影响到Y7 / Y7 ，他们是自由运行。
当AV
DD
接地， PLL被关闭，旁路用于测试目的。
当两个时钟输入端（ CK，CK ）为逻辑低电平时，该设备进入低功率模式。输入逻辑检测
电路上的差分输入，独立于输入缓冲器，检测所述逻辑低电平，并且执行在低
电源状态，所有输出，反馈，和PLL处于关闭状态。当被时钟输入转换
逻辑低是差分信号， PLL重新开启时，输入和输出使能，
锁相环获得反馈时钟对（ FBIN ， FBIN ）和时钟输入对（ CK，CK ）内的锁相
指定的稳定时间。
该CDCU2A877能够跟踪扩频时钟（ SSC ） ，从而降低EMI 。该器件可工作
0℃至70℃。
可选项
T
A
0 ° C至70℃
(1)
52球BGA
(1)
CDCU2A877ZQL
对于最新的封装和订购信息，请参阅
封装选项附录本文档的末尾，或见
TI的网站：
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请注意，一个重要的通知有关可用性，标准保修，并在得克萨斯州的关键应用程序使用
仪器的半导体产品和免责条款及其出现在此数据表的末尾。
微星少年是德州仪器的商标。
PRODUCTION数据信息为出版日期。
产品符合占德州条款规范
仪器标准保修。生产加工过程中不
不一定包括所有参数进行测试。
版权所有 2006年，德州仪器
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表1.端子功能
名字
AGND
AV
DD
CK
CK
FBIN
FBIN
FBOUT
FBOUT
OE
OS
GND
BGA
G1
H1
E1
F1
E6
F6
H6
G6
F5
D5
B2, B3, B4,
B5， C2，C5 ，
H2， H5 ，J2，J3 ，
J4, J5
D2, D3, D4,
E2， E5 ，F2
G2, G3, G4,
G5
MLF
7
8
4
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27
26
24
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22
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10
I
I
I
I
O
O
I
I
I / O
模拟地
模拟电源
时钟输入了（从10kΩ 100 kΩ的）下拉电阻
互补时钟输入，一个（ 10 kΩ到100 kΩ的）下拉电阻
反馈时钟输入
互补反馈时钟输入
反馈时钟输出
互补反馈时钟输出
输出使能（异步）
输出选择（连接到GND或VDD ）
地
描述
V
DDQ
1, 6, 9, 15, 20,
23, 28, 31, 36
逻辑和输出功率
Y[0:9]
A2，A1 ，D1
38, 39, 3, 11, 14,
J1 ， K3 ， A5 ， A6 ， 34 ， 33 ， 29 ， 19 ， 16
D6 ，J6 K4
A3， B1，C1，
37, 40, 2, 12, 13,
K1，K2 ，A4
35, 32, 30, 18, 17
维生素B6， C6 ，K6， K5
O
时钟输出
Y[0:9]
O
互补的时钟输出
表2.功能表
输入
AV
DD
GND
GND
GND
GND
1.8 V Nomnal
1.8 V Nomnal
1.8 V Nomnal
1.8 V Nomnal
1.8 V Nomnal
X
OE
H
H
L
L
L
L
H
H
X
X
OS
X
X
H
L
H
L
X
X
X
X
CK
L
H
L
H
L
H
L
H
LH
H
CK
H
L
H
L
H
L
H
L
L
H
Y
L
H
L
Z
LZ
Y7活动
L
Z
LZ
Y7活动
L
H
L
Z
L
Z
LZ
Y7活动
L
Z
LZ
Y7活动
H
L
L
Z
输出
Y
FBOUT
L
H
L
H
L
H
L
H
L
Z
版权所有
FBOUT
H
L
H
L
H
L
H
L
L
Z
旁路/关
旁路/关
旁路/关
旁路/关
On
On
On
On
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图1.逻辑图（正逻辑）
绝对最大额定值
在工作自由空气的温度范围内（除非另有说明）
(1)
价值
V
DDQ
A
VDD
V
I
V
O
I
IK
I
OK
I
O
I
DDC
R
θJA
R
θJC
T
英镑
(1)
(2)
(3)
(4)
电源电压范围
输入电压范围
(2) (3)
输出电压范围
(2) (3)
输入钳位电流（V
I
＆ LT ; 0或V
I
＆ GT ; V
DDQ
)
输出钳位电压（V
O
＆ LT ; 0或V
O
＆ GT ; V
DDQ
)
连续输出电流（V
O
= 0至V
DDQ
)
连续电流通过每个V
DDQ
或GND
热阻，结到环境
(4)
热阻，结到外壳
(4)
存储温度范围
没有空气流动
Airllflow 150英尺/分钟
没有空气流动
-0.5 TP 2.5
-0.5到V
DDQ
+ 0.5
-0.5到V
DDQ
+ 0.5
±50
±50
±50
±100
151.9
146.1
102.4
-65到150
°C
K / W
单位
V
V
V
mA
mA
mA
mA
强调超越那些在列
绝对最大额定值
可能对器件造成永久性损坏。这些压力额定值
只和功能在这些或任何其他条件超出下所指示的设备的操作
推荐工作
条件
是不是暗示。暴露于长时间处于最大绝对额定情况下会影响器件的可靠性。
如果输入和输出钳位电流额定值是所观察到的输入和输出电压额定值可能被超过。
这个值被限制为2.5伏的最大值。
封装的热阻抗的计算按照JESD51和JEDEC2S1P （高K板） 。
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推荐工作条件
民
V
DDQ
AV
DD
V
IL
V
IH
I
OH
I
OL
V
IX
V
I
V
ID
T
A
(1)
(2)
输出电源电压
供应
电压
(1)
OE ， OS
CK ， CK
0.65
×
V
DDQ
–18
18
(V
DDQ
/2)-0.15
–0.3
DC
AC
0.3
0.6
0
(V
DDQ
/2)+0.15
V
DDQ
+0.3
V
DDQ
+0.4
V
DDQ
+0.4
70
低电平输入电压
(2)
高电平输入电压
(2)
高电平的输出电流（见
图2）
低电平输出电流（见
图2）
输入差分对的跨压
输入电压电平
输入差分电压
(2)
（见
图4）
工作自由空气的温度
1.7
喃
1.8
V
DDQ
0.35
×
V
DDQ
V
V
mA
mA
V
V
V
V
°C
最大
1.9
单位
V
PLL被关闭并且被旁路时的AV用于测试目的
DD
被接地。在此测试模式，V
DDQ
保持内
推荐工作条件，也没有时间参数的保证。
V
ID
是在CK上的输入电平，并在CK上的输入电平之间的差的量值，见
图4
对于定义。 CK和
CK V
IH
和V
IL
界限决定的直流低电平和高电平的逻辑检测状态。
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