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CDC536
3.3 -V锁相环时钟驱动器
具有三态输出
SCAS378F - 1994年4月 - 修订1998年10月
D
D
D
D
D
D
D
D
D
D
D
D
D
低输出偏移的时钟分配
和时钟产生应用
工作在3.3 V V
CC
分配一个时钟输入至输出的六
一个选择输入配置三路输出
以操作的二分之一或双输入
频率
无需外部RC网络所需
外部反馈引脚（ FBIN ）用于
输出同步时钟输入
申请同步DRAM ，
高速微处理器
负边沿触发的清除
二分频输出
TTL兼容的输入和输出
输出驱动50 Ω并行端接
输电线路
国家的最先进的
EPIC-
ΙΙ
B
BiCMOS工艺设计
显著降低了功耗
分布式V
CC
和地引脚减少
开关噪声
塑料包装28引脚收缩型小
外形封装
DB或DL包装
（ TOP VIEW ）
AV
CC
AGND
CLKIN
SEL
OE
GND
1Y1
V
CC
GND
1Y2
V
CC
GND
1Y3
V
CC
1
2
3
4
5
6
7
8
9
10
11
12
13
14
28
27
26
25
24
23
22
21
20
19
18
17
16
15
AV
CC
AGND
FBIN
TEST
CLR
V
CC
2Y1
GND
V
CC
2Y2
GND
V
CC
2Y3
GND
描述
该CDC536是一款高性能，低偏移，低抖动时钟驱动器。它使用了一个锁相回路（PLL ），以精确地
对齐，在频率和相位，所述时钟信号输出至所述时钟输入（ CLKIN）信号。它是专门
专为同步DRAM和流行的微处理器从50 MHz工作频率的速度来使用
100 MHz或下降到25兆赫上构造为半频输出端输出。该CDC536工作在3.3 -V
V
CC
并设计用于驱动一个50-
W
传输线。
反馈输入（ FBIN ）用于同步输出时钟的频率和相位与输入时钟
（ CLKIN ） 。一项所述的六个输出时钟必须反馈到FBIN对于PLL之间保持同步
CLKIN和输出。用作反馈引脚的输出被同步到相同的频率CLKIN 。
在Y输出可以配置在相，并在相同的频率CLKIN的切换。选择（ SEL ）
输入配置三根Y输出的二分之一经营或加倍CLKIN频率取决于哪个引脚
被反馈到FBIN （见表1和表2）。所有输出信号的占空比被调整为独立的50％的
占空比的输入时钟。
输出使能（OE）提供了一种用于输出控制。当OE为高电平时，输出处于高阻抗状态。
当OE为低电平时，输出处于激活状态。试验是用于该设备的工厂测试，并且可以使用旁通
该PLL 。试验应接GND时正常工作。
含锁相环与许多产品， CDC536不需要外部RC网络。对于环路滤波器
PLL被包含在芯片上，减少了元件数量，电路板空间和成本。
请注意，一个重要的通知有关可用性，标准保修，并且在关键的应用程序中使用
德州仪器公司的半导体产品和免责条款及其出现在此数据表的末尾。
EPIC - ΙΙB是德州仪器的商标。
PRODUCTION数据信息为出版日期。
产品符合每德州仪器条款规范
标准保修。生产加工并不包括
所有测试参数。
版权
1998年，德州仪器
邮政信箱655303
达拉斯，德克萨斯州75265
1
CDC536
3.3 -V锁相环时钟驱动器
具有三态输出
SCAS378F - 1994年4月 - 修订1998年10月
描述（续）
因为它是基于锁相环电路，所述CDC536需要一个稳定时间以达到锁相
反馈信号与参考信号。这个稳定时间要求如下开机和应用
一个固定频率的，在CLKIN的固定相位信号以及下列任何改变PLL的参考或
反馈信号。这种变化发生时的选择输入的变化，通过测试使能PLL ，并且在
通过启用OE所有输出。
该CDC536的特点是操作从0℃至70℃。
输出配置的详细描述
压控振荡器（VCO）中的CDC536具有100兆赫到200兆赫的频率范围内，两次
工作频率范围的CDC536输出。 VCO的输出是由两个与由4到分
提供参考频率的二分之一和四分之一VCO的频率为50 ％的占空比。该SEL0
和SEL1输入决定哪两个信号进行缓冲，以对设备输出的每个组。
一台设备的输出必须从外部连接到FBIN完成PLL 。 VCO的工作，使得所述
这个输出的频率相匹配的CLKIN信号。在一个VCO / 2的输出被连接到FBIN的情况下，
压控振荡器必须工作在CLKIN频率的两倍，从而导致设备的输出，在相同的操作或
二分之一的CLKIN频率。如果一个VCO / 4输出连接到FBIN ，器件输出的同时运行，或
于CLKIN频率的两倍。
输出配置一
输出配置A是有效的，当在表1中配置为一个1×频率输出任何输出被反馈到
在FBIN输入。输入频率范围为CLKIN的输入为50兆赫到100兆赫使用输出时
配置配置A.输出为1/ 2×输出的一半CLKIN频率运行，同时输出
配置为1×输出的频率相同的CLKIN输入操作。
表1.输出配置一
输入
SEL
L
H
注： n = 1时，2，3
输出
1/2
×
频率
无
1Yn
1
×
频率
所有
2Yn
输出配置B
输出配置B是有效的，当在表2中配置为一个1×频率输出任何输出被反馈到
FBIN 。输入频率范围为CLKIN的输入是25MHz至50MHz的使用输出配置B时
配置输出， 1 ×输出在CLKIN频率运行，同时配置为2 ×输出输出
操作在CLKIN输入的两倍的频率。
表2.输出配置B
输入
SEL
L
H
注： n = 1时，2，3
输出
1
×
频率
所有
1Yn
2
×
频率
无
2Yn
2
邮政信箱655303
达拉斯，德克萨斯州75265
CDC536
3.3 -V锁相环时钟驱动器
具有三态输出
SCAS378F - 1994年4月 - 修订1998年10月
功能框图
OE
5
24
CLR
26
锁相环
3
CLKIN
TEST
25
SEL
4
邮政信箱655303
达拉斯，德克萨斯州75265
B
2
7
1Y1
10
1Y2
13
1Y3
22
2Y1
19
2Y2
16
2Y3
3
FBIN
B
2
CDC536
3.3 -V锁相环时钟驱动器
具有三态输出
SCAS378F - 1994年4月 - 修订1998年10月
终端功能
终奌站
名字
号
I / O
描述
时钟输入。 CLKIN提供时钟信号由CDC536时钟驱动电路进行分配。 CLKIN使用
以提供所述参考信号，以集成的锁相环生成该时钟输出信号。 CLKIN
必须有一个固定的频率和固定的相位，为了使锁相回路，以获得相位锁定。一旦
电路被加电和有效CLKIN的信号时，需要为锁相回路的稳定化时间
到相位锁定反馈信号到它的参考信号。
CLR仅用于测试目的。
反馈输入。 FBIN提供反馈信号到内部PLL 。 FBIN必须被硬连接到的所述一个
6时钟输出，以提供频率和相位锁定。内部PLL调节输出时钟，以获得零
该FBIN和差动CLKIN的输入之间的相位延迟。
输出使能。 OE为输出使能所有输出。当OE为低电平时，所有输出被使能。当OE
高，所有输出均处于高阻抗状态。由于用于所述锁相环的反馈信号被取
直接从一个输出端，把输出端处于高阻抗状态，中断反馈环路;因此，
当高到低电平的转换发生在OE ，使输出缓冲器之前，需要一个稳定时间
该锁相环获得相位锁定。
输出配置选择。 SEL选定为每个输出组（例如1× 1/ 2×或2× ）的输出配置。
（见表1和表2）。
试验是用来绕过锁相环电路，用于该设备的工厂测试。当测试低，所有的
输出工作使用PLL电路。当测试为高时，输出被放置在一个测试模式，绕过
该PLL电路。测试应接地正常运行。
这些输出由SEL配置以发射一半或四分之一VCO的频率。该
于CLKIN频率和输出频率之间的关系依赖于SEL 。的占空比
Y输出信号的标称值为50％时，独立于CLKIN信号的占空比。
这些输出传送一半的VCO的频率。于CLKIN次数之间的关系
输出频率取决于输出的频率反馈到FBIN 。的占空比
Y输出信号是独立于CLKIN信号的占空比的标称的50％。
CLKIN
3
I
CLR
FBIN
24
26
I
I
OE
5
I
SEL
4
I
TEST
25
I
1Y1 – 1Y3
7, 10, 13
O
2Y1 – 2Y3
22, 19, 16
O
4
邮政信箱655303
达拉斯，德克萨斯州75265
CDC536
3.3 -V锁相环时钟驱动器
具有三态输出
SCAS378F - 1994年4月 - 修订1998年10月
在工作自由空气的温度范围内绝对最大额定值（除非另有说明）
电源电压范围，V
CC
。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 - 0.5 V至4.6 V
输入电压范围，V
I
（见注1 ） 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 - 0.5 V至7 V
电压范围适用于任何输出高电平状态或关机状态下，V
O
（见注1 ） 。 。 。 - 0.5 V至5.5 V
电流转换成处于低状态的任何输出，我
O
。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 64毫安
输入钳位电流，I
IK
(V
I
< 0）。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 - 20毫安
输出钳位电流，I
OK
(V
O
< 0）。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 - 50毫安
在T最大功耗
A
= 55 ° C（在静止空气中） （见注2 ） ： DB包。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 0.68 W
DL包。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 0.7 W
工作的自由空气的温度范围内，T
A
。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 0 ° C至70℃
存储温度范围，T
英镑
。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 - 65 ℃150 ℃的
超出“绝对最大额定值”列出的强调可能会造成永久性损坏设备。这些压力额定值只，和
该设备在这些或超出下标明的任何其他条件的功能操作“推荐工作条件”不
暗示。暴露于长时间处于最大绝对额定情况下会影响器件的可靠性。
注意：如果输入和输出钳位电流额定值观察1的输入和输出负电压额定值可能被超过。
2.最大的封装功耗采用150 ° C的结温为75密耳板的走线长度计算。
欲了解更多信息，请参阅
封装的热考虑
应用笔记中
ABT先进的BiCMOS技术数据
书，
文献编号SCBD002 。
推荐工作条件（见注3 ）
民
VCC
VIH
VIL
VI
IOH
IOL
电源电压
高电平输入电压
低电平输入电压
输入电压
高电平输出电流
低电平输出电流
0
0
3
2
0.8
5.5
– 32
32
70
最大
3.6
单位
V
V
V
V
mA
mA
°C
TA
工作自由空气的温度
注3 ：未使用的输入必须保持为高或低。
电气特性在推荐工作的自由空气的温度范围内（除非
另有说明）
参数
VIK
VOH
VOL
II
IOZH
IOZL
ICC
Ci
Co
VCC = 3 V ，
VCC = MIN到MAX ，
VCC = 3 V ，
VCC = 3 V ，
VCC = 3 V ，
VCC = 0或MAX ，
VCC = 3.6 V ，
VCC = 3.6 V ，
VCC = 3.6 V ，
VCC = 3.6 V ，
36V
VI = VCC或GND
VI = VCC或GND
VO = VCC或GND
测试条件
II = -18毫安
IOH = - 100
A
IOH = - 32毫安
IOL = 100
A
IOL = 32毫安
VI = 3.6 V
VI = VCC或GND
VO = 3 V
VO = 0
输出高电平
IO = 0
0,
输出低电平
输出禁用
TA = 25°C
民
最大
–1.2
VCC - 0.2
2
0.2
0.5
±10
±1
10
– 10
2
2
2
6
9
pF
pF
mA
单位
V
V
V
A
A
A
对于显示为MIN和MAX的条件下，使用推荐的工作条件下，指定相应的值。
邮政信箱655303
达拉斯，德克萨斯州75265
5
CDC536
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SCAS378G - 1994年4月 - 修订2004年7月
具有三态输出的3.3V锁相环时钟驱动器
特点
低输出偏移的时钟分配和
时钟产生应用
工作在3.3 V V
CC
分配一个时钟输入至输出的六
一个选择输入配置三路输出到
工作在一半或双输入
频率
无需外部RC网络所需
外部反馈引脚（ FBIN ）用于
输出同步时钟输入
申请同步DRAM ，
高速微处理器
负边沿触发的清除
二分频输出
TTL兼容的输入和输出
输出驱动50 Ω并行端接
输电线路
国家的最先进的
EPIC -IIB
BiCMOS工艺设计
显著降低了功耗
分布式V
CC
和地引脚减少
开关噪声
塑料包装28引脚收缩型小
外形封装
DB或DL包装
（ TOP VIEW ）
AV
CC
AGND
CLKIN
SEL
OE
GND
1Y1
V
CC
GND
1Y2
V
CC
GND
1Y3
V
CC
1
2
3
4
5
6
7
8
9
10
11
12
13
14
28
27
26
25
24
23
22
21
20
19
18
17
16
15
AV
CC
AGND
FBIN
TEST
CLR
V
CC
2Y1
GND
V
CC
2Y2
GND
V
CC
2Y3
GND
描述
该CDC536是一款高性能，低偏移，低抖动时钟驱动器。它使用了一个锁相回路（PLL ），以精确地
对齐，在频率和相位，所述时钟信号输出至所述时钟输入（ CLKIN）信号。它是专门
专为同步DRAM和流行的微处理器从50 MHz工作频率的速度来使用
100 MHz或下降到25兆赫上构造为半频输出端输出。该CDC536工作在3.3 -V
V
CC
并设计用于驱动一个50 - W传输线。
反馈输入（ FBIN ）用于同步输出时钟的频率和相位与输入时钟
（ CLKIN ） 。一项所述的六个输出时钟必须反馈到FBIN对于PLL之间保持同步
CLKIN和输出。用作反馈引脚的输出被同步到相同的频率CLKIN 。
在Y输出可以配置在相，并在相同的频率CLKIN的切换。选择（ SEL ）输入
配置三根Y输出的二分之一进行操作，或加倍CLKIN的频率取决于哪个引脚被馈
回FBIN （见表1和表2）。所有输出信号的占空比被调整为独立的占空50％的
周期的输入时钟。
输出使能（OE）提供了一种用于输出控制。当OE为高电平时，输出处于高阻抗状态。
当OE为低电平时，输出处于激活状态。试验是用于该设备的工厂测试，并且可以使用旁通
该PLL 。试验应接GND时正常工作。
请注意，一个重要的通知有关可用性，标准保修，并在得克萨斯州的关键应用程序使用
仪器的半导体产品和免责条款及其出现在此数据表的末尾。
EPIC -IIB
是Texas Instruments公司的商标。
PRODUCTION数据信息为出版日期。
产品符合占德州条款规范
仪器标准保修。生产加工过程中不
不一定包括所有参数进行测试。
版权所有 1994-2004年，德州仪器
CDC536
SCAS378G - 1994年4月 - 修订2004年7月
www.ti.com
含锁相环与许多产品， CDC536不需要外部RC网络。对于环路滤波器
PLL被包含在芯片上，减少了元件数量，电路板空间和成本。
因为它是基于锁相环电路，所述CDC536需要一个稳定时间以达到锁相
反馈信号与参考信号。这个稳定时间要求的下列权力和应用
固定频率，在CLKIN的固定相位信号以及下列任何改变PLL的参考或反馈
信号。这种变化发生时的选择输入的变化，通过测试使能PLL ，并在启用
通过OE所有输出。
该CDC536的特点是操作从0℃至70℃。
输出配置的详细描述
压控振荡器（VCO）中的CDC536具有100兆赫到200兆赫的频率范围内，两次
工作频率范围的CDC536输出。 VCO的输出是由两个与由4到分
提供参考频率的二分之一和四分之一VCO的频率为50 ％的占空比。该SEL0
和SEL1输入决定哪两个信号进行缓冲，以对设备输出的每个组。
一台设备的输出必须从外部连接到FBIN完成PLL 。 VCO的工作，使得所述
这个输出的频率相匹配的CLKIN信号。在一个VCO / 2的输出被连接到FBIN的情况下，该
压控振荡器必须工作在CLKIN频率的两倍，导致其在相同或二分之一操作装置输出
在CLKIN频率。如果一个VCO / 4的输出被连接到FBIN ，该装置的输出在相同或两次的操作
CLKIN频率。
输出配置一
输出配置A是有效的，当在表1中配置为一个1×频率输出任何输出被反馈到所述
FBIN输入。输入频率范围为CLKIN的输入为50兆赫到100兆赫使用输出时
配置配置A.输出为1/ 2×输出的一半CLKIN频率运行，同时输出
配置为1×输出的频率相同的CLKIN输入操作。
表1.输出配置一
输入
SEL
L
H
1/2×
频率
无
1Yn
输出
1×
频率
所有
2Yn
输出配置B
输出配置B是有效的，当在表2中配置为一个1×频率输出任何输出被反馈到
FBIN 。输入频率范围为CLKIN的输入是25MHz至50MHz的使用输出配置B时
配置输出， 1 ×输出在CLKIN频率运行，同时配置为2 ×输出输出
操作在CLKIN输入的两倍的频率。
表2.输出配置B
输入
SEL
L
H
1×
频率
所有
1Yn
输出
2×
频率
无
2Yn
2
CDC536
www.ti.com
SCAS378G - 1994年4月 - 修订2004年7月
功能框图
OE
5
24
CLR
26
FBIN
锁相环
B2
3
CLKIN
TEST
25
SEL
4
B2
7
1Y1
10
1Y2
13
1Y3
22
2Y1
19
2Y2
16
2Y3
3
CDC536
SCAS378G - 1994年4月 - 修订2004年7月
www.ti.com
功能框图（续）
终端功能
终奌站
名字
号
I / O
描述
时钟输入。 CLKIN提供时钟信号由CDC536时钟驱动电路进行分配。 CLKIN是
用于提供基准信号给所述集成锁相环路，其产生的时钟输出
信号。 CLKIN必须有一个固定的频率和固定的相位，为了使锁相回路，以获得
相位锁定。一旦电路被加电和有效CLKIN的信号时，一个稳定时间是
到相位锁定反馈信号到它的基准信号所需的锁相环。
CLR仅用于测试目的。 CLR连接到GND正常运行。
反馈输入。 FBIN提供反馈信号到内部PLL 。 FBIN必须被硬连接到一个
的6个时钟输出，以提供频率和相位锁定。内部PLL调节输出时钟
获得FBIN和差动CLKIN的输入之间的零相位延迟。
输出使能。 OE为输出使能所有输出。当OE为低电平时，所有输出被使能。当OE
为高电平时，所有输出处于高阻抗状态。由于用于所述锁相环的反馈信号是
直接从一个输出取，将所述输出端处于高阻抗状态，中断反馈环路;
因此，当从高至低跳变发生在OE ，使输出缓冲器，一个稳定时间
该锁相回路之前需要获得相位锁定。
输出配置选择。 SEL选择为每个输出组的输出配置（例如1 × 1/ 2× ，或
2× ） 。 （参照表1和表2）。
试验是用来绕过锁相环电路，用于该设备的工厂测试。当测试低，
所有输出操作使用PLL电路。当测试为高时，输出被放置在一个测试模式
绕过PLL电路。测试应接地正常运行。
这些输出由SEL配置以发射一半或四分之一VCO的频率。该
于CLKIN频率和输出频率之间的关系依赖于SEL 。占空比
Y输出信号的标称值为50％时，独立于CLKIN信号的占空比。
这些输出传送一半的VCO的频率。于CLKIN频率之间的关系
和输出频率取决于输出的频率反馈到FBIN 。税
Y输出信号的周期是独立于CLKIN信号的占空比的标称的50％。
CLKIN
3
I
CLR
FBIN
24
26
I
I
OE
5
I
SEL
TEST
4
25
I
I
1Y1-1Y3
7, 10, 13
O
2Y1-2Y3
22, 19, 16
O
绝对最大额定值
在工作自由空气的温度范围内（除非另有说明）
(1)
单位
电源电压范围，V
CC
输入电压范围，V
I
（见
(2)
)
(2)
)
-0.5 V至4.6 V
-0.5V至7V的
-0.5 V至5.5 V
64毫安
-20毫安
-50毫安
(3)
):
电压范围适用于任何输出高电平状态或关机状态下，V
O
（见
电流转换成处于低状态的任何输出，我
O
输入钳位电流，I
IK
(V
I
< 0 ）
输出钳位电流，I
OK
(V
O
< 0 ）
在T最大功耗
A
= 55 ° C（在静止空气中） （见
工作的自由空气的温度范围内，T
A
存储温度范围，T
英镑
(1)
(2)
(3)
DB包装
DL包装
0.68 W
0.7 W
0 ° C至70℃
-65 ℃150 ℃的
超越那些在"absolute最大额定值讲“ ，可能会对设备造成永久性损坏。这些压力额定值
只，而根据"recommended操作指示的装置，在这些或超出任何其他条件的功能操作
条件“是不是暗示。暴露于长时间处于最大绝对额定情况下会影响器件的可靠性。
如果输入和输出钳位电流额定值是所观察到的输入和输出负电压额定值可能被超过。
最大的封装功耗采用150 ° C的结温为75密耳板的走线长度计算。为
更多信息，请参阅
封装的热考虑
应用笔记中
ABT先进的BiCMOS技术数据手册，
文献编号SCBD002 。
4
CDC536
www.ti.com
SCAS378G - 1994年4月 - 修订2004年7月
(1)
推荐工作条件（见
V
CC
V
IH
V
IL
V
I
I
OH
I
OL
T
A
(1)
电源电压
高电平输入电压
低电平输入电压
输入电压
高电平输出电流
低电平输出电流
工作自由空气的温度
未使用的输入必须保持高电平或低电平。
)
民
3
2
0.8
0
5.5
32
32
0
70
最大
3.6
单位
V
V
V
V
mA
mA
°C
电气特性
在推荐工作的自由空气的温度范围（除非另有说明）
参数
V
IK
V
OH
V
OL
I
I
I
OZH
I
OZL
I
CC
C
i
C
o
(1)
V
CC
= 3 V,
V
CC
=最小值到最大值
(1)
,
V
CC
= 3 V,
V
CC
= 3 V,
V
CC
= 3 V,
V
CC
= 0或最大值
(1)
,
V
CC
= 3.6 V,
V
CC
= 3.6 V,
V
CC
= 3.6 V,
V
CC
= 3.6 V，I
O
= 0, V
I
= V
CC
或GND
V
I
= V
CC
或GND
V
O
= V
CC
或GND
测试条件
I
I
= -18毫安
I
OH
= -100 A
I
OH
= -32毫安
I
OL
= 100 A
I
OL
= 32毫安
V
I
= 3.6 V
V
I
= V
CC
或GND
V
O
= 3 V
V
O
= 0
输出高电平
输出低电平
输出禁用
2
0.2
0.5
±10
±1
10
10
2
2
2
6
9
pF
pF
mA
T
A
= 25°C
最小最大
1.2
V
CC
-0.2
单位
V
V
V
A
A
A
对于显示为最小值或最大值的条件下，使用推荐的工作条件下，指定相应的值。
时序要求
在推荐的电源电压范围和经营自由空气温度
民
f
时钟
时钟频率
输入时钟的占空比
SEL后
稳定时间
(1)
OE ↑后
电后
CLKIN后
(1)
当压控振荡器工作在四倍于CLKIN频率
当VCO运行在两倍CLKIN频率
25
50
40%
最大
50
100
60%
50
50
50
50
s
单位
兆赫
所需时间为一体的PLL电路，以获得它的反馈信号的相位锁定到它的参考信号。为了使相位锁定到
来获得，固定频率，固定相位基准信号必须存在于CLKIN 。直到获得相位锁定，规格
传播延迟和开关特性表中给出偏移参数不适用。
5
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