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82C84A
数据表
2005年12月6日
FN2974.3
CMOS时钟发生器驱动器
Intersil的82C84A是一种高性能的CMOS时钟
发生器驱动器，其目的是提供服务的要求
CMOS和NMOS的微处理器，如对
80C86 ， 80C88 ， 8086和8088。该芯片包含一个晶体
控制振荡器，一个分频计数器3和完整
“就绪” ，并同步复位逻辑。
静态CMOS电路设计允许与外部操作
频率源从DC至25MHz的。晶控
操作，以25MHz的是保证在使用一个平行的
基本模式晶体和两个小负载电容。
所有输入（除X1和RES ）的TTL兼容了
温度和电压范围。
耗电量的，等效的一小部分
双极性电路。这个速度，功耗CMOS的特征
允许设计人员量身定制自己的系统设计
对于功率和/或速度的要求。
特点
生成系统时钟的CMOS或NMOS
微处理器
高达25MHz的操作
使用并行模式晶振电路或外部
频率源
提供同步就绪
生成系统由施密特触发器复位输出
输入
TTL兼容输入/输出
极低功耗
单5V电源
工作温度范围
- C82C84A 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 0 ° C至+ 70°C
- I82C84A 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -40 ° C至+ 85°C
- M82C84A 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -55 ° C至+ 125°C
无铅加退火有（符合RoHS ）
订购信息
部分
数
CP82C84A
CP82C84AZ
（见注）
IP82C84A
CS82C84A
CS82C84AZ
（注）
部分
记号
CP82C84A
CP82C84AZ
IP82C84A
CS82C84A
CS82C84AZ
温度。
范围（° C）
0至+70
0至+70
-40至+85
0至+70
0至+70
0至+70
包
18 Ld的PDIP
18 Ld的PDIP *
（无铅）
18 Ld的PDIP
20 Ld的PLCC
20 Ld的PLCC
（无铅）
PKG 。
DWG 。 ＃
E18.3
E18.3
E18.3
N20.35
N20.35
引脚配置
CSYNC
PCLK
AEN1
RDY1
准备
RDY2
AEN2
CLK
GND
82C84A （ PDIP ， CERDIP ）
顶视图
1
2
3
4
5
6
7
8
9
18
17
16
15
14
13
12
11
10
V
CC
X1
X2
ASYNC
EFI
F / C
OSC
水库
RESET
CS82C84AZ96 CS82C84AZ
（注）
IS82C84A
CD82C84A
ID82C84A
MD82C84A/B
8406801VA
MR82C84A/B
84068012A
IS82C84A
CD82C84A
ID82C84A
MD82C84A/B
8406801VA
MR82C84A/B
84068012A
N20.35
20 Ld的PLCC
磁带和卷轴
（无铅）
20 Ld的PLCC
N20.35
18 Ld的CERDIP
F18.3
18 Ld的CERDIP
F18.3
-40至+85
0至+70
-40至+85
PCLK
AEN1
V
CC
20
-55到+125 20垫CLCC
J20.A
-55到+125 20垫CLCC
J20.A
SMD ＃
RDY1
准备
RDY2
AEN2
NC
4
5
6
7
8
3
2
1
19
18
17
16
15
14
X2
ASYNC
EFI
F / C
NC
*无铅PDIPs可用于通孔波焊处理
只。他们不打算在回流焊接加工利用
应用程序。
注： Intersil无铅加退火产品采用特殊的无铅
材料套;模塑料/晶片的附属材料和100 ％雾
锡板终止完成，这是符合RoHS标准，兼容
既锡铅和无铅焊接操作。 Intersil无铅
产品分类MSL在无铅峰值回流温度下
达到或超过IPC / JEDEC J STD- 020对无铅要求。
9
CLK
10
GND
11
RESET
12
水库
13
OSC
1
注意：这些器件对静电放电敏感;遵循正确的IC处理程序。
1-888- INTERSIL或1-888-468-3774
|
Intersil公司（和设计）是Intersil Americas Inc.公司的注册商标。
版权所有Intersil公司美洲1997年， 2002年， 2005年版权所有
提及的所有其他商标均为其各自所有者的财产。
X1
-55到+125 18 Ld的CERDIP
F18.3
SMD ＃
CSYNC
-55到+125 18 Ld的CERDIP
F18.3
82C84A （ PLCC ， CLCC ）
顶视图
82C84A
工作原理图
11
水库
X1
X2
17
16
XTAL
振荡器
D
CK
Q
10
RESET
12
OSC
F / C
EF1
CSYNC
RDY1
AEN1
RDY2
AEN2
ASYNC
13
14
1
4
3
6
7
15
CK
D
Q
FF1
÷
3
SYNC
÷
2
SYNC
2
PCLK
8
CLK
CK
5
D
Q
FF2
准备
控制引脚
F / C
水库
RDY1 ， RDY2
AEN1 ， AEN2
ASYNC
逻辑1
外部时钟
正常
公交就绪
解决残疾人
1准备阶段
同步
逻辑0
液晶驱动
RESET
公交车未就绪
地址启用
2级就绪
同步
2
FN2974.3
2005年12月6日
82C84A
引脚说明
符号
AEN1,
AEN2
数
3, 7
TYPE
I
描述
地址使能： AEN为低电平信号。 AEN用来限定其各自的总线就绪
信号（ RDY1和RDY2 ） 。 AEN1验证RDY1而AEN2验证RDY2 。两个AEN信号输入是
有用的系统配置，其允许处理器访问两个多主机系统总线。
在非多主机配置， AEN信号输入与真（ LOW） 。
BUS READY （传输完成） 。 RDY为高电平有效信号，则表明从设备
位于该数据已经被接收，或者被提供RDY1由AEN1合格的系统数据总线上
而RDY2是AEN2合格。
READY同步选择：是异步输入定义的同步模式
READY（就绪）的逻辑。当ASYNC为低电平时，设置就绪同步的两个阶段。当
ASYNC是左开或HIGH ，设置就绪同步的单级。
准备：准备为高电平有效信号是同步的RDY信号输入。 READY是
清除已达到承诺保持时间到处理器后。
晶体中： X1和X2是向其中一个晶体所连接的引脚。晶振频率为3次
所需的处理器的时钟频率， （注1） 。
频率/ CRYSTAL选择： F / C是一个魁梧的选择。当绑低。 F / C允许
要由晶体生成处理器的时钟。当F / C绑高， CLK是用于生成
电喷输入， （注1） 。
外部频率IN：当F / C绑高， CLK由输入频率生成
出现在此引脚。输入信号是一个方波所需CLK的3倍的频率
输出。
处理器时钟： CLK为所使用的处理器的时钟输出，且所有设备直接哪
连接到处理器的局部总线。 CLK具有输出频率为晶体或EFI的三分之一
输入频率和一个1/3的占空比。
外设时钟： PCLK是外围时钟信号，其输出频率为1/2 CLK的
并具有50 ％的占空比。
振荡器输出：振荡器是内部振荡器电路的输出。其频率等于
该晶体的。
RESET IN ： RES是其用于产生复位的低电平有效信号。该82C84A提供
施密特触发器输入，使得一个RC连接可用于建立适当的电复位
持续时间。
RESET ：复位是用来重置80C86系列处理器的高电平信号。其时序
特性由RES确定。
时钟同步： CSYNC是一个高电平有效信号，它允许多个82C84As是
同步提供的时钟是同相的。当CSYNC是HIGH内部计数器复位。
当CSYNC变低的内部计数器被允许重新开始计数。 CSYNC需要
外部同步到EFI 。当使用内部振荡器CSYNC应以硬连线
地面上。
地
V
CC
：在+ 5V电源引脚。 V之间的0.1μF电容
CC
和GND推荐
脱钩。
RDY1,
RDY2
ASYNC
4, 6
I
15
I
准备
X1, X2
F / C
5
17, 16
13
O
IO
I
EFI
14
I
CLK
8
O
PCLK
OSC
水库
2
12
11
O
O
I
RESET
CSYNC
10
1
O
I
GND
V
CC
注意：
9
18
1.如果不使用晶振输入X1必须连接到V
CC
或GND和X2应由开放。
3
FN2974.3
2005年12月6日
82C84A
功能说明
振荡器
在82C84A的振荡电路的设计主要是为
与外部并联谐振的基础模式下使用
晶体从该基本操作频率而得。
晶体的频率应在3倍进行选择
所需的CPU时钟。 X1和X2是两个晶体输入
水晶连接。对的最稳定的操作
振荡器（OSC ）输出的电路中，两个电容器（ C1 = C2 ），为
在该波形图中所示的推荐。该
振荡器的输出缓冲，并带出对OSC
使其他系统的定时信号可以从该衍生
稳定，晶控源。
表1.水晶规格
参数
频率
操作类型
不需要的模
负载电容
典型的晶体SPEC
2.4 - 25MHz的，基本的， “ AT ”切
并行
6分贝（最低）
18 - 32pF
时钟输出
在CLK输出为33 ％占空比的时钟驱动器设计
直接驱动80C86 ， 80C88处理器。 PCLK是
外设时钟信号，其输出频率为1/2的
CLK 。 PCLK具有50 ％的占空比。
复位逻辑
复位逻辑提供了一个施密特触发器输入（ RES ）和
同步IP- FL佛罗里达州运来产生复位时序。复位
信号被同步到CLK的下降沿。一个简单的RC
网络可用于通过利用该提供上电复位
功能82C84A的。
准备同步
两个READY输入（ RDY1 ， RDY2 ）被提供给
容纳两个系统总线。每路输入都有限定
（ AEN1和AEN2 ，分别地） 。该AEN信号验证
它们各自的RDY信号。如果在多主机系统不
正在使用的AEN引脚应连接低电平。
同步是必需的所有异步主动正在进行
任RDY输入的边缘，以保证该RDY设置
时间和保持时间得到满足。非活动持续RDY的边缘
通常准备系统不需要同步，但
必须满足RDY建立和保持的适当的系统的问题
设计。
异步输入定义READY两种模式
同步操作。
当异步为低时，同步的两个阶段是
提供用于活性就绪输入信号。正向
异步READY输入将第一个被同步到倒装
触发器CLK的上升沿1 （需要一个建立时间
tR1VCH ）和同步到触发器2在下一
CLK下降沿，在这之后时间就绪输出将为
有效（高电平） 。负向异步READY输入
将直接同步到触发器2的下降沿
CLK的，之后，在准备就绪输出将变为无效。这
操作模式用于异步使用
（通常没有准备好） ，在系统中无法设备
通过设计保证，以满足所需的RDY安装时间，
TR1VCL ，在每个总线周期。
当async为高电平或悬空时，先准备好触发器是
绕过处于READY同步逻辑。 READY输入
由佛罗里达州的ip-佛罗里达州运2在CLK的下降沿同步
前它们被提交给处理器。此模式是
可用于该可保证同步设备
满足所需的RDY准备时间。
ASYNC可以在每个总线周期来改变选择
同步用于在每台设备相应的模式
系统。
电容器C1，C2进行选择，使得它们的组合
电容
C1 X C2
-
CT =
---------------------
（包括杂散电容）
C1 + C2
由晶体相匹配的负载电容为特定网络版
制造商。这确保了频率范围内操作
宽容特定网络版由晶体制造商。
时钟发生器
时钟发生器由一个同步分频的副产品
3计数器与一个特殊的清除输入的抑制
计数。这清零输入（ CSYNC ）允许输出时钟
与外部事件（如相互同步
82C84A时钟） 。有必要同步CSYNC
输入到外部的82C84A电喷时钟。这是
通过两个触发器。 （参见图1）。计数器
输出为三分之一输入一个33 ％占空比的时钟
频率。
注： F / C输入是一个魁梧的引脚，或者选择水晶
振荡器或电喷输入作为时钟的
÷
3计数器。如果
在EFI输入作为时钟源，所述振荡器
部分可以独立地用于另一时钟源。
输出取自OSC 。
4
FN2974.3
2005年12月6日
82C84A
EFI
时钟
同步
EFI
D
Q
D
Q
82C84A
CSYNC
＆ GT ;
＆ GT ;
（如其它82C84As ）
注：如果EFI输入时，则晶振输入X1必须连接到V
CC
或GND和X2应由开放。如果晶体的输入时，
然后EFI应该连接到V
CC
或GND 。
图1 CSYNC同步
5
FN2974.3
2005年12月6日
82C84A
1997年3月
CMOS时钟发生器驱动器
描述
Intersil的82C84A是一种高性能的CMOS时钟发电机 -
驱动器，其被设计成服务于这两个CMOS的要求
和NMOS的微处理器，如80C86 ， 80C88 ， 8086和
在8088的芯片包含一个晶体控制振荡器，分频逐
3计数器和完整的“准备”同步和复位逻辑。
静态CMOS电路设计允许与外部频操作
昆西源从DC至25MHz的。晶控操作
25MHz的是保证与使用平行，基本模式
水晶和两个小负载电容。
所有输入（除X1和RES ）的TTL兼容了温
自命电压范围。
耗电量是，等效双极税务局局长的一小部分
cuits 。这个速度，功耗CMOS特性允许
设计师量身定制自己的系统设计对于电源
和/或速度的要求。
特点
生成系统时钟的CMOS或NMOS
微处理器
高达25MHz的操作
使用并行模式晶振电路或外部
频率源
提供同步就绪
生成系统由施密特触发器复位输出
输入
TTL兼容输入/输出
极低功耗
单5V电源
工作温度范围
- C82C84A 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 0.0
o
C至+70
o
C
- I82C84A 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -40
o
C至+ 85
o
C
- M82C84A 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -55
o
C至+ 125
o
C
订购信息
部分
数
CP82C84A
IP82C84A
CS82C84A
IS82C84A
CD82C84A
ID82C84A
MD82C84A/B
8406801VA
MR82C84A/B
84068012A
-55
o
C至+ 125
o
C
TEMP 。 RANGE
0
o
C至+70
o
C
-40
o
C至+ 85
o
C
0
o
C至+70
o
C
-40
o
C至+ 85
o
C
0
o
C至+70
o
C
-40
o
C至+ 85
o
C
-55
o
C至+ 125
o
C
SMD ＃
20垫CLCC
SMD ＃
包
18 Ld的PDIP
20 Ld的PLCC
PKG 。
号
E18.3
E18.3
N20.35
N20.35
18 Ld的CERDIP F18.3
F18.3
F18.3
F18.3
J20.A
J20.A
引脚配置
82C84A （ PDIP ， CERDIP ）
顶视图
CSYNC
PCLK
AEN1
RDY1
准备
RDY2
AEN2
CLK
GND
1
2
3
4
5
6
7
8
9
18
17
16
15
14
13
12
11
10
V
CC
X1
X2
RDY1
ASYNC
准备
EFI
F / C
OSC
水库
RESET
RDY2
AEN2
NC
4
5
6
7
8
9
CLK
10
GND
11
RESET
12
水库
13
OSC
82C84A （ PLCC ， CLCC ）
顶视图
CSYNC
PCLK
AEN1
V
CC
20
3
2
1
19
18
17
16
15
14
X2
ASYNC
EFI
F / C
NC
X1
注意：这些器件对静电放电敏感;遵循正确的IC处理程序。
http://www.intersil.com或407-727-9207
|
版权
Intersil公司1999
网络文件编号
2974.1
4-287
82C84A
工作原理图
11
水库
X1
X2
17
16
XTAL
振荡器
D
CK
Q
10
RESET
12
OSC
F / C
EF1
CSYNC
RDY1
AEN1
RDY2
AEN2
ASYNC
13
14
1
4
3
6
7
15
CK
D
Q
FF1
÷
3
SYNC
÷
2
SYNC
2
PCLK
8
CLK
CK
5
D
Q
FF2
准备
控制引脚
F / C
水库
RDY1 ， RDY2
AEN1 ， AEN2
ASYNC
逻辑1
外部时钟
正常
公交就绪
解决残疾人
1准备阶段
同步
逻辑0
液晶驱动
RESET
公交车未就绪
地址启用
2级就绪
同步
4-288
82C84A
引脚说明
符号
AEN1,
AEN2
数
3, 7
TYPE
I
描述
地址使能： AEN为低电平信号。 AEN用来限定其各自的总线
READY信号（ RDY1或RDY2 ） 。 AEN1验证RDY1而AEN2验证RDY2 。两个AEN
信号输入是在系统的配置，其允许处理器访问两个多有用
主系统总线。在非多主机配置， AEN信号输入与真实
（低） 。
BUS READY （传输完成） 。 RDY为高电平有效信号，则表明从
设备位于该数据已经被接收，或者在系统数据总线上可用RDY1是的质
通过AEN1后指定，而RDY2由AEN2合格。
READY同步选择： ASYNC是输入限定所述同步
就绪逻辑的方式。当ASYNC为低电平时， READY同步的两个阶段是亲
vided 。当异步保持打开或HIGH时， READY同步的单级设置。
准备：准备为高电平有效信号是同步的RDY信号输入。 READY
被清除已经达到保证的保持时间后处理器。
晶体中： X1和X2是向其中一个晶体所连接的引脚。晶振频率为3
次所需的处理器的时钟频率， （注1） 。
频率/ CRYSTAL选择： F / C是一个魁梧的选择。当绑低。 F / C证
要由晶体生成该处理器的时钟。当F / C绑高， CLK为gen-
erated对EFI·输入， （注1） 。
外部频率IN：当F / C绑高， CLK从输入生成频
昆西出现在此引脚。输入信号是一个方波在DE-的3倍的频率
sired CLK输出。
处理器时钟： CLK为所使用的处理器的时钟输出和其中二 - 所有设备
请直接连接到处理器的局部总线。 CLK具有输出频率为crys-的三分之一
河谷或EFI输入频率和一个1/3的占空比。
外设时钟： PCLK是外围时钟信号，其输出频率为1/2的
CLK和具有50 ％的占空比。
振荡器输出：振荡器是内部振荡器电路的输出。它的频率是
等于晶体。
RESET IN ： RES是其用于产生复位的低电平有效信号。该82C84A亲
国际志愿施密特触发器输入，使得一个RC连接可用于建立电
复位的正确时间。
RESET ：复位是用来重置80C86系列处理器的高电平信号。其
定时特性由RES确定。
时钟同步： CSYNC是一个高电平有效信号，它允许多个82C84As
被同步，以提供时钟是同相的。当CSYNC是HIGH内部
计数器复位。当CSYNC变低的内部计数器被允许继续减计数
ING 。 CSYNC需要进行外部同步到EFI 。当使用内部振荡器
CSYNC应该被硬连线到地面。
地
V
CC
：在+ 5V电源引脚。 V之间的0.1μF电容
CC
和GND推荐
脱钩。
RDY1,
RDY2
4, 6
I
ASYNC
15
I
准备
5
O
X1, X2
17, 16
IO
F / C
13
I
EFI
14
I
CLK
8
O
PCLK
2
O
OSC
12
O
水库
11
I
RESET
10
O
CSYNC
1
I
GND
V
CC
注意：
9
18
1.如果不使用晶振输入X1必须连接到V
CC
或GND和X2应由开放。
4-289
82C84A
功能说明
振荡器
在82C84A的振荡电路的设计主要是为
与外部并联谐振的基础模式下使用
晶体从该基本操作频率而得。
晶体的频率应在3倍进行选择
所需的CPU时钟。 X1和X2是两个晶体输入
水晶连接。对的最稳定的操作
振荡器（OSC ）输出的电路中，两个电容器（ C1 = C2 ），为
在波形音响居雷什表示建议。在输出
放振荡器的缓冲，并带出对OSC这样
其他系统的定时信号可以从该台站中导出
BLE ，晶控源。
表1.水晶规格
参数
频率
操作类型
不需要的模
负载电容
典型的晶体SPEC
2.4 - 25MHz的，基本的， “ AT ”切
并行
6分贝（最低）
18 - 32pF
时钟输出
在CLK输出为33 ％占空比的时钟驱动器设计
直接驱动80C86 ， 80C88处理器。 PCLK是一个外设
全部擦除时钟信号，其输出频率为1/2 CLK的。
PCLK具有50 ％的占空比。
复位逻辑
复位逻辑提供了一个施密特触发器输入（ RES ）和
同步IP- FL佛罗里达州运来产生复位时序。复位
信号被同步到CLK的下降沿。一个简单的RC
网络可用于通过利用该提供上电复位
功能82C84A的。
准备同步
两个READY输入（ RDY1 ， RDY2 ）提供给accommo-
日期2系统总线。每路输入都有对外贸易资质连接器（ AEN1和
AEN2 ，分别）。该AEN信号验证它们各自的
RDY信号。如果不使用多主机系统
AEN引脚应连接低电平。
同步是必需的所有异步主动正在进行
任RDY输入的边缘，以保证该RDY设置
时间和保持时间得到满足。非活动持续RDY的边缘去甲
马利准备系统不需要同步，但必须
满足RDY建立和保持的适当的系统的问题
设计。
异步输入解网络网元2 READY的同步模式
化操作。
当异步为低时，同步的两个阶段是亲
vided主动READY输入信号。正向asynchro-
理性READY输入将连接RST同步到佛罗里达州IP- FL操作之一
CLK的上升沿（需要一个建立时间tR1VCH ）和
同步到IP- FL佛罗里达州运2时的一个下降沿
CLK，之后将就绪输出将变为有效（高电平） 。
负向异步READY的投入将是同步的
的发布直接到佛罗里达州的ip-运算2在CLK的下降沿之后，佛罗里达州
其中READY输出将变为无效。操作的这种方式
化的目的是使用异步（通常没有准备好）
不能由设计保证系统中的设备
以满足所需的RDY设置定时， TR1VCL ，各总线上的
周期。
当async为高电平或悬空时，网络首先READY FL IP- FL op是
绕过处于READY同步逻辑。 READY输入
由佛罗里达州的ip-佛罗里达州运2在CLK的下降沿同步
前它们被提交给处理器。此模式是可用
能够对可以保证满足同步设备
所需的RDY准备时间。
ASYNC可以在每个总线周期来改变选择
同步用于在每台设备相应的模式
系统。
电容器C1，C2进行选择，使得它们的组合
电容
C1 X C2
-
CT =
---------------------
（包括杂散电容）
C1 + C2
由晶体相匹配的负载电容为特定网络版
制造商。这确保了频率范围内操作
宽容特定网络版由晶体制造商。
时钟发生器
时钟发生器由一个同步分频的副产品
3计数器与一个特殊的清除输入的抑制
计数。这清零输入（ CSYNC ）允许输出时钟
与外部事件（如相互同步
82C84A时钟） 。有必要同步CSYNC
输入到外部的82C84A电喷时钟。这是accom-
有两个plished FL IP- FL欢声笑语。 （参见图1）。计数器输出
放是在三分之一的输入为33 ％的占空比时钟
频率。
注： F / C输入是一个魁梧的引脚，或者选择水晶
振荡器或电喷输入作为时钟的
÷
3计数器。如果
在EFI输入作为时钟源，所述振荡器
部分可以独立地用于另一时钟源。
输出取自OSC 。
EFI
时钟
同步
EFI
D
Q
D
Q
82C84A
CSYNC
＆ GT ;
＆ GT ;
（如其它82C84As ）
注：如果EFI输入时，则晶振输入X1必须连接到V
CC
或GND和X2应由开放。如果晶体的输入时，
然后EFI应该连接到V
CC
或GND 。
图1 CSYNC同步
4-290
82C84A
绝对最大额定值
电源电压。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 + 8.0V
输入，输出或I / O电压。 。 。 。 。 。 。 。 。 。 。 GND -0.5V到V
CC
+0.5V
ESD分类科幻阳离子。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 1级
热信息
热阻。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
θ
JA
(
o
C / W ）
θ
JC
(
o
C / W ）
CERDIP封装。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
80
20
CLCC封装。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
95
28
PDIP封装。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
85
不适用
PLCC封装。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
85
不适用
o
C至+150
o
C
存储温度范围。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -65
最高结温。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 175
o
C
引线温度（焊接10秒） 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 +300
o
C
（ PLCC - 只会提示）
工作条件
工作电压范围。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 + 4.5V至+ 5.5V
工作温度范围
C82C84A 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 0
o
C至+70
o
C
I82C84A 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -40
o
C至+ 85
o
C
M82C84A 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -55
o
C至+ 125
o
C
模具特点
门数。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。盖茨50
注意：如果运行条件超过上述“绝对最大额定值” ，可能对器件造成永久性损坏。这是一个压力只有额定值和运作
该设备在这些或以上的本规范的业务部门所标明的任何其他条件是不是暗示。
直流电特定网络阳离子
V
CC
= +5.0V
±10%,
T
A
= 0
o
C至+70
o
C（ C82C84A ）
T
A
= -40
o
C至+ 85
o
C（ I82C84A ）
T
A
= -55
o
C至+ 125
o
C（ M82C84A ）
符号
V
IH
V
IL
V
国际卫生条例
V
ILR
VT + - VT-
V
OH
V
OL
II
参数
合乎逻辑的输入电压
民
2.0
2.2
-
V
CC
-0.8
-
0.2 V
CC
V
CC
-0.4
-
最大
-
单位
V
V
V
V
V
-
V
测试条件
C82C84A ， I82C84
M82C84A ，注意事项1， 2
注意事项1， 2 ， 3
逻辑零输入电压
复位输入高电压
复位输入低电压
复位输入迟滞
合乎逻辑的输出电流
0.8
-
0.5
-
-
I
OH
= -4.0mA的CLK输出
I
OH
= -2.5mA对于所有其他
I
OL
= + 4.0毫安的CLK输出
I
OL
= + 2.5毫安的所有其他
V
IN
= V
CC
或GND除了异步，
X1 ： （注4 ）
晶体频率= 25MHz的
输出打开，注5
逻辑零的输出电压
0.4
V
A
mA
输入漏电流
-1.0
1.0
I
CCOP
注意事项：
工作电源电流
-
40
1， F / C是一个带选项，要追究任
≤
0.8V或
≥
2.2V 。并不适用于X1和X2引脚。
2.由于关系到噪声测试设备的限制，实际的测试值可能不同于指定，但在指定的限制是
保证。
3. CSYNC引脚与V测试
IL
≤
0.8V.
4. ASYNC销包括一个内部17.5kΩ标称上拉电阻。对于异步输入在GND ，异步输入漏电流= 300μA
名义上， X1 - 水晶反馈输入。
5. F = 25MHz的可利用基于在拍摄F = 2MHz的和f = 10MHz时测量的外推值进行测试。
电容
T
A
= +25
o
C
符号
C
IN
C
OUT
参数
输入电容
输出电容
典型
10
15
单位
pF
pF
测试条件
FREQ = 1MHz时，所有的测量都
引用到设备GND
4-291
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