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性S E M I C 0 N D ü (C T)
CD54AC163/3A
CD54ACT163/3A
工作原理图
P0
3
SPE
CP
MR
PE
TE
9
2
1
7
10
4
P1
5
P2
6
14
13
12
11
15
Q0
Q1
Q2
Q3
TC
P3
1997年6月
完整的数据表
即将推出!
同步可预置二进制计数器
描述
该CD54AC163 / 3A和CD54ACT163 / 3A是同步的
即利用哈里斯高级预置二进制计数器
CMOS逻辑工艺。该CD54AC163 / 3A和
CD54ACT163 / 3A与该时钟同步地复位。
计算和并行预置都是多才多艺的同步
chronously用的负到正的转变
时钟。
在同步并行低水平使能输入, SPE ,
禁用的计数操作,并允许数据在P0到
P3的输入端被加载到计数器(前提是
满足了SPE的建立和保持要求) 。
计数器重置与法师在低水平
复位输入,MR 。为建立和保持时间的要求
相对于该时钟必须得到满足。
两个计数使能, PE和TE中,在每个计数器设置
为n位的级联。不管发生的复位动作
的SPE , PE和TE的投入水平。
先行进位功能,简化网络连接的ES串行级联
计数器。两个计数使能输入( PE和TE )必须
高计数。 TE输入与门的Q输出
所有四个阶段,使得在最大的计数,该终端
计数(TC)的输出变为高电平为一个时钟周期。这TC
脉冲,用来使能下一个级联级。
该CD54AC163 / 3A和CD54ACT163 / 3A的供给
16引脚双列直插式陶瓷封装(F SUF网络X) 。
GND = 8
V
CC
= 16
ACT输入负载表
输入
Pn
CP
MR, TE
SPE
PE
注意:
1.机组负荷
I
CC
在直流电气连接特定的阳离子限制特定网络版
表,例如, 2.4毫安最大的25
o
C.
机组负荷
(注1 )
0.13
1
0.83
0.67
0.5
绝对最大额定值
直流电源电压,V
CC
。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -0.5V至+ 6V
DC输入二极管电流,I
IK
对于V
I
< -0.5V或V
I
& GT ; V
CC
+ 0.5V
。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 ± 20毫安
DC输出二极管电流,I
OK
对于V
O
< -0.5V或V
O
& GT ; V
CC
+ 0.5V
。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 ± 50毫安
DC输出源或灌电流,每个输出引脚,我
O
对于V
O
> -0.5V或V
O
& LT ; V
CC
+ 0.5V
。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 ± 50毫安
DC V
CC
或接地电流,I
CC
还是我
GND
多达4个输出每设备,添加
±25mA
每个
额外的输出
。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 ±100
功耗每包,P
D
T
A
= -55
o
C至+100
o
C( F组) 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 500mW的
T
A
= +100
o
C至+ 125
o
C( F组) 。 。 。 。 。 。 。 。减免线性的
8mW/
o
C至300mW的
工作温度范围,T
A
包装F型。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -55
o
C至+ 125
o
C
贮藏温度,T
英镑
. . . . . . . . . . . . . . . . . . -65
o
C至+150
o
C
焊接温度(焊接时)
在距离1 / 16英寸
±
1 / 32英寸( 1.59毫米
±
0.79mm)
从案例10秒最大。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 265
o
C
插入印刷电路板单元(最小厚度1 / 16英寸, 1.59毫米)
焊锡接触式导线头而已。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 +300
o
C
注意:如果运行条件超过上述“绝对最大额定值” ,可能对器件造成永久性损坏。这是一个压力只有额定值和运作
该设备在这些或以上的本规范的业务部门所标明的任何其他条件是不是暗示。
推荐工作条件
电源电压范围,V
CC
除非另有规定ED ,所有电压参考GND
T
A
=全包温度范围
CD54AC类型。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 .1.5V至5.5V
CD54ACT类型。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 .4.5V至5.5V
DC输入或输出电压,V
I
, V
O
。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 0V至V
CC
工作温度,T
A
. . . . . . . . . . . . . . . . . . . -55
o
C至+ 125
o
C
输入上升和下降斜率, DT / DV
在1.5V到3V ( AC型) 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。为0ns / V至为50ns / V
在3.6V至5.5V ( AC型) 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。为0ns / V至20ns的音频/视频
在4.5V至5.5V ( AC型) 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。为0ns / V至10ns的音频/视频
注意:这些器件对静电放电敏感。用户应遵循正确的I.C.处理程序。
版权
哈里斯公司1994年
网络文件编号
3893
1
性S E M I C 0 N D ü (C T)
CD54AC163/3A
CD54ACT163/3A
工作原理图
P0
3
SPE
CP
MR
PE
TE
9
2
1
7
10
4
P1
5
P2
6
14
13
12
11
15
Q0
Q1
Q2
Q3
TC
P3
1997年6月
完整的数据表
即将推出!
同步可预置二进制计数器
描述
该CD54AC163 / 3A和CD54ACT163 / 3A是同步的
即利用哈里斯高级预置二进制计数器
CMOS逻辑工艺。该CD54AC163 / 3A和
CD54ACT163 / 3A与该时钟同步地复位。
计算和并行预置都是多才多艺的同步
chronously用的负到正的转变
时钟。
在同步并行低水平使能输入, SPE ,
禁用的计数操作,并允许数据在P0到
P3的输入端被加载到计数器(前提是
满足了SPE的建立和保持要求) 。
计数器重置与法师在低水平
复位输入,MR 。为建立和保持时间的要求
相对于该时钟必须得到满足。
两个计数使能, PE和TE中,在每个计数器设置
为n位的级联。不管发生的复位动作
的SPE , PE和TE的投入水平。
先行进位功能,简化网络连接的ES串行级联
计数器。两个计数使能输入( PE和TE )必须
高计数。 TE输入与门的Q输出
所有四个阶段,使得在最大的计数,该终端
计数(TC)的输出变为高电平为一个时钟周期。这TC
脉冲,用来使能下一个级联级。
该CD54AC163 / 3A和CD54ACT163 / 3A的供给
16引脚双列直插式陶瓷封装(F SUF网络X) 。
GND = 8
V
CC
= 16
ACT输入负载表
输入
Pn
CP
MR, TE
SPE
PE
注意:
1.机组负荷
I
CC
在直流电气连接特定的阳离子限制特定网络版
表,例如, 2.4毫安最大的25
o
C.
机组负荷
(注1 )
0.13
1
0.83
0.67
0.5
绝对最大额定值
直流电源电压,V
CC
。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -0.5V至+ 6V
DC输入二极管电流,I
IK
对于V
I
< -0.5V或V
I
& GT ; V
CC
+ 0.5V
。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 ± 20毫安
DC输出二极管电流,I
OK
对于V
O
< -0.5V或V
O
& GT ; V
CC
+ 0.5V
。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 ± 50毫安
DC输出源或灌电流,每个输出引脚,我
O
对于V
O
> -0.5V或V
O
& LT ; V
CC
+ 0.5V
。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 ± 50毫安
DC V
CC
或接地电流,I
CC
还是我
GND
多达4个输出每设备,添加
±25mA
每个
额外的输出
。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 ±100
功耗每包,P
D
T
A
= -55
o
C至+100
o
C( F组) 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 500mW的
T
A
= +100
o
C至+ 125
o
C( F组) 。 。 。 。 。 。 。 。减免线性的
8mW/
o
C至300mW的
工作温度范围,T
A
包装F型。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -55
o
C至+ 125
o
C
贮藏温度,T
英镑
. . . . . . . . . . . . . . . . . . -65
o
C至+150
o
C
焊接温度(焊接时)
在距离1 / 16英寸
±
1 / 32英寸( 1.59毫米
±
0.79mm)
从案例10秒最大。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 265
o
C
插入印刷电路板单元(最小厚度1 / 16英寸, 1.59毫米)
焊锡接触式导线头而已。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 +300
o
C
注意:如果运行条件超过上述“绝对最大额定值” ,可能对器件造成永久性损坏。这是一个压力只有额定值和运作
该设备在这些或以上的本规范的业务部门所标明的任何其他条件是不是暗示。
推荐工作条件
电源电压范围,V
CC
除非另有规定ED ,所有电压参考GND
T
A
=全包温度范围
CD54AC类型。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 .1.5V至5.5V
CD54ACT类型。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 .4.5V至5.5V
DC输入或输出电压,V
I
, V
O
。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 0V至V
CC
工作温度,T
A
. . . . . . . . . . . . . . . . . . . -55
o
C至+ 125
o
C
输入上升和下降斜率, DT / DV
在1.5V到3V ( AC型) 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。为0ns / V至为50ns / V
在3.6V至5.5V ( AC型) 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。为0ns / V至20ns的音频/视频
在4.5V至5.5V ( AC型) 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。为0ns / V至10ns的音频/视频
注意:这些器件对静电放电敏感。用户应遵循正确的I.C.处理程序。
版权
哈里斯公司1994年
网络文件编号
3893
1
WWW.ALLDATASHEET.COM
版权所有每个制造公司。
所有的数据表不能擅自修改。
该数据表已经从下载:
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100 %免费的搜索datasheet的网站。
免费下载。
没有注册。
快速检索系统。
WWW.ALLDATASHEET.COM
CD54ACT163 , CD74ACT163
4位同步二进制计数器
SCHS300 - 2000年4月
D
D
D
D
D
D
输入是TTL电压兼容
内部预读的快速计数
携带输出为N位的级联
同步计数
可编程同步
封装选择包括塑料
小外形(M ) ,标准塑料( E)和
陶瓷(F )下降
CD54ACT163 。 。 。 F封装
CD74ACT163 。 。 。 E或男包
( TOP VIEW )
描述
CLR
CLK
A
B
C
D
ENP
GND
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
V
CC
RCO
Q
A
Q
B
Q
C
Q
D
耳鼻喉科
负载
该CD54ACT163和CD74ACT163设备
4位二进制计数器。这些同步的,
可预置计数器具有内部结转
先行在高速计数应用
设计。由具有所有触发器提供同步操作同时计时,以使输出
当由所述计数使能( ENP , ENT)的输入和内部选通指令改变相互一致。
这种操作模式消除了通常与同步相关联的输出计数尖峰
(纹波时钟)计数器。缓冲时钟( CLK )输入触发四个触发器在上升(正)的边缘
的时钟波形。
该计数器是完全可编程的;也就是说,它们可以被预先设定为任意数为0至9或15 。
预置是同步的;因此,建立在负载输入端的低电平禁止计数器和原因
的输出以符合下一个时钟脉冲之后设置数据,而不管使能输入水平的变化。
清除功能是同步的。在清除( CLR )输入的低电平将所有四个触发器输出低电平
CLK的下一个从低到高的跳变后,不管使能输入端的电平。这种同步清除
允许的计数长度可以很容易地通过解码该Q输出为所需的最大计数值修正。该
栅极的用于解码低电平有效的输出被连接到CLR同步地清除计数器到0000
(LLLL).
在先行进位电路提供了级联计数器n位不同步应用
额外的门。 ENP , ENT和纹波进位输出( RCO )是有助于实现这个功能。
无论ENP和ENT要高数,耳鼻喉科前馈,使RCO 。启用RCO产生
当计数为最大的高电平脉冲(9或15的带Q
A
高点) 。这种高层次的溢波进位脉冲
可以用来使连续级联级。转换为ENP或耳鼻喉科是允许的,不管
CLK的电平。
这些器件具有一个完全独立的时钟电路。在控制输入( ENP , ENT ,或LOAD )的变化
修改操作模式对计数器的内容没有任何影响,直到时钟发生。的功能
计数器(是否启用,禁用,装载,或计数)由符合条件的单独决定
稳定的建立和保持时间。
该CD54ACT163的特点是工作在-55 ° C至125°C的整个军用温度范围。
该CD74ACT163的特点是操作温度范围为-40 ° C至85°C 。
请注意,一个重要的通知有关可用性,标准保修,并且在关键的应用程序中使用
德州仪器公司的半导体产品和免责条款及其出现在此数据表的末尾。
版权
2000年,德州仪器
PRODUCTION数据信息为出版日期。
产品符合每德州仪器条款规范
标准保修。生产加工并不包括
所有测试参数。
邮政信箱655303
达拉斯,德克萨斯州75265
1
CD54ACT163 , CD74ACT163
4位同步二进制计数器
SCHS300 - 2000年4月
功能表
输入
CLR
L
h
h
h
h
h
CLK
X
X
ENP
X
X
X
h
l
X
耳鼻喉科
X
X
X
h
X
l
负载
X
l
l
h
h
h
A,B , C,D
X
l
h
X
X
X
输出
Qn
L
L
H
qn
qn
RCO
L
L
注1
注1
注1
L
功能
复位(清)
并行加载
抑制
H =水平高, L =水平低,X =无关,H =高电平一个设置之前CLK的时间
低到高的转变, L =低一级建立时间之前CLK低到高的转变, Q =的
引用的输出状态之前CLK低到高的转变,
= CLK从低到高
过渡。
注1: RCO输出为高时,耳鼻喉科高,并且计数器是在终端计数( HHHH ) 。
逻辑符号
1
CLR
负载
耳鼻喉科
ENP
CLK
A
B
C
D
10
7
2
3
4
5
6
9
CTRDIV16
5CT=0
M1
M2
G3
G4
C5/2,3,4+
1,5D
[1]
[2]
[4]
[8]
14
13
12
11
QA
QB
QC
QD
15
3CT=15
RCO
这个符号是按照ANSI / IEEE标准91-1984和IEC出版617-12 。
2
邮政信箱655303
达拉斯,德克萨斯州75265
CD54ACT163 , CD74ACT163
4位同步二进制计数器
SCHS300 - 2000年4月
逻辑图(正逻辑)
负载
耳鼻喉科
ENP
9
10
7
LDε
CK =
CLK
CLR
2
1
CK
R
LD
15
RCO
A
3
M1
G2
1 , 2T / 1C3
G4
3D
4R
M1
G2
1 , 2T / 1C3
G4
3D
4R
14
QA
13
QB
B
4
C
5
M1
G2
1 , 2T / 1C3
G4
3D
4R
12
QC
D
6
M1
G2
1 , 2T / 1C3
G4
3D
4R
11
QD
为简单起见,互补信号LD和CK的路由这个整体逻辑图上未示出。这些信号的用途示
为D的逻辑图/ T触发器。
邮政信箱655303
达拉斯,德克萨斯州75265
3
CD54ACT163 , CD74ACT163
4位同步二进制计数器
SCHS300 - 2000年4月
逻辑符号,每个D / T触发器
LD (LOAD)
TE (切换使能)
的CK (时钟)
M1
G2
1 , 2T / 1C3
G4
3D
4R
Q(输出)
D(反向的数据)
R(倒复位)
逻辑图中,每个D / T触发器(正逻辑)
CK
LD
TE
LDε
TG
TG
LDε
D
TG
TG
TG
CK =
CK =
TG
Q
CK =
R
LD和CK的起源是示出在整体设备的逻辑图。
CK =
4
邮政信箱655303
达拉斯,德克萨斯州75265
CD54ACT163 , CD74ACT163
4位同步二进制计数器
SCHS300 - 2000年4月
典型的清晰,预置,计数,并抑制序列
下面的序列图所示:
1.清除输出为零(同步)
2.预设为二进制12
3.计数到13 ,14,15 , 0 ,1和2
4.禁止
CLR
负载
A
B
C
D
CLK
ENP
耳鼻喉科
QA
QB
QC
QD
RCO
12
13
14
15
0
1
2
抑制
SYNC预设
明确
数据
输入
数据
输出
邮政信箱655303
达拉斯,德克萨斯州75265
5
CD54ACT163 , CD74ACT163
4位同步二进制计数器
SCHS300B - 2000年4月 - 修订2003年3月
D
D
D
D
D
输入是TTL电压兼容
内部预读的快速计数
携带输出为N位的级联
同步计数
可编程同步
CD54ACT163 。 。 。 F封装
CD74ACT163 。 。 。 E或男包
( TOP VIEW )
描述/订购信息
在' ACT163设备是4位二进制计数器。
11
6
这些同步,可预置计数器功能
10
7
内部先行进位为在应用
9
8
高速计数的设计。同步
操作是由具有所有触发器设置
同时计时,以使输出发生变化,相互重合,在由指示
计数使能( ENP , ENT)输入和内部选通。这种操作模式,无需输出计数
尖峰通常与同步(纹波时钟)柜台联系。缓冲时钟( CLK )输入触发
在时钟波形的上升(正)边缘4触发器。
该计数器是完全可编程的;也就是说,它们可以被预先设定为任意数为0至9或15 。
预置是同步的;因此,建立在负载输入端的低电平禁止计数器和原因
的输出以符合下一个时钟脉冲之后设置数据,而不管使能输入水平的变化。
清除功能是同步的。在清除( CLR )输入的低电平将所有四个触发器输出低电平
CLK的下一个从低到高的跳变后,不管使能输入端的电平。这种同步清除
允许的计数长度可以很容易地通过解码该Q输出为所需的最大计数值修正。该
栅极的用于解码低电平有效的输出被连接到CLR同步地清除计数器到0000
(LLLL).
在先行进位电路提供了级联计数器n位不同步应用
额外的门。 ENP , ENT和纹波进位输出( RCO )是有助于实现这个功能。
无论ENP和ENT要高数,耳鼻喉科前馈,使RCO 。启用RCO产生
当计数为最大的高电平脉冲(9或15 ,带Q
A
高点) 。这种高层次的溢波进位脉冲
可以用来使连续级联级。转换为ENP或耳鼻喉科是允许的,不管
CLK的电平。
这些器件具有一个完全独立的时钟电路。在控制输入( ENP , ENT ,或LOAD )的变化
修改操作模式对计数器的内容没有任何影响,直到时钟发生。的功能
计数器(是否启用,禁用,装载,或计数)由符合条件的单独决定
稳定的建立和保持时间。
订购信息
TA
包装
PDIP - ê
-55 ° C至125°C
55°C
SOIC - M
CDIP - F
磁带和卷轴
订购
产品型号
CD74ACT163E
CD74ACT163M
CD74ACT163M96
CD54ACT163F3A
TOP- SIDE
记号
CD74ACT163E
ACT163M
CD54ACT163F3A
CLR
CLK
A
B
C
D
ENP
GND
1
2
3
4
5
16
15
14
13
12
V
CC
RCO
Q
A
Q
B
Q
C
Q
D
耳鼻喉科
负载
请注意,一个重要的通知有关可用性,标准保修,并且在关键的应用程序中使用
德州仪器公司的半导体产品和免责条款及其出现在此数据表的末尾。
版权
2003年,德州仪器
关于产品符合MIL -PRF- 38535 ,所有参数进行测试
除非另有说明。在所有其他产品,生产
加工不一定包括所有参数进行测试。
PRODUCTION数据信息为出版日期。
产品符合每德州仪器条款规范
标准保修。生产加工并不包括
所有测试参数。
邮政信箱655303
达拉斯,德克萨斯州75265
1
CD54ACT163 , CD74ACT163
4位同步二进制计数器
SCHS300B - 2000年4月 - 修订2003年3月
功能表
输入
CLR
L
h
h
h
h
h
CLK
X
X
ENP
X
X
X
h
l
X
耳鼻喉科
X
X
X
h
X
l
负载
X
l
l
h
h
h
A,B , C,D
X
l
h
X
X
X
输出
Qn
L
L
H
qn
qn
RCO
L
L
注1
注1
注1
L
功能
复位(清)
并行加载
抑制
H =水平高, L =水平低,X =无关,H =高电平一个设置之前CLK的时间
低到高的转变, L =低一级建立时间之前CLK低到高的转变, Q =的
引用的输出状态之前CLK低到高的转变,并
= CLK从低到高
过渡。
注1: RCO输出为高时,耳鼻喉科高,并且计数器是在终端计数
(HHHH).
2
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达拉斯,德克萨斯州75265
CD54ACT163 , CD74ACT163
4位同步二进制计数器
SCHS300B - 2000年4月 - 修订2003年3月
逻辑图(正逻辑)
负载
耳鼻喉科
ENP
9
10
7
LDε
CK =
CLK
CLR
2
1
CK
R
LD
15
RCO
A
3
M1
G2
1 , 2T / 1C3
G4
3D
4R
M1
G2
1 , 2T / 1C3
G4
3D
4R
14
QA
13
QB
B
4
C
5
M1
G2
1 , 2T / 1C3
G4
3D
4R
12
QC
D
6
M1
G2
1 , 2T / 1C3
G4
3D
4R
11
QD
为简单起见,互补信号LD和CK的路由这个整体逻辑图上未示出。这些信号的用途示
为D的逻辑图/ T触发器。
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逻辑符号,每个D / T触发器
LD (LOAD)
TE (切换使能)
的CK (时钟)
M1
G2
1 , 2T / 1C3
G4
3D
4R
Q(输出)
D(反向的数据)
R(倒复位)
逻辑图中,每个D / T触发器(正逻辑)
CK
LD
TE
LDε
TG
TG
LDε
D
TG
TG
TG
CK =
CK =
TG
Q
CK =
R
LD和CK的起源是示出在整体设备的逻辑图。
CK =
4
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典型的清晰,预置,计数,并抑制序列
下面的序列图所示:
1.清除输出为零(同步)
2.预设为二进制12
3.计数到13 ,14,15 , 0 ,1和2
4.禁止
CLR
负载
A
B
C
D
CLK
ENP
耳鼻喉科
QA
QB
QC
QD
RCO
12
13
14
15
0
1
2
抑制
SYNC预设
明确
数据
输入
数据
输出
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