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位置：首页 > IC型号导航 > 首字符A型号页 > 首字符A的型号第1190页 > ATF1508ASVL-20AC100
特点
高密度，高性能，电可擦除
复杂可编程逻辑器件
- 3.0V至3.6V工作电压范围
- 128个宏单元
- 每个宏单元，可扩展5产品条款高达40宏单元
- 84 ， 100 ， 160引脚
- 15 ns最大引脚至引脚延时
- 注册操作高达77 MHz的
- 增强的路由资源
灵活的逻辑宏单元
- D / T /锁存器配置的触发器
- 全球和个人寄存器控制信号
- 全球和个人输出使能
可编程输出摆率
- 可编程输出集电极开路选项
- 通过在一个COM输出埋葬一个注册的最大的逻辑利用率
先进的电源管理功能
- 自动5 μA待机为“L”版本
- 引脚控制的100 μA待机模式
- 可编程引脚门将输入和I / O
- 每个宏单元省电功能
提供商业和工业温度范围
可提供84引脚PLCC和100引脚PQFP和TQFP封装，
160引脚PQFP封装
高级EE技术
- 100％测试
- 完全可再编程
- 10,000编程/擦除周期
- 20年的数据保存
- 2000V的ESD保护
- 200毫安闭锁抗扰度
JTAG边界扫描测试IEEE标准。 1149.1-1990和1149.1a - 1993支持
快速的在系统可编程（ ISP ）通过JTAG
符合PCI标准
安全保险丝功能
HIGH-
性能
EE PLD
ATF1508ASV
ATF1508ASVL
增强功能
改进的连接（附加的反馈路径，交替输入路由）
输出使能产品条款
透明锁存模式
组合输出，带内的任何宏蜂窝注册反馈
三个全局时钟引脚
在全局时钟，输入和I ITD （输入瞬态检测）电路/ O
从产品期限快速注册输入
可编程的“脚老板”选项
V
CC
上电复位选项
上拉功能的JTAG引脚TMS和TDI
先进的电源管理功能
- 边控掉电“L”
- 个人宏单元电源选项
- 禁用ITD在全球时钟，输入和I / O的“Z”零部件
牧师1408E -09 / 00
1
84引脚PLCC
顶视图
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INPUT/OE2/GCLK2
输入/ GCLR
INPUT/OE1
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100引脚TQFP
顶视图
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100引脚PQFP
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输入/ GCLR
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160引脚PQFP
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VCCIO
I / O / TDI
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I / O / TMS
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ATF1508ASV(L)
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I / O
N / C
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I / O
VCCIO
I / O
ATF1508ASV(L)
框图
612个
3
描述
该ATF1508ASV （ L）是一款高性能，高密度
复杂可编程逻辑器件（CPLD ） ，它利用
爱特梅尔经过验证的电可擦除技术。 128
逻辑宏单元和多达100个的输入，可轻松集成
逻辑从几个TTL ， SSI ， MSI ， LSI和经典的可编程逻辑器件。
该ATF1508ASV （ L）的增强型路由交换矩阵
增加可用门数，增加success-赔率
FUL管脚锁定的设计修改。
该ATF1508ASV （ L）拥有多达96个双向I / O引脚
和四个专用输入管脚，具体取决于类型
器件封装选择。每个专用引脚还可以
作为一个全球性的控制信号，时钟寄存器，寄存器
复位或输出使能。每个这些控制信号可以是
选择用于每个单独的宏小区内使用。
每128个宏单元的生成埋反馈
该前进到全局总线。每个输入和I / O引脚也
服务于全球的总线。在每个逻辑开关矩阵
块，然后选择来自全局总线40的各个信号。
每个宏单元也产生一个折返逻辑术语
去一个地方总线。宏单元之间的逻辑级联
在ATF1508ASV （ L）可以快捷，高效的代
复杂的逻辑功能。该ATF1508ASV （L ）包含
八个这样的逻辑链，每一个都能够创建和项的
逻辑用风扇，在高达40个乘积项。
该ATF1508ASV （L）的宏小区，在图1中示出，是灵活性
BLE足够支持高度复杂的逻辑功能能操作
阿婷在高速。宏小区由五个
内容：产品的术语和产品期限选择多
路器，或/异或/级联逻辑，一个触发器，输出选择
并启用，以及逻辑阵列输入。
未使用的宏单元是由编译自动禁用
编译器，以减少耗电量。一个安全的保险丝，
编程时，保护的内容
ATF1508ASV （L）。的用户签名的两个字节（16位）是
访问为目的，例如存储项目的用户
名称，零件号，修订或日期。用户签名是
访问无论安全保险丝的状态。
该ATF1508ASV （ L）装置是一种在系统可编程
商（ISP）的设备。它采用了行业标准的4针JTAG
接口（ IEEE标准1149.1 ） ，并且是完全符合
JTAG的边界扫描描述语言（ BSDL ） 。 ISP
允许将不除去它编程的设备
从印刷电路板。除了简化
制造流程， ISP还允许设计修改
可以通过软件制作中的字段。
产品条款及选择MUX
每个ATF1508ASV （ L）宏单元有五个乘积项。
每个乘积项作为接收其输入来自所有信号
无论是全局总线和区域总线。
该产品期限选择多路转换器（ PTMUX ）的分配
5个乘积项根据需要宏蜂窝逻辑门
和控制信号。该PTMUX编程是阻止 -
由设计编译器，选择最佳开采
宏单元配置。
OR / XOR / CASCADE逻辑
该ATF1508ASV （L）的逻辑结构被设计成艾菲
ciently支持所有类型的逻辑。在单个宏单元，
所有乘积项可以被路由到或门，产生
5输入和/或和项。在添加的
从邻近宏小区Casin酒店，这可以扩展
至多达40个乘积项与一些额外的延迟。
宏蜂窝的异或门可以有效的实现
的比较和运算功能。一个输入到异或
来自OR和项。其他XOR输入可以是
一个乘积项或一个固定的高或低的水平。对于combinato-
里亚尔输出，固定电平输入允许极性选择。
对于已注册的功能，固定级别允许德摩根
最小化的乘积项。 XOR门也被用于
模拟T型和JK型触发器。
倒装佛罗里达州运
该ATF1508ASV （ L）的触发器具有非常灵活的数据和
控制功能。数据输入可以来自任一
异或门，从一个单独的乘积项，或直接从
在I / O引脚。选择单独的乘积项允许cre-
一个组合内通报BULLETIN的埋藏注册反馈
输出宏单元。 （此功能会自动imple-
由钳工软件mented ） 。除了D，T， JK和
SR运行，触发器也可以被配置为一个液流 -
通过锁存器。在这种模式中，数据通过时
时钟为高时，在时钟为低电平进行锁存。
时钟本身可以是全局的CLK信号（ GCK ）
或单个产品的术语。触发器改变状态
在时钟的上升沿。当GCK信号作为
时钟，对宏小区的乘积项1可以是
选定为时钟使能。当时钟使能功能
处于活动状态且使能信号（乘积项）为低电平时，所有
时钟边沿被忽略。触发器的异步复位
信号（ AR ）可以是全局清除（ GCLEAR ） ，一
产品期限，或始终关闭。 AR也可以是一个逻辑或
GCLEAR与产品期限。异步预置
（AP）可以是一个乘积项或始终关闭。
4
ATF1508ASV(L)
ATF1508ASV(L)
图1 。
ATF1508ASV （L）的宏单元
输出选择和启用
该ATF1508ASV （L）的宏蜂窝输出可以被选择作为
注册或组合。埋反馈信号
无论是组合还是不管登记信号
是否输出为组合或注册。
输出使能多路转换器（MOE）控制输出
使能信号。任何缓冲可以永久启用
简单的输出操作。缓冲剂也可以是永久
禁用，允许使用的引脚作为输入。在这种组态
口粮。所有宏小区的资源仍然可用，
包括埋反馈，扩展和级联
逻辑。输出使能针对每个宏单元可
选为全球产量的一个使能信号。该
器件具有六个全球OE信号。
全局总线/开关矩阵
全局总线包含所有的输入和I / O引脚的信号，以及
从所有128个宏单元的埋反馈信号。
每个逻辑块中的开关矩阵接收作为其输入
从全局总线的所有信号。在软件控制下，最高
到40这些信号可以被选择作为输入的逻辑
块。
折返巴士
每个宏单元也产生一个折返乘积项。
这个信号输送到区域总线，并提供给16
宏单元。折返是中的一个的逆极性
宏单元的乘积项。在每个16折返条款
地区允许代高扇入和项（多达21个
积计）与小的额外延迟。
集电极开路输出选项
此选项可使设备输出提供控制
例如，可以通过任何被断言的中断信号
所述多个装置。
5
特点
高密度，高性能，电可擦除
复杂可编程逻辑器件
- 3.0V至3.6V工作电压范围
- 128个宏单元
- 每个宏单元，可扩展5产品条款高达40宏单元
- 84 ， 100 ， 160引脚
- 15 ns最大引脚至引脚延时
- 注册操作高达77 MHz的
- 增强的路由资源
灵活的逻辑宏单元
- D / T /锁存器配置的触发器
- 全球和个人寄存器控制信号
- 全球和个人输出使能
可编程输出摆率
- 可编程输出集电极开路选项
- 通过在一个COM输出埋葬一个注册的最大的逻辑利用率
先进的电源管理功能
- 自动5 μA待机为“L”版本
- 引脚控制的100 μA待机模式
- 可编程引脚门将输入和I / O
- 每个宏单元省电功能
提供商业和工业温度范围
可提供84引脚PLCC和100引脚PQFP和TQFP封装，
160引脚PQFP封装
高级EE技术
- 100％测试
- 完全可再编程
- 10,000编程/擦除周期
- 20年的数据保存
- 2000V的ESD保护
- 200毫安闭锁抗扰度
JTAG边界扫描测试IEEE标准。 1149.1-1990和1149.1a - 1993支持
快速的在系统可编程（ ISP ）通过JTAG
符合PCI标准
安全保险丝功能
绿色（无铅/无卤化物/ RoHS标准）封装选项
HIGH-
性能
EE PLD
ATF1508ASV
ATF1508ASVL
增强功能
改进的连接（附加的反馈路径，交替输入路由）
输出使能产品条款
透明锁存模式
组合输出，带内的任何宏蜂窝注册反馈
三个全局时钟引脚
在全局时钟，输入和I ITD （输入瞬态检测）电路/ O
从产品期限快速注册输入
可编程的“脚老板”选项
V
CC
上电复位选项
上拉功能的JTAG引脚TMS和TDI
先进的电源管理功能
- 边控掉电“L”
- 个人宏单元电源选项
- 禁用ITD在全球时钟，输入和I / O的“Z”零部件
牧师1408H - PLD - 7月5日
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84引脚PLCC
顶视图
I / O
I / O
I / O
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I / O
I / O
I / O
VCCINT
INPUT/OE2/GCLK2
输入/ GCLR
INPUT/OE1
INPUT/GCLK1
GND
I/O/GCLK3
I / O
I / O
VCCIO
I / O
I / O
I / O
100引脚PQFP
顶视图
I / O
I / O
I / O
GND
I / O
I / O
I / O
VCCINT
INPUT/OE2/GCLK2
输入/ GCLR
INPUT/OE1
INPUT/GCLK1
GND
I/O/GCLK3
I / O
I / O
VCCIO
I / O
I / O
I / O
I / O
I / O
I / O
I / O
I / O
VCCIO
I / O
I / O
I / O
GND
VCCINT
I / O
I/O/PD2
I / O
GND
I / O
I / O
I / O
I / O
I / O
VCCIO
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
51
52
53
I/O/PD1
VCCIO
I / O / TDI
I / O
I / O
I / O
I / O
GND
I / O
I / O
I / O
I / O / TMS
I / O
I / O
VCCIO
I / O
I / O
I / O
I / O
I / O
GND
12
13
14
15
16
17
18
19
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25
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10
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84
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60
59
58
57
56
55
54
I / O
I / O
GND
I / O / TDO
I / O
I / O
I / O
I / O
VCCIO
I / O
I / O
I / O
I / O / TCK
I / O
I / O
GND
I / O
I / O
I / O
I / O
I / O
100
99
98
97
96
95
94
93
92
91
90
89
88
87
86
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84
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81
80
79
78
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70
69
68
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59
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57
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41
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43
44
45
46
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48
49
50
I / O
I / O
I/O/PD1
I / O
VCCIO
I / O / TDI
I / O
I / O
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I / O
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I / O
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I / O
I / O / TMS
I / O
I / O
VCCIO
I / O
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I / O
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I / O
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1
2
3
4
5
6
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9
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I / O
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I / O / TDO
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VCCIO
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I / O
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VCCIO
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100引脚TQFP
顶视图
I / O
I / O
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GND
I / O
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VCCINT
INPUT/OE2/GCLK2
输入/ GCLR
INPUT/OE1
INPUT/GCLK1
GND
I/O/GCLK3
I / O
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VCCIO
I / O
I / O
I / O
I / O
I / O
I / O
160
159
158
157
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150
149
148
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120
119
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117
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113
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110
109
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106
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103
102
101
100
99
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97
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95
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92
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89
88
87
86
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84
83
82
81
41
42
43
44
45
46
47
48
49
50
51
52
53
54
55
56
57
58
59
60
61
62
63
64
65
66
67
68
69
70
71
72
73
74
75
76
77
78
79
80
I / O
I/O/PD2
I / O
N / C
N / C
N / C
N / C
I / O
I / O
I / O
I / O
I / O
GND
I / O
I / O
I / O
I / O
VCCINT
INPUT/OE2/GCLK2
输入/ GCLR
INPUT/OE1
INPUT/GCLK1
GND
I/O/GCLK3
I / O
I / O
I / O
VCCIO
I / O
I / O
I / O
I / O
I / O
N / C
N / C
N / C
N / C
I / O
I / O
I / O
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I / O
VCCIO
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I / O
I / O
GND
VCCINT
I / O
I/O/PD2
I / O
GND
I / O
I / O
I / O
I / O
I / O
160引脚PQFP
顶视图
I/O/PD1
I / O
VCCIO
I / O / TDI
I / O
I / O
I / O
I / O
I / O
I / O
GND
I / O
I / O
I / O
I / O / TMS
I / O
I / O
VCCIO
I / O
I / O
I / O
I / O
I / O
I / O
I / O
1
2
3
4
5
6
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9
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12
13
14
15
16
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33
33
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42
43
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47
48
49
50
75
74
73
72
71
70
69
68
67
66
65
64
63
62
61
60
59
58
57
56
55
54
53
52
51
I / O
GND
I / O / TDO
I / O
I / O
I / O
I / O
I / O
I / O
VCCIO
I / O
I / O
I / O
I / O / TCK
I / O
I / O
GND
I / O
I / O
I / O
I / O
I / O
I / O
I / O
VCCIO
GND
I / O
I / O
I / O
I / O
I / O
I / O
I / O
VCCIO
I / O
I / O
I / O
GND
VCCINT
I / O
I/O/PD2
I / O
GND
I / O
I / O
I / O
I / O
I / O
I / O
I / O
N / C
N / C
N / C
N / C
N / C
N / C
N / C
VCCIO
I / O / TDI
I / O
I / O
I / O
I / O
I / O
I / O
I / O
GND
I / O
I / O
I / O
I / O
I / O / TMS
I / O
I / O
I / O
VCCIO
I / O
I / O
I / O
I / O
I / O
I / O
I / O
N / C
N / C
N / C
N / C
N / C
N / C
N / C
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
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22
23
24
25
26
27
28
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30
31
32
33
34
35
36
37
38
39
40
N / C
N / C
N / C
N / C
N / C
N / C
N / C
GND
I / O / TDO
I / O
I / O
I / O
I / O
I / O
I / O
I / O
VCCIO
I / O
I / O
I / O
I / O
I / O / TCK
I / O
I / O
I / O
GND
I / O
I / O
I / O
I / O
I / O
I / O
I / O
N / C
N / C
N / C
N / C
N / C
N / C
N / C
100
99
98
97
96
95
94
93
92
91
90
89
88
87
86
85
84
83
82
81
80
79
78
77
76
2
ATF1508ASV(L)
1408H–PLD–7/05
I / O
GND
I / O
N / C
N / C
N / C
N / C
I / O
I / O
I / O
I / O
I / O
I / O
I / O
VCCIO
I / O
I / O
I / O
I / O
GND
VCCINT
I / O
I/O/PD1
I / O
I / O
GND
I / O
I / O
I / O
I / O
I / O
I / O
I / O
N / C
N / C
N / C
N / C
I / O
VCCIO
I / O
ATF1508ASV(L)
框图
612个
3
1408H–PLD–7/05
描述
该ATF1508ASV （L）为一个高性能，高密度复杂可编程逻辑
器件（CPLD ） ，利用Atmel的成熟的电可擦除技术。 128
逻辑宏单元和多达100个输入端，它很容易地从多个初始TTL， SSI的集成逻辑，
MSI ， LSI和经典的可编程逻辑器件。该ATF1508ASV （ L）的增强型路由交换矩阵
增加可用门数，并增加成功的引脚锁定设计赔率
修改。
该ATF1508ASV （ L）拥有多达96个双向I / O引脚和四个专用输入引脚，
根据器件封装的选择的类型。每个专用引脚也可以作为
作为一个全球性的控制信号，时钟寄存器，寄存器复位或输出使能。每个这些
控制信号可被选择用于每个单独的宏小区内使用。
每128个宏单元中产生的埋入反馈前进到全局总线。
每个输入和I / O引脚也能服务于全球的总线。在每个逻辑开关矩阵
块，然后选择来自全局总线40的各个信号。每个宏单元还gener-
阿泰一个折返逻辑术语，去一个地方总线。之间的级联逻辑
在ATF1508ASV （ L）宏单元可以快速，有效地生成复杂的逻辑功能
系统蒸发散。该ATF1508ASV （L）包含八个这样的逻辑链，每一个都能够产生的
综上所述术语逻辑用风扇在高达40个乘积项。
该ATF1508ASV （L）的宏小区，在图1中示出，具有足够的灵活性来支持highly-
复杂的逻辑功能在高速运行。宏蜂窝包括五个部分：
乘积项和乘积项选择多路复用器，或/异或/级联逻辑，一个触发器，
输出选择并启用，以及逻辑阵列输入。
未使用的宏单元是由编译器自动关闭，以减少功率变
消费。一个安全的保险丝，当编程，保护的内容
ATF1508ASV （L）。的用户签名的两个字节（16位）是可访问的用户
用途，如存储项目名称，型号，版本或日期。用户拍号
TURE访问无论安全熔丝的状态。
该ATF1508ASV （ L）装置是一种在系统可编程（ ISP）的设备。它使用
行业标准的4针JTAG接口（ IEEE标准1149.1 ） ，并完全符合
JTAG的边界扫描描述语言（ BSDL ） 。 ISP允许器件是亲
编程不从印刷电路板中除去它。除了简化
制造流程， ISP也可以通过将取得在该领域的设计修改
软件。
产品条款及选择
MUX
每个ATF1508ASV （ L）宏单元有五个乘积项。每款产品期限为收到
它的输入来自全球的总线和区域公交的所有信号。
该产品期限选择多路转换器（ PTMUX ）分配的五大产品条款
需要宏蜂窝逻辑门和控制信号。该PTMUX编程
由设计编译器，选择最佳的宏单元配置决定。
OR / XOR / CASCADE逻辑
该ATF1508ASV （ L）的逻辑结构设计，以有效地支持所有类型的逻辑。
在单个宏小区中，所有乘积项可以被路由到或门，产生一个
5 ，输入和/或和项。与来自邻近宏小区的加入Casin酒店的，
这可扩展到多达40个乘积项与一些额外的延迟。
宏蜂窝的异或门可以有效的实现比较和运算
功能。一个输入到异或来自OR和项。其他XOR输入可
是一个乘积项或一个固定的高或低的水平。用于组合输出，固定电平
允许输入极性选择。对于已注册的功能，固定级别允许德摩根
最小化的乘积项。 XOR门也被用于模拟的T和JK型
触发器。
4
ATF1508ASV(L)
1408H–PLD–7/05
ATF1508ASV(L)
倒装佛罗里达州运
该ATF1508ASV （L）的触发器具有非常灵活的数据和控制功能。数据
输入可以来自异或门，从一个单独的乘积项，或直接从
在I / O引脚。选择单独的乘积项允许创建埋注册
在一个组合输出宏单元的反馈。 （此功能会自动imple-
由钳工软件mented ） 。除了D，T， JK和SR运行，该触发器可以
也可以配置为一个流过锁存器。在这种模式中，数据通过时
时钟为高时，在时钟为低电平进行锁存。
时钟本身可以是全局的CLK信号（ GCK ）或单个乘积项。
触发器在时钟的上升沿改变状态。当GCK信号作为
时钟，对宏小区的乘积项可以被选择为时钟使能。当
时钟使能功能处于激活状态和使能信号（乘积项）为低电平时，所有时钟
边缘被忽略。触发器的异步复位信号（AR）可以是格洛
BAL清除（ GCLEAR ） ，产品期限，或始终关闭。 AR也可以是一个逻辑或
GCLEAR与产品期限。异步预置（AP）可以是一个乘积项或
始终关闭。
图1 。
ATF1508ASV （L）的宏单元
5
1408H–PLD–7/05
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