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位置:首页 > IC型号导航 > 首字符A型号页 > 首字符A的型号第1777页 > ATA5724P3-TKQY
特点
接收频率范围( 3版本)
– f
0
= 312.5 MHz至317.5 MHz或
– f
0
= 431.5 MHz至436.5 MHz或
– f
0
= 868 MHz至870 MHz的
30分贝镜像抑制
接收带宽
– B
IF
= 300千赫315兆赫/ 433 MHz的版本
– B
IF
= 600千赫为868 MHz的版本
完全集成的LC- VCO和PLL环路滤波器
非常高的灵敏度与功率匹配的LNA
- ATA5723 / ATA5724 :
-107 dBm时, FSK, BR_0 (1.0千比特/秒到1.8千比特/秒) ,曼彻斯特,误码率10E- 3
-113 dBm时, ASK, BR_0 (1.0千比特/秒到1.8千比特/秒) ,曼彻斯特,误码率10E- 3
- ATA5728 :
-105 dBm时, FSK, BR_0 (1.0千比特/秒到1.8千比特/秒) ,曼彻斯特,误码率10E- 3
-111 dBm时, ASK, BR_0 (1.0千比特/秒到1.8千比特/秒) ,曼彻斯特,误码率10E- 3
高IIP3系统
- -18 dBm的在868兆赫
- -23 dBm的433兆赫
- -24 dBm的在315兆赫
系统1 - 1dB压缩点
- -27.7 dBm的在868兆赫
- -32.7 dBm的433兆赫
- -33.7 dBm的在315兆赫
在GSM波段高大信号能力(拦截-33 dBm的在10 MHz时,
IIP3 = -24 dBm的在20兆赫)
对数RSSI输出
XTO启动1.5 kΩ的电阻负
5V至20V汽车兼容的数据接口
数据时钟可用于曼彻斯特和双相编码信号
可编程数字噪声抑制
低功耗,由于配置的轮询
温度范围:-40 ° C至+ 105°C
ESD保护2kV的HBM ,所有引脚
通信使用的是单双向数据线微控制器可能
低成本的解决方案由于集成度高用最少的外部电路
需求
电源电压范围4.5V至5.5V
超高频ASK / FSK
接收器
ATA5723
ATA5724
ATA5728
好处
低BOM清单由于高集成度
使用低成本13 MHz晶体的
最低的平均电流消耗的应用由于自轮询功能
ATA5743软件重用
全球范围内覆盖有一块PCB由于3个版本是引脚兼容
9106E–RKE–07/08
1.描述
该ATA5723 / ATA5724 / ATA5728处于SSO20供给的多芯片的PLL接收机设备
封装。它为射频低成本的数据传输系的需求专门开发
TEMS数据速率为1 kbit / s到10 kBbit / s的曼彻斯特和双相代码。其主要
应用在无钥匙进入系统等领域,胎压监测系统, teleme-
tering和安全技术系统。它可在该频率接收范围内使用
f
0
= 312.5 MHz至317.5 MHz的,女
0
= 431.5 MHz至436.5 MHz的或f
0
= 868 MHz到870 MHz的频率
ASK或FSK数据传输。以下所有的发言是指315兆赫, 433兆赫和
868.3兆赫的应用。
图1-1 。
系统框图
超高频ASK / FSK
遥控接收器
ATA5723/
ATA5724/
ATA5728
解调。
PLL
天线
VCO
天线
IF放大器
PLL
XTO
超高频ASK / FSK
遥控发射器
T5750/53/54
1至5个
控制
MICRO-
调节器
XTO
动力
安培。
LNA
VCO
2
ATA5723/ATA5724/ATA5728
9106E–RKE–07/08
ATA5723/ATA5724/ATA5728
图1-2 。
框图
CDEM
FSK / ASK
解调器
和数据过滤器
RSSI
限OUT
RSSI
DEM_OUT
数据
接口
数据
RSSI
SENS
AVCC
AGND
DGND
DVCC
轮询/ _ON
灵敏度
减少
轮询电路
和控制逻辑
IF
安培。
DATA_CLK
模式
4.订单
f
0
= 1兆赫
FE
CLK
IC_ACTIVE
LPF
f
g
= 2.2兆赫
待机
逻辑
IF
安培。
滤波器
XTAL2
XTO
XTAL1
聚LPF
f
g
= 7 MHz的
f
LC- VCO
:2
或: 3
LNAREF
f
LNA_IN
LNAGnd
LNA
:2
或: 4
f
:128
或: 64
3
9106E–RKE–07/08
2.引脚配置
图2-1 。
钢钉SSO20
SENS
IC_ACTIVE
CDEM
AVCC
TEST1
RSSI
AGND
LNAREF
LNA_IN
1
2
3
4
5
6
7
8
9
ATA5723/
ATA5724/
ATA5728
20 DATA
19轮询/ _ON
18 DGND
17 DATA_CLK
16模式
15 DVCC
14 XTAL2
13 XTAL1
12 TEST3
11 TEST2
LNAGND 10
表2-1 。
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
引脚说明
符号
SENS
IC_ACTIVE
CDEM
AVCC
测试1
RSSI
AGND
LNAREF
LNA_IN
LNAGnd
测试2
测试3
XTAL1
XTAL2
DVCC
模式
DATA_CLK
DGND
轮询/ _ON
数据
功能
灵敏度控制电阻
IC条件指标:低=睡眠模式,高=主动模式
低截止频率数据过滤
模拟电源
测试引脚,在操作过程中GND
RSSI输出
模拟地
高频基准节点的LNA和混频器
RF输入
直流接地LNA和混频器
工作期间不要接
测试引脚,在操作过程中GND
晶体振荡器XTAL连接1
晶体振荡器XTAL连接2
数字电源
选择315兆赫/其他版本
低: 315 MHz的版本( ATA5723 )
高: 433兆赫/ 868 MHz的版本( ATA5724 / ATA5728 )
数据流的比特时钟
数字地
选择查询或接收模式;低:接收模式,高:轮询模式
数据输出/输入配置
4
ATA5723/ATA5724/ATA5728
9106E–RKE–07/08
ATA5723/ATA5724/ATA5728
3.射频前端
接收器的RF前端是输入转换低中频外差结构显
纳尔成约1兆赫的中频信号用的30dB的典型的镜像抑制。根据图
科幻gure
1-2第3页
前端包括一个LNA(低噪声放大器) , LO(本机振荡器) , I / Q的
混频器,多相位低通滤波器和中频放大器。
该PLL生成驱动频率f
LO
该混频器采用具有完全集成的合成器
集成低噪声的LC -VCO (压控振荡器)和PLL的环路滤波器。对XTO ( crys-
TAL振荡器)产生的基准频率f
REF
= f
XTO
/ 2 ( 868 MHz和433 MHz的版本)
或f
REF
= f
XTO
/ 3 ( 315 MHz的版本) 。集成的LC- VCO产生的两个或四倍
混频器的驱动频率f
VCO
。用的除2或产生用于混频器的I / Q信号
4电路(六
LO
= f
VCO
/ 2为868 MHz的版本中,f
LO
= f
VCO
/ 4为433 MHz和315 MHz的版本) 。
f
VCO
由128或64的因子分和馈入的相位频率检测器,是的COM
相比以f
REF
。相位频率检测器的输出被馈送到一个集成的环路滤波器
并由此产生控制电压的VCO。若f
LO
判定中,f
XTO
可以calcu-
使用下面的公式迟来:
f
REF
= f
LO
/ 128 868 MHz频段中,f
REF
= f
LO
/ 64 433 MHz频段中,f
REF
= f
LO
/ 64 315 MHz的
带。
所述XTO是双销振荡器,工作在石英晶体的串联共振
高电流,低电压信号,使得存在于晶体振荡器只有一个小的电压
频率引脚XTAL1和XTAL2 。根据
图3-1 ,
该晶体的连接
至GND两个用电容器C
L1
和C
L2
从XTAL1和XTAL2分别。的值
这些电容器被推荐的晶体供货商。由于在电感性阻抗
稳态振荡,一些PCB寄生效应,C的较低值
L1
和C
L2
通常
有必要的。
C的值
Lx
对于个别的电路板布局达到的精确值应该优化
f
XTO
并因此F
LO
。 (最佳的方法是使用已知的负载谐振频率的晶体,以
找到该电容器正确的值。 )当在接收频带 - 方面设计系统
宽度和本地振荡器的精度,所说的晶体的精度和所述XTO必须加以考虑。
图3-1 。
XTO外设
DVCC
XTAL2
XTAL1
C
L1
TEST3
TEST2
V
S
C
L2
标称频率f
LO
由RF输入频率f确定
RF
和IF频率f
IF
使用下面的公式(低边注入) :
f
LO
= f
RF
– f
IF
5
9106E–RKE–07/08
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