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特点
符合可信计算组织( TCG )的可信平台模块( TPM )主
规范版本1.2
符合TCG PC客户特定TPM接口规范1.2版
单芯片整体解决方案
五金非对称加密引擎
2048 RSA登录500毫秒
AVR
RISC微处理器
33 MHz的LPC (低引脚数)总线的易PC接口
安全硬件和固件设计
真随机数发生器( RNG ) - FIPS 140.2兼容
安全实时时钟选项
3.3V ± 10 %电源电压
28引脚TSSOP封装或40引脚QFN封装
0-70 °C温度范围
可信
平台
模块
AT97SC3203
摘要
描述
可信平台模块( TPM )的AT97SC3203是Atmel公司的最新产品,
世界上的TPM芯片的首选。爱特梅尔公司是全球第一家生产供应商
v1.1b TPM的AT97SC3201 ,扩大了它的成功为V1.2的TPM与
AT97SC3203 。爱特梅尔继续踱步TPM的技术的发展和
积极参与可信计算组( TCG) ,并有助于专业知识
中的TPM规范的开发。利用Atmel公司的TPM ,您可以
相信,要实现目前市场上最先进的TPM芯片
今天和未来。
该AT97SC3203是一个完全集成的安全模块设计融入
个人计算机和其他嵌入式系统。它实现的1.2版本
可信计算组织规范,可信平台模块。
该TPM包括能够计算2048位RSA的加密加速器
签名在500毫秒和1024位RSA签名100毫秒。性能
SHA-1的促进剂是每64字节块L50微秒。在大多数情况下, TCG的密钥生成
操作将使用专有机制在不到1毫秒内完成。
该芯片具有通过LPC接口的个人计算机进行通信。 TPM的支持
SIRQ (用于中断)和CLKRUN允许时钟停止以节省功耗的
移动计算机。
ADVANCE
信息
牧师5116AS - TPM - 7月5日
注:这是一个总结性文件。一个完整的文档
保密协议下提供。欲了解更多信息,请联系您
当地爱特梅尔销售办事处。
1
图1 。
AT97SC3203框图
只读存储器
节目
EEPROM
节目
33兆赫
LPC
接口
AVR
8/16位
中央处理器
SRAM
EEPROM
数据
GPIO6
V
BB
32.768千赫
GPIO
RNG
RTC
定时器
物理
安全
电路
密码
发动机
图2中。
爱特梅尔AT97SC3203 TPM引脚配置
28引脚TSSOP
9.6毫米,0.65毫米间距
6.1毫米胶宽度
40引脚QFN封装
6.0毫米X 6.0毫米
0.50毫米间距
NC
NC
NC
NC
NC
NC
NC
NC
LPCPD #
SERIRQ
40
39
38
37
36
35
34
33
32
31
11
12
13
14
15
16
17
18
19
20
NC
XTALI / 32K的
XTALO
NC
NC
NC
NC
NC
CLKRUN #
LRESET #
NC
GND
SB3V
GPIO6
NC
TESTI
TestBI / BADD
3V
GND
VBAT
1
2
3
4
5
6
7
8
9
10
30
29
28
27
26
25
24
23
22
21
LAD0
GND
3V
LAD1
LFRAME #
LCLK
LAD2
3V
GND
LAD3
NC 1
NC 2
NC
3
GND 4
SB3V
5
GPIO6 6
NC 7
TESTI
8
TestBI / BADD
9
3V
10
GND 11
VBAT 12
XTALI / 32K 13
XTALO 14
28 LPCPD #
27
SERIRQ
26 LAD0
25 GND
24
3V
23 LAD1
22 LFRAME #
21 LCLK
20 LAD2
19
3V
18 GND
17 LAD3
16 LRESET #
15 CLKRUN
2
AT97SC3203
5116AS-TPM–7/05
AT97SC3203
表1中。
引脚说明
名字
LAD [ 3:0]
LFRAME #
LPCPD #
TSSOP引脚#
17, 20, 23,
26
22
28
QFN封装引脚#
30, 27, 24,
21
26
32
TYPE
输入或
产量
输入
输入
输入或
产量
输入
输入
描述
LPC复用命令,地址,数据:内部上拉,
提供的。
LPC帧:表示一个LPC周期,或者中止的开始。
关机:表示TPM应该电源准备
来的LPC接口上切断。如果该引脚是不用的,它应该是
通过一个电阻连接到3V电源引脚。
PCI时钟运行:低电平有效输出使系统LPC时钟。如果
该引脚是不用的,应当接地。
33MHz的PCI时钟提供时间上的PCI所有交易
总线。
PCI信号来复位驻留在PCI总线上的所有设备。
连载中断请求信号。如果SERIRQ功能
启用时,此引脚应连接到CPU SERIRQ输入,
而行,通过一个电阻上拉至3V电源引脚。如果
该引脚未使用,应该绑在3V电源引脚
通过一个电阻。
备用电源3.3V供电。如果没有单独的备用电源
连接到该引脚,该引脚应直接连接到3V
电源引脚。
通过提供初级3.3V直流电源输入轨
主板。可以被称为Vcc的。
系统地。
无连接。该引脚可浮动。如果XOR链I / O测试
模式时,该引脚应该连接到直接或通过一个接地
电阻器。保留的SMBus数据I / O功能。
无连接。该引脚可浮动。如果XOR链I / O测试
模式时,该引脚应该连接到直接或通过一个接地
电阻器。保留的SMBus时钟输入功能。
卖方无连接,为指定的PC客户端TIS
规范。该引脚可浮动。如果XOR链I / O测试
模式时,该引脚应该连接到直接或通过一个接地
电阻器。
通用输入/输出。内部上拉电阻。该引脚
映射到NV指数TPM_NV_INDEX_GPIO_00 ,并作为
该GPIO - EXPRESS- 00 。默认TPM配置: GPIO输入。
GPIO6也可以作为在I / O测试模式异或链输出。
无连接。该输入引脚具有内部下拉电阻和
可浮动。如果异或链I / O测试模式时,该引脚
应直接或通过一个电阻连接到电源电压为3V 。
TPM制造测试输入无效。该引脚可浮动。如果
异或链I / O测试模式时,该引脚应直接挂钩
到地面。
TestBI和BADD功能禁用。该引脚应连接
直接接地。
CLKRUN #
LCLK
LRESET #
15
21
16
19
25
20
SERIRQ
27
31
输入或
产量
SB3V
5
3
输入
3V
GND
NC
10, 19, 24
4, 11, 18, 25
1
8, 23, 28
2, 9, 22, 29
39
输入
输入
产量
NC
2
40
产量
VNC
3
1
产量
GPIO6
6
4
输入或
产量
NC
7
5
输入
TESTI
8
6
产量
TestBI / BADD
9
7
输入
3
5116AS-TPM–7/05
表1中。
引脚说明(续)
名字
VBAT
XTALI / 32K的
XTALO
TSSOP引脚#
12
13
14
QFN封装引脚#
10
12
13
TYPE
输入
输入
产量
描述
3.3V电池输入。如果没有外部电池连接到该引脚,
该引脚应直接连接到3V电源引脚。
32 kHz晶振输入或32 kHz的时钟输入。该引脚
应连接,如果不使用接地。
32 kHz晶振输出。
绝对最大额定值(初步)
工作温度.............................. 0 ° C至+ 70°C
存储温度(不带偏见) ........... 0 ° C至+ 70°C
电压I / O引脚..............................- 0.1 V
CC
+0.3V
电压VCC相对于地面................. 6.0V
最大ESD电压2000V ..........................................
*注意:
强调超越那些在列
绝对
最大额定值“,可能会造成永久性
损坏设备。这是一个额定值
和设备的这些功能操作或
超越那些标明的任何其他条件
本规范的业务部门可能
引起暂时性或永久性失效。曝光
在绝对最大额定值条件下,
长时间可能会影响器件的可靠性。
表2中。
DC参数(初步)
VCC = 3.0 3.6V ;温度为0 70℃
符号
VCC
ICC
IST
ISL
伊布
ILIO
VIH
VIL
VOH
VOL
IOLCR
CI
注意事项:
参数
电源电压
工作电流为FCLK = 33 MHz的
静态电流
休眠电流,芯片空闲
电池电流
输入漏
输入高门槛
输入低阈值
输出高电压
输出低电压
输出低电流, CLKRUN #
输入引脚电容
1.这些参数保证了设计。
7
6
0.5 * Vcc的
-0.5
0.9 * Vcc的
0.98 * Vcc的
0.1 * Vcc的
3.0
3.3
25
5
40
2
0.1
最大
3.6
50
10
100
4
3
0.5 + Vcc的
0.3 * Vcc的
单位
V
mA
mA
A
A
A
V
V
V
V
mA
pF
在IOUT = -500 μA
V在IOUT = 1.5毫安
在VOUT = 0.615 * VCC
注1
VCC = 3.6V ;值为fXTAL = 0赫兹;
积极投入
VCC = 3.6V ;值为fXTAL = 0赫兹
VCC = 0V ;值为fXTAL = 0赫兹
VIN = VCC或GND
笔记
4
AT97SC3203
5116AS-TPM–7/05
AT97SC3203
表3中。
AC参数
CL = 10pF的; VCC = 3.0 3.7V ;温度为0 70 -C
符号
Tval
花花公子
TSU
TH
TRST
TRST-
CLK
TRST-
关闭
TCLKIN
TCLKL
O
tCLKHI
注意事项:
参数
CLK在信号有效的延迟 - LAD0-3
FL燕麦主动延迟
积极为FL燕麦延迟
输入设置时间CLK
输入保持时间从CLK
重新上电后稳定的活动时间
复位有效CLK稳定后
重新激活输出FL燕麦延迟
CLK周期
CLK低时间
CLK高时间
29.5
13.4
13.4
30
7
0
1
100
40
31
18
18
2
–500
2
2
5
4
28
最大
11
单位
nS
nS
nS
nS
nS
mS
mS
nS
nS
nS
nS
注1
注1
注1
注3
注2 ,注3
注2 ,注3
笔记
测量Vtrise = 0.285 * VCC和Vtfal
= 0.615 * VCC 。测量从CLK在VTEST =
0.4 * VCC ;负载= 200 。
1.这些参数保证了设计。
2.相对于测量到的信号交叉VTEST所有参数= 0.4 * VCC的,除非另有说明。
3.最小参数绝不能在任何情况下,除非违反LRESET #是断言。如果适当CLKRUN #
信令观察,最大规格可侵犯。
表4 。
订购信息
订购代码
(1)
AT97SC3203-01AC
AT97SC3203-X1AC
AT97SC3203-01MC
AT97SC3203-X1MC
注意事项:
28A3 ( TSSOP )
28A3 ( TSSOP )
40ML1 ( QFN )
40ML1 ( QFN )
LEAD -FREE
(2)
LEAD -FREE
(2)
工作范围
商用(0 °至70℃ )
商用(0 °至70℃ )
商用(0 °至70℃ )
商用(0 °至70℃ )
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5
5116AS-TPM–7/05
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    -
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