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位置：首页 > IC型号导航 > 首字符A型号页 > 首字符A的型号第390页 > AT89S8253-24SC
特点
兼容MCS
产品-51
在系统可编程（ ISP）闪存程序存储器12K字节
- 对下载程序的SPI串行接口
耐力：10,000写/擦除周期
2K字节的EEPROM数据存储器
- 耐力：100,000写/擦除周期
64字节用户签名数组
2.7V至5.5V工作电压范围
全静态操作： 0 Hz至24 MHz的
三级程序存储器锁定
256 ×8位内部RAM
32个可编程I / O线
3个16位定时器/计数器
九中断源
增强型UART串行口与帧错误检测和自动地址
承认
增强的SPI （双读/写缓冲）串行接口
低功耗空闲和掉电模式
恢复中断从掉电模式
可编程看门狗定时器
双数据指针
断电标志
灵活的ISP编程（字节和页模式）
- 页面模式： 64字节/页的程序存储器， 32字节/页的数据存储器
四级增强型中断控制器
可编程和Fuseable X2时钟选项
内部上电复位
42引脚PDIP封装选项，可降低EMC辐射
8-bit
微控制器
有12K字节
闪存和2K
字节EEPROM
AT89S8253
初步
描述
该AT89S8253是一种低功耗，高性能CMOS 8位微控制器
12K字节的系统内可编程（ ISP）闪存程序存储器和2K字节
EEPROM数据存储器。该器件采用Atmel的高密度非制造
非易失性存储器技术，与工业标准的MCS -51兼容
指令集和引脚。片上下载Flash允许程序存储器中的
储器，以通过SPI串行接口或通过一个常规的可在系统编程
非易失性存储器编程。通过结合一个多功能8位CPU与下装
一个单芯片上能够闪光， Atmel的AT89S8253是一个功能强大的单片机
它提供了一个高度灵活和具有成本效益的解决方案，为许多嵌入式控制
应用程序。
该AT89S8253提供以下标准功能：对系统内亲12K字节
可编程闪存， EEPROM 2K字节， 256字节RAM ， 32个I / O口线，
可编程看门狗定时器， 2个数据指针，三个16位定时器/计数器，一个六
矢量， 4级中断结构，一个全双工串行口，片内振荡器和
时钟电路。此外， AT89S8253设计有静态逻辑操作
下降到零频率，并支持两种软件选择的省电模式。
空闲模式下，CPU停止工作，允许RAM ，定时器/计数器，串行端口，
中断系统继续工作。在掉电模式保存RAM CON-
帐篷，但冻结振荡器，禁用所有其他芯片功能，直到下一个外部
中断或硬件复位。
板载闪存/ EEPROM是通过SPI串行接口访问。控股
RESET现役部队SPI总线为串行编程接口，允许
程序存储器写入或读出，除非一个或多个锁定位已
激活。
修订版3286A -MICRO- 7月4日
1
销刀豆网络gurations
PDIP
PLCC
P1.4 （ SS ）
P1.3
P1.2
P1.1 （ T2 EX ）
P1.0 （T2）的
NC
VCC
P0.0 （ AD0 ）
P0.1 （ AD1 ）
P0.2 （ AD2 ）
P0.3 （ AD3 ）
RST
（RXD） P3.0
（TXD） P3.1
（ INT0 ） P3.2
（ INT1 ） P3.3
（ T0 ） P3.4
（T1）， P3.5
（ WR ）， P3.6
（ RD ）， P3.7
XTAL2
XTAL1
GND
PWRGND
（A8） P2.0
（A9） P2.1
（A10） P2.2
（A11） P2.3
（ A12 ） P2.4
（ A13 ） P2.5
（ A14 ） P2.6
（ A15 ） P2.7
（ T2）， P1.0
（ T2 EX ） P1.1
P1.2
P1.3
（ SS ） P1.4
（ MOSI ）， P1.5
（ MISO ）， P1.6
（ SCK ） P1.7
RST
（RXD） P3.0
（TXD） P3.1
（ INT0 ） P3.2
（ INT1 ） P3.3
（ T0 ） P3.4
（T1）， P3.5
（ WR ）， P3.6
（ RD ）， P3.7
XTAL2
XTAL1
GND
1
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VCC
P0.0 （ AD0 ）
P0.1 （ AD1 ）
P0.2 （ AD2 ）
P0.3 （ AD3 ）
P0.4 （ AD4 ）
P0.5 （ AD5 ）
P0.6 （ AD6 ）
P0.7 （ AD7 ）
EA / VPP
ALE / PROG
PSEN
P2.7 （ A15 ）
P2.6 （ A14 ）
P2.5 （ A13 ）
P2.4 （ A12 ）
P2.3 （A11）
P2.2 （A10）
P2.1 （A9）
P2.0 （A8）
TQFP
P1.4 （ SS ）
P1.3
P1.2
P1.1 （ T2 EX ）
P1.0 （T2）的
NC
VCC
P0.0 （ AD0 ）
P0.1 （ AD1 ）
P0.2 （ AD2 ）
P0.3 （ AD3 ）
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（ MOSI ）， P1.5
（ MISO ）， P1.6
（ SCK ） P1.7
RST
（RXD） P3.0
NC
（TXD） P3.1
（ INT0 ） P3.2
（ INT1 ） P3.3
（ T0 ） P3.4
（T1）， P3.5
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P0.4 （ AD4 ）
P0.5 （ AD5 ）
P0.6 （ AD6 ）
P0.7 （ AD7 ）
EA / VPP
NC
ALE / PROG
PSEN
P2.7 （ A15 ）
P2.6 （ A14 ）
P2.5 （ A13 ）
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AT89S8253 [初步]
3286A–MICRO–7/04
（ WR ）， P3.6
（ RD ）， P3.7
XTAL2
XTAL1
GND
GND
（A8） P2.0
（A9） P2.1
（A10） P2.2
（A11） P2.3
（ A12 ） P2.4
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（ WR ）， P3.6
（ RD ）， P3.7
XTAL2
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GND
NC
（A8） P2.0
（A9） P2.1
（A10） P2.2
（A11） P2.3
（ A12 ） P2.4
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（ MOSI ）， P1.5
（ MISO ）， P1.6
（ SCK ） P1.7
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（RXD） P3.0
NC
（TXD） P3.1
（ INT0 ） P3.2
（ INT1 ） P3.3
（ T0 ） P3.4
（T1）， P3.5
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P0.4 （ AD4 ）
P0.5 （ AD5 ）
P0.6 （ AD6 ）
P0.7 （ AD7 ）
EA / VPP
NC
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PSEN
P2.7 （ A15 ）
P2.6 （ A14 ）
P2.5 （ A13 ）
PDIP
42
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P1.7 （ SCK ）
P1.6 （ MISO ）
P1.5 （ MOSI ）
P1.4 （ SS ）
P1.3
P1.2
P1.1 （ T2EX ）
P1.0 （T2）的
VDD
PWRVDD
P0.0 （ AD0 ）
P0.1 （ AD1 ）
P0.2 （ AD2 ）
P0.3 （ AD3 ）
P0.4 （ AD4 ）
P0.5 （ AD5 ）
P0.6 （ AD6 ）
P0.7 （ AD7 ）
EA / VPP
ALE / PROG
PSEN
AT89S8253 [初步]
引脚说明
VCC
GND
VDD
PWRVDD
电源电压（除42 - PDIP所有的包）。
地面（除42 - PDIP所有套餐; 42引脚PDIP GND相连只有逻辑核心和
嵌入式程序/数据存储器） 。
电源电压为42引脚PDIP ，连接唯一的核心逻辑和嵌入式亲
克/数据存储器。
电源电压为42-引脚PDIP只连接的I / O焊盘的驱动程序。
应用板
必须
连接VDD和PWRVDD的电路板电源电压。
PWRGND
地面为42引脚PDIP ，只有连接的I / O焊盘的驱动程序。 PWRGND和GND
通过共同的硅衬底的弱连接，但不通过任何金属链接。该
应用板
必须
无论GND和PWRGND连接到电路板接地。
P0口是一个8位漏极开路双向I / O口。作为输出口，每位能驱动6 TTL
输入。当1秒写入端口0引脚，引脚可作为高阻抗输入。
端口0也可以被配置成在被复用的低阶地址/数据总线
访问外部程序和数据存储器。在这种模式下， P0具有内部上拉电阻。
P0口还可在Flash编程接收的字节代码，并输出代码字节
在程序验证。
在程序的验证，需要外部上拉电阻。
端口0
端口1
端口1是一个8位双向I / O和内部上拉电阻的端口。端口1输出缓冲器可
汇/源6 TTL逻辑电平。当1秒写入端口1引脚，它们拉高了
内部弱上拉，并可以作为输入。作为输入使用时， P1口是外部
被拉低时将输出电流（I
IL
,150
一个典型的因为内部弱上拉的） 。
一些端口1引脚提供额外的功能。 P1.0和P1.1可以被配置为在
定时器/计数器2的外部计数输入（ P1.0 / T2）和定时器/计数器2的触发输入
（ P1.1 / T2EX ） ，分别。
此外， P1.4 ， P1.5 ， P1.6 ， P1.7和可配置为SPI的从端口选择，数据
输入/输出和移位时钟输入/输出引脚作为示于下表中。
端口引脚
P1.0
P1.1
P1.4
P1.5
P1.6
P1.7
第二功能
T2 （外部计数输入到定时器/计数器2 ） ，时钟输出
T2EX （定时器/计数器2捕捉/重装触发和方向控制）
SS （从端口选择输入）
MOSI （主数据输出，从机数据输入引脚SPI通道）
MISO （主数据输入，从机数据输出引脚SPI通道）
SCK（主控时钟输出，从机时钟输入引脚SPI通道）
端口1也接收过程中的Flash编程和校验低位地址字节。
3
3286A–MICRO–7/04
端口2
端口2是一个8位双向I / O和内部上拉电阻的端口。端口2输出缓冲器可
汇/源6 TTL逻辑电平。当1秒写入端口2引脚，它们拉高了
内部弱上拉，并可以作为输入。作为输入使用时， P2口是外部
被拉低时将输出电流（I
IL
,150
一个典型的因为内部弱上拉的） 。
端口2在从外部程序存储器取发出的高位地址字节
在使用16位地址外部数据存储器访问（ MOVX @ DPTR ） 。在这
应用程序， P2口使用很强的内部上拉发送1 。在外部访问
使用8位地址（ MOVX @ RI）的数据存储器，端口2发出的P2的内容
特殊功能寄存器。
端口2还接收闪光期间的高位地址位和一些控制信号
编程和VERI网络阳离子。
端口3
端口3是一个8位双向I / O和内部上拉电阻的端口。端口3输出缓冲器可
汇/源6 TTL逻辑电平。当1秒写入端口3引脚，它们拉高了
内部弱上拉，并可以作为输入。作为输入使用时， P3口是外部
被拉低时将输出电流（I
IL
,150
一个典型的因为内部弱上拉的） 。
端口3收到对Flash编程和校验一些控制信号。
端口3也可以用做其他不同的特殊功能AT89S8253的功能，如图所示
下面的表格。
端口引脚
P3.0
P3.1
P3.2
P3.3
P3.4
P3.5
P3.6
P3.7
注意：
第二功能
RXD （串行输入端口）
TXD （串行输出端口）
INT0 （外部中断0 ）
(1)
INT1 （外部中断1 ）
(1)
T0 （定时器0外部输入）
T1（定时器1外部输入）
WR （外部数据存储器写选通）
RD （外部数据存储器读选通）
1.在端口1和端口2和端口3 ，几乎所有引脚上的所有引脚（例外是P3.2 INT0和P3.3
INT1 ）在掉电模式下禁止其内部弱上拉。端口引脚P3.2
（INT0 ）和P3.1 （INT1 ）的活性，即使在掉电模式（能够感测
中断请求退出掉电模式） ，因此还是有自己的内部弱
引体向上打开。
RST
ALE / PROG
复位输入。高该引脚上至少有两个机器周期振荡器运行时
重置设备。
地址锁存使能。 ALE / PROG是一输出脉冲用于锁存地址的低字节
（在其下降沿）时访问外部存储器。该引脚也是编程脉冲
输入（ PROG ）在Flash编程。
在正常操作中， ALE以1/6的恒定速率的振荡器频率和可
用于外部定时或时钟的目的。但是请注意，一个ALE脉冲
在每次访问外部数据存储器跳过。
4
AT89S8253 [初步]
3286A–MICRO–7/04
AT89S8253 [初步]
如果需要， ALE操作可以通过设置位的AUXR SFR的0在位置8EH被禁用。
同位设置，只有一条MOVX和MOVC指令ALE激活。否则，销是
微弱拉高。设置ALE-禁止位没有任何影响，如果微控制器处于外部
执行模式。
PSEN
程序存储启用。 PSEN是读选通外部程序存储器（低电平有效） 。
当AT89S8253执行外部程序存储器代码， PSEN被激活
两次每个机器周期，除了两个PSEN激活期间，每次访问都被跳过
到外部数据存储器。
EA / VPP
外部访问允许。 EA必须以允许在设备上读取绑到GND
从外部程序存储器位置的代码开始0000H到FFFFH 。但是请注意，
如果锁定位1被编程， EA将内部锁存复位。
EA应绑V
CC
内部程序执行。该引脚也接收
12伏的编程使能电压（V
PP
）在Flash编程时， 12伏编程
明被选中。
XTAL1
XTAL2
输入到振荡器反相放大器和输入到内部时钟工作电路。
输出振荡器反相放大器器。
5
3286A–MICRO–7/04
特点
兼容MCS
产品-51
在系统可编程（ ISP）闪存程序存储器12K字节
- 对下载程序的SPI串行接口
耐力：10,000写/擦除周期
2K字节的EEPROM数据存储器
- 耐力：100,000写/擦除周期
64字节用户签名数组
2.7V至5.5V工作电压范围
全静态操作： 0 Hz至24 MHz的
三级程序存储器锁定
256 ×8位内部RAM
32个可编程I / O线
3个16位定时器/计数器
九中断源
增强型UART串行口与帧错误检测和自动
地址识别
增强的SPI （双读/写缓冲）串行接口
低功耗空闲和掉电模式
恢复中断从掉电模式
可编程看门狗定时器
双数据指针
断电标志
灵活的ISP编程（字节和页模式）
- 页面模式： 64字节/页的程序存储器， 32字节/页的数据存储器
四级增强型中断控制器
可编程和Fuseable X2时钟选项
内部上电复位
42引脚PDIP封装选项，可降低EMC辐射
绿色（无铅/无卤化物）的包装选项
8-bit
微控制器
有12K字节
闪存和2K
字节EEPROM
AT89S8253
1.描述
该AT89S8253是一种低功耗，高性能CMOS 8位微控制器
12K字节的系统内可编程（ ISP）闪存程序存储器和2K字节
EEPROM数据存储器。该器件采用Atmel的高密度非制造
非易失性存储器技术，与工业标准的MCS -51兼容
指令集和引脚。片上下载Flash允许程序存储器中的
储器，以通过SPI串行接口或通过一个可在系统编程
传统的非易失性存储器编程。通过结合一个多功能的8位CPU
一个单芯片上可下载的闪存， Atmel的AT89S8253是一款功能强大
微控制器提供了一个高度灵活和具有成本效益的解决方案很多
嵌入式控制应用。
3286H–MICRO–9/05
该AT89S8253提供以下标准功能：对系统内可编程12K字节
BLE闪存， EEPROM 2K字节， 256字节RAM ， 32个I / O口线，可编程看门狗定时器，
两个数据指针，三个16位定时器/计数器，一个6向量， 4级中断结构，全
全双工串行口，片内振荡器和时钟电路。此外， AT89S8253设计
与静态逻辑操作下降到零频率，并支持两种软件可选
省电模式。空闲模式下，CPU停止工作，允许RAM ，定时器/计数器，
串行口和中断系统继续工作。在掉电模式保存RAM
内容，但冻结振荡器，禁止所有其他芯片功能，直到下一个外部中断
中断或硬件复位。
板载闪存/ EEPROM是通过SPI串行接口访问。保持复位
现役部队SPI总线为串行编程接口，允许程序存储器
写入或从，除非一个或多个锁定位被激活读取。
2.引脚配置
2.1
40P6 - 40引脚PDIP
（ T2）， P1.0
（ T2 EX ） P1.1
P1.2
P1.3
（ SS ） P1.4
（ MOSI ）， P1.5
（ MISO ）， P1.6
（ SCK ） P1.7
RST
（RXD） P3.0
（TXD） P3.1
（ INT0 ） P3.2
（ INT1 ） P3.3
（ T0 ） P3.4
（T1）， P3.5
（ WR ）， P3.6
（ RD ）， P3.7
XTAL2
XTAL1
GND
1
2
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6
7
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VCC
P0.0 （ AD0 ）
P0.1 （ AD1 ）
P0.2 （ AD2 ）
P0.3 （ AD3 ）
P0.4 （ AD4 ）
P0.5 （ AD5 ）
P0.6 （ AD6 ）
P0.7 （ AD7 ）
EA / VPP
ALE / PROG
PSEN
P2.7 （ A15 ）
P2.6 （ A14 ）
P2.5 （ A13 ）
P2.4 （ A12 ）
P2.3 （A11）
P2.2 （A10）
P2.1 （A9）
P2.0 （A8）
2.2
44A - 44引脚TQFP
P1.4 （ SS ）
P1.3
P1.2
P1.1 （ T2 EX ）
P1.0 （T2）的
NC
VCC
P0.0 （ AD0 ）
P0.1 （ AD1 ）
P0.2 （ AD2 ）
P0.3 （ AD3 ）
44
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（ MOSI ）， P1.5
（ MISO ）， P1.6
（ SCK ） P1.7
RST
（RXD） P3.0
NC
（TXD） P3.1
（ INT0 ） P3.2
（ INT1 ） P3.3
（ T0 ） P3.4
（T1）， P3.5
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P0.4 （ AD4 ）
P0.5 （ AD5 ）
P0.6 （ AD6 ）
P0.7 （ AD7 ）
EA / VPP
NC
ALE / PROG
PSEN
P2.7 （ A15 ）
P2.6 （ A14 ）
P2.5 （ A13 ）
2
AT89S8253
3286H–MICRO–9/05
（ WR ）， P3.6
（ RD ）， P3.7
XTAL2
XTAL1
GND
GND
（A8） P2.0
（A9） P2.1
（A10） P2.2
（A11） P2.3
（ A12 ） P2.4
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AT89S8253
2.3
44J - 44引脚PLCC
P1.4 （ SS ）
P1.3
P1.2
P1.1 （ T2 EX ）
P1.0 （T2）的
NC
VCC
P0.0 （ AD0 ）
P0.1 （ AD1 ）
P0.2 （ AD2 ）
P0.3 （ AD3 ）
2.4
42PS6 - PDIP
RST
（RXD） P3.0
（TXD） P3.1
（ INT0 ） P3.2
（ INT1 ） P3.3
（ T0 ） P3.4
（T1）， P3.5
（ WR ）， P3.6
（ RD ）， P3.7
XTAL2
XTAL1
GND
PWRGND
（A8） P2.0
（A9） P2.1
（A10） P2.2
（A11） P2.3
（ A12 ） P2.4
（ A13 ） P2.5
（ A14 ） P2.6
（ A15 ） P2.7
1
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P1.7 （ SCK ）
P1.6 （ MISO ）
P1.5 （ MOSI ）
P1.4 （ SS ）
P1.3
P1.2
P1.1 （ T2EX ）
P1.0 （T2）的
VDD
PWRVDD
P0.0 （ AD0 ）
P0.1 （ AD1 ）
P0.2 （ AD2 ）
P0.3 （ AD3 ）
P0.4 （ AD4 ）
P0.5 （ AD5 ）
P0.6 （ AD6 ）
P0.7 （ AD7 ）
EA / VPP
ALE / PROG
PSEN
3.引脚说明
3.1
VCC
电源电压（除42 - PDIP所有的包）。
3.2
GND
地面（除42 - PDIP所有套餐; 42引脚PDIP GND相连只有逻辑核心和
嵌入式程序/数据存储器） 。
3.3
VDD
电源电压为42引脚PDIP ，连接唯一的核心逻辑和嵌入式亲
克/数据存储器。
3.4
PWRVDD
电源电压为42-引脚PDIP只连接的I / O焊盘的驱动程序。
应用板
必须
连接VDD和PWRVDD的电路板电源电压。
3
3286H–MICRO–9/05
（ WR ）， P3.6
（ RD ）， P3.7
XTAL2
XTAL1
GND
NC
（A8） P2.0
（A9） P2.1
（A10） P2.2
（A11） P2.3
（ A12 ） P2.4
18
19
20
21
22
23
24
25
26
27
28
（ MOSI ）， P1.5
（ MISO ）， P1.6
（ SCK ） P1.7
RST
（RXD） P3.0
NC
（TXD） P3.1
（ INT0 ） P3.2
（ INT1 ） P3.3
（ T0 ） P3.4
（T1）， P3.5
6
5
4
3
2
1
44
43
42
41
40
7
8
9
10
11
12
13
14
15
16
17
39
38
37
36
35
34
33
32
31
30
29
P0.4 （ AD4 ）
P0.5 （ AD5 ）
P0.6 （ AD6 ）
P0.7 （ AD7 ）
EA / VPP
NC
ALE / PROG
PSEN
P2.7 （ A15 ）
P2.6 （ A14 ）
P2.5 （ A13 ）
3.5
PWRGND
地面为42引脚PDIP ，只有连接的I / O焊盘的驱动程序。 PWRGND和GND
通过共同的硅衬底的弱连接，但不通过任何金属链接。该
应用板
必须
无论GND和PWRGND连接到电路板接地。
3.6
端口0
P0口是一个8位漏极开路双向I / O口。作为输出口，每位能驱动6 TTL
输入。当1秒写入端口0引脚，引脚可作为高阻抗输入。
端口0也可以被配置成在访问多路复用的低位地址/数据总线
外部程序和数据存储器。在这种模式下， P0具有内部上拉电阻。
P0口还可在Flash编程接收的字节代码，并输出代码字节很好地协同
荷兰国际集团计划验证。
在程序的验证，需要外部上拉电阻。
3.7
端口1
端口1是一个8位双向I / O和内部上拉电阻的端口。端口1输出缓冲器可
汇/源6 TTL逻辑电平。当1秒写入端口1引脚，它们被拉高弱
内部上拉，并可以作为输入。作为输入使用时， P1口被外部
拉低时将输出电流（I
IL
,150
一个典型的因为内部弱上拉的） 。
一些端口1引脚提供额外的功能。 P1.0和P1.1可以被配置为在
定时器/计数器2的外部计数输入（ P1.0 / T2）和定时器/计数器2的触发输入（ P1.1 / T2EX ）
分别。
此外， P1.4 ， P1.5 ， P1.6 ， P1.7和可配置为SPI的从端口选择，数据
输入/输出和移位时钟输入/输出引脚作为示于下表中。
端口引脚
P1.0
P1.1
P1.4
P1.5
P1.6
P1.7
第二功能
T2 （外部计数输入到定时器/计数器2 ） ，时钟输出
T2EX （定时器/计数器2捕捉/重装触发和方向控制）
SS （从端口选择输入）
MOSI （主数据输出，从机数据输入引脚SPI通道）
MISO （主数据输入，从机数据输出引脚SPI通道）
SCK（主控时钟输出，从机时钟输入引脚SPI通道）
端口1也接收过程中的Flash编程和校验低位地址字节。
3.8
端口2
端口2是一个8位双向I / O和内部上拉电阻的端口。端口2输出缓冲器可
汇/源6 TTL逻辑电平。当1秒写入端口2引脚，它们是拉高由弱
内部上拉，并可以作为输入。作为输入使用时， P2口被外部
拉低时将输出电流（I
IL
,150
一个典型的因为内部弱上拉的） 。
端口2在从外部程序存储器和很好地协同取发出的高位地址字节
ING访问到使用16位地址的外部数据存储器（ MOVX @ DPTR ） 。在这
应用程序， P2口使用很强的内部上拉发送1 。在外部访问
使用8位地址（ MOVX @ RI）的数据存储器，端口2发出的P2的内容
特殊功能寄存器。
端口2还接收闪光期间的高位地址位和一些控制信号
编程和VERI网络阳离子。
4
AT89S8253
3286H–MICRO–9/05
AT89S8253
3.9
端口3
端口3是一个8位双向I / O和内部上拉电阻的端口。端口3输出缓冲器可
汇/源6 TTL逻辑电平。当1秒写入端口3引脚，它们被拉高弱
内部上拉，并可以作为输入。作为输入使用时， P3口被外部
拉低时将输出电流（I
IL
,150
一个典型的因为内部弱上拉的） 。
端口3收到对Flash编程和校验一些控制信号。
端口3也可以用做其他不同的特殊功能AT89S8253的功能，如图所示
下面的表格。
端口引脚
P3.0
P3.1
P3.2
P3.3
P3.4
P3.5
P3.6
P3.7
注意：
第二功能
RXD （串行输入端口）
TXD （串行输出端口）
INT0 （外部中断0 ）
(1)
INT1 （外部中断1 ）
(1)
T0 （定时器0外部输入）
T1（定时器1外部输入）
WR （外部数据存储器写选通）
RD （外部数据存储器读选通）
1.在端口1和端口2和端口3 ，几乎所有引脚上的所有引脚（例外是P3.2 INT0和P3.3
INT1 ）在掉电模式下禁止其内部弱上拉。端口引脚P3.2
（INT0 ）和P3.3 （INT1 ）的活性，即使在掉电模式（能够感测
中断请求退出掉电模式） ，因此还是有自己的内部弱
引体向上打开。
3.10
RST
复位输入。高该引脚上至少有两个机器周期振荡器运行时
重置设备。
3.11
ALE / PROG
地址锁存使能。 ALE / PROG是一输出脉冲用于锁存地址的低字节（上
在访问外部存储器的下降沿）。该引脚也用作编程输入脉冲
（ PROG ）在Flash编程。
在正常操作中， ALE以1/6的恒定速率的振荡器频率，可以是
用于外部定时或时钟的目的。但是请注意，一个ALE脉冲被跳过很好地协同
荷兰国际集团每次访问外部数据存储器。
如果需要， ALE操作可以通过设置位的AUXR SFR的0在位置8EH被禁用。同
该位设置，只有一条MOVX和MOVC指令ALE激活。否则，该引脚为弱
拉高。设置ALE-禁止位没有任何影响，如果微控制器处于外部execu-
化模式。
3.12
PSEN
程序存储启用。 PSEN是读选通外部程序存储器（低电平有效） 。
当AT89S8253执行外部程序存储器代码， PSEN被激活
两次每个机器周期，除了两个PSEN激活期间，每次访问都被跳过
外部数据存储器。
5
3286H–MICRO–9/05
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