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位置：首页 > IC型号导航 > 首字符A型号页 > 首字符A的型号第151页 > AT89LS51
特点
兼容MCS- 51
制品
在系统可编程（ ISP） Flash存储器的4K字节
- 耐力： 1000写/擦除周期
2.7V至4.0V工作电压范围
全静态操作： 0 Hz至16 MHz的
三级程序存储器锁定
128 ×8位内部RAM
32个可编程I / O线
2个16位定时器/计数器
6个中断源
全双工UART串行通道
低功耗空闲和掉电模式
恢复中断从掉电模式
看门狗定时器
双数据指针
断电标志
灵活的ISP编程（字节和页模式）
描述
该AT89LS51是一个低电压，高性能CMOS 8位微控制器与4K
字节的系统内可编程闪存。该器件采用制造
Atmel的高密度非易失性存储器技术，并与行业兼容
尝试标准80C51指令集和引脚。片上Flash允许程序
内存在系统或通过传统的非易失性存储器进行重新编程亲
语法。通过在结合了多功能8位CPU与系统内可编程闪存
单片芯片， Atmel的AT89LS51是一个功能强大的单片机，它提供一个
高度灵活和具有成本效益的解决方案，为许多嵌入式控制应用。
该AT89LS51提供以下标准功能： 4K字节的闪存， 128字节
的RAM ， 32个I / O口线，看门狗定时器，两个数据指针，两个16位定时器/计数器，一个
五向量2级中断结构，一个全双工串行口，片上振荡器，
和时钟电路。此外， AT89LS51设计有静态逻辑操作
下降到零频率，并支持两种软件选择的省电模式。
空闲模式下，CPU停止工作，允许RAM ，定时器/计数器，串行端口，
中断系统继续工作。在掉电模式保存RAM CON-
帐篷，但冻结振荡器，禁用所有其他芯片功能，直到下一个外部
中断或硬件复位。
8-bit
低电压
微控制器
4K字节
在系统
可编程
FL灰
AT89LS51
初步
修订版3053A - 8051-05 / 02
1
销刀豆网络gurations
PDIP
P1.0
P1.1
P1.2
P1.3
P1.4
（ MOSI ）， P1.5
（ MISO ）， P1.6
（ SCK ） P1.7
RST
（RXD） P3.0
（TXD） P3.1
（ INT0 ） P3.2
（ INT1 ） P3.3
（ T0 ） P3.4
（T1）， P3.5
（ WR ）， P3.6
（ RD ）， P3.7
XTAL2
XTAL1
GND
1
2
3
4
5
6
7
8
9
10
11
12
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15
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34
33
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31
30
29
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26
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24
23
22
21
VCC
P0.0 （ AD0 ）
P0.1 （ AD1 ）
P0.2 （ AD2 ）
P0.3 （ AD3 ）
P0.4 （ AD4 ）
P0.5 （ AD5 ）
P0.6 （ AD6 ）
P0.7 （ AD7 ）
EA / VPP
ALE / PROG
PSEN
P2.7 （ A15 ）
P2.6 （ A14 ）
P2.5 （ A13 ）
P2.4 （ A12 ）
P2.3 （A11）
P2.2 （A10）
P2.1 （A9）
P2.0 （A8）
PLCC
P1.4
P1.3
P1.2
P1.1
P1.0
NC
VCC
P0.0 （ AD0 ）
P0.1 （ AD1 ）
P0.2 （ AD2 ）
P0.3 （ AD3 ）
TQFP
P1.4
P1.3
P1.2
P1.1
P1.0
NC
VCC
P0.0 （ AD0 ）
P0.1 （ AD1 ）
P0.2 （ AD2 ）
P0.3 （ AD3 ）
44
43
42
41
40
39
38
37
36
35
34
（ MOSI ）， P1.5
（ MISO ）， P1.6
（ SCK ） P1.7
RST
（RXD） P3.0
NC
（TXD） P3.1
（ INT0 ） P3.2
（ INT1 ） P3.3
（ T0 ） P3.4
（T1）， P3.5
1
2
3
4
5
6
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P0.4 （ AD4 ）
P0.5 （ AD5 ）
P0.6 （ AD6 ）
P0.7 （ AD7 ）
EA / VPP
NC
ALE / PROG
PSEN
P2.7 （ A15 ）
P2.6 （ A14 ）
P2.5 （ A13 ）
2
AT89LS51
3053A–8051–05/02
（ WR ）， P3.6
（ RD ）， P3.7
XTAL2
XTAL1
GND
GND
（A8） P2.0
（A9） P2.1
（A10） P2.2
（A11） P2.3
（ A12 ） P2.4
（ WR ）， P3.6
（ RD ）， P3.7
XTAL2
XTAL1
GND
NC
（A8） P2.0
（A9） P2.1
（A10） P2.2
（A11） P2.3
（ A12 ） P2.4
18
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（ MOSI ）， P1.5
（ MISO ）， P1.6
（ SCK ） P1.7
RST
（RXD） P3.0
NC
（TXD） P3.1
（ INT0 ） P3.2
（ INT1 ） P3.3
（ T0 ） P3.4
（T1）， P3.5
7
8
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4
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44
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36
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33
32
31
30
29
P0.4 （ AD4 ）
P0.5 （ AD5 ）
P0.6 （ AD6 ）
P0.7 （ AD7 ）
EA / VPP
NC
ALE / PROG
PSEN
P2.7 （ A15 ）
P2.6 （ A14 ）
P2.5 （ A13 ）
AT89LS51
框图
P0.0 - P0.7
P2.0 - P2.7
V
CC
端口0 DRIVERS
GND
PORT 2名司机
RAM地址。
注册
内存
端口0
LATCH
端口2
LATCH
FL灰
B
注册
加
堆
指针
节目
地址
注册
卜FF器
TMP2
TMP1
ALU
中断，串口，
和定时器功能块
PC
增量
PSW
节目
计数器
PSEN
ALE / PROG
EA / V
PP
RST
观看
狗
端口3
LATCH
定时
和
控制
指令
注册
双DPTR
端口1
LATCH
ISP
PORT
节目
逻辑
OSC
端口3驱动程序
PORT 1 DRIVERS
P3.0 - P3.7
P1.0 - P1.7
3
3053A–8051–05/02
引脚说明
VCC
GND
端口0
电源电压。
地面上。
P0口是一个8位漏极开路双向I / O口。作为输出口，每位能驱动8个
TTL输入。当1秒写入端口0引脚，引脚可作为高阻抗
输入。
端口0也可以被配置成在被复用的低阶地址/数据总线
访问外部程序和数据存储器。在这种模式下， P0具有内部上拉电阻。
P0口还可在Flash编程接收的字节代码，并输出代码字节
在程序验证。
在程序的验证，需要外部上拉电阻。
端口1
端口1是一个具有内部上拉电阻的8位双向I / O口。端口1输出缓冲器可
汇/源4个TTL输入。当1秒写入端口1引脚，它们拉高了
内部上拉，并可以作为输入。作为输入使用时， P1口被外部
拉低时将输出电流（I
IL
由于内部上拉的） 。
端口1也接收过程中的Flash编程和校验低位地址字节。
端口引脚
P1.5
P1.6
P1.7
第二功能
MOSI （用于在系统编程）
MISO （用于在系统编程）
SCK （用于在系统编程）
端口2
端口2是一个具有内部上拉电阻的8位双向I / O口。端口2输出缓冲器可
汇/源4个TTL输入。当1秒写入端口2引脚，它们拉高了
内部上拉，并可以作为输入。作为输入使用时， P2口被外部
拉低时将输出电流（I
IL
由于内部上拉的） 。
端口2在从外部程序存储器取发出的高位地址字节
在使用16位地址外部数据存储器访问（ MOVX @ DPTR ） 。在这
应用程序， P2口使用很强的内部上拉发送1 。在外部访问
使用8位地址（ MOVX @ RI）的数据存储器，端口2发出的P2 Spe-的内容
CIAL功能寄存器。
口也接收期间闪存程序高阶地址位和一些控制信号
编程和验证。
端口3
端口3是一个具有内部上拉电阻的8位双向I / O口。端口3输出缓冲器可
汇/源4个TTL输入。当1秒写入端口3引脚，它们拉高了
内部上拉，并可以作为输入。作为输入使用时， P3口被外部
拉低时将输出电流（I
IL
由于上拉的） 。
端口3收到对Flash编程和校验一些控制信号。
端口3也可以用做其他不同的特殊功能AT89LS51的功能，如图所示
下面的表格。
4
AT89LS51
3053A–8051–05/02
AT89LS51
端口引脚
P3.0
P3.1
P3.2
P3.3
P3.4
P3.5
P3.6
P3.7
第二功能
RXD （串行输入端口）
TXD （串行输出端口）
INT0 （外部中断0 ）
INT1 （外部中断1 ）
T0 （定时器0外部输入）
T1（定时器1外部输入）
WR （外部数据存储器写选通）
RD （外部数据存储器读选通）
RST
复位输入。而振荡器运行复位高该引脚上出现两个机器周期
装置。该引脚为高看门狗超时后98个振荡周期。解散
在SFR AUXR （地址8EH ） RTO位可禁用此功能。在默认状态下
位DISRTO的，复位高电平功能被启用。
地址锁存使能（ ALE）是输出脉冲时锁存地址的低字节
访问外部存储器。该引脚也用作编程输入脉冲（ PROG ）闪存中
编程。
在正常操作中， ALE以1/6的恒定速率的振荡器频率和可
用于外部定时或时钟的目的。但是请注意，一个ALE脉冲
在每次访问外部数据存储器跳过。
如果需要的话， ALE操作可以通过设置的SFR的位置8EH位0被禁用。同位设置，
只有在执行MOVX或MOVC指令ALE激活。否则，该引脚被弱上拉
高。设置ALE-禁止位没有任何影响，如果微控制器处于外部执行
模式。
ALE / PROG
PSEN
程序存储允许（ PSEN ）是读选通外部程序存储器。
当AT89LS51执行外部程序存储器代码， PSEN被激活
两次每个机器周期，除了两个PSEN激活期间，每次访问都被跳过
到外部数据存储器。
EA / VPP
外部访问允许。 EA必须以允许在设备上读取绑到GND
从外部程序存储器位置的代码开始0000H到FFFFH 。但是请注意，
如果锁定位1被编程， EA将内部锁存复位。
EA应绑V
CC
内部程序执行。
该引脚也接收12伏编程使能电压（V
P P
）闪光时
编程。
XTAL1
XTAL2
输入到振荡器反相放大器和输入到内部时钟工作电路。
振荡器反相放大器的输出ER
5
3053A–8051–05/02
特点
兼容MCS
产品-51
在系统可编程（ ISP） Flash存储器的4K字节
- 耐力： 1000写/擦除周期
2.7V至4.0V工作电压范围
全静态操作： 0 Hz至16 MHz的
三级程序存储器锁定
128 ×8位内部RAM
32个可编程I / O线
2个16位定时器/计数器
6个中断源
全双工UART串行通道
低功耗空闲和掉电模式
恢复中断从掉电模式
看门狗定时器
双数据指针
断电标志
灵活的ISP编程（字节和页模式）
绿色（无铅/无卤化物）的包装选项
1.描述
该AT89LS51是一个低电压，高性能CMOS 8位微控制器
4K字节的系统内可编程闪存。该装置被制
采用Atmel的高密度非易失性存储器技术，并与兼容
行业标准的80C51指令集和引脚。片上Flash允许亲
克内存在系统或通过传统的非易失性可再编程
编程器。通过结合一个多功能8位CPU和在系统可编
一个单芯片上BLE闪存，爱特梅尔AT89LS51是一个功能强大的单片机
它提供了一个高度灵活和具有成本效益的解决方案，为许多嵌入式控制
应用程序。
该AT89LS51提供以下标准功能： 4K字节的闪存， 128字节
的RAM ， 32个I / O口线，看门狗定时器，两个数据指针，两个16位定时器/计数器，一个
五向量2级中断结构，一个全双工串行口，片上振荡器，
和时钟电路。此外， AT89LS51设计的静态逻辑操作
和灰下降到零频率，并支持两种软件可选的节电
模式。空闲模式下，CPU停止工作，允许RAM ，定时器/计数器，串行
口和中断系统继续工作。在掉电模式下保存
RAM中的内容，但冻结振荡器，禁止所有其他芯片功能，直到下一个
外部中断或硬件复位。
8-bit
低电压
微控制器
4K字节
在系统
可编程
FL灰
AT89LS51
3053B–MICRO–3/05
2.引脚配置
2.1
40引脚PDIP
P1.0
P1.1
P1.2
P1.3
P1.4
（ MOSI ）， P1.5
（ MISO ）， P1.6
（ SCK ） P1.7
RST
（RXD） P3.0
（TXD） P3.1
（ INT0 ） P3.2
（ INT1 ） P3.3
（ T0 ） P3.4
（T1）， P3.5
（ WR ）， P3.6
（ RD ）， P3.7
XTAL2
XTAL1
GND
1
2
3
4
5
6
7
8
9
10
11
12
13
14
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16
17
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20
40
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33
32
31
30
29
28
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25
24
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22
21
VCC
P0.0 （ AD0 ）
P0.1 （ AD1 ）
P0.2 （ AD2 ）
P0.3 （ AD3 ）
P0.4 （ AD4 ）
P0.5 （ AD5 ）
P0.6 （ AD6 ）
P0.7 （ AD7 ）
EA / VPP
ALE / PROG
PSEN
P2.7 （ A15 ）
P2.6 （ A14 ）
P2.5 （ A13 ）
P2.4 （ A12 ）
P2.3 （A11）
P2.2 （A10）
P2.1 （A9）
P2.0 （A8）
2.3
44引脚PLCC
P1.4
P1.3
P1.2
P1.1
P1.0
NC
VCC
P0.0 （ AD0 ）
P0.1 （ AD1 ）
P0.2 （ AD2 ）
P0.3 （ AD3 ）
2.2
44引脚TQFP
P1.4
P1.3
P1.2
P1.1
P1.0
NC
VCC
P0.0 （ AD0 ）
P0.1 （ AD1 ）
P0.2 （ AD2 ）
P0.3 （ AD3 ）
2.4
42引脚PDIP
RST
（RXD） P3.0
（TXD） P3.1
（ INT0 ） P3.2
（ INT1 ） P3.3
（ T0 ） P3.4
（T1）， P3.5
（ WR ）， P3.6
（ RD ）， P3.7
XTAL2
XTAL1
GND
PWRGND
（A8） P2.0
（A9） P2.1
（A10） P2.2
（A11） P2.3
（ A12 ） P2.4
（ A13 ） P2.5
（ A14 ） P2.6
（ A15 ） P2.7
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
42
41
40
39
38
37
36
35
34
33
32
31
30
29
28
27
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25
24
23
22
P1.7 （ SCK ）
P1.6 （ MISO ）
P1.5 （ MOSI ）
P1.4
P1.3
P1.2
P1.1
P1.0
VDD
PWRVDD
P0.0 （ AD0 ）
P0.1 （ AD1 ）
P0.2 （ AD2 ）
P0.3 （ AD3 ）
P0.4 （ AD4 ）
P0.5 （ AD5 ）
P0.6 （ AD6 ）
P0.7 （ AD7 ）
EA / VPP
ALE / PROG
PSEN
44
43
42
41
40
39
38
37
36
35
34
（ MOSI ）， P1.5
（ MISO ）， P1.6
（ SCK ） P1.7
RST
（RXD） P3.0
NC
（TXD） P3.1
（ INT0 ） P3.2
（ INT1 ） P3.3
（ T0 ） P3.4
（T1）， P3.5
1
2
3
4
5
6
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9
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12
13
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29
28
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26
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24
23
P0.4 （ AD4 ）
P0.5 （ AD5 ）
P0.6 （ AD6 ）
P0.7 （ AD7 ）
EA / VPP
NC
ALE / PROG
PSEN
P2.7 （ A15 ）
P2.6 （ A14 ）
P2.5 （ A13 ）
2
AT89LS51
3053B–MICRO–3/05
（ WR ）， P3.6
（ RD ）， P3.7
XTAL2
XTAL1
GND
GND
（A8） P2.0
（A9） P2.1
（A10） P2.2
（A11） P2.3
（ A12 ） P2.4
（ WR ）， P3.6
（ RD ）， P3.7
XTAL2
XTAL1
GND
NC
（A8） P2.0
（A9） P2.1
（A10） P2.2
（A11） P2.3
（ A12 ） P2.4
18
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20
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28
（ MOSI ）， P1.5
（ MISO ）， P1.6
（ SCK ） P1.7
RST
（RXD） P3.0
NC
（TXD） P3.1
（ INT0 ） P3.2
（ INT1 ） P3.3
（ T0 ） P3.4
（T1）， P3.5
7
8
9
10
11
12
13
14
15
16
17
6
5
4
3
2
1
44
43
42
41
40
39
38
37
36
35
34
33
32
31
30
29
P0.4 （ AD4 ）
P0.5 （ AD5 ）
P0.6 （ AD6 ）
P0.7 （ AD7 ）
EA / VPP
NC
ALE / PROG
PSEN
P2.7 （ A15 ）
P2.6 （ A14 ）
P2.5 （ A13 ）
AT89LS51
3.框图
P0.0 - P0.7
P2.0 - P2.7
V
CC
端口0 DRIVERS
GND
PORT 2名司机
RAM地址。
注册
内存
端口0
LATCH
端口2
LATCH
FL灰
B
注册
加
堆
指针
节目
地址
注册
卜FF器
TMP2
TMP1
ALU
中断，串口，
和定时器功能块
PC
增量
PSW
节目
计数器
PSEN
ALE / PROG
EA / V
PP
RST
观看
狗
端口3
LATCH
定时
和
控制
指令
注册
双DPTR
端口1
LATCH
ISP
PORT
节目
逻辑
OSC
端口3驱动程序
PORT 1 DRIVERS
P3.0 - P3.7
P1.0 - P1.7
3
3053B–MICRO–3/05
4.引脚说明
4.1
VCC
电源电压。
4.2
GND
地面上。
4.3
端口0
P0口是一个8位漏极开路双向I / O口。作为输出口，每位能驱动8个TTL
输入。当1秒写入端口0引脚，引脚可作为高阻抗输入。
端口0也可以被配置成在访问多路复用的低位地址/数据总线
外部程序和数据存储器。在这种模式下， P0具有内部上拉电阻。
P0口还可在Flash编程接收的字节代码，并输出代码字节很好地协同
荷兰国际集团计划验证。
在程序的验证，需要外部上拉电阻。
4.4
端口1
端口1是一个具有内部上拉电阻的8位双向I / O口。端口1输出缓冲器可
汇/源4个TTL输入。当1秒写入端口1引脚，它们被拉高的接口
最终上拉电阻，可以用来作为输入。作为输入使用时， P1口被外部拉低
将输出电流（I
IL
由于内部上拉的） 。
端口1也接收过程中的Flash编程和校验低位地址字节。
端口引脚
P1.5
P1.6
P1.7
第二功能
MOSI （用于在系统编程）
MISO （用于在系统编程）
SCK （用于在系统编程）
4.5
端口2
端口2是一个具有内部上拉电阻的8位双向I / O口。端口2输出缓冲器可
汇/源4个TTL输入。当1秒写入端口2引脚，它们拉高了跨
最终上拉电阻，可以用来作为输入。作为输入使用时， P2口被外部拉低
将输出电流（I
IL
由于内部上拉的） 。
端口2在从外部程序存储器和很好地协同取发出的高位地址字节
ING访问到使用16位地址的外部数据存储器（ MOVX @ DPTR ） 。在这
应用程序， P2口使用很强的内部上拉发送1 。在外部访问
使用8位地址（ MOVX @ RI）的数据存储器，端口2发出的P2的特别的内容
功能寄存器。
口也接收过程中的Flash编程高阶地址位和一些控制信号
明和验证。
4
AT89LS51
3053B–MICRO–3/05
AT89LS51
4.6
端口3
端口3是一个具有内部上拉电阻的8位双向I / O口。端口3输出缓冲器可
汇/源4个TTL输入。当1秒写入端口3引脚，它们被拉高的接口
最终上拉电阻，可以用来作为输入。作为输入使用时， P3口被外部拉低
将输出电流（I
IL
由于上拉的） 。
端口3收到对Flash编程和校验一些控制信号。
端口3也可以用做其他不同的特殊功能AT89LS51的功能，如图所示
下面的表格。
端口引脚
P3.0
P3.1
P3.2
P3.3
P3.4
P3.5
P3.6
P3.7
第二功能
RXD （串行输入端口）
TXD （串行输出端口）
INT0 （外部中断0 ）
INT1 （外部中断1 ）
T0 （定时器0外部输入）
T1（定时器1外部输入）
WR （外部数据存储器写选通）
RD （外部数据存储器读选通）
4.7
RST
复位输入。而振荡器运行复位高该引脚上出现两个机器周期
装置。该引脚为高看门狗超时后98个振荡周期。该DISRTO
在SFR AUXR （地址8EH ）位可禁用此功能。中位的默认状态
DISRTO ，复位高电平功能被启用。
4.8
ALE / PROG
地址锁存使能（ ALE）是输出脉冲时锁存地址的低字节
访问外部存储器。该引脚也用作编程输入脉冲（ PROG ）闪存中
编程。
在正常操作中， ALE以1/6的恒定速率的振荡器频率，可以是
用于外部定时或时钟的目的。但是请注意，一个ALE脉冲被跳过很好地协同
荷兰国际集团每次访问外部数据存储器。
如果需要的话， ALE操作可以通过设置的SFR的位置8EH位0被禁用。同位设置，
只有在执行MOVX或MOVC指令ALE激活。否则，该引脚被微弱拉高。
设置ALE-禁止位没有任何影响，如果微控制器处于外部执行模式。
4.9
PSEN
程序存储允许（ PSEN ）是读选通外部程序存储器。
当AT89LS51执行外部程序存储器代码， PSEN被激活两次
每个机器周期，除了两个PSEN激活期间，每次访问都跳过来克斯特
内部数据存储器。
5
3053B–MICRO–3/05
特点
兼容MCS- 51 产品
编程的Flash存储器的4K字节
- 耐力： 1000写/擦除周期
2.7V至6V的工作电压范围
全静态操作： 0 Hz至12 MHz的
三级程序存储器锁定
128 ×8位内部RAM
32个可编程I / O线
2个16位定时器/计数器
6个中断源
可编程串行通道
低功耗空闲和掉电模式
描述
该AT89LV51是一个低电压，高性能CMOS 8位微计算机与
4K字节的Flash可编程和可擦除只读存储器中。该装置是
采用Atmel的高密度非易失性存储器技术制造，是的COM
兼容与业界标准的MCS- 51 指令集和引脚。片上
Flash允许程序存储器在系统或由conven-进行重新编程
tional非易失性存储器编程。通过结合一个多功能8位CPU和Flash
一个单芯片上，爱特梅尔AT89LV51是一个功能强大的微型计算机亲
国际志愿组织一个高度灵活和具有成本效益的解决方案为许多嵌入式控制应用
系统蒸发散。该AT89LV51工作在2.7伏至6.0伏。
（续）
8-Bit
微控制器
4K字节
FL灰
AT89LV51
销刀豆网络gurations
P1.0
P1.1
P1.2
P1.3
P1.4
P1.5
P1.6
P1.7
RST
（RXD） P3.0
（TXD） P3.1
（ INT0 ） P3.2
（ INT1 ） P3.3
（ T0 ） P3.4
（T1）， P3.5
（ WR ）， P3.6
（ RD ）， P3.7
X TA L 2
X TA L 1
GND
PDIP
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
40
39
38
37
36
35
34
33
32
31
30
29
28
27
26
25
24
23
22
21
VCC
P0.0 （ AD0 ）
P0.1 （ AD1 ）
P0.2 （ AD2 ）
P0.3 （ AD3 ）
P0.4 （ AD4 ）
P0.5 （ AD5 ）
P0.6 （ AD6 ）
P0.7 （ AD7 ）
EA / VPP
ALE / PROG
PSEN
P2.7 （ A15 ）
P2.6 （ A14 ）
P2.5 （ A13 ）
P2.4 （ A12 ）
P2.3 （A11）
P2.2 （A10）
P2.1 （A9）
P2.0 （A8）
不推荐
用于新的设计。
使用AT89LS51 。
TQFP
(AD0)
(AD1)
(AD2)
(AD3)
44 42 40
38
36 34
43 41 39
37
35
P1.5
P1.6
P1.7
RST
P3.0
NC
P3.1
P3.2
P3.3
P3.4
P3.5
P1.4
P1.3
P1.2
P1.1
P1.0
NC
VCC
P0.0
P0.1
P0.2
P0.3
指数
角落
（ RXD）
（ TXD）处
(INT0)
(INT1)
(T0)
(T1)
1
2
3
4
5
6
7
8
9
10
11
13 15 17 19 21
12 14 16 18 20 22
33
32
31
30
29
28
27
26
25
24
23
P0.4 （ AD4 ）
P0.5 （ AD5 ）
P0.6 （ AD6 ）
P0.7 （ AD7 ）
EA / VPP
NC
ALE / PROG
PSEN
P2.7 （ A15 ）
P2.6 （ A14 ）
P2.5 （ A13 ）
PLCC
(AD0)
(AD1)
(AD2)
(AD3)
（ WR ）， P3.6
（ RD ）， P3.7
X TA L 2
X TA L 1
GND
GND
（A8） P2.0
（A9） P2.1
（A10） P2.2
（A11） P2.3
（ A12 ） P2.4
（ RXD）
（ TXD）处
(INT0)
(INT1)
(T0)
(T1)
P1.5
P1.6
P1.7
RST
P3.0
NC
P3.1
P3.2
P3.3
P3.4
P3.5
6
4
2
44 42 40
1
3
4 3 4 13 9
7 5
8
38
9
37
36
10
35
11
34
12
33
13
32
14
31
15
16
30
1 7 1 9 2 1 2 3 2 5 2 72 9
18 20 22 24 26 28
（ WR ）， P3.6
（ RD ）， P3.7
X TA L 2
X TA L 1
GND
NC
（A8） P2.0
（A9） P2.1
（A10） P2.2
（A11） P2.3
（ A12 ） P2.4
P1.4
P1.3
P1.2
P1.1
P1.0
NC
VCC
P0.0
P0.1
P0.2
P0.3
指数
角落
P0.4 （ AD4 ）
P0.5 （ AD5 ）
P0.6 （ AD6 ）
P0.7 （ AD7 ）
EA / VPP
NC
ALE / PROG
PSEN
P2.7 （ A15 ）
P2.6 （ A14 ）
P2.5 （ A13 ）
0303D-D–12/97
4-45
框图
4-46
不
不
该AT89LV51提供以下标准功能：
4K字节的Flash ， 128字节RAM ， 32个I / O口线，两个16
位定时器/计数器，一个5向量两级中断architec-
TURE ，一个全双工串行口，片内振荡器和时钟
电路。此外， AT89LV51设计和配置
逻辑操作下降到零频率和支撑
两个软件选择的省电模式。空闲
模式时CPU停止工作，允许RAM ，
定时器/计数器，串行口和中断系统继续
工作。掉电方式保存RAM中CON-
帐篷，但冻结振荡器停止芯片其它功能
系统蒸发散，直到下一个硬件复位。
发送1 。在外部数据存储器访问
储器使用8位地址（ MOVX @ RI ） ，端口2发出的
的P2特殊功能寄存器的内容。
端口2还接收高位地址位和一些
在flash编程和校验的控制信号。
端口3
端口3是一个具有内部上拉电阻的8位双向I / O口。
端口3输出缓冲器可吸收/ 4个TTL输入。
当1秒写入端口3引脚他们被拉高
的内部上拉和可被用作输入。作为输入，
P3口被外部拉低，将输出
电流（I
IL
）由于上拉的。
端口3也可以用做其他不同的特殊功能，该功能
在AT89LV51为如下：
端口引脚
P3.0
P3.1
P3.2
P3.3
P3.4
P3.5
P3.6
P3.7
第二功能
RXD （串行输入端口）
TXD （串行输出端口）
INT0 （外部中断0 ）
INT1 （外部中断1 ）
T0 （定时器0外部输入）
T1（定时器1外部输入）
WR （外部数据存储器写选通）
RD （外部数据存储器读选通）
引脚说明
V
CC
电源电压。
GND
地面上。
端口0
P0口是一个8位漏极开路双向I / O口。作为一个
输出端口的每个引脚可以驱动8个TTL逻辑电平。当1秒
写入端口0引脚，引脚可作为高
阻抗输入。
端口0也可以被配置为复用的低
顺序的地址/数据总线时访问外部亲
克和数据存储器。在这种模式下P0具有内部PUL-
lups 。
P0口还可在闪存编程器接收到的字节码
明，并在程序输出代码字节verifica-
化。在程序verifica-需要外部上拉电阻
化。
端口1
端口1是一个具有内部上拉电阻的8位双向I / O口。
端口1输出缓冲器可吸收/ 4个TTL输入。
当1秒写入端口1引脚他们拉高
的内部上拉和可被用作输入。作为输入，
P1口被外部拉低，将输出
电流（I
IL
因为内部上拉电阻的） 。
端口1期间也接收低位地址字节
闪存编程和验证。
端口2
端口2是一个具有内部上拉电阻的8位双向I / O口。
端口2输出缓冲器可吸收/ 4个TTL输入。
当1秒写入端口2引脚他们拉高
的内部上拉和可被用作输入。作为输入，
P2口被外部拉低，将输出
电流（I
IL
因为内部上拉电阻的） 。
端口2发出时取高位地址字节
从外部程序存储器和期间访问
使用16位地址的外部数据存储器（ MOVX @
DPTR ） 。在这种应用中，它使用强大的内部上拉
3口还接收了闪存程序一些控制信号
编程和验证。
RST
复位输入。高该引脚上出现两个机器周期，而
振荡器运行复位设备。
ALE / PROG
地址锁存使能输出脉冲用于锁存低字节
期间访问外部存储器的地址。这
引脚也用作编程输入脉冲（ PROG ）闪存中
编程。
在正常操作中，ALE在1/6的恒定速率被发射
振荡器的频率，并且可以使用外部时序
荷兰国际集团或时钟使用。但是请注意，一个ALE
在每次访问外部数据存储器脉冲被跳过
ORY 。
PSEN
程序存储允许的读选通到外部的亲
程序存储器。
当AT89LV51执行外部亲代码
程序存储器， PSEN在每个机器启动两次
周期，所不同的是2的PSEN激活则过程跳过
每次访问外部数据存储器。
4-47
EA / V
PP
外部访问允许。 EA必须绑GND
为了使该装置来从外部亲代码
开始0000H到FFFFH克的内存位置。
但请注意，如果锁定位1被编程， EA会
内部锁存复位。
EA应绑V
CC
内部程序执行
系统蒸发散。
该引脚也接收12伏编程使能电压
年龄（V
PP
）在Flash编程时， 12伏亲
编程选择。
XTAL1
输入到振荡器反相放大器和输入到
内部时钟工作电路。
XTAL2
输出振荡器反相放大器器。
表1中。
AT89LV51 SFR映射和复位值
0F8H
0F0H
0E8H
0E0H
0D8H
0D0H
0C8H
0C0H
0B8H
0B0H
0A8H
0A0H
98H
90H
88H
80H
IP
XX000000
P3
11111111
IE
0X000000
P2
11111111
SCON
00000000
P1
11111111
TCON
00000000
P0
11111111
TMOD
00000000
SP
00000111
TL0
00000000
DPL
00000000
TL1
00000000
DPH
00000000
SBUF
XXXXXXXX
PSW
00000000
T2CON
00000000
T2MOD
XXXXXX00
RCAP2L
00000000
RCAP2H
00000000
加
00000000
B
00000000
特殊功能寄存器
片上存储器区域的地图被称为特殊功能
灰寄存器（SFR）空间被示于表1 。
注意，不是所有的地址都被占用，并unoc-
cupied地址可能不能在芯片上实现。
读这些地址将在总体回报
随机数据，并写入访问将有indetermi-
内特效果。
用户软件不要向其写入1秒到这些未上市的某些地区可能
系统蒸发散，因为它们可能会在未来的产品可用于调用
新的功能。在这种情况下，复位或不活动的值
新的比特总是为0 。
定时器0和1
定时器0和定时器1的AT89LV51运行相同的应用
方式定时器0和定时器1的AT89C51 。
0FFH
0F7H
0EFH
0E7H
0DFH
0D7H
TL2
00000000
TH2
00000000
0CFH
0C7H
0BFH
0B7H
0AFH
0A7H
9FH
97H
TH0
00000000
TH1
00000000
PCON
0XXX0000
8FH
87H
4-48
不
不
振荡器特性
XTAL1和XTAL2是输入和输出，分别
可以使用被配置为一个反相放大器的
片上振荡器，如示于图1中。石英
晶体或陶瓷谐振器都可以使用。驱动
装置从外部时钟源， XTAL2要保持
悬空而XTAL1被驱动，如图2中所示。
有对外部的占空比没有要求
时钟信号，由于输入到内部时钟电路
是通过除以2的触发器，但最小和马克西
妈妈高电压和低时间规范必须是
观察
图1 。
振荡器连接
C2
XTAL2
C1
XTAL1
GND
空闲模式
在空闲模式下，CPU把自己睡，而所有的导通
片上外设保持活跃。该模式是通过调用
软件。的芯片上的RAM中的内容，包括所有出特殊
CIAL功能寄存器在此保持不变
模式。空闲模式可由任何允许被终止
中断或硬件复位。
应当指出的是，当空闲是由硬终止
洁具复位后，设备恢复正常程序执行
化，从离开的地方，最多两个机器周期前
内部复位算法获得控制权。片上硬件
禁止访问内部RAM在这种情况下，但访问
该端口没有被禁止。要消除的可能性
一个意外的写入空闲时被终止端口引脚
复位后，指令之后的一个调用空闲
不应该是一个写入端口引脚或外部
内存。
注意：
C1 ， C2 = 30 pF的±10 pF，适用于晶体
= 40 pF的±10 pF的陶瓷谐振器
图2中。
外部时钟配置
NC
XTAL2
外
振荡器
信号
XTAL1
GND
掉电模式
在电源关断模式时，振荡器停止，并且
指令调用掉电是最后的指令
执行。片内RAM和特殊功能寄存器
TER值保留其值，直到掉电模式时结
经过NAT 。从掉电唯一的出口是一个硬件复位。
复位重新定义了特殊功能寄存器但不改变片
内存。复位不应V前被激活
CC
is
恢复到它的正常操作电平，并且必须保持
主动足够长的时间以使振荡器重新启动并台站
bilize 。
外部引脚的状态在空闲模式和掉电模式
模式
空闲
空闲
掉电
掉电
程序存储器
国内
外
国内
外
ALE
1
1
0
0
PSEN
1
1
0
0
PORT0
数据
FL燕麦
数据
FL燕麦
PORT1
数据
数据
数据
数据
PORT2
数据
地址
数据
数据
PORT3
数据
数据
数据
数据
4-49
特点
兼容MCS
产品-51
在系统可编程（ ISP） Flash存储器的4K字节
耐力：10,000写/擦除周期
2.7V至4.0V工作电压范围
全静态操作： 0 Hz至16 MHz的
三级程序存储器锁定
128 ×8位内部RAM
32个可编程I / O线
2个16位定时器/计数器
6个中断源
全双工UART串行通道
低功耗空闲和掉电模式
恢复中断从掉电模式
看门狗定时器
双数据指针
断电标志
灵活的ISP编程（字节和页模式）
绿色（无铅/无卤化物）的包装选项
1.描述
该AT89LS51是一个低电压，高性能CMOS 8位微控制器
4K字节的系统内可编程闪存。该装置被制
采用Atmel的高密度非易失性存储器技术，并与兼容
行业标准的80C51指令集和引脚。片上Flash允许亲
克内存在系统或通过传统的非易失性可再编程
编程器。通过结合一个多功能8位CPU和在系统可编
一个单芯片上BLE闪存，爱特梅尔AT89LS51是一个功能强大的单片机
它提供了一个高度灵活和具有成本效益的解决方案，为许多嵌入式控制
应用程序。
该AT89LS51提供以下标准功能： 4K字节的闪存， 128字节
的RAM ， 32个I / O口线，看门狗定时器，两个数据指针，两个16位定时器/计数器，一个
五向量2级中断结构，一个全双工串行口，片上振荡器，
和时钟电路。此外， AT89LS51设计的静态逻辑操作
和灰下降到零频率，并支持两种软件可选的节电
模式。空闲模式下，CPU停止工作，允许RAM ，定时器/计数器，串行
口和中断系统继续工作。在掉电模式下保存
RAM中的内容，但冻结振荡器，禁止所有其他芯片功能，直到下一个
外部中断或硬件复位。
8-bit
低电压
微控制器
4K字节
在系统
可编程
FL灰
AT89LS51
3053C–MICRO–6/08
2.引脚配置
2.1
40引脚PDIP
P1.0
P1.1
P1.2
P1.3
P1.4
（ MOSI ）， P1.5
（ MISO ）， P1.6
（ SCK ） P1.7
RST
（RXD） P3.0
（TXD） P3.1
（ INT0 ） P3.2
（ INT1 ） P3.3
（ T0 ） P3.4
（T1）， P3.5
（ WR ）， P3.6
（ RD ）， P3.7
XTAL2
XTAL1
GND
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
40
39
38
37
36
35
34
33
32
31
30
29
28
27
26
25
24
23
22
21
VCC
P0.0 （ AD0 ）
P0.1 （ AD1 ）
P0.2 （ AD2 ）
P0.3 （ AD3 ）
P0.4 （ AD4 ）
P0.5 （ AD5 ）
P0.6 （ AD6 ）
P0.7 （ AD7 ）
EA / VPP
ALE / PROG
PSEN
P2.7 （ A15 ）
P2.6 （ A14 ）
P2.5 （ A13 ）
P2.4 （ A12 ）
P2.3 （A11）
P2.2 （A10）
P2.1 （A9）
P2.0 （A8）
2.3
44引脚PLCC
P1.4
P1.3
P1.2
P1.1
P1.0
NC
VCC
P0.0 （ AD0 ）
P0.1 （ AD1 ）
P0.2 （ AD2 ）
P0.3 （ AD3 ）
2.2
44引脚TQFP
P1.4
P1.3
P1.2
P1.1
P1.0
NC
VCC
P0.0 （ AD0 ）
P0.1 （ AD1 ）
P0.2 （ AD2 ）
P0.3 （ AD3 ）
44
43
42
41
40
39
38
37
36
35
34
（ MOSI ）， P1.5
（ MISO ）， P1.6
（ SCK ） P1.7
RST
（RXD） P3.0
NC
（TXD） P3.1
（ INT0 ） P3.2
（ INT1 ） P3.3
（ T0 ） P3.4
（T1）， P3.5
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
33
32
31
30
29
28
27
26
25
24
23
P0.4 （ AD4 ）
P0.5 （ AD5 ）
P0.6 （ AD6 ）
P0.7 （ AD7 ）
EA / VPP
NC
ALE / PROG
PSEN
P2.7 （ A15 ）
P2.6 （ A14 ）
P2.5 （ A13 ）
2
AT89LS51
3053C–MICRO–6/08
（ WR ）， P3.6
（ RD ）， P3.7
XTAL2
XTAL1
GND
GND
（A8） P2.0
（A9） P2.1
（A10） P2.2
（A11） P2.3
（ A12 ） P2.4
（ WR ）， P3.6
（ RD ）， P3.7
XTAL2
XTAL1
GND
NC
（A8） P2.0
（A9） P2.1
（A10） P2.2
（A11） P2.3
（ A12 ） P2.4
18
19
20
21
22
23
24
25
26
27
28
（ MOSI ）， P1.5
（ MISO ）， P1.6
（ SCK ） P1.7
RST
（RXD） P3.0
NC
（TXD） P3.1
（ INT0 ） P3.2
（ INT1 ） P3.3
（ T0 ） P3.4
（T1）， P3.5
7
8
9
10
11
12
13
14
15
16
17
6
5
4
3
2
1
44
43
42
41
40
39
38
37
36
35
34
33
32
31
30
29
P0.4 （ AD4 ）
P0.5 （ AD5 ）
P0.6 （ AD6 ）
P0.7 （ AD7 ）
EA / VPP
NC
ALE / PROG
PSEN
P2.7 （ A15 ）
P2.6 （ A14 ）
P2.5 （ A13 ）
AT89LS51
3.框图
P0.0 - P0.7
P2.0 - P2.7
V
CC
端口0 DRIVERS
GND
PORT 2名司机
RAM地址。
注册
内存
端口0
LATCH
端口2
LATCH
FL灰
B
注册
加
堆
指针
节目
地址
注册
卜FF器
TMP2
TMP1
ALU
中断，串口，
和定时器功能块
PC
增量
PSW
节目
计数器
PSEN
ALE / PROG
EA / V
PP
RST
观看
狗
端口3
LATCH
定时
和
控制
指令
注册
双DPTR
端口1
LATCH
ISP
PORT
节目
逻辑
OSC
端口3驱动程序
PORT 1 DRIVERS
P3.0 - P3.7
P1.0 - P1.7
3
3053C–MICRO–6/08
4.引脚说明
4.1
VCC
电源电压。
4.2
GND
地面上。
4.3
端口0
P0口是一个8位漏极开路双向I / O口。作为输出口，每位能驱动8个TTL
输入。当1秒写入端口0引脚，引脚可作为高阻抗输入。
端口0也可以被配置成在访问多路复用的低位地址/数据总线
外部程序和数据存储器。在这种模式下， P0具有内部上拉电阻。
P0口还可在Flash编程接收的字节代码，并输出代码字节很好地协同
荷兰国际集团计划验证。
在程序的验证，需要外部上拉电阻。
4.4
端口1
端口1是一个具有内部上拉电阻的8位双向I / O口。端口1输出缓冲器可
汇/源4个TTL输入。当1秒写入端口1引脚，它们被拉高的接口
最终上拉电阻，可以用来作为输入。作为输入使用时， P1口被外部拉低
将输出电流（I
IL
由于内部上拉的） 。
端口1也接收过程中的Flash编程和校验低位地址字节。
端口引脚
P1.5
P1.6
P1.7
第二功能
MOSI （用于在系统编程）
MISO （用于在系统编程）
SCK （用于在系统编程）
4.5
端口2
端口2是一个具有内部上拉电阻的8位双向I / O口。端口2输出缓冲器可
汇/源4个TTL输入。当1秒写入端口2引脚，它们拉高了跨
最终上拉电阻，可以用来作为输入。作为输入使用时， P2口被外部拉低
将输出电流（I
IL
由于内部上拉的） 。
端口2在从外部程序存储器和很好地协同取发出的高位地址字节
ING访问到使用16位地址的外部数据存储器（ MOVX @ DPTR ） 。在这
应用程序， P2口使用很强的内部上拉发送1 。在外部访问
使用8位地址（ MOVX @ RI）的数据存储器，端口2发出的P2的特别的内容
功能寄存器。
口也接收过程中的Flash编程高阶地址位和一些控制信号
明和验证。
4
AT89LS51
3053C–MICRO–6/08
AT89LS51
4.6
端口3
端口3是一个具有内部上拉电阻的8位双向I / O口。端口3输出缓冲器可
汇/源4个TTL输入。当1秒写入端口3引脚，它们被拉高的接口
最终上拉电阻，可以用来作为输入。作为输入使用时， P3口被外部拉低
将输出电流（I
IL
由于上拉的） 。
端口3收到对Flash编程和校验一些控制信号。
端口3也可以用做其他不同的特殊功能AT89LS51的功能，如图所示
下面的表格。
端口引脚
P3.0
P3.1
P3.2
P3.3
P3.4
P3.5
P3.6
P3.7
第二功能
RXD （串行输入端口）
TXD （串行输出端口）
INT0 （外部中断0 ）
INT1 （外部中断1 ）
T0 （定时器0外部输入）
T1（定时器1外部输入）
WR （外部数据存储器写选通）
RD （外部数据存储器读选通）
4.7
RST
复位输入。而振荡器运行复位高该引脚上出现两个机器周期
装置。该引脚为高看门狗超时后98个振荡周期。该DISRTO
在SFR AUXR （地址8EH ）位可禁用此功能。中位的默认状态
DISRTO ，复位高电平功能被启用。
4.8
ALE / PROG
地址锁存使能（ ALE）是输出脉冲时锁存地址的低字节
访问外部存储器。该引脚也用作编程输入脉冲（ PROG ）闪存中
编程。
在正常操作中， ALE以1/6的恒定速率的振荡器频率，可以是
用于外部定时或时钟的目的。但是请注意，一个ALE脉冲被跳过很好地协同
荷兰国际集团每次访问外部数据存储器。
如果需要的话， ALE操作可以通过设置的SFR的位置8EH位0被禁用。同位设置，
只有在执行MOVX或MOVC指令ALE激活。否则，该引脚被微弱拉高。
设置ALE-禁止位没有任何影响，如果微控制器处于外部执行模式。
4.9
PSEN
程序存储允许（ PSEN ）是读选通外部程序存储器。
当AT89LS51执行外部程序存储器代码， PSEN被激活两次
每个机器周期，除了两个PSEN激活期间，每次访问都跳过来克斯特
内部数据存储器。
5
3053C–MICRO–6/08
特点
兼容MCS- 51
制品
在系统可编程（ ISP） Flash存储器的4K字节
- 耐力： 1000写/擦除周期
2.7V至4.0V工作电压范围
全静态操作： 0 Hz至16 MHz的
三级程序存储器锁定
128 ×8位内部RAM
32个可编程I / O线
2个16位定时器/计数器
6个中断源
全双工UART串行通道
低功耗空闲和掉电模式
恢复中断从掉电模式
看门狗定时器
双数据指针
断电标志
灵活的ISP编程（字节和页模式）
描述
该AT89LS51是一个低电压，高性能CMOS 8位微控制器与4K
字节的系统内可编程闪存。该器件采用制造
Atmel的高密度非易失性存储器技术，并与行业兼容
尝试标准80C51指令集和引脚。片上Flash允许程序
内存在系统或通过传统的非易失性存储器进行重新编程亲
语法。通过在结合了多功能8位CPU与系统内可编程闪存
单片芯片， Atmel的AT89LS51是一个功能强大的单片机，它提供一个
高度灵活和具有成本效益的解决方案，为许多嵌入式控制应用。
该AT89LS51提供以下标准功能： 4K字节的闪存， 128字节
的RAM ， 32个I / O口线，看门狗定时器，两个数据指针，两个16位定时器/计数器，一个
五向量2级中断结构，一个全双工串行口，片上振荡器，
和时钟电路。此外， AT89LS51设计有静态逻辑操作
下降到零频率，并支持两种软件选择的省电模式。
空闲模式下，CPU停止工作，允许RAM ，定时器/计数器，串行端口，
中断系统继续工作。在掉电模式保存RAM CON-
帐篷，但冻结振荡器，禁用所有其他芯片功能，直到下一个外部
中断或硬件复位。
8-bit
低电压
微控制器
4K字节
在系统
可编程
FL灰
AT89LS51
初步
修订版3053A - 8051-05 / 02
1
销刀豆网络gurations
PDIP
P1.0
P1.1
P1.2
P1.3
P1.4
（ MOSI ）， P1.5
（ MISO ）， P1.6
（ SCK ） P1.7
RST
（RXD） P3.0
（TXD） P3.1
（ INT0 ） P3.2
（ INT1 ） P3.3
（ T0 ） P3.4
（T1）， P3.5
（ WR ）， P3.6
（ RD ）， P3.7
XTAL2
XTAL1
GND
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
40
39
38
37
36
35
34
33
32
31
30
29
28
27
26
25
24
23
22
21
VCC
P0.0 （ AD0 ）
P0.1 （ AD1 ）
P0.2 （ AD2 ）
P0.3 （ AD3 ）
P0.4 （ AD4 ）
P0.5 （ AD5 ）
P0.6 （ AD6 ）
P0.7 （ AD7 ）
EA / VPP
ALE / PROG
PSEN
P2.7 （ A15 ）
P2.6 （ A14 ）
P2.5 （ A13 ）
P2.4 （ A12 ）
P2.3 （A11）
P2.2 （A10）
P2.1 （A9）
P2.0 （A8）
PLCC
P1.4
P1.3
P1.2
P1.1
P1.0
NC
VCC
P0.0 （ AD0 ）
P0.1 （ AD1 ）
P0.2 （ AD2 ）
P0.3 （ AD3 ）
TQFP
P1.4
P1.3
P1.2
P1.1
P1.0
NC
VCC
P0.0 （ AD0 ）
P0.1 （ AD1 ）
P0.2 （ AD2 ）
P0.3 （ AD3 ）
44
43
42
41
40
39
38
37
36
35
34
（ MOSI ）， P1.5
（ MISO ）， P1.6
（ SCK ） P1.7
RST
（RXD） P3.0
NC
（TXD） P3.1
（ INT0 ） P3.2
（ INT1 ） P3.3
（ T0 ） P3.4
（T1）， P3.5
1
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5
6
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29
28
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26
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23
P0.4 （ AD4 ）
P0.5 （ AD5 ）
P0.6 （ AD6 ）
P0.7 （ AD7 ）
EA / VPP
NC
ALE / PROG
PSEN
P2.7 （ A15 ）
P2.6 （ A14 ）
P2.5 （ A13 ）
2
AT89LS51
3053A–8051–05/02
（ WR ）， P3.6
（ RD ）， P3.7
XTAL2
XTAL1
GND
GND
（A8） P2.0
（A9） P2.1
（A10） P2.2
（A11） P2.3
（ A12 ） P2.4
（ WR ）， P3.6
（ RD ）， P3.7
XTAL2
XTAL1
GND
NC
（A8） P2.0
（A9） P2.1
（A10） P2.2
（A11） P2.3
（ A12 ） P2.4
18
19
20
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（ MOSI ）， P1.5
（ MISO ）， P1.6
（ SCK ） P1.7
RST
（RXD） P3.0
NC
（TXD） P3.1
（ INT0 ） P3.2
（ INT1 ） P3.3
（ T0 ） P3.4
（T1）， P3.5
7
8
9
10
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6
5
4
3
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1
44
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41
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P0.4 （ AD4 ）
P0.5 （ AD5 ）
P0.6 （ AD6 ）
P0.7 （ AD7 ）
EA / VPP
NC
ALE / PROG
PSEN
P2.7 （ A15 ）
P2.6 （ A14 ）
P2.5 （ A13 ）
AT89LS51
框图
P0.0 - P0.7
P2.0 - P2.7
V
CC
端口0 DRIVERS
GND
PORT 2名司机
RAM地址。
注册
内存
端口0
LATCH
端口2
LATCH
FL灰
B
注册
加
堆
指针
节目
地址
注册
卜FF器
TMP2
TMP1
ALU
中断，串口，
和定时器功能块
PC
增量
PSW
节目
计数器
PSEN
ALE / PROG
EA / V
PP
RST
观看
狗
端口3
LATCH
定时
和
控制
指令
注册
双DPTR
端口1
LATCH
ISP
PORT
节目
逻辑
OSC
端口3驱动程序
PORT 1 DRIVERS
P3.0 - P3.7
P1.0 - P1.7
3
3053A–8051–05/02
引脚说明
VCC
GND
端口0
电源电压。
地面上。
P0口是一个8位漏极开路双向I / O口。作为输出口，每位能驱动8个
TTL输入。当1秒写入端口0引脚，引脚可作为高阻抗
输入。
端口0也可以被配置成在被复用的低阶地址/数据总线
访问外部程序和数据存储器。在这种模式下， P0具有内部上拉电阻。
P0口还可在Flash编程接收的字节代码，并输出代码字节
在程序验证。
在程序的验证，需要外部上拉电阻。
端口1
端口1是一个具有内部上拉电阻的8位双向I / O口。端口1输出缓冲器可
汇/源4个TTL输入。当1秒写入端口1引脚，它们拉高了
内部上拉，并可以作为输入。作为输入使用时， P1口被外部
拉低时将输出电流（I
IL
由于内部上拉的） 。
端口1也接收过程中的Flash编程和校验低位地址字节。
端口引脚
P1.5
P1.6
P1.7
第二功能
MOSI （用于在系统编程）
MISO （用于在系统编程）
SCK （用于在系统编程）
端口2
端口2是一个具有内部上拉电阻的8位双向I / O口。端口2输出缓冲器可
汇/源4个TTL输入。当1秒写入端口2引脚，它们拉高了
内部上拉，并可以作为输入。作为输入使用时， P2口被外部
拉低时将输出电流（I
IL
由于内部上拉的） 。
端口2在从外部程序存储器取发出的高位地址字节
在使用16位地址外部数据存储器访问（ MOVX @ DPTR ） 。在这
应用程序， P2口使用很强的内部上拉发送1 。在外部访问
使用8位地址（ MOVX @ RI）的数据存储器，端口2发出的P2 Spe-的内容
CIAL功能寄存器。
口也接收期间闪存程序高阶地址位和一些控制信号
编程和验证。
端口3
端口3是一个具有内部上拉电阻的8位双向I / O口。端口3输出缓冲器可
汇/源4个TTL输入。当1秒写入端口3引脚，它们拉高了
内部上拉，并可以作为输入。作为输入使用时， P3口被外部
拉低时将输出电流（I
IL
由于上拉的） 。
端口3收到对Flash编程和校验一些控制信号。
端口3也可以用做其他不同的特殊功能AT89LS51的功能，如图所示
下面的表格。
4
AT89LS51
3053A–8051–05/02
AT89LS51
端口引脚
P3.0
P3.1
P3.2
P3.3
P3.4
P3.5
P3.6
P3.7
第二功能
RXD （串行输入端口）
TXD （串行输出端口）
INT0 （外部中断0 ）
INT1 （外部中断1 ）
T0 （定时器0外部输入）
T1（定时器1外部输入）
WR （外部数据存储器写选通）
RD （外部数据存储器读选通）
RST
复位输入。而振荡器运行复位高该引脚上出现两个机器周期
装置。该引脚为高看门狗超时后98个振荡周期。解散
在SFR AUXR （地址8EH ） RTO位可禁用此功能。在默认状态下
位DISRTO的，复位高电平功能被启用。
地址锁存使能（ ALE）是输出脉冲时锁存地址的低字节
访问外部存储器。该引脚也用作编程输入脉冲（ PROG ）闪存中
编程。
在正常操作中， ALE以1/6的恒定速率的振荡器频率和可
用于外部定时或时钟的目的。但是请注意，一个ALE脉冲
在每次访问外部数据存储器跳过。
如果需要的话， ALE操作可以通过设置的SFR的位置8EH位0被禁用。同位设置，
只有在执行MOVX或MOVC指令ALE激活。否则，该引脚被弱上拉
高。设置ALE-禁止位没有任何影响，如果微控制器处于外部执行
模式。
ALE / PROG
PSEN
程序存储允许（ PSEN ）是读选通外部程序存储器。
当AT89LS51执行外部程序存储器代码， PSEN被激活
两次每个机器周期，除了两个PSEN激活期间，每次访问都被跳过
到外部数据存储器。
EA / VPP
外部访问允许。 EA必须以允许在设备上读取绑到GND
从外部程序存储器位置的代码开始0000H到FFFFH 。但是请注意，
如果锁定位1被编程， EA将内部锁存复位。
EA应绑V
CC
内部程序执行。
该引脚也接收12伏编程使能电压（V
P P
）闪光时
编程。
XTAL1
XTAL2
输入到振荡器反相放大器和输入到内部时钟工作电路。
振荡器反相放大器的输出ER
5
3053A–8051–05/02
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