【特点单2.5V或2.7V至3.6V电源急流串行接口： 66 MHz最大时钟频率- 兼容SPI模式0和】,IC型号AT45DB041D-SSU-SL954,AT45DB041D-SSU-SL954 PDF资料,AT45DB041D-SSU-SL954经销商,ic,电子元器件-51电子网

特点

单2.5V或2.7V至3.6V电源

急流

串行接口： 66 MHz最大时钟频率

- 兼容SPI模式0和3

用户可配置的页面大小

- 每页256字节

- 每页264字节

- 页面大小可在工厂预先配置为256字节

页编程操作

- 智能编程操作

- 2048页（二百六十四分之二百五十六字节/页）主内存

灵活的擦除选项

- 页擦除（ 256字节）

- 块擦除（ 2字节）

- 扇区擦除（ 64字节）

- 芯片擦除（ 4兆位）

两个SRAM数据缓冲区（ 264分之256字节）

- 允许数据的接收，同时重新编程的闪存阵列

通过整个阵列连续读取功能

- 理想的代码映射应用程序

低功耗

- 7毫安有效的读电流典型

- 25 μA待机电流典型

- 5 μA深度掉电典型

硬件和软件数据保护功能

- 个别部门

部门锁定的安全代码和数据存储

- 个别部门

安全性： 128字节安全寄存器

- 64字节的用户可编程空间

- 唯一的64字节的设备标识符

JEDEC标准制造商和设备ID读

100000编程/擦除周期每页最低

数据保留 - 20岁

工业温度范围

绿色（无铅/无卤化物/ RoHS标准）的包装选项

4-megabit

2.5伏或

2.7-volt

数据闪存

AT45DB041D

1.描述

该AT45DB041D是2.5V或2.7V ，串行接口闪存产品适合于

各种各样的数字支持语音，图像 - ，程序代码和数据存储应用。

该AT45DB041D支持要求非常急流应用的串行接口

高速操作。急流串行接口SPI的兼容频率高达

66兆赫。其4325376比特的存储器被组织为2048页的256字节或

264字节每个。除了在主存储器中， AT45DB041D还包含两个

每个264分之256字节的SRAM缓冲器。该缓冲器允许而数据的接收

在主存储器页面进行重新编程，以及写入一个连续的数据

流。 EEPROM仿真（位或字节变性）很容易与自CON-处理

tained 3步骤读 - 修改 - 写操作。不同于传统的闪存

了与多个地址线和并行接口，所述随机访问

数据闪存采用了急流串行接口按顺序访问其数据。简单

顺序访问极大地降低了活动的引脚数，简化硬件设计，

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提高了系统可靠性，最大限度地降低开关噪声，并降低了封装尺寸。该装置是

用在许多商业和工业应用的优化，其中高密度，低针

数，低电压和低功耗是必不可少的。

以允许简单的系统重新编程，该AT45DB041D并不需要高输入

电压进行编程。该器件采用单电源， 2.5V至3.6V或2.7V

到3.6V，同时为程序和读取操作。该AT45DB041D通过启用

片选引脚（ CS）和访问通过一个三线接口，包括串行输入的（ SI ），

串行输出（ SO ）和串行时钟（ SCK ）。

所有的编程和擦除周期都是自定时的。

2.引脚配置和引脚

表2-1 。

符号

销刀豆网络gurations

断言

状态

TYPE

名称和功能

片选：

断言CS引脚选择设备。当CS引脚置为无效，该设备将被取消

并且通常被放置在待机模式下（未深度掉电模式），并且在输出引脚（SO ）将在一个

高阻抗状态。当设备被取消，数据不会被输入引脚（ SI ）接受。

在CS引脚从高电平到低电平的转换才能启动的操作，以及由低到高的转变要求

结束的操作。当结束一个内部自定时操作，如编程或擦除周期中，设备

不会进入待机模式，直到操作完成。

串行时钟：

该引脚用于提供一个时钟的装置和用于控制数据的流入和流出

该设备。命令，出现在SI引脚地址，并输入数据总是锁定在SCK的上升沿，

而在SO引脚输出数据总是同步输出SCK的下降沿。

串行输入：

SI引脚被用于将数据转移到器件中。 SI引脚用于所有的数据输入，包括

命令和地址序列。 SI引脚上的数据总是锁定在SCK的上升沿。

串行输出：

SO引脚用来转移数据从设备。在SO引脚上的数据总是同步输出

SCK的下降沿。

写保护：

当WP引脚置位，所有部门保护的扇区保护寄存器指定会

加以保护，防止程序也不管擦除操作是否启用扇区保护命令

已签发与否。 WP引脚功能独立于软件控制的保护方法。后

WP引脚变低，扇区保护寄存器的内容不能被修改。

低

输入

SCK

–

输入

–

输入

产量

如果一个编程或擦除命令被发出，而WP引脚被置设备，该设备将简单地忽略

该命令并执行任何操作。该设备将返回到空闲状态，一旦CS引脚一直

拉高。在启动扇区保护命令和部门锁定的命令，不过，将

认识到该设备时， WP引脚被置位。

WP引脚在内部上拉，高，可能会悬空，如果硬件控制的保护将不会被使用。

但是，我们建议在WP引脚也可以从外部连接到V

只要有可能。

RESET ：

在复位引脚（ RESET ）低的状态将终止正在进行的操作，并复位内部状态

机到空闲状态。该装置只要将保持在复位状态为低电平是存在于RESET

引脚。正常操作就可以恢复，一旦RESET引脚被拉回到较高水平。

该器件集成了一个内部上电复位电路，所以有在RESET引脚上没有任何限制

上电序列。如果此引脚和功能都没有使用，建议RESET引脚驱动为高电平

外部。

器件电源：

在V

销是用来提供电源电压的装置。

在无效的V操作

电压可能产生虚假的结果，不应该试图。

地面：

用于电源的接地参考。接地应连接到系统接地。

低

输入

RESET

低

输入

GND

–

动力

地

AT45DB041D

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AT45DB041D

图2-1 。

MLF （ VDFN ）顶视图

SCK

RESET

图2-2 。

GND

VCC

SOIC顶视图

SCK

RESET

GND

VCC

注意：

1.对MLF封装的底部的金属焊盘是浮动的。这种垫可以是“无连接”，或连接到GND 。

3.框图

闪存阵列

页面（二百六十四分之二百五十六字节）

缓冲器1（ 264分之256字节）

缓冲液2 （ 264分之256字节）

SCK

RESET

VCC

GND

I / O接口

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4.内存阵列

以提供最佳的灵活性， AT45DB041D的存储器阵列被划分为三个等级

粒度，包括行业，块和页面。在“内存体系结构图” illus-

trates每个级别的故障，并详细说明的每个扇区和块的页数。所有

程序操作的数据闪存出现在页面上逐页的基础。在擦除操作

将在芯片，部门，块或页级执行。

图4-1 。

内存架构图

座建筑

扇形

块0

1座

BLOCK 2

扇形

架构

扇形

0a =

网页

2048 / 2112字节

页面架构

网页

块0

第0页

第1页

扇形

0B = 248页

63,488 / 65,472字节

第6页

第7页

页面

块

扇形

1 = 256页

65,536 / 67,584字节

块

扇形

2 = 256页

65,536/67,584

字节

扇形

1座

块

第9页

第14页

第15页

BLOCK 62

BLOCK 63

BLOCK 64

扇形

6 = 256页

65,536 / 67,584字节

BLOCK 65

第16页

第17页

第18页

扇形

7 = 256页

65,536 / 67,584字节

BLOCK 254

BLOCK 255

第2046

2,047页

块= 2048 / 2112字节

页=二百六十四分之二百五十六字节

5.设备操作

该设备的操作是通过来自主处理器的指令控制。的指令的列表

与它们相关联的操作码中包含

表15-1至15-7 。

有效教学

开始于CS的下降沿后跟适当的8位的操作码和所需的缓冲

或主内存地址的位置。当CS引脚为低电平，触发SCK引脚控制

装载操作码，并通过在SI所需的缓冲器或主存储器地址位置

（串行输入）引脚。所有的指令，地址和数据传送的最显著

位（ MSB）在前。

缓冲区寻址的数据闪存标准的页面大小（ 264字节）的被引用

使用的术语BEA8数据表 - BFA0表示指定所需的9位地址

缓冲区内的字节地址。主内存寻址时使用的术语引用

PA10 - PA0和BA8 - BA0 ，其中PA10 - PA0表示要desig-所需的11位地址

内特页地址和BA8 - BA0表示指定字节所需的9位地址

在页面内解决。

对于二进制页面大小（256字节）中的“第2电源”时，缓冲器寻址中所引用的

使用传统的术语BFA7数据表 - BFA0来表示8位地址

到缓冲器中指定一个字节地址必需的。主内存寻址引用

使用的术语A18 - A0 ， A18在哪里 - A8表示，以desig-所需的11位地址

内特页地址和A7 - A0表示指定字节所需的8位地址

在页面中解决。

AT45DB041D

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AT45DB041D

6.读取命令

通过指定适当的操作码，数据可以从主存储器或从读取任

1两个SRAM数据缓冲区。该数据闪存支持模式0和激流协议

模式3，请参阅“详细的位级读时序”图中这个数据表

于每种模式的时钟周期序列的详细信息。

6.1

连续阵列读取（旧命令 - E8H ）：高达66 MHz的

通过提供一个初始地址的主存储器阵列，该阵列的连续读

命令可以被用来从该设备通过顺序地读出的数据的连续流

简单地提供一个时钟信号的装置;没有额外的寻址信息或控制信号需要

来提供。该数据闪存集成了一个内部地址计数器将自动

计数器每个时钟周期，使一个连续的读操作，而不需要

额外的地址序列。从数据闪存标准的页面进行连续读取

大小（ 264字节）， E8H的操作码，必须移入器件后跟三个地址

个字节（它包括24位页和字节地址序列）和4-不在乎字节。该

第11位（ PA10 - PA0 ）的20位地址序列指定主MEM-的哪一页

储器阵列中读取数据，最后9位（ BA8 - BA0 ）的20位地址序列指定

在页面内起始字节地址。从二进制页面尺寸进行连续读

（ 256字节），操作码（ E8H ）必须移入器件后跟三个地址字节

4不在乎字节。第11位（ A18 - A8 ）的19位序列指定的页面

主存储器阵列中读取数据，最后8位 - 19位地址序列（ A7 A0 ）

指定页内的起始字节地址。不在乎跟着地址字节

字节需要初始化读操作。继不在乎字节，额外的时钟

SCK引脚上的脉冲会导致数据上的SO （串行输出）引脚输出。

CS引脚必须的操作码的加载过程中保持较低水平，地址字节，不关心

字节，并且数据的读取。当在一个被达到，主存储器中的页的结束

连续阵列读取，所述装置将继续读取下一个页面的开始

没有延迟页边界交叉（从一个页面末尾的交叉过程中发生的

到下一个页面的开始处）。当主存储器阵列中的最后一位被读出，

所述装置将继续读回的存储器中的第一页的开头。与交叉

荷兰国际集团在页面边界，无延迟，将的结束缠绕时，将发生

阵列到阵列的开头。

在CS引脚从低到高的跳变将终止读操作和三态输出

引脚（SO ）。对于连续阵列的最大SCK频率允许读取被定义

这架F

CAR1

规范。连续阵列读取绕过这两个数据缓冲区和离开

缓冲区不变的内容。

6.2

连续阵列读取（高频率模式 - 0BH ）：高达66 MHz的

该命令可以用串行接口用于读取存储器阵列中顺序地在主

在高速模式中的任何时钟频率高达最大指定为f

CAR1

。要执行

与页大小连续读阵列设置为264字节时，CS必须首先被断言然后一个

操作码0BH必须移入器件后跟三个地址字节和一个虚拟的

字节。第11位（ PA10 - PA0 ）的20位地址序列指定的哪一页

主存储器阵列中读取数据，并在最后9位（ BA8 - BA0 ）的20位的地址序列的光谱

IFY的页面内的起始字节地址。与页大小进行连续读

设置为256字节，操作码， 0BH ，必须移入器件后跟三个地址

字节（ A18 - A0 ）和一个空字节。继空字节，额外的时钟脉冲的

SCK引脚将导致数据上的SO （串行输出）引脚输出。

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