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特点
串行EEPROM系列配置的Altera FLEX
10K设备
简单的,易于使用的4针接口
E
2
可编程的1M位串行存储器用来存储配置程序
对于可编程门阵列
级联,以支持额外配置或未来的高密度阵列
低功耗CMOS EEPROM工艺
可编程复位极性
可以在节省空间的表面贴装PLCC封装
在系统通过2线总线可编程
的24CXX系列的EPROM仿真
可在3.3V
±
10%的LV和5V
±
5 %C版本
描述
该AT17C512 / 010A和AT17LV512 / 010A ( AT17A系列) FPGA配置
的EEPROM (配置程序)提供并易于使用,具有成本效益的构
存储器进行编程的Altera FLEX现场可编程门阵列,FPGA (该
“设备” ) 。该AT17A系列封装在流行的20引脚PLCC封装。该
AT17A系列系列采用一个简单的串行访问过程来配置一个或多个
FPGA器件。该AT17A系列组织提供足够的内存配置
的一个或多个较小的FPGA。使用AT17A系列的特色,用户
可以通过编程的EEPROM字节选择复位功能的极性。该
AT17C / LV512 / 010A份产生其自己的内部时钟,并且可以被用来作为一个系
统的“主人”为加载FPGA器件。
爱特梅尔器件还支持系统友好的READY引脚和写保护
机制。 READY(就绪)引脚用于简化系统上电的考虑。该
WP1引脚用于在系统内编程,以保护设备内存的一部分。
该AT17A系列可与工业标准的程序员编程。
FPGA系列
CON组fi guration
回忆
AT17C512A
AT17LV512A
AT17C010A
AT17LV010A
销刀豆网络gurations
20引脚PLCC
NC
数据
NC
VCC
NC
3
2
1
20
19
NCS
GND
NC
nCASC
NC
9
10
11
12
13
DCLK
WP1
NC
NC
RESET / OE
4
5
6
7
8
18
17
16
15
14
SER_EN
NC
NC
准备
NC
修订版0974A -04 / 98
1
框图
SER_EN
程序设计
模式逻辑
程序设计
数据移位
注册
OSC
控制
ROW
地址
计数器
OSC
24/32
11
ROW
解码器
EEPROM
CELL
矩阵
24/32
计数器
5
COLUMN
解码器
TC
DCLK
OE
NCS
nCASC
数据
设备CON组fi guration
配置的EEPROM - NCS , OE控制信号,
随着FPGA器件控制和DCLK接口直接
信号。所有的FPGA器件可以控制整个的配置
化过程和检索配置数据
EEPROM ,而不需要外部的智能控制 -
LER 。
配置EEPROM器件的OE和NCS销
控制上的数据输出引脚的三态缓冲器和
使地址计数器和振荡器。当OE
驱动为低电平,配置EEPROM器件复位
地址计数器和三态其数据引脚。 NCS的销
控制AT17A系列的输出。如果NCS保持高电平
在OE复位脉冲后,计数器被禁用,
数据输出引脚为三态。当NCS是驱动为低电平时,
计数器和数据输出引脚被启用。当OE
再次变低时,地址计数器复位,
数据输出引脚为三态,无论状态
NCS 。
当配置赶出所有的数据和
nCASC被驱动为低电平时,器件三态DATA引脚为
避免争用其他配置器。上电时,
地址计数器会自动复位。
2
FPGA器件配置
FPGA器件可以与AT17A系列被配置
EEPROM 。该AT17A系列设备存储的配置
在EEPROM阵列的数据和时钟的数据串行移出
其内部振荡器。在OE , NCS和DCLK引脚
提供控制信号,用于地址计数器和所述
输出三态缓冲器。该AT17A系列设备发送
配置数据的串行比特流的DATA引脚,其中
连接到FPGA器件上的DATA0输入引脚。
当为一个FPGA器件超出配置数据
单AT17A系列设备的能力,多AT17A
系列设备可串行连接在一起。当多
PLE AT17A系列设备是必需的,在nCASC和
NCS引脚提供AT17A系列之间的握手
设备。
一个AT17A系列设备链中的地位阻止 -
地雷其操作。第一AT17A系列设备中
配置器链通电时或与NCS低和复位
配置为FPGA器件的协议。这AT17A
系列器件提供所有的时钟脉冲的一个或多个
FPGA器件和任何下游AT17A系列很好地协同
荷兰国际集团的配置。第一AT17A系列器件还亲
志愿组织数据的第一数据流的FPGA器件中
AT17C/LV/512A/010A
AT17C/LV/512A/010A
多设备的配置。一旦第一AT17A系列
设备完成发送配置数据,它驱动了
nCASC引脚为低电平,从而驱动第二的NCS销
AT17A系列器件的低。这将激活第二AT17A
系列装置的配置数据发送到FPGA
装置。
第一AT17A系列器件时钟的所有后续AT17A
系列设备,直到配置完成。一旦所有
配置数据被传送和NCS在第一
AT17A系列器件驱动为高电平通过CONF_DONE上
在FPGA器件中,第一AT17A系列器件时钟16
额外的周期来初始化FPGA器件。然后,
第一AT17A系列器件进入零功耗(空闲)状态。
如果第一AT17A系列设备上的NCS驱动为高电平
所有的配置数据之前传送,或者是NCS
毕竟配置数据transferred-不拉高
位nSTATUS被拉低,表明出现配置错误。
图1 。
FPGA器件配置有两个AT17A系列设备
VCC
VCC
1KW
1KW
VCC
设备1
送到nCONFIG
DCLK
DATA0
CONF_DONE
MSEL0
MSEL1
的nSTATUS
的nCE
AT17C010A
设备1
DCLK
数据
NCS
OE
nCASC
AT17C010A
设备2
DCLK
数据
NCS
OE
GND
GND
3
销刀豆网络gurations
引脚数
( 20引脚PLCC )
2
4
引脚名称
数据
DCLK
PIN TYPE
产量
I / O
描述
串行数据输出。
时钟输出和时钟输入。在DCLK的上升沿递增的内部地址
计数器和呈现数据的下位的数据引脚。的计数器递增
只有当OE输入保持高电平时,网络控制系统的输入保持为低电平,所有的配置数据
没有被传输到目标设备(否则,在FPGA的10K主模式中,
在DCLK引脚驱动低) 。
写保护( 1 ) 。使用的编程过程中保护的内存部分。看
编程指南了解详细信息。
输出使能(高电平有效)和复位(低电平有效) 。低逻辑电平复位地址
计数器。高逻辑电平实现了数据,并允许地址计数器计数。在
该模式下,如果该引脚为低电平(复位) ,内部振荡器将变得无效, DCLK
驱动低。
片选输入端(低电平有效) 。低输入允许DCLK递增地址
计数器,使数据来驱动的。如果AT17A系列复位与NCS低,
设备初始化为菊花链中的第一个设备。如果AT17A系列与复位
NCS高,该装置初始化为下一AT17A系列装置中的链
A 0.2
F
去耦电容应放置在V之间
CC
和GND引脚。
级联选择输出(低电平有效) 。该输出变低时,地址计数器
已达到其最大值。在菊花链的AT17A系列设备,所述
一个设备的nCASC销通常被连接到下一个设备的网络控制系统的输入管脚
在链中,这允许DCLK到时钟数据从下一AT17A系列设备中
链条。
设备的选择输入, A2 。这用于在启用(或选择)的设备
编程时SER_EN为低(见编程指南了解更多详情)
集电极开路复位状态指示灯。在上电期间复位低电平,当发布
电完成。 (如果使用推荐该引脚上一个4.7KΩ上拉) 。
串行使能FPGA在加载操作通常较高。把SER_EN
低,使编程的两线串行接口模式。
电源引脚。
5
8
WP1
RESET / OE
输入
输入
9
NCS
输入
10
12
GND
nCASC
产量
A2
15
18
20
准备
SER_EN
V
CC
输入
产量
输入
动力
绝对最大额定值*
工作温度.................................. -55 ° C至+ 125°C
存储温度..................................... -65 ° C至+ 150°C
任何引脚电压
相对于地面.............................- 0.1V至V
CC
+ 0.5V
电源电压(V
CC
) .........................................- 0.5V至+ 7.0V
最大焊接温度。 ( 10秒@ 1/16 ) .................. 260℃
ESD (R
ZAP
= 1.5K ,C
ZAP
= 100 pF的) ................................ 2000V
*注意:
强调超越上述绝对马克西上市
妈妈额定值可能会造成永久性损坏
装置。这些仅仅是极限参数和功能
该设备在这些或任何其他条件的操作
超越那些在工作条件列出系统蒸发散
是不是暗示。暴露在绝对最大额定
英格斯条件对于延长的时间段可
影响器件的可靠性。
4
AT17C/LV/512A/010A
AT17C/LV/512A/010A
工作条件
AT17CXXXA
符号
描述
广告
V
CC
产业
军事
电源电压相对于GND
-0 ° C至+ 70°C
电源电压相对于GND
-40 ° C至+ 85°C
电源电压相对于GND
-55 ° C至+ 125°C
4.75
4.5
4.5
最大
5.25
5.5
5.5
AT17LVXXXA
3.0
3.0
3.0
最大
3.6
3.6
3.6
单位
V
V
V
5
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