ADS5404
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SLAS945 - 2013年4月
双通道12位500Msps的模拟数字转换器
检查样品：
ADS5404
1
特点
双通道
12位分辨率
最大时钟速率： 500 Msps的
低摆幅满刻度输入： 1.0 Vpp的
模拟输入缓冲器，具有高阻抗输入
输入带宽（3 dB为单位） ： >1.2 GHz的
数据输出接口： DDR LVDS
196引脚BGA封装（ 12x12mm ）
功耗： 910毫瓦/通道
在f性能
in
= 230 MHz的IF
- SNR ： 60.6 dBFS的
- SFDR ： 77 dBc的
在f性能
in
= 700 MHz的IF
- SNR ： 59.4 dBFS的
- SFDR ： 70 dBc的
应用
测试和测量仪器
超宽带软件无线电
数据采集
电源放大器线性化器
信号情报和干扰
雷达和卫星系统
微波接收器
设备型号
ADS5402
ADS5401
ADS5404
ADS5403
数
频道
2
1
2
1
速度等级
800Msps
800Msps
500Msps
500Msps
描述
该ADS5404是一个高线性双通道的12位， 500 MSPS的模拟 - 数字转换器（ADC），缓解前
到底滤波器设计宽的带宽接收器。模拟输入缓冲器隔离导通的内部开关
片内采样和保持从干扰信号源，以及提供一个高阻抗输入。可选的
输出的数据可以由两个来抽取。专为高SFDR ，该ADC具有低噪声性能和
出色的无杂散动态范围较大的输入频率范围。该器件采用196引脚
被指定的BGA封装，在整个工业温度范围（-40 ° C至85°C ） 。
INA
12bit
500Msps
数字
块
DA [11：0 ]
DACLK
CLKIN
SYNCIN
CLK
卜FF器
INB
12bit
500Msps
数字
块
DB [ 11 ： 0 ]
DBCLK
1
请注意，一个重要的通知有关可用性，标准保修，并且在关键的应用程序中使用
德州仪器公司的半导体产品和免责条款及其出现在此数据表的末尾。
PRODUCTION数据信息为出版日期。
产品符合占德州条款规范
仪器标准保修。生产加工过程中不
不一定包括所有参数进行测试。
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这个集成电路可以被ESD损坏。德州仪器建议所有集成电路与处理
适当的预防措施。如果不遵守正确的操作和安装程序，可以造成损坏。
ESD损害的范围可以从细微的性能下降，完成设备故障。精密集成电路可能会更
容易受到伤害，因为很小的参数变化可能导致设备不能满足其公布的规格。
详细的框图。
OVRAP / N
SRESETB
SCLK
OVERRANGE
VREF
VCM
电压
参考
CLKOUT
根
门槛
程序设计
数据
控制
SDIO
SDO
SDENB
卜FF器
INA_P / N
ADC
交错
更正
估计
增益校正
偏移校正
DC或
Fs/2
DEC
x2
DACLKP / N
FIR滤波器
DDR LVDS
输出缓冲器
...
...
DA [11：0 ]的P / N
CLKP / N
时钟
分配
SYNCP / N
DDR LVDS
输出缓冲器
多芯片
SYNC
DB [ 11 ： 0 ] P / N
交错
更正
INB_P / N
ADC
卜FF器
估计
增益校正
偏移校正
DC或
Fs/2
FIR滤波器
DEC
x2
CLKOUT
根
DBCLKP / N
OVERRANGE
门槛
SYNCOUTP / M
SYNCOUTP / N
OVRBP / N
图1.详细的框图
2
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引线的信息
A
B
C
D
E
F
G
H
J
K
L
M
N
P
14
VREF
VCM
GND
INB_N
INB_P
GND
AVDDC
AVDDC
GND
INA_P
INA_N
GND
GND
CLKINP
14
13
SDENB
TEST
模式
SRESET
B
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
CLKINN
13
12
SCLK
GND
AVDD33
AVDD33
AVDD33
AVDD33
AVDD33
AVDD33
AVDD33
AVDD33
GND
AVDD33
AVDD33
12
11
SDIO
启用
GND
AVDD18
AVDD18
AVDD18
AVDD18
AVDD18
AVDD18
AVDD18
AVDD18
GND
AVDD18
AVDD18
11
10
SDO
IOVDD
GND
AVDD18
GND
GND
GND
GND
GND
GND
AVDD18
GND
NC
NC
10
9
DVDD
DVDD
GND
GND
GND
GND
GND
GND
GND
GND
GND
GND
SYNCn
SYNCP
9
8
DVDD
DVDD
DVDD
DVDD
GND
GND
GND
GND
GND
GND
DVDD
DVDD
DVDD
DVDD
8
7
DB0N
DB0P
DVDD
LVDS
DVDD
LVDS
DVDD
LVDS
DVDD
LVDS
GND
GND
GND
GND
GND
GND
DVDD
LVDS
DVDD
LVDS
DVDD
LVDS
DVDD
LVDS
NC
NC
7
6
DB1N
DB1P
GND
GND
GND
GND
GND
GND
NC
NC
6
5
DB2N
DB2P
OVRBN
OVRBP
GND
GND
GND
GND
GND
GND
OVRAN
OVRAP
SYNC
OUTN
SYNC
OUTP
5
4
DB3N
DB3P
DB8P
DB10P
NC
NC
NC
DA0P
DA2P
DA4P
DA6P
DA8P
NC
NC
4
3
DB4N
DB4P
DB8N
DB10N
NC
NC
NC
DA0N
DA2N
DA4N
DA6N
DA8N
DA11N
DA11P
3
2
DB5N
DB5P
DB7P
DB9P
DB11P
SYNC
OUTP
SYNC
OUTN
DBCLKP
DACLKP
DA1P
DA3P
DA5P
DA7P
DA10N
DA10P
2
1
DB6N
DB6P
DB7N
DB9N
DB11N
DBCLKN DACLKN
DA1N
DA3N
DA5N
DA7N
DA9N
DA9P
1
A
B
C
D
E
F
G
H
J
K
L
M
N
P
图2.引脚的DDR输出模式（俯视图）
引脚分配
针
名字
输入/基准
INA_P / N
INB_P / N
VCM
VREF
CLOCK / SYNC
CLKINP / N
SYNCP / N
控制/串
SRESET
B12
I
串行接口，复位输入。低电平有效。在高分到低分进行初始化内部寄存器
过渡。异步。内部50kΩ的上拉电阻到IOVDD 。
P14, P13
P9 ， N9
I
I
差分输入时钟
同步输入。如果不活动的逻辑低电平。当处于高状态开始计时，这是用来
用于复位的内部时钟和数字逻辑和启动SYNCOUT信号。内部100Ω
终止。
K14 ， L14
D14 ， E14
B14
A14
I
I
O
I
ADC的模拟差分输入信号。
模拟的ADC乙差分输入信号。
输出的模拟输入共模（标称值为1.9V ） 。一个0.1μF的电容到AGND是
推荐使用。
参考电压输入。一个0.1μF的电容到AGND建议，但不是必需的。
数
I / O
描述
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ADS5404
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引脚分配（续）
针
名字
启用
SCLK
SDIO
SDENB
SDO
TESTMODE
数据接口
P3 ，N3， P2，N2 ，
P1， N1 ，M4， M3，
M2，M1 ，L4 ，L3
L 2 ，L 1， K4 ，K3
K 2 ，K 1 ，J4 ，J3，
J 2 ，J 1 ，H 4 ，H 3
的E2 ，E1， D4 ，D3
D2，D1 ， C4，C3 ，
C2，C1 ，B1， A1，
B 2 ，A 2， B 3 ，A3
B4 ，A4，B5 ，A5
B6， A6 ，B7， A7
H2, H1
G2, G1
F2，F1 ，P5， N5
M5 ， L5
D5 ， C5
E3，E4 ，F3，F4 ，
G3，G4， N4 ，N6- ，
N7 ， N10 ， P4 ， P6 ，
P7, P10
D12， E12 ，F12，
G12 ， H12 ， J12 ，
K12 ， L12 ， N12 ，
P12
G14 ， H14
D10 ， D11 ， E11 ，
F11 ， G11， H11 ，
J11 ， K11 ， L10 ，
L11 ， N11 ， P11
A8，A9 ，B8， B9，
C8 ，D8， L8 ，M8，
N8 ， P8
C6，C7 ，D6，D7 ，
L6 ， L7 ， M6 ， M7
B10
数
B11
A12
A11
A13
A10
B13
I / O
I
I
I / O
I
O
–
描述
芯片使能 - 高电平有效。掉电功能，可通过SPI寄存器来控制
分配。内部50kΩ的上拉电阻到IOVDD 。
串行接口的时钟。内部50kΩ的下拉电阻。
在3引脚模式（默认）双向串行数据。在4-pin的接口模式（寄存器X00 ， D16 ） ，
在SDIO引脚仅作为输入。内部50kΩ的上拉下来。
串行接口使能。内部50kΩ的下拉电阻。
在4引脚模式单向串行接口数据（寄存器X00 ， D16 ） 。 SDO引脚为三
在3针接口模式（默认）表示。内部50kΩ的下拉电阻。
工厂内部测试，不连接
DA [11：0 ]的P / N
O
ADC一个数据位11 （ MSB）为0（ LSB ）的DDR输出模式。标准的LVDS输出。
DB [ 11 ： 0 ] P / N
O
ADC B数据位11 （ MSB）到0 （ LSB ）的DDR输出模式。标准的LVDS输出。
DACLKP / N
DBCLKP / N
SYNCOUTP / N
OVRAP / N
OVRBP / N
O
O
O
O
O
DDR差分输出数据时钟总线A.寄存器编程为上升沿
或下降沿到稳定的数据标称定时的中心。
DDR差分输出数据时钟总线B.寄存器编程，以提供上升沿
或下降沿到稳定的数据标称定时的中心。可选的总线B可以被锁定
DACLKP / N 。
同步输出信号同步多个ADC 。可以通过SPI被禁止。
总线A ，超量程指示， LVDS输出。逻辑高电平信号的模拟输入超过
在满量程范围。可选的同步输出。
总线B ，超量程指示， LVDS输出。逻辑高电平信号的模拟输入超过
在满量程范围。可选的同步输出。
不要连接到引脚
NC
电源
AVDD33
AVDDC
AVDD18
–
I
I
I
3.3V模拟电源
1.8V供电的时钟输入
1.8V模拟电源
DVDD
DVDDLVDS
IOVDD
GND
I
I
I
I
1.8V电源的数字模块
1.8V电源为LVDS输出
1.8V的数字I / O
地
4
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封装/订购信息
产品
套餐 -
领导
包
代号
特定网络版
温度
范围
-40 ° C至85°C
ECO
计划
(2)
绿色
（符合RoHS &无
锑/溴）
铅/焊球
完
包
记号
订购
数
ADS5404IZAY
ADS5404I
ADS5404IZAYR
运输
MEDIA ，
QUANTITY
TRAY
磁带和卷轴
ADS5404
196-BGA
ZAY
绝对最大额定值
在工作自由空气的温度范围内（除非另有说明）
价值
民
电源电压范围， AVDD33
电源电压范围， AVDDC
电源电压范围， AVDD18
电源电压范围， DVDD
电源电压范围， DVDDLVDS
电源电压范围， IOVDD
INA / B_P ， INA / B_N
电压施加到输入引脚
CLKINP ， CLKINN
SYNCP ， SYNCN
SRESET ， SDENB ， SCLK ， SDIO ， SDO ， ENABLE
工作的自由空气的温度范围内，T
A
工作结温范围，T
J
存储温度范围
ESD，人体模型
–65
–0.5
–0.5
–0.5
–0.5
–0.5
–0.5
–0.5
–0.5
–0.5
–0.5
–40
最大
4
2.3
2.3
2.3
2.3
4
AVDD33 + 0.5
AVDDC + 0.5
AVDD33 + 0.5
IOVDD + 0.5
85
150
150
2
单位
V
V
V
V
V
V
V
V
V
V
°C
°C
°C
kV
热信息
ADS5404
热公制
θ
JA
θ
JCtop
θ
JB
ψ
JT
ψ
JB
结至环境热阻
结至电路板的热阻
(4)
(5)
(2)
(1)
NFBGA
196引脚
37.6
6.8
16.8
0.2
16.4
单位
结至外壳（顶部）热阻
(3)
结至顶部的特征参数
° C / W
结至电路板的特征参数
(6)
间隔
(1)
(2)
(3)
(4)
(5)
(6)
有关传统和新的热度量的更多信息，请参阅
IC封装热度量
申请报告，
SPRA953.
在自然对流的结点至环境热阻是在一个JEDEC标准，高K板上的模拟获得，如
在JESD51-7指定，在JESD51-2a描述的环境。
通过模拟在封装顶部冷板试验获得的结到壳体（顶部）的热阻。没有具体JEDEC-
标准测试存在，但密切描述可以在ANSI SEMI标准G30-88被发现。
通过模拟的环境中具有环冷板夹具来控制印刷电路板得到的结到电路板的热阻
温度，如在JESD51-8说明。
结至顶部的特征参数，
ψ
JT
估计装置的结温在实际的系统中，并且被提取
从仿真数据用于获得
θ
JA
使用在JESD51-2a描述的方法（第6和7）。
结至电路板的特征参数，
ψ
JB
估计装置的结温在实际的系统中，并且被提取
从仿真数据用于获得
θ
JA
使用在JESD51-2a描述的方法（第6和7）。
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