ADS5204 Q1
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SGLS271A - 2004年10月 - 修订2008年6月
双10位40 MSPS低功耗
与PGA的模拟数字转换器
特点
D
通过汽车应用认证
D
3.3 V单电源供电
D
双通道同步采样和保持输入
D
差分或单端模拟输入
D
可编程增益放大器：0 dB到18分贝
D
独立的串行控制接口
D
单路或双路并行总线输出
D
60 - dB的SNR在f
IN
= 10.5兆赫
D
73 - dB的无杂散动态范围在f
IN
= 10.5兆赫
D
低功耗： 275毫瓦
D
300 - MHz模拟输入带宽
D
3.3 - V TTL / CMOS兼容数字I / O
D
内部或外部基准
D
可调基准电压输入范围
D
掉电（待机）模式
D
TQFP -48封装
应用
D
数字通信（基带采样）
D
便携式仪表
D
视频处理
描述
该ADS5204是一个双路10位， 40 MSPS模拟到数字
转换器（ADC ） 。它同时将每个模拟
输入信号转换成一个10位的二进制编码的数字字到
每个通道40 MSPS的最大采样速率。所有
数字输入和输出3.3 V TTL / CMOS
兼容。
创新的双流水线架构实施
CMOS工艺和3.3V电源产生非常
低功耗。为了提供最大的
灵活性，无论是顶部和底部的参考电压可以
可以从用户提供的电压设定。另外，如果没有
外部引用是可用的，芯片上的内部
引用都可以使用。两个ADC都有一个共同的
引用以改善偏移和增益匹配。如果
外部基准电压电平可用，则
内部基准电压源，可断电
独立地从芯片的其余部分，从而产生连
更大的功率节省。
该ADS5204还具有双通道，板载可编程
增益放大器（PGA ），允许为0 dB设置为18 dB
调整各组输入的增益，以便匹配
所述输入信号的振幅。
该ADS5204的特点是操作从-40°C
至+ 85°C ，并采用TQFP -48封装。
请注意，一个重要的通知有关可用性，标准保修，并在德州仪器公司的关键应用程序使用
半导体产品和免责条款及其出现在此数据表的末尾。
PRODUCTION数据信息为出版日期。产品符合
每德州仪器标准保修条款的规范。生产加工
不一定包括所有参数进行测试。
版权
2008年，德州仪器
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这个集成电路可以被ESD损坏。德州仪器建议所有集成电路处理
用适当的预防措施。如果不遵守正确的操作和安装程序，可以造成损坏。
ESD损害的范围可以从细微的性能下降，完成设备故障。精密集成电路可能会更
容易受到伤害，因为很小的参数变化可能导致设备不能满足其公布的规格。
框图
订购信息
{
产品
ADS5204
PACKAGE -LEAD
TQFP48
包
代号
}
PFB
特定网络版
温度
范围
-40 ° C至+ 85°C
包
记号
AZ5204Q
订购
数
ADS5204IPFBRQ1
运输
媒体， QUANTITY
磁带和卷轴1000
对于最新的封装和订购信息，请参阅封装选项附录本文档的末尾，或者看到TI网站
在http://www.ti.com 。
包装图纸，热数据和符号可在http://www.ti.com/packaging 。
绝对最大额定值
ADS5204Q1
AVDD到AGND ，
DVDD至DGND
为AVDD DVDD ，
AGND至DGND
-0.5 V至3.6 V
电源电压
-0.5 V至0.5 V
数字输入电压范围为DGND
NOW
NOW
VREFT ， VREFB
TA
TSTG
NOW
模拟输入电压范围为AGND
从外部施加数字输出电压。来源DGND
基准电压输入范围为AGND
工作自由空气的温度范围内（ ADS5204I
存储温度范围
从案例的焊接温度1.6毫米（ 1/16英寸） ，持续10秒
-0.5 V至DVDD + 0.5 V
-0.5 V至AVDD + 0.5 V
-0.5 V至DVDD + 0.5 V
-0.5 V至AVDD + 0.5 V
-40 ° C至85°C
-65_C到150_C
300°C
（ 1 ）强调超越“绝对最大额定值”，可能对器件造成永久性损坏。这些压力额定值只，和
该设备在这些或超出下标明的任何其他条件的功能操作“推荐工作条件”不
暗示。暴露于长时间处于最大绝对额定情况下会影响器件的可靠性。
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推荐工作条件
在工作自由空气的温度范围， TA ，除非另有说明（ 1 ）
参数
电源
AVDD
DVDD
电源电压
0
3.3
3.6
V
条件
民
喃
最大
单位
DRVDD
模拟和参考输入
VREFT
VREFB
VREFT - VREFB
RREF
IREF
VIN
VIN
CI
基准输入电压（上）
基准输入电压（下）
参考电压差动
参考输入电阻
参考输入电流
模拟输入电压，差动
模拟输入电压，单端（ 1 ）
模拟量输入电容
时钟输入端（2 ）
CML电压
CML输出电阻
数字输入
VIH
VIL
TC （ 80兆赫）
总重量（ CLKH ） ， TW （ CLKL ）
（ 80兆赫）
高电平输入电压
低电平输入电压
输入电容
时钟周期
脉冲持续时间
时钟高或低
12.5
5.25
25
11.25
2.4
DGND
5
DVDD
0.8
V
V
pF
ns
ns
ns
ns
FCLK = 1 MHz到80 MHz
FCLK = 1 MHz到80 MHz
FCLK = 1 MHz到80 MHz
FCLK = 80 MHz的
FCLK = 80 MHz的
1
CML -1
8
0
AVDD/2
2.3
AVDD
1.9
0.95
0.95
2
1
1
1650
0.62
1
CML +1
2.15
1.1
1.1
V
V
V
mA
V
V
pF
V
V
k
模拟输出
TC （ 40兆赫）
时钟周期
总重量（ CLKH ）
t
W（ CLKL ）脉冲持续时间
时钟高或低
（ 40兆赫）
（ 1 ）只适用于当参考信号输入端连接到CML 。
（ 2 ）时钟引脚参考AVDD / AVSS 。
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电气特性
在与FCLK = 80MHz的和使用的内部电压基准和PGA增益为0dB推荐工作条件，除非另有说明。
参数
测试条件
民
典型值
64
最大
72
2.2
27
345
300
175
单位
电源
AVDD
DVDD
DRVDD
P
D
P
D（ STBY ）
t
PD
t
WU
I
IH
I
IL
功耗
待机功耗
开机时间从待机所有引用
唤醒时间
在数字输入高电平输入电流包括CLK
在数字输入低电平输入电流包括CLK
外部参考
1
1
IDD工作电源电流
AVDD = DVDD = DRVDD = 3.3 V ，
CL = 10 pF的， VIN = 3.5 MHz时， -1 dBFS的
PWDN_REF =“L”
PWDN_REF =' H'
STDBY =' H' ， CLK保持高电平或低电平
1.7
18
275
240
125
550
40
mA
mW
W
ms
s
数字输入
AV
DD
DV
DD
= DRV
DD
= 3.6 V
1
1
A
A
数字输出
V
OH
V
OL
C
O
I
OZH
I
OZL
高电平输出电压
低电平输出电压
输出电容
高阻抗状态的输出电流为高电平
高阻抗状态的输出电流为低电平
数据输出上升时间和下降时间
参考输出
V
REFTO
V
REFBO
REFT ， REFB
DC精度
INL
DNL
积分非线性，终点。
微分非线性
失码
零误差
(3)
满量程误差
增益误差
AV
DD
DV
DD
= DRV
DD
= 3.3 V
外部参照
(3)
国内
参考文献：
(1)
国内
参考文献：
(2)
T
A
= -40 ° C至85°C
T
A
= -40 ° C至85°C
1.5
0.9
±0.4
±0.4
1.5
1.0
最低位
最低位
参考电压最高
参考电压底部
差分基准电压
绝对最小值/最大值有效和测试
为AV
DD
= 3.3 V
1.85
0.925
0.925
2
1
1.0
2.1
1.05
1.05
V
V
V
AV
DD
DV
DD
= DRV
DD
= 3.6 V
C
负载
= 10 pF的，单总线模式
C
负载
= 10 pF的，双总线模式
1
1
3
5
AV
DD
DV
DD
= DRV
DD
= 3 V时
I
OH
= 50
A,
数字输出强制为高
AV
DD
DV
DD
= DRV
DD
= 3 V时
I
OL
= 50
A,
数字输出强制为低
2.8
2.96
0.04
5
1
1
0.2
V
V
pF
A
A
ns
ns
无失码放心
0.12
0.28
0.24
±1.5
±1.5
±1.5
％ FS
％ FS
％ FS
（1）积分非线性是指每个码与从零绘制到满刻度的线的偏离。作为零点的点出现1/2 LSB
之前的第一个代码转换。满量程点被定义为一个水平的1/2 LSB超出最后一个码转换。该偏差是由测得的
的每一个特定的码的中心到这两个端点之间的最佳拟合线。
（2）积分非线性是指每个码与从零绘制到满刻度的线的偏离。作为零点的点出现1/2 LSB
之前的第一个代码转换。满量程点被定义为一个水平的1/2 LSB超出最后一个码转换。该偏差是由测得的
的每一个特定的码的中心到这两个端点之间的最佳拟合线。
（3 ）零误差被定义为在模拟输入电压之间的理想电压与实际电压切换ADC输出的差
从代码0到代码1.理想的电压电平是通过将对应于1/2 LSB到下基准电平的电压来确定。该
对应于1个LSB电压是从顶部和底部的引用由ADC的输出电平的数目（1024）划分的差异发现。
满刻度误差被定义为在模拟输入的差分电压之间的理想电压与实际电压切换ADC的
从代码1022输出到代码1023的理想的电压电平是由从顶部减去对应于1.5的电压的LSB来确定
参考电平。对应于1个LSB的电压从顶部和底部的引用由ADC输出的数量除以该差值发现
水平（ 1024）。
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动态性能
(1)
TA = TMIN至TMAX ， AVDD = DVDD = DRVDD = 3.3 V ，FIN = -1 dBFS的，内部参考， FCLK = 80 MHz时， FS = 40 MSPS ，差分输入范围
= 2 Vp-p的和PGA增益= 0dB时，除非另有说明
参数
ENOB
有效位数
测试条件
鱼翅= 3.5 MHz的
在fIN = 10.5兆赫
散热片= 20 MHz的
鱼翅= 3.5 MHz的
THD
总谐波失真
在fIN = 10.5兆赫
散热片= 20 MHz的
鱼翅= 3.5 MHz的
在fIN = 10.5兆赫
散热片= 20 MHz的
鱼翅= 3.5 MHz的
SINAD
信号 - 噪声比+失真
在fIN = 10.5兆赫
散热片= 20 MHz的
鱼翅= 3.5 MHz的
在fIN = 10.5兆赫
散热片= 20 MHz的
见说明（ 2 ）
F1 = 9.5 MHz时， F2 = 9.9 MHz的
57
民
9.3
典型值
9.7
9.7
9.6
71
71
68
60.5
60.5
60
60
60
60
75
66
73
70.5
300
68
75
0.016
0.025
63
最大
单位
位
位
位
dB
dB
dB
dB
dB
dB
dB
dB
dB
dB
dB
dB
兆赫
dBc的
dBc的
FS的1.75 ％
FS 1％
SNR
信噪比
SFDR
无杂散动态范围
模拟输入带宽
IMD
2音互调失真
A / B通道串扰
A / B通道的偏移不匹配
A / B通道的满量程误差不匹配
（ 1 ）这些规范涉及到的25 Ω串联电阻和15 pF的差分电容A / B +和A / B-输入;任何信号源阻抗带来的
带宽下降。
（ 2）模拟输入带宽被定义为在该采样的输入信号是下降3dB的增益，并通过输入开关限定的频率
阻抗。
PGA特定网络阳离子
参数
增益范围
增益步长（ 1 ）
增益误差（2）
控制每通道位
（ 1 ）见表2 ， PGA增益码。理想的步长： 18.0618分贝/ 31 = 0.5826分贝
（ 2 ）偏离理想。见表2 ，所有增益设置。
0.15
民
典型值
0到18
0.5826
±0.025
0.15
5
最大
单位
dB
dB
dB
位
5
QQ：2881677436 复制
