ADC12H030 / ADC12H032 / ADC12H034 / ADC12H038 ， ADC12030 / ADC12032 / ADC12034 / ADC12038
自校准12位加符号位串行I / OA / D转换器，带有MUX和采样/保持
2007年4月
ADC12H030/ADC12H032/ADC12H034/ADC12H038,
ADC12030/ADC12032/ADC12034/ADC12038
自校准12位加符号位串行I / OA / D转换器
与MUX和采样/保持
概述
有些器件/封装组合已经过时，
如图仅供参考。
该ADC12030和ADC12H030家庭的12位加号
串行I / O逐次逼近式A / D转换器和
可配置的输入多路复用器。该ADC12034 / ADC12H034
和ADC12038 / ADC12H038有4个和8声道multiplex-
ERS分别。差分多路输出， A / D
输入可在MUXOUT1 ， MUXOUT2 ， A / DIN1
和A / DIN2引脚。该ADC12030 / ADC12H030具有2
通道多路复用器与多路复用器输出和A / D输入
把内部连接。该ADC12030系列测试
用5 MHz的时钟，而ADC12H030家庭测试
有一个8 MHz的时钟。根据要求，这些位A / D经过
自校准过程，调节线性，零点和满
度误差小于± 1 LSB每个。
模拟输入可配置在各种操作
的单端，差分或伪differ-组合
无穷区间模式。全差分单极性模拟输入范围
（ 0V至+ 5V） ，可以容纳一个单一的+ 5V电源。
在差分模式下，有效的输出，即使获得
当负输入是大于正BE-
事业的12位加符号位输出数据格式。
串行I / O配置以符合NSC MICROWIRE 。
对于电压基准看到LM4040 ， LM4050和LM4041 。
特点
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串行I / O（ MICROWIRE兼容）
2，4，或8瓒差分或单端多路转换器
模拟输入采样/保持功能
掉电模式
可变分辨率和转化率
可编程采集时间
可变数字输出字的长度和格式
无需零或满量程调整
完全经过测试，保证了4.096V基准
0V至5V的模拟输入范围，单5V电源
无漏失码温
关键的特定连接的阳离子
■
决议
■
12位加符号位转换时间
- ADC12H30家庭
- ADC12030家庭
12位加号
5.5微秒（最大值）
8.8微秒（最大值）
8.6微秒（最大值）
14微秒（最大值）
± 1 LSB （最大值）
5V ±10%
33毫瓦（最大）
100 μW （典型值）
■
12位加符号位的吞吐量时间
- ADC12H30家庭
- ADC12030家庭
■
积分非线性误差
■
单电源
■
耗电量
- 关机
应用
■
医疗器械
■
过程控制系统
■
测试设备
三州
是美国国家半导体公司的注册商标。
2007美国国家半导体公司
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ADC12038简化框图
1135401
连接图
16引脚宽体
SO封装
20引脚宽体
SO封装
1135406
顶视图
1135407
顶视图
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ADC12H030 / ADC12H032 / ADC12H034 / ADC12H038 ， ADC12030 / ADC12032 / ADC12034 / ADC12038
24引脚宽体
SO ， DIP ， SSOP- EIAJ包
28引脚宽体
SO封装
1135408
顶视图
1135409
顶视图
订购信息
工业温度范围
40°C
≤
T
A
≤
+85°C
ADC12H030CIWM,
ADC12030CIWM
ADC12030CIWMX
ADC12032CIWM
ADC12034CIN
ADC12034CIWM
ADC12H034CIMSA
ADC12H034CIMSAX
ADC12H038CIWM,
ADC12038CIWM
ADC12H038CIWMX,
ADC12038CIWMX
包
M16B ，宽体SO
M16B ，宽体SO - 磁带&卷轴
M20B ，宽体SO
N24C ，双列直插式
M24B ，宽体SO
MSA24 ， SSOP
MSA24 ， SSOP - 磁带&卷轴
M28B ，宽体SO
M28B ，宽体SO - 磁带&卷轴
*有些产品/封装组合是终生买入或已过时，如下所示，仅供参考。检查我们的
网站产品/包装的可用性。
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引脚说明
CCLK
时钟施加到该输入端接
指令对逐次逼近
转换时间间隔和AC-
quisition时间。上升和下降时间
在时钟的边缘不应超过
1 s.
这是串行数据时钟输入。
时钟施加到该输入端接
指令对速率的串行数据
交换发生。上升沿
加载的DI引脚的信息
入多路转换器的地址和
模式选择移位寄存器。该AD-
裙控制其信道
模拟输入多路复用器（MUX ）是
选择的操作模式
用于A / D转换。在CS为低电平下降
SCLK的上升沿将数据result-
从以前的ADC荷兰国际集团转换
锡永出溶解氧，除
数据的第一位。当CS为低电平
连续地，将数据的第一位
同步输出的上升沿
EOC （转换结束） 。当CS
被触发的CS AL-的下降沿
方式提供时钟输出数据的第一个比特。
CS应提请低时，
SCLK为低。上升和下降时间
在时钟的边缘不应超过
1 s.
这是串行数据输入管脚。该
应用到这个引脚的数据被转移
SCLK的上升沿进入mul-
路开关的地址和模式选择
注册。
表2
通过
表5
示出了多的分配
路器地址以及模式选择
数据。
该数据输出管脚。该引脚为
积极的推/拉输出，当CS为
低。当CS为高电平时，这个输出是
三州
。该A / D转换
结果（ D0 - D12 ）和转换器台站
土族数据的时钟由下降
SCLK的该引脚上的优势。这个词
长此结果与格式可以
而有所不同（见
表1）。
字长
和格式由数据控制
移入复用器地址
和模式选择寄存器（见
表
5).
该引脚是一个积极的推/拉输出
和指示的状态
ADC12030 / 2 /4/8 。当低，这显
的NAL的A / D正忙于一个反面
版本，自动校准，自动调零
或掉电周期。上升
EOC的边缘信号之一的端
这些周期。
这是片选引脚。当一个
逻辑低电平加到这个引脚上，
SCLK的上升沿将数据移
在DI到地址寄存器中。这
低也带来做出来的三
SCLK
DI
DOR
DO
CONV
EOC
PD
CS
态。在CS为低电平的下降沿
的SCLK移位产生的数据
从以前的ADC转换
出溶解氧，除的
数据的第一位。当CS为低浓度
tinuously ，该数据的第一个比特是
同步输出的上升沿
EOC （转换结束） 。当CS
被触发的CS AL-的下降沿
方式提供时钟输出数据的第一个比特。
CS应提请低时，
SCLK为低。 CS的下降沿
重置正在进行的转换和
开始的顺序为一个新的转换
版本。当CS被带回
在转换过程中的低，这CON-
版本过早终止。
在输出锁存器中的数据可
被破坏。因此，当CS为
一个转换过程中带回低
锡永正在进行中的数据输出在
该时间应该被忽略。 CS可能
还可以继续留低。在这
情况下，当务之急是正确的
SCLK脉冲数应用
向，以保持同步ADC的
异步的。 ADC的电源后，
通电后，预计将看到13
时钟脉冲为每个I / O序列。
时钟脉冲的数目的ADC的
期望是相同的数字
输出字长。本字长
可以通过移动的数据进行修改
在DO引脚。
表5
详细介绍
所需的数据。
这是数据就绪输出引脚。
该引脚是一个积极的推/拉输出。
它为低电平时，转换结果
被移出的，去到高
信号，所有的数据已经SHIFT-
编出来。
逻辑低电平，需要在这个引脚
任何编程模式或改变
如在列ADC的配置
编程模式
表5
例如
12位转换的8位转换，
自动校准，自动调零等。当这
针是高ADC被放置在
读取数据的只读模式。而在
读取数据仅供模式，将CS
低脉冲SCLK只会时钟
列于DO存储在AD-任何数据
Cs的输出移位寄存器。上的数据
DI将被忽略。一种新的转换
锡永将不会启动，并且ADC
将留在模式和/或CON-
成形之前编程。
读出的数据仅不能进行
而转换，自动校准和非盟
到零正在进行中。
这是掉电引脚。当
PD为高电平时， A / D断电;
当PD为低电平时， A / D转换为动力
了。该A / D最多需要250
μs的后命令是上电
给出。
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ADC12H030 / ADC12H032 / ADC12H034 / ADC12H038 ， ADC12030 / ADC12032 / ADC12034 / ADC12038
这些都是在模拟输入
MUX 。一个通道输入选择
在DI引脚上的地址信息，
其上的上升沿加载
SCLK到地址寄存器（见
表2，3， 4）。
施加到这些输入端上的电压
不应超过V
A
+或下面去
GND 。超出此范围的上
未选择的路会损坏
读出所选择的信道的。
COM
该引脚是另一个模拟输入引脚。
它被用作伪地面时
模拟多路转换器是单最终
ED 。
MUXOUT1,MUXOUT2
这些多路转换器输出
销。
A / DIN1 ， / DIN2
这些转换器的输入引脚。
MUXOUT1通常是连接到A / DIN1 。
MUXOUT2通常是连接到A / DIN2 。
如果外部电路被放置BE-
吐温MUXOUT1和A / DIN1 ，或
MUXOUT2和A / DIN2可能
要保护这些引脚。该
电压，这些引脚不应EX-
CH0–CH7
V
REF
+
V
REF
V
A
+, V
D
+
DGND
AGND
CEED V
A+
或者去下面AGND （见
图6）。
这是积极的模拟电压
参考输入。为了保持
精度，V的电压范围
REF
(V
REF
= V
REF
+ V
REF
- ）是1伏
DC
to
5.0 V
DC
并在V的电压
REF
+
不能超过V
A
+ 。看
图5
为
推荐旁路。
负参考电压IN-
放。为了保持精度，
在这个引脚上的电压不能走
下面GND或超过V
A
+ 。 （见
图5）。
这些是模拟和数字
电源引脚。 V
A+
和V
D+
是
不连接在一起的芯片上。
这些引脚应连接到
同样的电源和旁路
分开（见
图5）。
中的操作数
V的阿婷电压范围
A
+和V
D
+
是4.5 V
DC
至5.5 V
DC
.
这是数字地引脚（见
图5）。
这是模拟地引脚（见
图5）。
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